JPS60250666A - 素子間分離方法 - Google Patents
素子間分離方法Info
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- JPS60250666A JPS60250666A JP59105998A JP10599884A JPS60250666A JP S60250666 A JPS60250666 A JP S60250666A JP 59105998 A JP59105998 A JP 59105998A JP 10599884 A JP10599884 A JP 10599884A JP S60250666 A JPS60250666 A JP S60250666A
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- H10P90/19—Preparing inhomogeneous wafers
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- H10W10/01—Manufacture or treatment
- H10W10/061—Manufacture or treatment using SOI processes together with lateral isolation, e.g. combinations of SOI and shallow trench isolations
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- H10W10/10—Isolation regions comprising dielectric materials
- H10W10/181—Semiconductor-on-insulator [SOI] isolation regions, e.g. buried oxide regions of SOI wafers
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- H10W10/011—Manufacture or treatment of isolation regions comprising dielectric materials
- H10W10/014—Manufacture or treatment of isolation regions comprising dielectric materials using trench refilling with dielectric materials, e.g. shallow trench isolations
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- H10W10/17—Isolation regions comprising dielectric materials formed using trench refilling with dielectric materials, e.g. shallow trench isolations
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明は、半導体装置の製造方法に係わり、特に絶縁性
基板上の半導体装置の素子間分離方法に関する。
基板上の半導体装置の素子間分離方法に関する。
近年、絶縁性基板上の半導体層に素子を形成する、所謂
SO8半導体装置が開発されている。このSO8半導体
装置は、高速動作が容易で非常に少ない動作電流と云う
特徴を有しており、各種のデバイスへの適用が考えられ
ている。
SO8半導体装置が開発されている。このSO8半導体
装置は、高速動作が容易で非常に少ない動作電流と云う
特徴を有しており、各種のデバイスへの適用が考えられ
ている。
ところで、SO8基板上に半導体装置を形成する場合、
各素子間′を分離する必要がある。この素子間分離方法
としては、従来法の第1図(a)〜(e)に示す工程を
採っている。即ち、まずサファイア基板1上に高品質の
多結晶シリコン層をCVD法等により堆積した後、レー
ザビームアニール等により該シリコン層を単結晶化して
一結晶シリコン層2を形成する(第1図(a))。゛次
いで、上記形成されたSO8基板上に写真蝕剣法により
レジストマスク3を形成した後(第1図(b))、反応
性イオンエツチング(RIE)等の微細加工技術により
前記単結晶シリコン層2をエツチングして素子分離すべ
き溝4を形成する(第1図(C))。その後、例えばC
VD法によりシリコン酸化wA5を少なくとも上記溝4
の2〜3倍厚く堆積させることにより平坦化を行い(第
1図(d))、再びRI’Eによりこの層をエツチング
して最終的に溝4の中にシリコン酸化膜5が平坦に埋込
まれることになる貰第1図(e))。
各素子間′を分離する必要がある。この素子間分離方法
としては、従来法の第1図(a)〜(e)に示す工程を
採っている。即ち、まずサファイア基板1上に高品質の
多結晶シリコン層をCVD法等により堆積した後、レー
ザビームアニール等により該シリコン層を単結晶化して
一結晶シリコン層2を形成する(第1図(a))。゛次
いで、上記形成されたSO8基板上に写真蝕剣法により
レジストマスク3を形成した後(第1図(b))、反応
性イオンエツチング(RIE)等の微細加工技術により
前記単結晶シリコン層2をエツチングして素子分離すべ
き溝4を形成する(第1図(C))。その後、例えばC
VD法によりシリコン酸化wA5を少なくとも上記溝4
の2〜3倍厚く堆積させることにより平坦化を行い(第
1図(d))、再びRI’Eによりこの層をエツチング
して最終的に溝4の中にシリコン酸化膜5が平坦に埋込
まれることになる貰第1図(e))。
このように従来の素子間分離方法は、工程が複雑なうえ
に荷電粒子を用いるRIE工程が2度も実施されるので
、この荷電粒子による活性fR域7への照射損傷を生じ
る結果となる。特に、第1図(d)から同図(e)にお
ける最後のRi E工程による活性領域7への損傷は、
この上に半導体装置を形成することから、極めて有害な
ものとなる。
に荷電粒子を用いるRIE工程が2度も実施されるので
、この荷電粒子による活性fR域7への照射損傷を生じ
る結果となる。特に、第1図(d)から同図(e)にお
ける最後のRi E工程による活性領域7への損傷は、
この上に半導体装置を形成することから、極めて有害な
ものとなる。
本発明の目的は、絶縁性基板上に形成された半導体層の
活性な領域間を簡易な工程で絶縁分離することができ、
且つ該活性領域の荷電ビームによる照射損傷を防止し得
る素子間分離方法を提供することにある。
活性な領域間を簡易な工程で絶縁分離することができ、
且つ該活性領域の荷電ビームによる照射損傷を防止し得
る素子間分離方法を提供することにある。
本発明の骨子は、反応性の堆積ガス中で絶縁性基板の裏
面から光を照射することにより、この基板上に形成され
た活性な半導体領域を絶縁弁mすることにある。
面から光を照射することにより、この基板上に形成され
た活性な半導体領域を絶縁弁mすることにある。
即ち本発明は、絶縁性基板上の半導体層に形成される半
導体装置の各素子間を絶縁分離する素子間分離方法にお
いて、絶縁性基板上に形成された半、゛導体層を複数の
活性領域に分離したのち、上記基板を反応性の堆積ガス
雰囲気中に晒し、該基板の裏面側から前記分離領域間に
光を照射して該分離領域間に絶縁膜を埋込み形成するよ
うにした方法である。
導体装置の各素子間を絶縁分離する素子間分離方法にお
いて、絶縁性基板上に形成された半、゛導体層を複数の
活性領域に分離したのち、上記基板を反応性の堆積ガス
雰囲気中に晒し、該基板の裏面側から前記分離領域間に
光を照射して該分離領域間に絶縁膜を埋込み形成するよ
うにした方法である。
〔発明の効果〕 ・
本発明によれば、絶縁性基板上の単結晶半導体層上に半
導体装置を形成する際の微細な素子分離領域を作ること
ができ、且つその工程を従来方法に比較して大幅に簡略
化することができる。さらに、従来方法と異なり、絶縁
膜の埋込みにRIE工程等を用いる必要がないので、活
性領域に対する照射損傷がなく、超LSI製造プロセス
に極めて有効である。
導体装置を形成する際の微細な素子分離領域を作ること
ができ、且つその工程を従来方法に比較して大幅に簡略
化することができる。さらに、従来方法と異なり、絶縁
膜の埋込みにRIE工程等を用いる必要がないので、活
性領域に対する照射損傷がなく、超LSI製造プロセス
に極めて有効である。
第2図は本発明の一実施例方法に使用したiI膜形成装
置を示す概略構成図である。図中11は真空容器であり
、この容器11内には試料12を固定保持する試料台1
3が収容されている。試料台13は溶融石英からなり、
試料12を垂直に立てて固定するもので、図中矢印に示
す方向に回動自在に設けられている。さらに、試料台1
3には上記試料12を加熱するためのヒータ(図示せず
)が設けられている。また、真空容器11にはガス導入
口14が設けられており、このガス導入口14から反応
性の堆積ガス、例えばモノシラン5IH4と02との混
合ガスが導入される。さらに、真空容器11にはガス排
気口15が設けられており、このガス排気口15から上
記ガスが排気されるものとなっている。
置を示す概略構成図である。図中11は真空容器であり
、この容器11内には試料12を固定保持する試料台1
3が収容されている。試料台13は溶融石英からなり、
試料12を垂直に立てて固定するもので、図中矢印に示
す方向に回動自在に設けられている。さらに、試料台1
3には上記試料12を加熱するためのヒータ(図示せず
)が設けられている。また、真空容器11にはガス導入
口14が設けられており、このガス導入口14から反応
性の堆積ガス、例えばモノシラン5IH4と02との混
合ガスが導入される。さらに、真空容器11にはガス排
気口15が設けられており、このガス排気口15から上
記ガスが排気されるものとなっている。
一方、真空容器11の左方には、光源16が配置されて
おり、この光源16からの光17は容器11側壁に設け
られた溶融石英製の透明窓18を介して容器11内に導
入され、前記試料12の裏面側に照射されるものとなっ
ている。ここで、光源16はArF波長193 [nm
]の1キシマレーザである。また、真空容器11の右側
壁面には透明窓19が設けられており、この窓1つによ
り上記光源16から出て試料12を通過した光17は容
器11外に導光されるものとなっている。なお、図中2
1はモノシランSiH4ガス等の流量を制御するための
バルブ、22は02ガス等の流量を制御するためのバル
ブを示している。
おり、この光源16からの光17は容器11側壁に設け
られた溶融石英製の透明窓18を介して容器11内に導
入され、前記試料12の裏面側に照射されるものとなっ
ている。ここで、光源16はArF波長193 [nm
]の1キシマレーザである。また、真空容器11の右側
壁面には透明窓19が設けられており、この窓1つによ
り上記光源16から出て試料12を通過した光17は容
器11外に導光されるものとなっている。なお、図中2
1はモノシランSiH4ガス等の流量を制御するための
バルブ、22は02ガス等の流量を制御するためのバル
ブを示している。
次に、上記装置を用いた素子間分離方法について、第3
図(a)〜(e)を参照して説明する。
図(a)〜(e)を参照して説明する。
まず、第3図(a)に示す如くサファイア基板(絶縁性
基板)31上に、例えばエピタキシャル成長により単結
晶シリコンH(半導体層)32を成長させ、所謂SO8
基板を作成した。次いで、第3図(b)示す如くシリコ
ン層32上にレジストを塗布し、写真蝕刻法によりレジ
ストマスク33のパターンを形成した。続いて、例えば
RIE法を用いシリコン層32を素子分離すべき領域に
応じてエツチングし、第3図(C)示す如く絶縁層を埋
込むべき微細な1134を形成した。その後、レジスト
マスク33を除去した。
基板)31上に、例えばエピタキシャル成長により単結
晶シリコンH(半導体層)32を成長させ、所謂SO8
基板を作成した。次いで、第3図(b)示す如くシリコ
ン層32上にレジストを塗布し、写真蝕刻法によりレジ
ストマスク33のパターンを形成した。続いて、例えば
RIE法を用いシリコン層32を素子分離すべき領域に
応じてエツチングし、第3図(C)示す如く絶縁層を埋
込むべき微細な1134を形成した。その後、レジスト
マスク33を除去した。
上記工程の後、試料を前記第2図に示す装置の試料台1
3に固定保持し、試料台13を、例えば300 [℃]
に加熱した。この状態で、真空容器11内にSiH4と
02との混合ガスを導入し、光源16からのレーザビー
ム17を試料の裏面側に照射した。このとき、前記サフ
ァイア基板31は上記ビーム(波長193nm)17に
対して透明であるが、前記シリコン層32は不透明であ
る。
3に固定保持し、試料台13を、例えば300 [℃]
に加熱した。この状態で、真空容器11内にSiH4と
02との混合ガスを導入し、光源16からのレーザビー
ム17を試料の裏面側に照射した。このとき、前記サフ
ァイア基板31は上記ビーム(波長193nm)17に
対して透明であるが、前記シリコン層32は不透明であ
る。
従って、試料の裏面側に照射されたビーム17はシリコ
ン層32で反射されると共に、前記溝34内を通過する
ことになる。溝34を通過したビーム35は5it−1
4を直接分解して5rHXラジカルとなり、このラジカ
ルが02と反応して前記溝34内にのみ5io2膜36
が堆積することになる。この5iQ2膜′;36はAr
Fレーザビーム35に対しては完全に透明であり、従っ
て5iQ2膜36は1間の経過と共に厚く堆積し、最終
的に溝34内に完全に埋込まれる結果となる。
ン層32で反射されると共に、前記溝34内を通過する
ことになる。溝34を通過したビーム35は5it−1
4を直接分解して5rHXラジカルとなり、このラジカ
ルが02と反応して前記溝34内にのみ5io2膜36
が堆積することになる。この5iQ2膜′;36はAr
Fレーザビーム35に対しては完全に透明であり、従っ
て5iQ2膜36は1間の経過と共に厚く堆積し、最終
的に溝34内に完全に埋込まれる結果となる。
かくして本実施例方法によれば、素子分離すべき活性領
域37間にSiO2膜36を選択的に埋込むことができ
、活性領域37を絶縁分離することができる。そしてこ
の場合、平坦化を行うためのRIEを必要としないので
、活性領域37に対する照射損傷を完全になくすことが
できる。しがも、選択的に溝34内に5I02膜36を
埋込むことができるた、め、工程の大幅な簡略化をはか
り得、制御性の点でも優れている。また、第2図に示す
装置のように透明窓19を用いることにより、試料12
を通過したビーム35が容器11の壁面で反射して再び
試料12に照射されることがない゛ので、シリコン層3
2の上面に5iO2111が形成されるのを未然に防止
できる等の利点がある。
域37間にSiO2膜36を選択的に埋込むことができ
、活性領域37を絶縁分離することができる。そしてこ
の場合、平坦化を行うためのRIEを必要としないので
、活性領域37に対する照射損傷を完全になくすことが
できる。しがも、選択的に溝34内に5I02膜36を
埋込むことができるた、め、工程の大幅な簡略化をはか
り得、制御性の点でも優れている。また、第2図に示す
装置のように透明窓19を用いることにより、試料12
を通過したビーム35が容器11の壁面で反射して再び
試料12に照射されることがない゛ので、シリコン層3
2の上面に5iO2111が形成されるのを未然に防止
できる等の利点がある。
第4図は他の実施例方法を説明するための断面図である
。この実施例は、前記絶縁膜の形成時に前記試料台13
をレーザビーム17の照射方向に対して回動させるよう
にした方法である。即ち、前記第3図(a)〜(C)に
示す工程までi先の実施例と同様であり、この後同図(
e)に示す工程で試料台13を回動させながらSiO2
膜36の堆積を行った゛。
。この実施例は、前記絶縁膜の形成時に前記試料台13
をレーザビーム17の照射方向に対して回動させるよう
にした方法である。即ち、前記第3図(a)〜(C)に
示す工程までi先の実施例と同様であり、この後同図(
e)に示す工程で試料台13を回動させながらSiO2
膜36の堆積を行った゛。
このような方法であっても先の実施例と同様に溝34内
に5iO211136を選択的に堆積することができ、
活性−城37間の絶縁分離を行うことができる。さらに
この場合、単結晶シリコン層32の壁面41での反射光
42を利用しているので、溝34の両壁に対して5i0
2膜36゛の密着性を向上させることができる。
に5iO211136を選択的に堆積することができ、
活性−城37間の絶縁分離を行うことができる。さらに
この場合、単結晶シリコン層32の壁面41での反射光
42を利用しているので、溝34の両壁に対して5i0
2膜36゛の密着性を向上させることができる。
なお、本発明は上述した各実施例に限定されるものでは
ない。例えば、前記反応性の堆積ガスとしては、S i
H4と02との混合ガスに限らず、シラン類、有機シ
ラン類若しくは有機金属ガス等と02 、N20.NO
2若しく ハH2等との混合ガスを用いることが可能で
ある。さらに、上記混合ガスに82 H6、Pi−13
若しくはA S H3等を添加するようにしてもよい。
ない。例えば、前記反応性の堆積ガスとしては、S i
H4と02との混合ガスに限らず、シラン類、有機シ
ラン類若しくは有機金属ガス等と02 、N20.NO
2若しく ハH2等との混合ガスを用いることが可能で
ある。さらに、上記混合ガスに82 H6、Pi−13
若しくはA S H3等を添加するようにしてもよい。
また、前記sm形成装置の構成は前記第2図に河谷限定
されるものではな(、仕様に応じて適宜変更可能である
。例えば、第5図に示す如く容器11の右方に新たな光
源(波長10.6μ肌のGO2レーザ)51を設け、該
光源51からのレーザビーム52を紫外光カットフィル
タ53を介して容器11内に導入し試料12の表面側に
照射するようにしてもよい。
されるものではな(、仕様に応じて適宜変更可能である
。例えば、第5図に示す如く容器11の右方に新たな光
源(波長10.6μ肌のGO2レーザ)51を設け、該
光源51からのレーザビーム52を紫外光カットフィル
タ53を介して容器11内に導入し試料12の表面側に
照射するようにしてもよい。
この場合、前記溝34内に堆積中の5i02膜36はこ
の波長のレーザビームを効率良く吸収して加熱され、一
方シリコン層32に対しては透明であるため、温度上昇
を抑制することができ、溝34内の両壁との密着性の良
い5102M!36を堆積させることができる。
の波長のレーザビームを効率良く吸収して加熱され、一
方シリコン層32に対しては透明であるため、温度上昇
を抑制することができ、溝34内の両壁との密着性の良
い5102M!36を堆積させることができる。
また、前記絶縁性基板として、サファイア基板の代りに
単結晶シリコン基板上に絶縁層を形成したものを用いる
ことも可能である。この場合、絶縁性基板上の半導体層
としては、多結晶や非晶質の半導体層をアニールして申
結晶化したものを用いればよい。さらに、SO8に限ら
ず積層半導体装置の素子間分離に適用できるのは勿論の
ことである。その他、本発明の要旨を逸脱しない範囲で
、種々変形して実施することができる。
単結晶シリコン基板上に絶縁層を形成したものを用いる
ことも可能である。この場合、絶縁性基板上の半導体層
としては、多結晶や非晶質の半導体層をアニールして申
結晶化したものを用いればよい。さらに、SO8に限ら
ず積層半導体装置の素子間分離に適用できるのは勿論の
ことである。その他、本発明の要旨を逸脱しない範囲で
、種々変形して実施することができる。
第1図は従来の素子間分離工程を示す断面図、第2図は
本発明の一実施例方法に使用した薄膜形成装置を示す概
略構成図、第3図は上記装置を用いた素子間分離工程を
示す断面図、第4図は他の実施例を説明するための断面
図、第5図は1lll形成装置の変形例を示す概略構成
図である。 11・・・真空容器、12・・・試料、13・・・試料
台、14・・・ガス導入口、15・・・ガス排気口、1
6・・・光源、17光、18.19・・・透明窓、31
・・・サファイア基板(絶縁性基板)、32・・・単結
晶シリコン層(半導体層)、33・・・レジストマスク
、34・・・溝、36・・・5i02膜(絶縁膜)、3
7・・・活性領域。 出願人代理人 弁理士 鈴江武彦 第1 図 第2図
本発明の一実施例方法に使用した薄膜形成装置を示す概
略構成図、第3図は上記装置を用いた素子間分離工程を
示す断面図、第4図は他の実施例を説明するための断面
図、第5図は1lll形成装置の変形例を示す概略構成
図である。 11・・・真空容器、12・・・試料、13・・・試料
台、14・・・ガス導入口、15・・・ガス排気口、1
6・・・光源、17光、18.19・・・透明窓、31
・・・サファイア基板(絶縁性基板)、32・・・単結
晶シリコン層(半導体層)、33・・・レジストマスク
、34・・・溝、36・・・5i02膜(絶縁膜)、3
7・・・活性領域。 出願人代理人 弁理士 鈴江武彦 第1 図 第2図
Claims (1)
- 【特許請求の範囲】 (1)絶縁性基板上に形成された半導体層を複数の領域
に分離する工程と、次いで上記基板を反応性の堆積ガス
雰囲気中に晒し、該基板の裏面側から前記分離領域間に
光を照射して該分離領域間に絶縁膜を埋込み形成する工
程とを含むことを特徴とする素子間分離方法。 (2前記半導体層は、前記絶縁性基板上に形成された非
晶質或いは多結晶の半導体膜をアニールにより単結晶化
してなるものであることを特徴とする特許請求の範囲第
1項記載の素子間分離方法。 (a 前記半導体層は、前記絶縁性基板上にエピタキシ
ャル成長されたものであることを特徴とする特許請求の
範囲第1項記載の素子間分離方法。 (4)前記絶縁性基板及び前記分離領域間に埋込み形成
する絶縁膜は前記光に対して透明であり、且つ前記半導
体層は上記光に対して不透明であることを特徴とする特
許請求の範囲第1項記載の素子間分離方法。 (5)前記光は、前記反応性の堆積ガスに吸収されるも
のであることを特徴とする特許請求の範囲第1項記載の
素子間分離方法。 (6) 前記反応性の堆積ガスは、シラン類、有機シラ
ン類若しくは有機金属ガスと02 、 N20. N0
2若しくはH2との混合ガス、或いはこれらの混合ガス
に8286 、PH3若しくはASHa等の不純物を添
加してなるものであることを特徴とする特許請求の範囲
第1項記載の素子間分離方法。 (7)前記絶縁性の基板は、前記光とは別の光の照射に
より加熱されることを特徴とする特許請求の範囲第1項
記載の素子間分離方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59105998A JPS60250666A (ja) | 1984-05-25 | 1984-05-25 | 素子間分離方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59105998A JPS60250666A (ja) | 1984-05-25 | 1984-05-25 | 素子間分離方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60250666A true JPS60250666A (ja) | 1985-12-11 |
Family
ID=14422374
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59105998A Pending JPS60250666A (ja) | 1984-05-25 | 1984-05-25 | 素子間分離方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60250666A (ja) |
-
1984
- 1984-05-25 JP JP59105998A patent/JPS60250666A/ja active Pending
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