JPS6030046U - デ−タ記憶装置 - Google Patents
デ−タ記憶装置Info
- Publication number
- JPS6030046U JPS6030046U JP1983122947U JP12294783U JPS6030046U JP S6030046 U JPS6030046 U JP S6030046U JP 1983122947 U JP1983122947 U JP 1983122947U JP 12294783 U JP12294783 U JP 12294783U JP S6030046 U JPS6030046 U JP S6030046U
- Authority
- JP
- Japan
- Prior art keywords
- data
- shift register
- digit
- storage device
- data storage
- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
図面は本考案の一実施例を示すもので、第1図はシステ
ム全体の概略構成を示すブロック図、第2図はタイミン
グチャート、第3図はアドレス制御部の詳細を示す回路
構成図である。 1・・・ROM、2・・・ROMアドレス指定部、5・
・・制御部、6・・・アドレス変換部、8・・・アドレ
ス制御部、21・・・タイミング信号発生回路、24・
・・シフトレジスタ、25・・・バッファ、G1.G2
・・・ゲート回路。 tl 1NH,HN susnounNEJUM−砕
φR φイ φ5 S2
−−−か 誓
ム全体の概略構成を示すブロック図、第2図はタイミン
グチャート、第3図はアドレス制御部の詳細を示す回路
構成図である。 1・・・ROM、2・・・ROMアドレス指定部、5・
・・制御部、6・・・アドレス変換部、8・・・アドレ
ス制御部、21・・・タイミング信号発生回路、24・
・・シフトレジスタ、25・・・バッファ、G1.G2
・・・ゲート回路。 tl 1NH,HN susnounNEJUM−砕
φR φイ φ5 S2
−−−か 誓
Claims (1)
- 情報処理システムにおいて、各桁毎にデータを記憶する
M桁のシフトレジスタと、このシフトレジスタの最上位
桁にデータを書込む手段と、上記シフトレジスタの内容
を上記データの書込み後M−1桁循環シフトする手段と
、上記シフトレジスタの最下位桁に記憶されているデー
タのみを読出すデータ読出手段と、上記シフトレジスタ
をデータ読出し後1桁だけシフトする手段とを具備した
ことを特徴とするデータ記憶装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1983122947U JPS6030046U (ja) | 1983-08-08 | 1983-08-08 | デ−タ記憶装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1983122947U JPS6030046U (ja) | 1983-08-08 | 1983-08-08 | デ−タ記憶装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6030046U true JPS6030046U (ja) | 1985-02-28 |
Family
ID=30280830
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1983122947U Pending JPS6030046U (ja) | 1983-08-08 | 1983-08-08 | デ−タ記憶装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6030046U (ja) |
-
1983
- 1983-08-08 JP JP1983122947U patent/JPS6030046U/ja active Pending
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