JPS6045548U - ステレオ受信表示回路 - Google Patents
ステレオ受信表示回路Info
- Publication number
- JPS6045548U JPS6045548U JP1983136958U JP13695883U JPS6045548U JP S6045548 U JPS6045548 U JP S6045548U JP 1983136958 U JP1983136958 U JP 1983136958U JP 13695883 U JP13695883 U JP 13695883U JP S6045548 U JPS6045548 U JP S6045548U
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- JP
- Japan
- Prior art keywords
- circuit
- stereo
- signal
- synchronous detection
- level
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
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- Stereo-Broadcasting Methods (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第1図は従来例ステレオ受信表示回路のブロック構成図
。第2図は本考案−実施例ステレオ受信表示回路のブロ
ック構成図。第3図はその具体的回路図。 1・・・入力端子、2・・・バッファ回路、3・・・バ
イアス回路、4・・・同期検波回路、5・・・PLL回
路、6・・田−パスフィルタ、7・・・直流増幅器、8
・・・ステレオ表示駆動回路、9・・・ステレオ表示ラ
ンプ、11・・・電源電圧供給点、12・・・スイッチ
回路、2e、 2f、 7h・・・定電流源、2a
t 2bt 2ct2dt 4at 4bt 7a
t 7by 7ct 7dt 12 bq 12
gt 12 jq 12rn・・・トランジスタ、
4c、 4d、 4et 4f、 4g、 4ht 7
gt 10.12c、12d、12e、12h、12
k。 13・・・抵抗、12a、12i・・・ダイオード。 補正 昭58. 9.12 考案の名称、実用新案登録請求の範囲、図面の簡単な説
明を次のように補正する。 ■考案の名称 ステレオ受信表示回路 O実用新案登録請求の範囲 ステレオコンポジット信号中のパイロット信号に同期し
て信号を発生する信号発生回路と、前記信号発生回路の
出力信号と、前記ステレオコンポジット信号中のパイロ
ット信号とを入力して位相同期を検出する同期検波回路
と、前記同期検波回路の出力信号のレベルが所定レベル
以上になると動作するステレオ表示駆動回路と、 前記ステレオ表示駆動回路により点灯するステレオ表示
ランプと、 前記同期検波回路に所定のバイアス電圧を与えるバイア
ス回路とを備えたステレオ受信表示回路において、 前記バイアス回路により制御されこのバイアス回路の出
力電圧が正常値に達するまで前記同期検波回路の出力レ
ベルを前記ステレオ表示ランプが点灯しないレベルに固
定させるスイッチ回路を備えたことを特徴とする ステレオ受信表示回路。 図面の簡単な説明 第1図は従来例ステレオ受信表示回路のブロック構成図
。第2図は本考案−実施例ステレオ受信表示回路のブロ
ック構成図。第3図はその具体的回路図。 ・1・・・入力端子、2・・・バッファ回路、3・・・
バイアス回路、4・・・同期検波回路、5・・・PLL
回路、6・・・ローパスフィルタ、7・・・直流増幅器
、8・・・ステレオ表示駆動回路、9・・・ステレオ表
示ランプ、1 1・・・電源電圧供給点、12・・・
スイッチ回路。2e、 2 f、7 h”・定電流源、
2 at 2 by 2 C?2d、 3cw 3b
v 4av 4b、 7a、 7b、 ?ct 7c
L 12bw 12g= 12L 12m−・
・トランジスタ、3c・・・ツェナーダイオード、3d
。 12a・・・ダイオード、3 e、 4 ct 4
dt 4 et4f、4gv 4h、7gt
10v 12ct 12d、12e、12に、13
・・・抵抗。
。第2図は本考案−実施例ステレオ受信表示回路のブロ
ック構成図。第3図はその具体的回路図。 1・・・入力端子、2・・・バッファ回路、3・・・バ
イアス回路、4・・・同期検波回路、5・・・PLL回
路、6・・田−パスフィルタ、7・・・直流増幅器、8
・・・ステレオ表示駆動回路、9・・・ステレオ表示ラ
ンプ、11・・・電源電圧供給点、12・・・スイッチ
回路、2e、 2f、 7h・・・定電流源、2a
t 2bt 2ct2dt 4at 4bt 7a
t 7by 7ct 7dt 12 bq 12
gt 12 jq 12rn・・・トランジスタ、
4c、 4d、 4et 4f、 4g、 4ht 7
gt 10.12c、12d、12e、12h、12
k。 13・・・抵抗、12a、12i・・・ダイオード。 補正 昭58. 9.12 考案の名称、実用新案登録請求の範囲、図面の簡単な説
明を次のように補正する。 ■考案の名称 ステレオ受信表示回路 O実用新案登録請求の範囲 ステレオコンポジット信号中のパイロット信号に同期し
て信号を発生する信号発生回路と、前記信号発生回路の
出力信号と、前記ステレオコンポジット信号中のパイロ
ット信号とを入力して位相同期を検出する同期検波回路
と、前記同期検波回路の出力信号のレベルが所定レベル
以上になると動作するステレオ表示駆動回路と、 前記ステレオ表示駆動回路により点灯するステレオ表示
ランプと、 前記同期検波回路に所定のバイアス電圧を与えるバイア
ス回路とを備えたステレオ受信表示回路において、 前記バイアス回路により制御されこのバイアス回路の出
力電圧が正常値に達するまで前記同期検波回路の出力レ
ベルを前記ステレオ表示ランプが点灯しないレベルに固
定させるスイッチ回路を備えたことを特徴とする ステレオ受信表示回路。 図面の簡単な説明 第1図は従来例ステレオ受信表示回路のブロック構成図
。第2図は本考案−実施例ステレオ受信表示回路のブロ
ック構成図。第3図はその具体的回路図。 ・1・・・入力端子、2・・・バッファ回路、3・・・
バイアス回路、4・・・同期検波回路、5・・・PLL
回路、6・・・ローパスフィルタ、7・・・直流増幅器
、8・・・ステレオ表示駆動回路、9・・・ステレオ表
示ランプ、1 1・・・電源電圧供給点、12・・・
スイッチ回路。2e、 2 f、7 h”・定電流源、
2 at 2 by 2 C?2d、 3cw 3b
v 4av 4b、 7a、 7b、 ?ct 7c
L 12bw 12g= 12L 12m−・
・トランジスタ、3c・・・ツェナーダイオード、3d
。 12a・・・ダイオード、3 e、 4 ct 4
dt 4 et4f、4gv 4h、7gt
10v 12ct 12d、12e、12に、13
・・・抵抗。
Claims (1)
- 【実用新案登録請求の範囲】 ステレオコンポジット信号中のパイロット信号に同期し
て信号を発生する信号発生回路と、前記信号発生回路の
出力信号と、前記ステレオコンポジット信号中のパイロ
ット信号とを入力して位相同期を検出する同期検波回路
と、前記同期検波回路の出力信号のレベルが所定レベル
以上になると動作するステレオ表示駆動回路と、 前記ステレオ表示駆動回路により点灯するステレオ表示
ランプと、 前記同期検波回路に所定のバイアス回路を与えるバイア
ス回路とを備えたステレオ受信表示回路において、 前記バイアス回路により制御されこのバイアス回路の出
力電圧が正常値に達するまで前記同期検波回路の出力レ
ベルを前記ステレオ表示ランプが点灯しないレベルに固
定させるスイッチ回路を備えたことを特徴とする ステレオ受信表示回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1983136958U JPS6045548U (ja) | 1983-09-02 | 1983-09-02 | ステレオ受信表示回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1983136958U JPS6045548U (ja) | 1983-09-02 | 1983-09-02 | ステレオ受信表示回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6045548U true JPS6045548U (ja) | 1985-03-30 |
| JPH04600Y2 JPH04600Y2 (ja) | 1992-01-09 |
Family
ID=30307773
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1983136958U Granted JPS6045548U (ja) | 1983-09-02 | 1983-09-02 | ステレオ受信表示回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6045548U (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5826249U (ja) * | 1981-08-10 | 1983-02-19 | 株式会社ケンウッド | ステレオ表示誤動作防止回路 |
-
1983
- 1983-09-02 JP JP1983136958U patent/JPS6045548U/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5826249U (ja) * | 1981-08-10 | 1983-02-19 | 株式会社ケンウッド | ステレオ表示誤動作防止回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH04600Y2 (ja) | 1992-01-09 |
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