JPS6046077A - 可変容量素子 - Google Patents
可変容量素子Info
- Publication number
- JPS6046077A JPS6046077A JP58153977A JP15397783A JPS6046077A JP S6046077 A JPS6046077 A JP S6046077A JP 58153977 A JP58153977 A JP 58153977A JP 15397783 A JP15397783 A JP 15397783A JP S6046077 A JPS6046077 A JP S6046077A
- Authority
- JP
- Japan
- Prior art keywords
- insulating film
- variable capacitance
- capacitance
- capacitance element
- depletion layer
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D1/00—Resistors, capacitors or inductors
- H10D1/60—Capacitors
- H10D1/62—Capacitors having potential barriers
- H10D1/64—Variable-capacitance diodes, e.g. varactors
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D1/00—Resistors, capacitors or inductors
- H10D1/60—Capacitors
- H10D1/62—Capacitors having potential barriers
- H10D1/66—Conductor-insulator-semiconductor capacitors, e.g. MOS capacitors
Landscapes
- Semiconductor Integrated Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、太ぎな容量変化比が得られるようになされた
可変容量素子に関するものである。
可変容量素子に関するものである。
電子同調ラジオ等に使用される可変容量素子として従来
第1図のようなPN接合ダイオードが知られている。
第1図のようなPN接合ダイオードが知られている。
同図において1はN型半導体領域、2はP型半導体領域
、3はPN接合、4および5は上記領域1および領域2
に各々設けられたオーミック電極6および7は上記電極
4,5に各々設けられた引出し端子、8は空乏層である
。以上の構成において、引出し端子6および7に加えら
れるバイアス電圧に応じて空乏層8が伸縮し、これに基
づ(容量値の変化が上記引出し端子6および7間におい
て読み出されるようになっている。
、3はPN接合、4および5は上記領域1および領域2
に各々設けられたオーミック電極6および7は上記電極
4,5に各々設けられた引出し端子、8は空乏層である
。以上の構成において、引出し端子6および7に加えら
れるバイアス電圧に応じて空乏層8が伸縮し、これに基
づ(容量値の変化が上記引出し端子6および7間におい
て読み出されるようになっている。
ところでこのような構造の可変容量素子においては、上
記引き出し端子6および7が容量読出し端子(電極)と
して用いられると共にを2層8ン伸縮さセるためのバイ
アス電圧印加端子としても用いられるために、引出し端
子6および7間に容量続出用人力信号が印加されに時あ
るいはバイアス電圧が印加された時は共に空乏層8が伸
縮するので容量値が変化音ることになる。このために同
調回路に適用した場合には入力信号によって容量値が変
化してしまうので、同調ずれが生ずるようKなり、また
混変調特性の劣化の原因となる。すなわち入力信号によ
って容量変化を受けしかもその変化曲線は非線形となる
ので1人力信号周波数が変調ン受けて高周波成分が生ま
れるようになる。
記引き出し端子6および7が容量読出し端子(電極)と
して用いられると共にを2層8ン伸縮さセるためのバイ
アス電圧印加端子としても用いられるために、引出し端
子6および7間に容量続出用人力信号が印加されに時あ
るいはバイアス電圧が印加された時は共に空乏層8が伸
縮するので容量値が変化音ることになる。このために同
調回路に適用した場合には入力信号によって容量値が変
化してしまうので、同調ずれが生ずるようKなり、また
混変調特性の劣化の原因となる。すなわち入力信号によ
って容量変化を受けしかもその変化曲線は非線形となる
ので1人力信号周波数が変調ン受けて高周波成分が生ま
れるようになる。
このような欠点ン除くために容量読出し電極とバイアス
電圧印加電極とン分離させるように構成した。第2図(
aJのような3端子のMIS型可変可変容量素子開昭5
5−120175号公報で示されるように提供されてい
る。
電圧印加電極とン分離させるように構成した。第2図(
aJのような3端子のMIS型可変可変容量素子開昭5
5−120175号公報で示されるように提供されてい
る。
同図において、11はN型半導体領域+ 12A、 1
2BはP型半導体領域、13はPN接合、14は上記P
+型領域12A、128間のN型領域11表面に設けら
れ几絶縁膜、 15.16A、 16 B、 17は各
々N型領域11゜P1型領域12A、12B、絶縁膜1
4に設けられた電極。
2BはP型半導体領域、13はPN接合、14は上記P
+型領域12A、128間のN型領域11表面に設けら
れ几絶縁膜、 15.16A、 16 B、 17は各
々N型領域11゜P1型領域12A、12B、絶縁膜1
4に設けられた電極。
18、19.206’!各々電極15.電極16A、1
6B、電極17に設けられU引出し端子、21は空乏層
である。
6B、電極17に設けられU引出し端子、21は空乏層
である。
上記P型領域12A、12Bおよびこれらに設けられた
電極16A、16Bによって空乏層制御部幻が構成され
、絶縁膜14およびこれに設けられた電極17によって
容量読出部列が構成される。
電極16A、16Bによって空乏層制御部幻が構成され
、絶縁膜14およびこれに設けられた電極17によって
容量読出部列が構成される。
以上において引出しん子18.19間にPN接合13ン
逆バイアスするようなバイア2電圧vBン印加しこれを
可変することによりを2層21の幅が変化し、それによ
る容量変化が引出し端子18.20間から読み出されて
第2図(bJのような容量(CJ対箪圧(VJ特性が得
られる。ここで容量Hは上記逆バイアス電圧vBが00
時の値であり、容量りは逆バイア7、電圧vBが増加さ
れしぎい電圧VBTl”経過しに後の、 VBL時にお
ける値であり、各々Mis−C−V特性における容量最
大値CmaXおよび容量最小値Cm1nを示している。
逆バイアスするようなバイア2電圧vBン印加しこれを
可変することによりを2層21の幅が変化し、それによ
る容量変化が引出し端子18.20間から読み出されて
第2図(bJのような容量(CJ対箪圧(VJ特性が得
られる。ここで容量Hは上記逆バイアス電圧vBが00
時の値であり、容量りは逆バイア7、電圧vBが増加さ
れしぎい電圧VBTl”経過しに後の、 VBL時にお
ける値であり、各々Mis−C−V特性における容量最
大値CmaXおよび容量最小値Cm1nを示している。
ここで第2図(aJの構造で可変容量素子としての容量
変化比を大きくするためには上記H/L比を太きくする
必要がある。この要望を満たすための手段としては上記
容量読出部24ケ構成している絶縁膜14の膜厚ン小に
する方法、あるいはN型半導体領域11のキャリア濃度
7丁げろ方法が考えられる。
変化比を大きくするためには上記H/L比を太きくする
必要がある。この要望を満たすための手段としては上記
容量読出部24ケ構成している絶縁膜14の膜厚ン小に
する方法、あるいはN型半導体領域11のキャリア濃度
7丁げろ方法が考えられる。
しかし後者のように、キャリア濃度ン下げることはQ値
の低下ン招(ので好筐しくない。 !また前者において
は第3図に示すように、tfJ軸の絶縁膜14例えば酸
化膜の膜厚tを/J1にする程縦軸のH/L比を大きく
することができる力瓢それに比例して絶縁膜14内のピ
ンホール数が増加してくる等に因って絶縁膜14の絶縁
性が劣化して(るのは避けられない。
の低下ン招(ので好筐しくない。 !また前者において
は第3図に示すように、tfJ軸の絶縁膜14例えば酸
化膜の膜厚tを/J1にする程縦軸のH/L比を大きく
することができる力瓢それに比例して絶縁膜14内のピ
ンホール数が増加してくる等に因って絶縁膜14の絶縁
性が劣化して(るのは避けられない。
本発明は以上の問題に対処してなされKもので、半導体
基板上に空乏層制御部と絶縁膜を介して設げられ定容量
読出電極を含む容量読出部とが形成されてなる可変容量
素子において、上記絶縁膜が半導体基板表面に形成され
た第1の絶縁膜およびこの上に形成された第2の絶縁膜
の積層構造に構成することにより従来欠点を除去するよ
うにした可変容量素子を提供することを目的とするもの
である。以下図面を参照して本発明実施例を説明する。
基板上に空乏層制御部と絶縁膜を介して設げられ定容量
読出電極を含む容量読出部とが形成されてなる可変容量
素子において、上記絶縁膜が半導体基板表面に形成され
た第1の絶縁膜およびこの上に形成された第2の絶縁膜
の積層構造に構成することにより従来欠点を除去するよ
うにした可変容量素子を提供することを目的とするもの
である。以下図面を参照して本発明実施例を説明する。
第4図は本発明実施例による可変容量素子を示す断面図
で第2図(a)と同一部分は同一番号で示し、容量続出
部冴を構成する絶縁膜δはN型半導体領域11表面に形
成きれた第1の絶縁膜25A例えば酸化膜(5i02
)およびこの上に形成された第2の絶縁膜25B例えば
窒化膜(SiN )からなる積層構造によって構成され
る。
で第2図(a)と同一部分は同一番号で示し、容量続出
部冴を構成する絶縁膜δはN型半導体領域11表面に形
成きれた第1の絶縁膜25A例えば酸化膜(5i02
)およびこの上に形成された第2の絶縁膜25B例えば
窒化膜(SiN )からなる積層構造によって構成され
る。
H7L比のHレベルおよびLレベルは次の式によって絡
えられる。
えられる。
Hレベル:
Lレベルニ
ー例トシて、dSio2=100 A + dS tN
”” 100 Aに設定した時、上記(17,(2J
に基つ(計算の結果、H7L比は約41@を得ることが
でき瓦。これはdsiQ2= 100^で酸化#25A
のみ設けた場合のH/L比よりやや/J%さな値である
が、絶縁性の点では著るしく医れておりしかもdsi0
2ユ1,000λに単独に設けた場合に比べて約5陪の
値となる。
”” 100 Aに設定した時、上記(17,(2J
に基つ(計算の結果、H7L比は約41@を得ることが
でき瓦。これはdsiQ2= 100^で酸化#25A
のみ設けた場合のH/L比よりやや/J%さな値である
が、絶縁性の点では著るしく医れておりしかもdsi0
2ユ1,000λに単独に設けた場合に比べて約5陪の
値となる。
このように、容量読出部列の絶縁膜5を多層構造に構成
することにより、下部の絶縁膜25Aの膜厚を小に設定
してもこれに因る絶縁性の劣化は上部の絶縁膜25Bに
より補われるので、絶縁性を劣化させることな(H/L
比を大きくとることができるようになる。
することにより、下部の絶縁膜25Aの膜厚を小に設定
してもこれに因る絶縁性の劣化は上部の絶縁膜25Bに
より補われるので、絶縁性を劣化させることな(H/L
比を大きくとることができるようになる。
特に窒化膜は絶縁性に曖れていると共に外部からの有無
不純物等の侵入に対するマスク性にも浸れているので、
酸化膜と組み合わセることにより膜厚が小さくとも十分
大きなH/L比を得ることができる。
不純物等の侵入に対するマスク性にも浸れているので、
酸化膜と組み合わセることにより膜厚が小さくとも十分
大きなH/L比を得ることができる。
各絶縁膜の膜厚の設定は目的、用途に応じて任意に選ぶ
ことができる。
ことができる。
以上述べて明らかなように本発明によれば、半導体基板
上に空乏層制御部と絶縁膜を介して設けられ1こ容量読
出電極を含む容量続出部とが形成されてなる可変容量素
子において、上記絶縁膜が半導体基板表面に形成された
第1の絶縁膜およびこの上に形成された第2の絶縁膜の
積層構造に構成したものであるから、従来欠点を除去す
ることができる。
上に空乏層制御部と絶縁膜を介して設けられ1こ容量読
出電極を含む容量続出部とが形成されてなる可変容量素
子において、上記絶縁膜が半導体基板表面に形成された
第1の絶縁膜およびこの上に形成された第2の絶縁膜の
積層構造に構成したものであるから、従来欠点を除去す
ることができる。
本発明により容量変化比の大きな可変容量素子が得られ
るので、電子同調を必要とする各種同調回路に広範囲に
適用することかできる。
るので、電子同調を必要とする各種同調回路に広範囲に
適用することかできる。
第1図、第2図(a)および第2図(bJは従来例を示
す断面図および特性図、第3図は本発明を説明するため
の特性図、第4図は本発明実施例を示す断面図である。 16A、16B・・・バイアス電極、17・・・容量読
出電極、21・・・空乏層、乙・・・空乏層制御部、冴
・・・容量続出部、25、25A、 25B−・・絶縁
膜。 第1図 一一二岬 り。 寸 11 F) −H蘂 −L
す断面図および特性図、第3図は本発明を説明するため
の特性図、第4図は本発明実施例を示す断面図である。 16A、16B・・・バイアス電極、17・・・容量読
出電極、21・・・空乏層、乙・・・空乏層制御部、冴
・・・容量続出部、25、25A、 25B−・・絶縁
膜。 第1図 一一二岬 り。 寸 11 F) −H蘂 −L
Claims (1)
- 【特許請求の範囲】 1、半導体基板上に空乏層制御部と絶縁膜ン介して設け
られた容量読出電極ン含む容量続出部とが形成されてな
る可変容量素子において、上記絶縁膜が半導体基板表面
に形成された第1の絶縁膜およびこの上に形成された第
2の絶縁膜の積層構造から構成されたことン特徴とする
可変容量素子。 2、 上記第1の絶縁膜が酸化膜および第2の絶縁膜が
窒化膜から構成されたことヲ4?徴とする特許請求の範
囲第1項記載の可変容量素子。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58153977A JPS6046077A (ja) | 1983-08-23 | 1983-08-23 | 可変容量素子 |
| DE3431053A DE3431053A1 (de) | 1983-08-23 | 1984-08-23 | Kondensatorbauelement mit einstellbarer kapazitaet |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58153977A JPS6046077A (ja) | 1983-08-23 | 1983-08-23 | 可変容量素子 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6046077A true JPS6046077A (ja) | 1985-03-12 |
Family
ID=15574212
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58153977A Pending JPS6046077A (ja) | 1983-08-23 | 1983-08-23 | 可変容量素子 |
Country Status (2)
| Country | Link |
|---|---|
| JP (1) | JPS6046077A (ja) |
| DE (1) | DE3431053A1 (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4835587A (en) * | 1984-09-19 | 1989-05-30 | Fuji Electric Co., Ltd. | Semiconductor device for detecting radiation |
| KR940009352B1 (ko) * | 1990-07-09 | 1994-10-07 | 가부시끼가이샤 도시바 | 반도체 소자 |
| US6369671B1 (en) * | 1999-03-30 | 2002-04-09 | International Business Machines Corporation | Voltage controlled transmission line with real-time adaptive control |
-
1983
- 1983-08-23 JP JP58153977A patent/JPS6046077A/ja active Pending
-
1984
- 1984-08-23 DE DE3431053A patent/DE3431053A1/de not_active Withdrawn
Also Published As
| Publication number | Publication date |
|---|---|
| DE3431053A1 (de) | 1985-03-14 |
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