JPS586181A - 可変容量装置 - Google Patents
可変容量装置Info
- Publication number
- JPS586181A JPS586181A JP56104266A JP10426681A JPS586181A JP S586181 A JPS586181 A JP S586181A JP 56104266 A JP56104266 A JP 56104266A JP 10426681 A JP10426681 A JP 10426681A JP S586181 A JPS586181 A JP S586181A
- Authority
- JP
- Japan
- Prior art keywords
- capacitance
- depletion layer
- section
- variable capacitance
- change
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D1/00—Resistors, capacitors or inductors
- H10D1/60—Capacitors
- H10D1/62—Capacitors having potential barriers
- H10D1/64—Variable-capacitance diodes, e.g. varactors
Landscapes
- Semiconductor Integrated Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、半導体チップの側面に容量読出部を設けるよ
うに構成した三端子を有する可変容量装置に関するもの
である。
うに構成した三端子を有する可変容量装置に関するもの
である。
可変容量装置として従来第1図のようなPN接合素子を
利用することが行われている。同図において、lはN型
半導体層、2はP型半導体領域、3はPN接合部、4お
よび5は上記N型層lおよびP型領域2に各々設けられ
た電極、6および7は上記電極4および5に各々設けら
れた引出し端子、8はPN接合部3から主として不純物
濃度の低いN型層l側に拡がる空乏層である。以上にお
いて、引出し端子6および7間に加えられる逆バイアス
ミ圧に応じて空乏層、8が伸縮し、これに基づ(容量変
化が引出し端子6および7間で読み出されるようになっ
ている。
利用することが行われている。同図において、lはN型
半導体層、2はP型半導体領域、3はPN接合部、4お
よび5は上記N型層lおよびP型領域2に各々設けられ
た電極、6および7は上記電極4および5に各々設けら
れた引出し端子、8はPN接合部3から主として不純物
濃度の低いN型層l側に拡がる空乏層である。以上にお
いて、引出し端子6および7間に加えられる逆バイアス
ミ圧に応じて空乏層、8が伸縮し、これに基づ(容量変
化が引出し端子6および7間で読み出されるようになっ
ている。
しかしながら以上のようなPN接合素子を利用した従来
の可変容量装置は以下のような欠点を有している。
の可変容量装置は以下のような欠点を有している。
(4)PN接合における空乏層容量のバイアス電圧依存
性を利用するため、最小容量値は半導体領域の不純物濃
度により決定され、一方最大容量値はコンダクタンス成
分の増大により決定される。
性を利用するため、最小容量値は半導体領域の不純物濃
度により決定され、一方最大容量値はコンダクタンス成
分の増大により決定される。
このためQが大きい状態で容量変化中を大きくとること
は実用上不可能となり、また容量変化に伴うQの変化が
大きくなるので回路設計上困難を伴なう。
は実用上不可能となり、また容量変化に伴うQの変化が
大きくなるので回路設計上困難を伴なう。
(2)容量を変化させるためのバイアス電圧印加および
容量変化の読み出しt共通の引出し端子で行っているた
め、共振回路等に応用した時に入力信号電圧自体によっ
て不必要な容量変化を起こし易(なり信号劣化をもたら
す。また入力信号電圧とバイアス電圧との相互作用が少
なくなるような特別な回路構成が必要とされるので、用
途が限定されてしまう。
容量変化の読み出しt共通の引出し端子で行っているた
め、共振回路等に応用した時に入力信号電圧自体によっ
て不必要な容量変化を起こし易(なり信号劣化をもたら
す。また入力信号電圧とバイアス電圧との相互作用が少
なくなるような特別な回路構成が必要とされるので、用
途が限定されてしまう。
(3)空乏層容量を決定するための半導体領域の不純物
濃度が拡散法あるいはイオンインプランテーション法等
の制御手段により行われるが、一般に歩留りが悪いので
IC回路へ集積化することは実用上不可能である。
濃度が拡散法あるいはイオンインプランテーション法等
の制御手段により行われるが、一般に歩留りが悪いので
IC回路へ集積化することは実用上不可能である。
本発明は以上の問題に対処してなされたもので、一つの
表面に空乏層を発生させるための障壁を有する半導体基
板を用いこの基板の側面に容量読出部を設けることによ
り、実質的に容量続出部の平面的な面積を増加させるこ
となく容量変化を増加させるようにして従来欠点を除去
し得るように構成した可変容量装置を提供することを目
的とするものである。
表面に空乏層を発生させるための障壁を有する半導体基
板を用いこの基板の側面に容量読出部を設けることによ
り、実質的に容量続出部の平面的な面積を増加させるこ
となく容量変化を増加させるようにして従来欠点を除去
し得るように構成した可変容量装置を提供することを目
的とするものである。
以下図面を参照して本発明実施例を説明する。
第2図は本発明実施例による可変容量装置を示す断面図
で、9はN型層、10はこのN型層9上に形成されたP
型層、11は側面部でPN接合部3との間に傾斜角θを
有している。12は上記N型層9に設けられた空乏層制
御電極、13は上記側面部1】に設けられた容量読出電
極(図示せず)を備えた容量続出部、14は共通電極、
15は絶縁膜である。
で、9はN型層、10はこのN型層9上に形成されたP
型層、11は側面部でPN接合部3との間に傾斜角θを
有している。12は上記N型層9に設けられた空乏層制
御電極、13は上記側面部1】に設けられた容量読出電
極(図示せず)を備えた容量続出部、14は共通電極、
15は絶縁膜である。
上記容量続出部13の具体的構造は、第3図のように側
面部11に選択的にN型領域16を形成しこのN型領域
16上に容量読出電極17を設けるようにしたPN接合
構造、第4図のよ゛うに側面部1】に絶縁膜15を介し
て容量続出電極17を設けるようにしたMIS構造ある
いは第5図のように側面部11に容量読出電極を兼ねて
ショットキーノ(リアを形成し得る金属18を設けるよ
うにしたショットキー接合構造のいずれかから構成され
る。
面部11に選択的にN型領域16を形成しこのN型領域
16上に容量読出電極17を設けるようにしたPN接合
構造、第4図のよ゛うに側面部1】に絶縁膜15を介し
て容量続出電極17を設けるようにしたMIS構造ある
いは第5図のように側面部11に容量読出電極を兼ねて
ショットキーノ(リアを形成し得る金属18を設けるよ
うにしたショットキー接合構造のいずれかから構成され
る。
以上の構成において、空乏層制御電極12と共通電極1
4との間に逆バイアス電圧VRを印加すると、逆バイア
ス電圧の増加につれて空乏層8力SPN接合3から主と
して不純物濃度の低いP型層lO側に拡がり始め七の巾
dが増加する。同時に側面部11のスロープA下の空乏
層8の寸法りも増加し、一方スロープA下の空乏層8が
存在していない部分の寸法Bは徐々に減少していく。
4との間に逆バイアス電圧VRを印加すると、逆バイア
ス電圧の増加につれて空乏層8力SPN接合3から主と
して不純物濃度の低いP型層lO側に拡がり始め七の巾
dが増加する。同時に側面部11のスロープA下の空乏
層8の寸法りも増加し、一方スロープA下の空乏層8が
存在していない部分の寸法Bは徐々に減少していく。
すなわち、上記逆バイアス電圧vRを可変することによ
り空乏層8の巾dが伸縮するので、空乏層8の端部にお
ける側面部11との寸、法りも変化しこの部分の空乏層
の面積を変化させることができる。したがって、上記寸
法Bも変化しこの部分の面積は上記空乏層の面積の変化
に応じて制御されるようになる。この結果容量読出電極
17あるいは18とP型層lO間には上記寸法Bに対応
した面積を介した容量C1が形成されることになる。
り空乏層8の巾dが伸縮するので、空乏層8の端部にお
ける側面部11との寸、法りも変化しこの部分の空乏層
の面積を変化させることができる。したがって、上記寸
法Bも変化しこの部分の面積は上記空乏層の面積の変化
に応じて制御されるようになる。この結果容量読出電極
17あるいは18とP型層lO間には上記寸法Bに対応
した面積を介した容量C1が形成されることになる。
また容量続出電極、17あるいは18とN型層9間にお
いては、上記容量C1と空乏層8上下面間の容量C2と
の直列分容量に、容量読出電極17あるいは18と上記
寸法りに対応した面積を介したN型層9との間で形成さ
れる容量C3が並列接続された容量Cが形成される。
いては、上記容量C1と空乏層8上下面間の容量C2と
の直列分容量に、容量読出電極17あるいは18と上記
寸法りに対応した面積を介したN型層9との間で形成さ
れる容量C3が並列接続された容量Cが形成される。
以上により上記容量読出電極17.18と共通電極14
との間に容量変化が生じ、空乏層8の巾dが拡がる程寸
法Bが小さくなるので上記電極17.18および14間
で読み出される容量変化は小さくなり、逆バイアス電圧
の変化に対応した容量変化が読み出されるようになる。
との間に容量変化が生じ、空乏層8の巾dが拡がる程寸
法Bが小さくなるので上記電極17.18および14間
で読み出される容量変化は小さくなり、逆バイアス電圧
の変化に対応した容量変化が読み出されるようになる。
すなわち空乏層制御電極12と共通電極14との間に印
加される逆バイアス電圧によって、容量続出電極17.
18と共通電極14との間で読み出される容量変化は制
御されることになる。この容量続出電極17.18で読
み出される容量は、上記空乏層8による容量の他に絶縁
膜15による容量も含まれる。
加される逆バイアス電圧によって、容量続出電極17.
18と共通電極14との間で読み出される容量変化は制
御されることになる。この容量続出電極17.18で読
み出される容量は、上記空乏層8による容量の他に絶縁
膜15による容量も含まれる。
上記側面部1】に設けられた容量読出電極17.18の
有効面積はその角度なrとした時、平面上の面積の’/
sinθ倍と大きくすることができる。したがって平面
的に同一寸法のチップサイズとした場合でも、より大き
な容量変化を読み出すことができ、同じ容量変化を読み
出す場合は小さなチップサイズで事足りることができる
。角度θが小さくなる程容量変化の倍率を大きくするこ
とができるが、このθの値は目的に応じて任意に選択す
ることができる。
有効面積はその角度なrとした時、平面上の面積の’/
sinθ倍と大きくすることができる。したがって平面
的に同一寸法のチップサイズとした場合でも、より大き
な容量変化を読み出すことができ、同じ容量変化を読み
出す場合は小さなチップサイズで事足りることができる
。角度θが小さくなる程容量変化の倍率を大きくするこ
とができるが、このθの値は目的に応じて任意に選択す
ることができる。
側面部110角度θを形成する手段は周知の異方性エツ
チングを利用することによって容易に目的空乏層制御電
極12を設けて空乏層8を発生させるための障壁として
は、実施例ではP型層10とN型層9とのPN接合構造
を利用する場合について説明したが、何らこれに限定さ
れることなく例えばMI8構造、ショットキー接合構造
等を選択しても良い。
チングを利用することによって容易に目的空乏層制御電
極12を設けて空乏層8を発生させるための障壁として
は、実施例ではP型層10とN型層9とのPN接合構造
を利用する場合について説明したが、何らこれに限定さ
れることなく例えばMI8構造、ショットキー接合構造
等を選択しても良い。
以上のようにして得られる三端子の可変容量装置は、例
えばAMラジオフロントエンド部の電子同調回路をIC
化する際に同時に組み込むことができ、上記IC製造プ
ロセスをそのまま利用して形成することが可能となる。
えばAMラジオフロントエンド部の電子同調回路をIC
化する際に同時に組み込むことができ、上記IC製造プ
ロセスをそのまま利用して形成することが可能となる。
この点従来の可変容量装置では、IC製造プロセスをそ
のまま利用してIC化することが困難であったため、外
付は部品として別個に同調回路に接続する必要があった
。
のまま利用してIC化することが困難であったため、外
付は部品として別個に同調回路に接続する必要があった
。
以上説明して明らかなように本発明によれば、一つの表
面に空乏層を発生させ、るための障壁を有する半導体基
板をm−この基板の側面に容量続出部を設けることによ
り、実質的に容量読出部の平面的な面積を増加させるこ
となく容量変化を増加させるように構成するものである
から、単に逆バイアス電圧による平面的な空乏層容量を
利用する場合に比べ容易に容量を増加させることができ
る。
面に空乏層を発生させ、るための障壁を有する半導体基
板をm−この基板の側面に容量続出部を設けることによ
り、実質的に容量読出部の平面的な面積を増加させるこ
となく容量変化を増加させるように構成するものである
から、単に逆バイアス電圧による平面的な空乏層容量を
利用する場合に比べ容易に容量を増加させることができ
る。
また空乏層制御部と容量読出部とが独立した三端子構造
となっているために、入力信号による悪影響を避けるこ
とができる。さらに半導体領域の不純物濃度だけで空乏
層容量を決定する必要はないので、不純物濃度を正確に
制御するための複雑な手段は不要となるため、歩留り低
下なしに集積化が可能となる。
となっているために、入力信号による悪影響を避けるこ
とができる。さらに半導体領域の不純物濃度だけで空乏
層容量を決定する必要はないので、不純物濃度を正確に
制御するための複雑な手段は不要となるため、歩留り低
下なしに集積化が可能となる。
第1図は従来例を示す断面図、第2図乃至第5図はいず
れも本発明実施例を示す断面図である。 3・・・PN接合部、8・・・空乏層、11・・・側面
部、12・・空乏層制御電極、13・・・容量読出部、
14・・・共通電極、15・・・絶縁膜、17・・・容
量読出電極、18・・・金属。 特許出願人 タラリオン株式会社 代理人 弁理士 永 1)武 三 部第1− 第2図 第3図 第4図
れも本発明実施例を示す断面図である。 3・・・PN接合部、8・・・空乏層、11・・・側面
部、12・・空乏層制御電極、13・・・容量読出部、
14・・・共通電極、15・・・絶縁膜、17・・・容
量読出電極、18・・・金属。 特許出願人 タラリオン株式会社 代理人 弁理士 永 1)武 三 部第1− 第2図 第3図 第4図
Claims (1)
- 【特許請求の範囲】 1、−表面と空乏層を発生させるための障壁を備えた油
表面および側面とを有する半導体基板の、上記油表面に
空乏層制御部を側面に容量続出部を各々設け、上記空乏
層制御部を逆バイアスすることにより上記障壁がら空乏
層を上記側面に到達させ、これにより上記容量続出部か
ら容量変化を読み出すように構成したことを特徴とする
可変容量装置。 2、上記側面が傾斜面であることを特徴とする特許請求
の範囲第1項記載の可変容量装置。 3、上記半導体基板の一表面に共通電極部を設け、この
共通電極部と上記容量続出部間で容量変化を読み出すよ
うに構成したことを特徴とする特許請求の範囲第1項又
は第2項記載の可変容量装置。 4、上記容量読出部がP−N接合構造、MIS構造、シ
ョットキー接合構造のいずれかであることを特徴とする
特許請求の範囲第1項乃至第3項のいずれかに記載の可
変容量装置。 5、上記空乏層制御部がP−N接合構造、MIS構造、
ショットキー接合構造のいずれかであることを特徴とす
る特許請求の範囲第1項乃至第4項のいずれかに記載の
可変容量装置。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56104266A JPS586181A (ja) | 1981-07-03 | 1981-07-03 | 可変容量装置 |
| GB08219002A GB2103012A (en) | 1981-07-03 | 1982-07-01 | Variable capacitor |
| FR8211672A FR2509093A1 (fr) | 1981-07-03 | 1982-07-02 | Condensateur variable |
| DE19823224835 DE3224835A1 (de) | 1981-07-03 | 1982-07-02 | Veraenderlicher kondensator |
| NL8202682A NL8202682A (nl) | 1981-07-03 | 1982-07-02 | Variabele capacitantie. |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56104266A JPS586181A (ja) | 1981-07-03 | 1981-07-03 | 可変容量装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS586181A true JPS586181A (ja) | 1983-01-13 |
Family
ID=14376119
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56104266A Pending JPS586181A (ja) | 1981-07-03 | 1981-07-03 | 可変容量装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS586181A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60221818A (ja) * | 1984-04-18 | 1985-11-06 | Seiko Epson Corp | 情報機器 |
| JPS63184123A (ja) * | 1986-09-30 | 1988-07-29 | Canon Inc | 情報処理装置 |
| WO2019240889A1 (en) * | 2018-06-13 | 2019-12-19 | Qualcomm Incorporated | Iii-v based variable capacitor |
-
1981
- 1981-07-03 JP JP56104266A patent/JPS586181A/ja active Pending
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60221818A (ja) * | 1984-04-18 | 1985-11-06 | Seiko Epson Corp | 情報機器 |
| JPS63184123A (ja) * | 1986-09-30 | 1988-07-29 | Canon Inc | 情報処理装置 |
| WO2019240889A1 (en) * | 2018-06-13 | 2019-12-19 | Qualcomm Incorporated | Iii-v based variable capacitor |
| US10615294B2 (en) | 2018-06-13 | 2020-04-07 | Qualcomm Incorporated | Variable capacitor |
| CN112313803A (zh) * | 2018-06-13 | 2021-02-02 | 高通股份有限公司 | 基于iii-v的可变电容器 |
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