JPS6047495A - セラミツク配線基板 - Google Patents
セラミツク配線基板Info
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は、セラミック配線基板の配線部貫通孔部に発生
する微小亀裂を防止したセラミック配線基板に関する。
する微小亀裂を防止したセラミック配線基板に関する。
ICチップ用のキャリア、電子計算機2通信機器、家電
品等に使用される配線基板は、ますます小型化高密度化
の傾向にある。
品等に使用される配線基板は、ますます小型化高密度化
の傾向にある。
この配線基板としては、高密度な配線が可能でおること
、及び信頼性が高い等の理由によって、アルミナを主成
分とするセラミック基板上にW。
、及び信頼性が高い等の理由によって、アルミナを主成
分とするセラミック基板上にW。
Mo等の金属材料で配線を施した、多層形のセラミック
配線基板が使用される。
配線基板が使用される。
配線の微細化に伴ない、現在では、配線ライン幅が10
0μm以下になルつつある。
0μm以下になルつつある。
このような配線の微細化に伴ない、多層基板の上下配線
層間の接続をとるための貫通孔の間隔も、従来に比べて
急速に狭まってきている。
層間の接続をとるための貫通孔の間隔も、従来に比べて
急速に狭まってきている。
特に電子計算機等に用いられるセラミック配線基板にお
いては、基板表面に現われる貫通孔部が、ICチップを
接続するための端子として使われるので、その端子の数
の増加に伴ない、貫通孔の間隔が300μm以下になシ
つつある。
いては、基板表面に現われる貫通孔部が、ICチップを
接続するための端子として使われるので、その端子の数
の増加に伴ない、貫通孔の間隔が300μm以下になシ
つつある。
このように貫通孔部の間隔がますます狭くなるにつれて
、次のような新らたな問題が発生してきた。
、次のような新らたな問題が発生してきた。
即ち第1図に示すように、貫通孔4に配線導体2が充填
された状態において、セラミック配線10表面(貫通孔
4の周シ)に、微細なりラック3が発生するようになっ
てきた。
された状態において、セラミック配線10表面(貫通孔
4の周シ)に、微細なりラック3が発生するようになっ
てきた。
このクラック乙の発生け、セラミック配線基板の配線の
断線や、めっき工程において、クラック内にめっき液が
侵入してショートラ起す原因となる。従ってセラミック
配線基板としては、このようなりラックの発生は許され
ない。
断線や、めっき工程において、クラック内にめっき液が
侵入してショートラ起す原因となる。従ってセラミック
配線基板としては、このようなりラックの発生は許され
ない。
このクラックの発生は、第2図に示すように、セラミッ
クの熱膨張率(曲線6)の方が導体の熱膨張率(曲線5
)よシも大きく、この両者間の熱膨張の差によって起る
ものである。
クの熱膨張率(曲線6)の方が導体の熱膨張率(曲線5
)よシも大きく、この両者間の熱膨張の差によって起る
ものである。
即ちセラミック基板は、第4図に示すように、グリーン
シートに貫通孔を加工して、その貫通孔に導体全充填し
て積層し、これ′lc熱間圧着した後焼成して一体化し
、冷却される。
シートに貫通孔を加工して、その貫通孔に導体全充填し
て積層し、これ′lc熱間圧着した後焼成して一体化し
、冷却される。
この冷却過程において、セラミック部と導体金属部との
間の熱収縮差によって内部応力が発生し、この内部応力
がセラミックの許容応力よりも大きくなった場合にクラ
ックが発生することになる。
間の熱収縮差によって内部応力が発生し、この内部応力
がセラミックの許容応力よりも大きくなった場合にクラ
ックが発生することになる。
従って、セラミックと導体金属の一体化によって形成さ
れているセラミック配線基板にあっては、上記の応力発
生を皆無にすることは不可能でsb、セラミック配線基
板の小型化と配線の微細化高密度化に対し大きな障壁と
なっているのが実情である。
れているセラミック配線基板にあっては、上記の応力発
生を皆無にすることは不可能でsb、セラミック配線基
板の小型化と配線の微細化高密度化に対し大きな障壁と
なっているのが実情である。
本発明は、上記実情に鑑みなされたものであり、微小セ
ラミックが発生しないセラミック配線基板を提供せんと
するものである。
ラミックが発生しないセラミック配線基板を提供せんと
するものである。
即ち本発明は、セラミック配線基板の貫通孔よシも小さ
な貫通孔を有する絶縁層をセラミック配線基板の両面に
形成し、貫通孔部に充填した導体ペーストの縦断面形状
が、セラミック配線基板の表層部でくびれさせ、セラミ
ック配線基板の表面において、貫通孔の間隔を実質上大
きくしたことを特徴とするものである。
な貫通孔を有する絶縁層をセラミック配線基板の両面に
形成し、貫通孔部に充填した導体ペーストの縦断面形状
が、セラミック配線基板の表層部でくびれさせ、セラミ
ック配線基板の表面において、貫通孔の間隔を実質上大
きくしたことを特徴とするものである。
以下本発明の一実施例について詳細に説明する。
先ず発明者等は、この問題を解決するために、次の通シ
考察を試みた。
考察を試みた。
即ち、上述した通シ、セラミック配線基板の応力発生は
避けられない事実を踏まえて、セラミックに発生する応
力を軽減する方向に目を向け、貫通孔の直径と貫通孔の
ピッチ間隔及び、セラミック(絶縁層)の厚さの観点よ
シ考察した。
避けられない事実を踏まえて、セラミックに発生する応
力を軽減する方向に目を向け、貫通孔の直径と貫通孔の
ピッチ間隔及び、セラミック(絶縁層)の厚さの観点よ
シ考察した。
これを有限要素法による応力解析によってめたところ、
貫通孔の直径と貫通孔のピッチとセラミックの応力との
間には、第6図に示す関係のあることが判明した。
貫通孔の直径と貫通孔のピッチとセラミックの応力との
間には、第6図に示す関係のあることが判明した。
図において、貫通孔ピッチが同じ場合には、貫通孔の直
径が小さいほど、発生応力は小さくなる怪とが判る。又
この効果は、絶縁層の厚さく貫通孔の深さ)が0.01
mg以上あれば、応力低減の効果が得られる。
径が小さいほど、発生応力は小さくなる怪とが判る。又
この効果は、絶縁層の厚さく貫通孔の深さ)が0.01
mg以上あれば、応力低減の効果が得られる。
以下実験をもって、上記解析の可否を試みることとする
。
。
(グリーンシートについて)
粒子径数μ以下のAt* Os 、 S i 02 、
MgOの粉末を重量百分率にしてそれぞれ、95’4
.5.2%、1.8%になるように秤量し、これに有機
バインダとしてポリビニルブチラールを、上記混合粉末
の全重量に対してa5%加え、更に溶剤としてアゼオド
ロープを同様の重量比で45チ加える。
MgOの粉末を重量百分率にしてそれぞれ、95’4
.5.2%、1.8%になるように秤量し、これに有機
バインダとしてポリビニルブチラールを、上記混合粉末
の全重量に対してa5%加え、更に溶剤としてアゼオド
ロープを同様の重量比で45チ加える。
これをボールミルにて充分混合し、セラミック粉末を均
一に分散させたスラリーを作る。次にこのスラリーに数
滴の消泡剤を加え、攪拌しながら低圧で脱気し、スラリ
ー内の気泡を除去する。このスラリーを、ドクタープレ
イド型キャステイン〜グ装置を用いて薄板化し、グリー
ンシートを得る。
一に分散させたスラリーを作る。次にこのスラリーに数
滴の消泡剤を加え、攪拌しながら低圧で脱気し、スラリ
ー内の気泡を除去する。このスラリーを、ドクタープレ
イド型キャステイン〜グ装置を用いて薄板化し、グリー
ンシートを得る。
本実施例では、厚さ0.25m1と0.1朋の2種類の
グリーンシートを作製した。
グリーンシートを作製した。
(導体材料について)
0.5μmのW粉末と五〇μmのW粉末を重量比で3ニ
アの割合に混合したW粉末材料と、ペースト用有機バイ
ンダとしてのエチルセルロースと、有機溶剤としてのジ
エチレングリコールとを、それぞれ重量百分率にして8
0’%、 2.5%、17.51t:加え、アルミナ製
の乳鉢と乳棒から成るらいかい機で6時間混合する。次
いでこの混合物を通常の6本ロールにかけて30分間混
練する。次に配線印刷用として、粘度を調整するために
ブチルカルピトールを加える。
アの割合に混合したW粉末材料と、ペースト用有機バイ
ンダとしてのエチルセルロースと、有機溶剤としてのジ
エチレングリコールとを、それぞれ重量百分率にして8
0’%、 2.5%、17.51t:加え、アルミナ製
の乳鉢と乳棒から成るらいかい機で6時間混合する。次
いでこの混合物を通常の6本ロールにかけて30分間混
練する。次に配線印刷用として、粘度を調整するために
ブチルカルピトールを加える。
(υ比較例
本実施例と比較するために、第5図に示すセラミック配
線基板を作製した。図において貫通孔4は、セラミック
配線基板の表面及び内部とも一定直径の貫通孔にしたも
のである。
線基板を作製した。図において貫通孔4は、セラミック
配線基板の表面及び内部とも一定直径の貫通孔にしたも
のである。
先ず(1)に示すようにグリーンシート7の外形を切断
して80mmの正方形にした。次に(2)に示すように
超硬製ビンを有する打板金型を用いて、直径0.151
m、間隔0.5mmにして縦横50列づつ、貫通孔4を
明けた。次に(3)に示すように、スクリーン印刷法に
よって、導体ペースト8を貫通孔4に充填すると共に、
グリーンシート7の上面に幅0.1tnynの配線パタ
ーンを形成した。次に(4)に示すように、上記の配線
層を20枚重ね合せて、100’IC,50’P/s’
の圧力で加熱圧着して積層する。このようにして積層し
たグリーンシートを、次に焼成する。
して80mmの正方形にした。次に(2)に示すように
超硬製ビンを有する打板金型を用いて、直径0.151
m、間隔0.5mmにして縦横50列づつ、貫通孔4を
明けた。次に(3)に示すように、スクリーン印刷法に
よって、導体ペースト8を貫通孔4に充填すると共に、
グリーンシート7の上面に幅0.1tnynの配線パタ
ーンを形成した。次に(4)に示すように、上記の配線
層を20枚重ね合せて、100’IC,50’P/s’
の圧力で加熱圧着して積層する。このようにして積層し
たグリーンシートを、次に焼成する。
焼成は、次のようにして行なった。先ず焼成炉は、モリ
ブデンを発熱体とする箱型電気炉を用いた。焼成条件は
、通常のセラミック配線基板゛の焼成条件と同じく、室
温から2003時で昇温し、1000℃で1時間保持後
、再び200″CAで1600”罰で昇温し、この温度
で1時間保持後冷却した。
ブデンを発熱体とする箱型電気炉を用いた。焼成条件は
、通常のセラミック配線基板゛の焼成条件と同じく、室
温から2003時で昇温し、1000℃で1時間保持後
、再び200″CAで1600”罰で昇温し、この温度
で1時間保持後冷却した。
昇温時の雰囲気ガスとしては、窒素100017時。
水素400t/時の混合ガスを、45℃に保持した水を
601入れたバブラーの中を通したものを使用した。
601入れたバブラーの中を通したものを使用した。
又冷却時には、窒素1000t/時、水素400t/時
の混合ガスを用いた。
の混合ガスを用いた。
得られたセラミック配線基板は、密度3.5y7m’。
収縮率14%であった。
(2)実施例1゜
第6図において、厚さ0.25mmのグリーンシートを
比較例1と同じように作製した。即ちグリーンシート7
を80順の正方形に成形し、これに直径0.15m+間
隔0.5朋、縦横50列の孔4を明け、この孔に導体ペ
ーストラ充填すると共に、幅0.1mmの配線パターン
を形成した。
比較例1と同じように作製した。即ちグリーンシート7
を80順の正方形に成形し、これに直径0.15m+間
隔0.5朋、縦横50列の孔4を明け、この孔に導体ペ
ーストラ充填すると共に、幅0.1mmの配線パターン
を形成した。
一方第6図(1)に示すように厚さ0.1順のグリーン
シート7′に直径0.081gの貫通孔4′を超硬ビン
金型を用いて明けた。この貫通孔4′に導体ペースト8
を充填すると共に幅0.1mmの配線パターンを同様に
形成した。次に第6図(2)に示すように、厚さ0.2
5mのグリーンシート7を20枚重ね合せ、更にその表
と裏側に、厚さ0.11111のグリーンシートを重ね
合せて、比較例と同一条件で加熱圧着後焼成した。
シート7′に直径0.081gの貫通孔4′を超硬ビン
金型を用いて明けた。この貫通孔4′に導体ペースト8
を充填すると共に幅0.1mmの配線パターンを同様に
形成した。次に第6図(2)に示すように、厚さ0.2
5mのグリーンシート7を20枚重ね合せ、更にその表
と裏側に、厚さ0.11111のグリーンシートを重ね
合せて、比較例と同一条件で加熱圧着後焼成した。
このようにして作られた実施例1と比較例のセラミック
配線基板の表面を、光学顕微鏡で観察し、クラックの発
生の有無を調べた。
配線基板の表面を、光学顕微鏡で観察し、クラックの発
生の有無を調べた。
縦横50列(2500個)の貫通孔に対し、クラックの
入った貫通孔の数をパーセントで示すと次の通シであっ
た。
入った貫通孔の数をパーセントで示すと次の通シであっ
た。
比較例のクラック発生率は45チであったが、実施例1
では、クラックの発生は、全く見られなかった。
では、クラックの発生は、全く見られなかった。
(3)実施例2゜
この実施例2は、0.1mm厚さのグリーンシートを加
熱圧着する代シに、厚さ0.25mmのグリーンシート
の片面に、厚さ0.111111.貫通孔の直径0.0
8mmのアルミナペースト層をスクリーン印刷法によっ
て形成したものである。
熱圧着する代シに、厚さ0.25mmのグリーンシート
の片面に、厚さ0.111111.貫通孔の直径0.0
8mmのアルミナペースト層をスクリーン印刷法によっ
て形成したものである。
即ち第7図(1)において、厚さQ、25mmのグリー
ンシート70片面に、厚さ0.1m11、直径α08m
の貫通孔4′のピアホールを形成するように、スクリー
ン印刷法によってアルミナペースト層9全印刷する。
ンシート70片面に、厚さ0.1m11、直径α08m
の貫通孔4′のピアホールを形成するように、スクリー
ン印刷法によってアルミナペースト層9全印刷する。
このようにして片面にアルミナペースト層を印刷したグ
リーンシート7を2枚用意し、この2枚のグリーンシー
ト70間に他のグリーンシート7を挾んで第7図(2)
のように積層し焼結する。
リーンシート7を2枚用意し、この2枚のグリーンシー
ト70間に他のグリーンシート7を挾んで第7図(2)
のように積層し焼結する。
積層に際しての加熱圧着及び焼結の条件は、比較例と同
じである。又アルミナペーストの材料は、グリーンシー
トと同じである。
じである。又アルミナペーストの材料は、グリーンシー
トと同じである。
即ち、粒子径数pm以下のAtt Os 、 S i
Ox 、 MgOの微粉末を、重量百分率にしてそれぞ
れ93%、5.2% 、 1.8 %になるように秤量
して、これにバインダートシてエチルセルロース及びポ
リビニルブチラール、更に高沸点有機溶剤を加えて混練
しアルミナペーストとしたものである。
Ox 、 MgOの微粉末を、重量百分率にしてそれぞ
れ93%、5.2% 、 1.8 %になるように秤量
して、これにバインダートシてエチルセルロース及びポ
リビニルブチラール、更に高沸点有機溶剤を加えて混練
しアルミナペーストとしたものである。
この第2実施例において、その表面を光学顕微鏡で観察
した結果、クラックの発生は、全く見られなかった。
した結果、クラックの発生は、全く見られなかった。
(4)実施例五
第8図(1)に示すように、加熱圧着後の未焼成セラミ
ツク配線基板の両面に、実施例2と同様の方法で、第8
図(2)に示すように、アルミナペースト層9を形成し
、これを比較例と同一条件で焼成した。
ツク配線基板の両面に、実施例2と同様の方法で、第8
図(2)に示すように、アルミナペースト層9を形成し
、これを比較例と同一条件で焼成した。
この実施例乙においても、クラックの発生は、全く見ら
れなかった。
れなかった。
以上詳述した通シ、本発明のセラミック配線基板によれ
ば、セラミック配線基板の貫通孔よシも小さな貫通孔を
有する絶縁層を、セラミック配線基板の両面に形成した
ので、焼成工程後の冷却過程において、セラミック内部
に発生する応力を軽減し、セラきツク配線基板の表面に
はクラックの発生は起らない。
ば、セラミック配線基板の貫通孔よシも小さな貫通孔を
有する絶縁層を、セラミック配線基板の両面に形成した
ので、焼成工程後の冷却過程において、セラミック内部
に発生する応力を軽減し、セラきツク配線基板の表面に
はクラックの発生は起らない。
その結果、配線の微細化高密度化に対応することができ
ると共に、断線やショートの憂いはなく、信頼性が高い
セラミック配線基板にすることができた。
ると共に、断線やショートの憂いはなく、信頼性が高い
セラミック配線基板にすることができた。
又セラミック配線基板の表面に現われる貫通孔のみを小
さくシ、内部の貫通孔はそのままでおるので、配線抵抗
の増加はない。
さくシ、内部の貫通孔はそのままでおるので、配線抵抗
の増加はない。
第1図は、セラミック配線基板表面の貫通孔開シに発生
したクラックの状態を示す平面図、第2図は、セラミッ
クと導体の熱膨張率を示した線図、第6図は、発生応力
1貫孔経及びピッチとの間の関係を示した線図でおる。 第4図は、セラミック配線基板の製造工程を示すブロッ
ク図である。第5図は、貫通孔の直径をそのままにした
セラミック配線基板の比較例を示す縦断面図、第6図乃
至第8図は、本発明の実施例であυ、第6図は、小さい
直径の貫通孔を明けたグリーンシートを用いたものを、
第7図は、グリーンシートの片面にスクリーン印刷法に
よってアルミナペーストを印刷し、予めグリーンシート
表面に小さい貫通孔を形成したもの、第8図は積層した
グリーンシートの表面にスクリーン印刷法によってアル
ミナペーストを印刷して、グリーンシートの表面に小径
の貫通孔を形成したものを用いて作製したセラミック配
線基板の縦断面図でめる。 1・・・セラミック、2・・・配線導体、5・・・クラ
ック、4・・・貫通孔、4′・・・小さい径の貫通孔、
7・・・グリー:/シー)、3・・・導体ペースト、9
・・・アルミナペースト。 代理人 弁理士 秋 本 正 実 廉i−斗 メ 第3図 萌負刊径□ 第4図 第5図 第8図
したクラックの状態を示す平面図、第2図は、セラミッ
クと導体の熱膨張率を示した線図、第6図は、発生応力
1貫孔経及びピッチとの間の関係を示した線図でおる。 第4図は、セラミック配線基板の製造工程を示すブロッ
ク図である。第5図は、貫通孔の直径をそのままにした
セラミック配線基板の比較例を示す縦断面図、第6図乃
至第8図は、本発明の実施例であυ、第6図は、小さい
直径の貫通孔を明けたグリーンシートを用いたものを、
第7図は、グリーンシートの片面にスクリーン印刷法に
よってアルミナペーストを印刷し、予めグリーンシート
表面に小さい貫通孔を形成したもの、第8図は積層した
グリーンシートの表面にスクリーン印刷法によってアル
ミナペーストを印刷して、グリーンシートの表面に小径
の貫通孔を形成したものを用いて作製したセラミック配
線基板の縦断面図でめる。 1・・・セラミック、2・・・配線導体、5・・・クラ
ック、4・・・貫通孔、4′・・・小さい径の貫通孔、
7・・・グリー:/シー)、3・・・導体ペースト、9
・・・アルミナペースト。 代理人 弁理士 秋 本 正 実 廉i−斗 メ 第3図 萌負刊径□ 第4図 第5図 第8図
Claims (1)
- 配線部の貫通孔を有するセラミック配線基板において、
該セラミック配線基の貫通孔よシも小さな貫通孔を有す
る絶縁層をセラミック配線基板の両面に形成し、孔部に
充填した導体ペーストの形状がセラミック配線基板の表
層部でくびれていることを特徴とするセラミック配線基
板。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58154052A JPS6047495A (ja) | 1983-08-25 | 1983-08-25 | セラミツク配線基板 |
| DE3428259A DE3428259A1 (de) | 1983-08-25 | 1984-07-31 | Keramische vielschichtverdrahtungsplatte |
| US06/640,582 US4604496A (en) | 1983-08-25 | 1984-08-14 | Ceramic multilayer wiring board |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58154052A JPS6047495A (ja) | 1983-08-25 | 1983-08-25 | セラミツク配線基板 |
Publications (2)
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|---|---|
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| JPH025315B2 JPH025315B2 (ja) | 1990-02-01 |
Family
ID=15575857
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58154052A Granted JPS6047495A (ja) | 1983-08-25 | 1983-08-25 | セラミツク配線基板 |
Country Status (3)
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Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61172353A (ja) * | 1985-01-28 | 1986-08-04 | Nec Corp | セラミツク多層基板 |
| JPS63156393A (ja) * | 1986-12-19 | 1988-06-29 | 松下電器産業株式会社 | セラミツク多層回路基板の製造方法 |
| JPH0779079A (ja) * | 1993-09-09 | 1995-03-20 | Nec Corp | セラミック多層配線基板 |
| JPH07176865A (ja) * | 1992-05-28 | 1995-07-14 | Nikko Co | スルーホールを内包する多層セラミック配線基板 |
| JP2002216937A (ja) * | 2001-01-19 | 2002-08-02 | Citizen Watch Co Ltd | セラミックヒータの製造方法 |
| JP2007184314A (ja) * | 2005-12-30 | 2007-07-19 | Murata Mfg Co Ltd | セラミック多層基板の製造方法およびセラミック多層基板 |
Families Citing this family (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0714105B2 (ja) * | 1986-05-19 | 1995-02-15 | 日本電装株式会社 | 混成集積回路基板及びその製造方法 |
| JPS63170994A (ja) * | 1986-05-30 | 1988-07-14 | 古河電気工業株式会社 | 多層プリント配線板及びその製造方法 |
| US5212352A (en) * | 1987-07-31 | 1993-05-18 | Texas Instruments Incorporated | Self-aligned tungsten-filled via |
| US5084323A (en) * | 1989-04-07 | 1992-01-28 | Nippondenso Co., Ltd. | Ceramic multi-layer wiring substrate and process for preparation thereof |
| DE69730629T2 (de) | 1996-12-26 | 2005-02-03 | Matsushita Electric Industrial Co., Ltd., Kadoma | Leiterplatte und Elektronikkomponente |
| US6987316B2 (en) * | 2004-01-14 | 2006-01-17 | International Business Machines Corporation | Multilayer ceramic substrate with single via anchored pad and method of forming |
| RU2610302C2 (ru) * | 2015-07-07 | 2017-02-09 | Федеральное государственное бюджетное образовательное учреждение высшего профессионального образования "Марийский государственный университет" | Способ формирования межслойных переходов в многослойной металлокерамической плате |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5512756A (en) * | 1978-07-13 | 1980-01-29 | Nec Corp | Semiconductor device manufacturing method |
Family Cites Families (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3250848A (en) * | 1963-09-11 | 1966-05-10 | Rca Corp | Connections in multilayer circuits and method of making same |
| US3561110A (en) * | 1967-08-31 | 1971-02-09 | Ibm | Method of making connections and conductive paths |
| FR2296988A1 (fr) * | 1974-12-31 | 1976-07-30 | Ibm France | Perfectionnement aux procedes de fabrication d'un module de circuits multicouches en ceramique |
| JPS5328266A (en) * | 1976-08-13 | 1978-03-16 | Fujitsu Ltd | Method of producing multilayer ceramic substrate |
| JPS53147968A (en) * | 1977-05-30 | 1978-12-23 | Hitachi Ltd | Thick film circuit board |
| US4211603A (en) * | 1978-05-01 | 1980-07-08 | Tektronix, Inc. | Multilayer circuit board construction and method |
| JPS55156395A (en) * | 1979-05-24 | 1980-12-05 | Fujitsu Ltd | Method of fabricating hollow multilayer printed board |
| US4345955A (en) * | 1980-10-28 | 1982-08-24 | E. I. Du Pont De Nemours And Company | Process for manufacturing multilayer ceramic chip carrier modules |
| US4434134A (en) * | 1981-04-10 | 1984-02-28 | International Business Machines Corporation | Pinned ceramic substrate |
-
1983
- 1983-08-25 JP JP58154052A patent/JPS6047495A/ja active Granted
-
1984
- 1984-07-31 DE DE3428259A patent/DE3428259A1/de active Granted
- 1984-08-14 US US06/640,582 patent/US4604496A/en not_active Expired - Fee Related
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5512756A (en) * | 1978-07-13 | 1980-01-29 | Nec Corp | Semiconductor device manufacturing method |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61172353A (ja) * | 1985-01-28 | 1986-08-04 | Nec Corp | セラミツク多層基板 |
| JPS63156393A (ja) * | 1986-12-19 | 1988-06-29 | 松下電器産業株式会社 | セラミツク多層回路基板の製造方法 |
| JPH07176865A (ja) * | 1992-05-28 | 1995-07-14 | Nikko Co | スルーホールを内包する多層セラミック配線基板 |
| JPH0779079A (ja) * | 1993-09-09 | 1995-03-20 | Nec Corp | セラミック多層配線基板 |
| JP2002216937A (ja) * | 2001-01-19 | 2002-08-02 | Citizen Watch Co Ltd | セラミックヒータの製造方法 |
| JP2007184314A (ja) * | 2005-12-30 | 2007-07-19 | Murata Mfg Co Ltd | セラミック多層基板の製造方法およびセラミック多層基板 |
Also Published As
| Publication number | Publication date |
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| DE3428259C2 (ja) | 1987-11-19 |
| JPH025315B2 (ja) | 1990-02-01 |
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