JPS6048565A - 入出力制御方法 - Google Patents

入出力制御方法

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JPS6048565A
JPS6048565A JP15469683A JP15469683A JPS6048565A JP S6048565 A JPS6048565 A JP S6048565A JP 15469683 A JP15469683 A JP 15469683A JP 15469683 A JP15469683 A JP 15469683A JP S6048565 A JPS6048565 A JP S6048565A
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Yutaka Hiyoshi
豊 日吉
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Fujitsu Ltd
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Fujitsu Ltd
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    • GPHYSICS
    • G06COMPUTING OR CALCULATING; COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/10Program control for peripheral devices
    • G06F13/12Program control for peripheral devices using hardware independent of the central processor, e.g. channel or peripheral processor
    • G06F13/122Program control for peripheral devices using hardware independent of the central processor, e.g. channel or peripheral processor where hardware performs an I/O function other than control of data transfer

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (a)発明の技術分野 本発明は入出力制御方法に係り、特に磁気ディスク装置
と磁気テープ装置などの処理速度の異なる入出力装置を
同時に制御する入出力制御方法に関するものでる。
(b)技術の背景 情報処理システムが多様化するに伴い処理速度の異なる
入出力装置、例えば磁気ディスク装置と磁気テープ装置
とを同一の入出力制御装置で制御している。この入出力
制御装置に於ける制御方式は以下に述べる如き不都合が
あった。即ちこの入出力制御装置が磁気ディスク装置の
入出力処理を実行中に上位装置より磁気テープ装置の入
出力処理を要求された場合、前記磁気ディスク装置が突
離し制御中(磁気ディスク装置が制御装置から切り離さ
れ単独で与えられた命令を実行中の状態)例えばヘッド
の位置付は動作等の動作中の時は前記磁気テープ装置の
入出力処理を受りイ4けるが、磁気テープ装置の入出力
処理を前記制御装置が開始すると長時間該制御装置が磁
気テープ装置の処理に専有され、磁気ディスク装置の入
出力処理が停止]−する。即ち磁気ディスク装置が単独
処理を終了して回度制御装置と結合し、次の動作に移ろ
うとしても受L−+ 4=t 4−1でもらえず、タイ
ムアウトとなるためである。
第1図は磁気ディスク装置と磁気テープ装置とを同一・
の入出力制御装置を用いて構成した情報処理システムの
一例を示す。中央処理装置1からチャネル2を経て制御
装置3に例えば磁気ディスク装置5とデータ転送を行う
為、入出力命令が来る。
制御装置3は磁気ディスク装置5,6及び磁気テープ装
置7との結合状態を調べ、前記いずれの装置とも結合し
ていない時は磁気ディスク5をアダプタ4を経て選択し
結合する。制御装置3はチャネル2からの入出力命令を
解析し、磁気ディスク装置5のシリンダ番号、ヘッド番
号が目的のものと異なる場合、シーク動作(ヘッドの位
置イ」け動作)が必要となる為、突っ放し制御に入る。
この時点で磁気ディスク装置6に対する入出力命令がチ
ャネル2より制御装置3に与えられた時、制御装置3が
磁気ディスク装置6をアダプタ4を経て選択し結合して
も、制御装置3が磁気ディスク装置6の制御に専有され
る時間が短い為問題は無い。
しかし磁気テープ装置7に対する入出力命令であった場
合、制御装置3が磁気テープ装置7を選択して結合する
と、磁気ケープ装置7の動作時間が遅(制御装置が長時
間磁気テープ装置7の制御に専有される。従って磁気デ
ィスク装置5はタイムアウトとなり入出力処理が停止す
る。これば本来入出力処理を高速に実行すべき磁気ディ
スク装置にとっては大きな問題であった。
また、制御装置は入出力命令の受側Lj可能状態の時に
送出された入出力命令に対して入出力処理 ・を実行し
ていたため、入出力命令の受イ」け不可能状態の時に送
出された入出力命令にり・1しては入出力処理が実行さ
れず、ザービスの均等化が図られていなかった。
(C)発明の目的 本発明の目的は上記従来の欠点に濯め、制御装置が実行
中の各入出力装置に対する入出力処理を遅らせないよう
にするとともに、各入出力装置へのザービスの均等化を
図ることのできる入出力制御方法を提供することにある
(d)発明の構成 そして、この発明の目的は処理速度が異なるものを含む
複数の入出力装置と、これらの入出力装置を制御する入
出力制御装置と、この入出力制御装置に対して所定の入
出力装置に対する入出力処理を実行される入出力命令を
送出する中央処理装置とで構成される情報処理システム
において、前記入出力制御装置がある処理速度の入出力
装置に豐 対して入出力処理実行中であり、かつ該入出
力装置とは異なる処理速度の入出力装置対する入出力命
令が前記中央処理装置より送出された時この時点から前
記入出力処理終了までの間、前記入出力制御装置はこの
入出力命令を含むすべての入出力命令に対する受付処理
を禁止して、その旨を中央処理装置に応答するようにし
たことを特徴とする人出力制御方法を提供することによ
って達成される。
(f)発明の実施例 本発明は、一つの入出力装置に対する入出力命令を制御
装置が処理実行中である場合には、他の入出力装置の入
出力処理要求にり」してこの制御装置は中央処理装置(
ボスト)側へコン1〜ロール・ユニット・ヒシー(図中
CUBSY)スティタスで応答する。また他の入出力装
置の入出力処理要求に刻してコントロールユニットビジ
ースティタスで応答した後に、同一種類の入出力装置へ
の入出力処理要求に対してもコントロールユニノ1−ビ
ジースティタスで応答するものである。
以下、図面を参照しつつ、本発明の一実施例を詳細に説
明する。第2図は一台の磁気ディスク制御装置(DKC
)で3台の磁気ディスク(DKU・A、DKU・B、D
KU−C)と−・台の磁気テープ装置(MT)を制御す
る場合について、D KUとMTとの制御シーケンスを
説明するための図である。図面において斜線の矢印はポ
ストら各入出力装置に対する入出力命令、他の矢印は制
御装置が応答するスティタスであり、横軸は時間を表わ
す。
■まずボス(・よりDKU−Aに対する入出力命令がD
KCに送出されると、DKCはDKU・八に刻して入出
力処理を実行する(塗りつぶした部分)。その後、DK
U−Aが突き放し制御、即ちDKCがフリーの状態(空
白の部分)になる。
■次にI) K Cがフリーの状態でDKU −Bに対
する入出力命令が送出されると、D K CはDKU・
八に対して入出力処理を実行する。その後DKCは再び
フリーの状態になる。
0次にD K Cがフリーの状態でD K U −Cに
対する入出力命令が送出されると、I) K CはDK
U・Cに列して入出力処理を実行する。そのf! D 
K Cは再びフリーの状態になる。
■D K U −Bに対する入出力処理が終了するとD
KCはホストに対し、終了スティタス(図中END)を
応答する。
■そしてホス)・よりMTに対する入出力命令が送出さ
れると、この時点ではDKCはフリーの状態であるが、
DK[JとMTとはデバイスタイプ機種が異なり処理速
度が違うため、このMTに対する入出力命令は受りイリ
けず、 ■ホスト・に対し、コントロールユニットビジーを応答
する。
■その後DKU・八に対する入出力処理が終了し、ポス
トに対して終了スティタスを送出する。
■さらにポストよりDKU−Bに対する入出力命令が送
出される。この時点ではDKCはフリーの状態ではある
が、■においてDKCは一度コン1−ロール・ユニ・ノ
ド・ビジーで応答しているため、このI) K U −
Bに対する入出力命令を受け付りず■ボストに列し、コ
ンI・ロール・ユニ、1−・ビジーで応答する。
[相]DKU−Cに対する入出力処理が終了し、ポスト
に対して終了スティタスを送出する。
■さらにDKCはすべての入出力装置に対する入出力処
理が完全に終了したためMTに対する入出力命令を要求
したポストに対しコン1〜1コールユニットエンド(図
中CUEND)を応答し又、I) KUBに対する入出
力命令を要求したホストに対してもコントロールユニッ
トエンドで応答する。
■ボストに対してコントロールユニットエンドを応答し
たため■において受け付けなかったMTに対する入出力
命令がポストより再要求されMTの入出力命令をDKC
は実行する。
0ボストよりDKU−Bに対する入出力命令が再起動さ
れる。しかしこの時点で入出力処理を実行しているのば
MTであるので、D K U −Bの入出力命令はデバ
イスタイプが異なる。
■したがってDKU −Bに対する入出力命令は受け付
けられず、DKCはポストに対してコントロール・ユニ
ット・ビジーで応答する。
[相]MTの入出力処理が終了すると、ポストに対して
終了スティタスを応答する。
[相]■でコン)0−ルユニットビジーを応答したため
、DKCの入出力処理が完全に終了すればコントロール
ユニットエンドで応答する。
以上のようなシーケンスに従ってDKCはDKUとMT
に対する入出力処理を行う。ここでコントロールユニッ
トビジースティタスはポストに対して送出するものであ
って、このコマンドが送出されると、ホスト側において
DKCのビジー状態を認識できる。したがって複数のD
 K Cを備えている場合ボストの判断により別のDK
Cにより目が送出された時は、DKCはその入出力処理
が完全に終了すればコントロールユニットエントスティ
タスを送出して、ポストに対して、I) K Cの入出
力処理が完全に終了したことを知らせる。また終了ステ
ィタスは単にポストの1つの入出力装置に対する入出力
処理が終了したことを知らせるコードである。
従って、ボス(・は各々の入出力命令の実行状態を把握
でき、DKCに対して入出力命令を送出した順に入出力
処理を実行させることができる。
第3図は入出力命令がポストよりあった時に、この入出
力命令を受イ」けるがポストに対しでコン1ヘロール・
ユニット・ビジィで応答するかの判別回路の構成図であ
る。入出力命令かあるとデバイスタイプデコード回路8
によりこの入出力命令がDKUかM′Fに対するものか
をデコードする。そして起動判別回路10により入出力
命令を受付はるのかコントロール・ユニ7+−・ビジィ
で応答スるのかを判定する。入出力命令受付けの場合は
I10スティタス回路9にデバイスタイプ(DKUがM
Tか)とDKC動作中を知らせ、この入出力命令に対す
る動作を開始する。コントロール・ユニ、ト・ビジィの
場合は、コントロール・ユニット・ビジィ回路11に指
示し、さらにI10スティタス回路9とコン1〜ロール
・ユニット・エンド回路12にデバイス・タイプを知ら
せる。I10スティタス回路9は動作中のデバイスクイ
ブと異なるデバイスタイプに対する入出力命令が送出さ
れてコントロール・ユニット・ビジィを応答したことを
記憶することにより、現在DKCが実行中のデバイス・
タイプを同一タイプの入出力装置に対する入出力命令G
こ対してもコントロール・ユニット・ビジィになる様に
起動判別回路10に通知する。110スティタス回路9
においてDKCで実行中の入出力装置がなくなった時に
コン1〜ロールユニノ)・エンド回!?lにコントロー
ル・ユニット・エンドを応答する様に指示する。
(g)発明の・リノ果 以上詳細に説明したように、本発明によれば一つの入出
力装置に対する入出力命令を入出力制御装置が処理実行
中である場合には、これとデバイスタイプの異なる他の
入出力装置の入出力処理要求に対してコントロール・ユ
ニット・ビジイヲ応答させる。又、他の入出力装置の処
理要求でコントロール・ユニット・ビジィを応答した後
の実行中のデバイスタイプと同一の入出力装置への入出
力命令にもコントロール・ユニット・ビジィで応答する
ことによって、デバイスタイプの異なる他の外部記憶装
置へのナービスの均等化と実行中の入出力処理の遅れを
起こさない様にすることができる。
【図面の簡単な説明】
第1図は本発明が適用されるシステムの構成図。 第2図は入出力制御装置の入出力命令に対する制御シー
ケンスを説明するだめの図、第3図は第2図の制御シー
ケンスを実施するための判別回路である。 図面において11は中央処理装置、2はヂャネル、3は
入出力制御装置、4ばアダプタ、5,6は磁気ディスク
装置、7ば磁気テープ装置、8はデ2、イスタイプデj
−ド回路、9ばI10スティタス回路、10は起動判別
回路、11はCUBSY応答回路、12はCU E N
 D応答回路である。 芽 1 図

Claims (1)

    【特許請求の範囲】
  1. 処理速度が異なるものを含む複数の入出力装置と、これ
    らの入出力装置を制御する入出力制御装置と、この入出
    力制御装置に対して所定の入出力装置に刻する入出力処
    理を実行させる入出力命令を送出する中央処理装置とで
    構成される情報処理システムにおいて、前記入出力制御
    装置がある処理速度の入出力装置に対して入出力処理実
    行中に該入出力装置とは異なる処理速度の入出力装置に
    りjする入出力命令が前記中央処理装置より送出された
    時、この時点から前記入出力処理終了までの間、前記入
    出力制御装置はこの入出力命令を含むすべての入出力命
    令に対する受側処理を禁止して、その旨を中央処理装置
    に応答するようにしたことを特徴とする入出力制御方法
JP15469683A 1983-08-24 1983-08-24 入出力制御方法 Granted JPS6048565A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP15469683A JPS6048565A (ja) 1983-08-24 1983-08-24 入出力制御方法

Applications Claiming Priority (1)

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JP15469683A JPS6048565A (ja) 1983-08-24 1983-08-24 入出力制御方法

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Publication Number Publication Date
JPS6048565A true JPS6048565A (ja) 1985-03-16
JPS6248869B2 JPS6248869B2 (ja) 1987-10-15

Family

ID=15589942

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JP15469683A Granted JPS6048565A (ja) 1983-08-24 1983-08-24 入出力制御方法

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH03219022A (ja) * 1990-01-24 1991-09-26 Nippon Steel Corp レールの高周波誘導加熱法

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH03219022A (ja) * 1990-01-24 1991-09-26 Nippon Steel Corp レールの高周波誘導加熱法

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JPS6248869B2 (ja) 1987-10-15

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