JPS6064264A - 電流検出回路 - Google Patents
電流検出回路Info
- Publication number
- JPS6064264A JPS6064264A JP17253683A JP17253683A JPS6064264A JP S6064264 A JPS6064264 A JP S6064264A JP 17253683 A JP17253683 A JP 17253683A JP 17253683 A JP17253683 A JP 17253683A JP S6064264 A JPS6064264 A JP S6064264A
- Authority
- JP
- Japan
- Prior art keywords
- current
- transistor
- input terminal
- flowing
- mirror circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
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- 238000001514 detection method Methods 0.000 claims description 55
- 238000010586 diagram Methods 0.000 description 3
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- Measurement Of Current Or Voltage (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は電流検出回路、特にカレントミラー回路を用い
て第１の入力電流と第２の入力電流との差電流を検出す
ることのできる電流検出回路に関する。
て第１の入力電流と第２の入力電流との差電流を検出す
ることのできる電流検出回路に関する。
従来、第１の入力電流と第２の入力電流との差電流を検
出する回路として第１図に示すような電流検出回路が公
知である。
出する回路として第１図に示すような電流検出回路が公
知である。
第１図において、カレント・ミラー回路１の入力端１０
は第１の電流入力端子２へ接続され、カレント・ミラー
回路１の出力端１１は第２の電流入力端子３へ接続され
ている。出力端１１ｉ１さらに電流検出用トランジスタ
４のエミッタに接続されている。
は第１の電流入力端子２へ接続され、カレント・ミラー
回路１の出力端１１は第２の電流入力端子３へ接続され
ている。出力端１１ｉ１さらに電流検出用トランジスタ
４のエミッタに接続されている。
電流検出用トランジスタ４０ベースはバイアス電源５へ
接続され、そのコレクタは出力端子６に接続されている
。
接続され、そのコレクタは出力端子６に接続されている
。
このような構成になっているため、第１の電流入力端子
に流れる第１の入力電流はカレント・ミラー回路１の入
力端子１０に流れ、カレント・ミラー回路１の出力端１
１からは第１の電流入力端子２に流れた第１の入力電流
と等しい電流が取り出される。−万、カレント・ミラー
回路１の出力１１は第２の電流入力端子３と電流検出用
トランジスタ４のエミッタへ接続されているため、第２
の電流入力端子３に流れる第２の入力電流の万が前記第
１の入力電流よシ大きいときには両者の差電流分だけ電
流検出用トランジスタ４のコレクタへ接続された出力端
子６よシ該電流が取シ出される。ここで、バイアス電源
５は電流検出用トランジスタ４のベースへバイアス電圧
を供給するためのものである。第１の電流入力端子２に
流れる第１の入力電流の万が第２の電流入力端子３に流
れる第２の入力電流より大きい場合は、電流検出用トラ
ンジスタ４はカットオフとなシ出力端子６に電流は流れ
ない。
に流れる第１の入力電流はカレント・ミラー回路１の入
力端子１０に流れ、カレント・ミラー回路１の出力端１
１からは第１の電流入力端子２に流れた第１の入力電流
と等しい電流が取り出される。−万、カレント・ミラー
回路１の出力１１は第２の電流入力端子３と電流検出用
トランジスタ４のエミッタへ接続されているため、第２
の電流入力端子３に流れる第２の入力電流の万が前記第
１の入力電流よシ大きいときには両者の差電流分だけ電
流検出用トランジスタ４のコレクタへ接続された出力端
子６よシ該電流が取シ出される。ここで、バイアス電源
５は電流検出用トランジスタ４のベースへバイアス電圧
を供給するためのものである。第１の電流入力端子２に
流れる第１の入力電流の万が第２の電流入力端子３に流
れる第２の入力電流より大きい場合は、電流検出用トラ
ンジスタ４はカットオフとなシ出力端子６に電流は流れ
ない。
このように、第１図に示した従来の市、光検出回路は、
第２の電流入力端子３に流れる第２の入力電流の万が第
１の電流入力端子２に流れる第１の入力電流よシ大きい
場合には両者の差電流を取シ出すことができていた。
第２の電流入力端子３に流れる第２の入力電流の万が第
１の電流入力端子２に流れる第１の入力電流よシ大きい
場合には両者の差電流を取シ出すことができていた。
しかし、第１図の電流検出回路においては、バイアス電
源５が必要となる欠点があシ、寸だ、出力端子６から取
シ出すことのできる差電流は、第２の電流入力端子３に
流れる第２の入力電流の万が第１の電流入力端子２に流
れる第１の入力ｉｔ１流検高検出回路供することにある
。
源５が必要となる欠点があシ、寸だ、出力端子６から取
シ出すことのできる差電流は、第２の電流入力端子３に
流れる第２の入力電流の万が第１の電流入力端子２に流
れる第１の入力ｉｔ１流検高検出回路供することにある
。
本発明の他の目的は、−万の入力電流の万が大きい場合
でも他方の入力電流の万が大きい場合でも、それらの差
電流を検出し得る電流検出回路を提供することにある。
でも他方の入力電流の万が大きい場合でも、それらの差
電流を検出し得る電流検出回路を提供することにある。
本発明は、カレントミラー回路と二つのトランジスタと
を設け、−万のトランジスタのベースと他方のトランジ
スタのエミッタをカレントミラー回路の入力端に結合し
、他方のトランジスタのベレクタを検出出力としたこと
を特徴とする。
を設け、−万のトランジスタのベースと他方のトランジ
スタのエミッタをカレントミラー回路の入力端に結合し
、他方のトランジスタのベレクタを検出出力としたこと
を特徴とする。
以下、図面を参照して本発明の実施例を詳細に説明する
。
。
第２図は本発明の一実施例による電流検出回路を示す。
第２図において、カレントミラー回路ｊの入力端子１０
は第１の電流検出用トランジスタ４のベースへ接続され
、さらにダイオード８を介して第１の電流入力端子２と
第２の電流検出用トランジスタ７のエミッタとへ接続さ
れる。カレントミラー回路１の出力端１１は第２の電流
入力端子３へ接続されるとともにあ１の電流検出用トラ
ンジスタ４のエミッタと第２の電流検出用トランジスタ
７のベースとへ共通に接続される。第１の？ｔ】流検出
用トランジスタ４と第２の電流検出用トランジスタ７と
のコレクタは出力端子６へ共通接続されている。
は第１の電流検出用トランジスタ４のベースへ接続され
、さらにダイオード８を介して第１の電流入力端子２と
第２の電流検出用トランジスタ７のエミッタとへ接続さ
れる。カレントミラー回路１の出力端１１は第２の電流
入力端子３へ接続されるとともにあ１の電流検出用トラ
ンジスタ４のエミッタと第２の電流検出用トランジスタ
７のベースとへ共通に接続される。第１の？ｔ】流検出
用トランジスタ４と第２の電流検出用トランジスタ７と
のコレクタは出力端子６へ共通接続されている。
第２図に示した電流検出回路において、第１の電流入力
端子２は第２の電流検出用トランジスタ７のエミッタへ
接続されているとともに、ダイオード８を介して、第１
の電流検出用トランジスタ４のベースとカレントミラー
回路Ｉの入力端１゜に接続されているため、次式〇が成
立する。
端子２は第２の電流検出用トランジスタ７のエミッタへ
接続されているとともに、ダイオード８を介して、第１
の電流検出用トランジスタ４のベースとカレントミラー
回路Ｉの入力端１゜に接続されているため、次式〇が成
立する。
１、 ＝ Ｉ２ ＋１３ ・・・・ ・ −・・■ここ
で、１１：第１の電流入力端子２に流れる電Ｉ２：カレ
ントミ２−回路１の入力端 １０に流れる電流 Ｉ３：第２の電流検出用トランジスタ７に流れる電流 また、カレントミラー回路１の入力端１ｏに流れる電流
Ｉ２と等しい電流工２がカレント・ミラー回路１の出力
端１１よシ取り出されるため、次式■が成立する。
で、１１：第１の電流入力端子２に流れる電Ｉ２：カレ
ントミ２−回路１の入力端 １０に流れる電流 Ｉ３：第２の電流検出用トランジスタ７に流れる電流 また、カレントミラー回路１の入力端１ｏに流れる電流
Ｉ２と等しい電流工２がカレント・ミラー回路１の出力
端１１よシ取り出されるため、次式■が成立する。
Ｉ４＝： Ｉ２＋ Ｉ、・・ ・ ・ ・・・・ ■こ
こで、■４：第２の電流入力端子３に流れる電流 ■２：カレントーミラー回路１の出方端１１に流れる電
流 ■５：第１の電流検出用トランジスタ４に流れる電流 Ｌ＜Ｌのときには、第２の電流検出用トランジスタ７は
カット・オフとなるため、Ｉ３−０である。従って、 １１＝ Ｉ、・ ・−・ ・・ ・・・ ・−■となシ
、０式および０式より ■、＝１４−１１ ・・・・ ・・・・ ・・・ ・
−■となる。すなわち、出力端子６からは、第１の電流
検出用トランジスタ４に流れた電流であって、第２の電
流入力端子３０入力電流工４と第１の電流入力端子２０
入力電流■！の差電流が取シ出されることになる。
こで、■４：第２の電流入力端子３に流れる電流 ■２：カレントーミラー回路１の出方端１１に流れる電
流 ■５：第１の電流検出用トランジスタ４に流れる電流 Ｌ＜Ｌのときには、第２の電流検出用トランジスタ７は
カット・オフとなるため、Ｉ３−０である。従って、 １１＝ Ｉ、・ ・−・ ・・ ・・・ ・−■となシ
、０式および０式より ■、＝１４−１１ ・・・・ ・・・・ ・・・ ・
−■となる。すなわち、出力端子６からは、第１の電流
検出用トランジスタ４に流れた電流であって、第２の電
流入力端子３０入力電流工４と第１の電流入力端子２０
入力電流■！の差電流が取シ出されることになる。
逆に、Ｉ ｌ＞ Ｉ ４のときは、第１の電流検出用ト
ランジスタ４がカット・オフとなるため、■ｓ＝０であ
る。
ランジスタ４がカット・オフとなるため、■ｓ＝０であ
る。
従って、
Ｉ４＝ １２ ・・・ ・・・ −・■であシ、０式お
よび０式よシ Ｉ、 ＝ Ｉ、 −１４・・・・・・・・・・・・・・
・・ ・・■となる。すなわち、出力端子６からは第２
の電流検出用トランジスタ７に流れた電流であって、第
１の電流入力端子２０入力電流■１と第２の電流入力端
子３の入力電流■４の差電流が取シ出されることになる
。
よび０式よシ Ｉ、 ＝ Ｉ、 −１４・・・・・・・・・・・・・・
・・ ・・■となる。すなわち、出力端子６からは第２
の電流検出用トランジスタ７に流れた電流であって、第
１の電流入力端子２０入力電流■１と第２の電流入力端
子３の入力電流■４の差電流が取シ出されることになる
。
ここで、ダイオード８はカレントミラー回路１の出力端
子１工の動作点をカレントミラー回路１が正常に動作す
る範囲に保つための電圧降下回路として動作している。
子１工の動作点をカレントミラー回路１が正常に動作す
る範囲に保つための電圧降下回路として動作している。
第１および第２の電流検出用トランジスタ４，７のベー
スがカレントミラー回路１の入力端子１０および出力端
１１にそれぞれ接続されているため第１．第２の電流検
出用トランジスタ４，７がオンしているときのベース・
バイアス電流もカレント−ミラー回路１の入力端１０ま
たは出力端子１１に流れる結果、検出される差電流に誤
差を与えることとなる。しかしながら、第１および第２
の電流検出用トランジスタ４゜７のり、ｌ を約１００
以上に選べば通常は問題とならない。高精度の動作が必
要であれば、第１および第２の電流検出用トランジスタ
４，７をダーリントン接続された２ヶ以上のトランジス
タに置き換えればよい。
スがカレントミラー回路１の入力端子１０および出力端
１１にそれぞれ接続されているため第１．第２の電流検
出用トランジスタ４，７がオンしているときのベース・
バイアス電流もカレント−ミラー回路１の入力端１０ま
たは出力端子１１に流れる結果、検出される差電流に誤
差を与えることとなる。しかしながら、第１および第２
の電流検出用トランジスタ４゜７のり、ｌ を約１００
以上に選べば通常は問題とならない。高精度の動作が必
要であれば、第１および第２の電流検出用トランジスタ
４，７をダーリントン接続された２ヶ以上のトランジス
タに置き換えればよい。
以上説明したように、本発明による電流検出回路は、第
１の電流入力端子２に流れる第１の入力電流と＄２の電
流入力端子３に流れる第２の入力電流の大きさに係わら
ず両者の差電流を取υ出すことができ、しかもバイアス
電源が必要とならない利点がある。
１の電流入力端子２に流れる第１の入力電流と＄２の電
流入力端子３に流れる第２の入力電流の大きさに係わら
ず両者の差電流を取υ出すことができ、しかもバイアス
電源が必要とならない利点がある。
第３図に本発明の他の実施例を示す。第３図は第２図に
おける第１．第２の電流検出用トランジスタ４，７の導
電型が逆であるためこれらのベースとエミッタを逆に接
続したものである。すガわち、カレントミラー回路１０
入力端１０はトランジスタ４のエミッタに接続され、さ
らにダイオード８を介して第１の電流入力端子２と第２
の電流検出用トランジスタ７０ベースとへ接続されてい
る。がレントミラー回路１の出力端ＩＪは第２の電流入
力端子３へ接続されているとともに第１の電流検出用ト
ランジスタ４０ペースと第２の電流検出用トランジスタ
７のエミッタとへ共通に接続されている。第１の電流検
出用トランジスタ４と第２の電流検出用トランジスタ７
とのコレクタは出力端子６へ共通に接続されている。
おける第１．第２の電流検出用トランジスタ４，７の導
電型が逆であるためこれらのベースとエミッタを逆に接
続したものである。すガわち、カレントミラー回路１０
入力端１０はトランジスタ４のエミッタに接続され、さ
らにダイオード８を介して第１の電流入力端子２と第２
の電流検出用トランジスタ７０ベースとへ接続されてい
る。がレントミラー回路１の出力端ＩＪは第２の電流入
力端子３へ接続されているとともに第１の電流検出用ト
ランジスタ４０ペースと第２の電流検出用トランジスタ
７のエミッタとへ共通に接続されている。第１の電流検
出用トランジスタ４と第２の電流検出用トランジスタ７
とのコレクタは出力端子６へ共通に接続されている。
第３図に示した電流検出回路において、第１の電流入力
端子２は第２の電流検出用トランジスタ７のベースへ接
続されているとともに、ダイオード８を介して、第１の
Ｎ光検出用トランジスタ４のエミッタとカレントミラー
回路１の入力端１０に接続されているため、次式■が成
立する。
端子２は第２の電流検出用トランジスタ７のベースへ接
続されているとともに、ダイオード８を介して、第１の
Ｎ光検出用トランジスタ４のエミッタとカレントミラー
回路１の入力端１０に接続されているため、次式■が成
立する。
Ｉ’、 ＝ Ｐ、 ＋１′５ ・・・・・・・・・・・
・・・・・・・・・・・・・■ここで、Ｉ′、：第１の
電流入力端子２に流れる電流 １′２：カレントミラー回路１の入力端ｌＯに流れる電
流 ■′５：第５：電流検出用トランジスタ４に流れる電流 カレントミラー回路１の入力端子１０に流れる電流■′
２と等しい電流１′２がカレント・ミラー回路１の出力
端１１よシ取ル出されるため、次式■が成立する。
・・・・・・・・・・・・・■ここで、Ｉ′、：第１の
電流入力端子２に流れる電流 １′２：カレントミラー回路１の入力端ｌＯに流れる電
流 ■′５：第５：電流検出用トランジスタ４に流れる電流 カレントミラー回路１の入力端子１０に流れる電流■′
２と等しい電流１′２がカレント・ミラー回路１の出力
端１１よシ取ル出されるため、次式■が成立する。
Ｉ’、 ： １’４＋ １’３ ・・・・・・・・・・
・・・・・・・・・・・・・・■ここで、１′４：第２
の電流入力端子３に流れる電流 １′２：カレント−ミラー回路１の出力端１１に流れる
電流 ■′３：第３：電流検出用トランジスタ７に流れる電流 ｌ／１〈工′４のときには第２の電流検出用トランジス
タ７はカット・オフとなるため、■′３＝０である。
・・・・・・・・・・・・・・■ここで、１′４：第２
の電流入力端子３に流れる電流 １′２：カレント−ミラー回路１の出力端１１に流れる
電流 ■′３：第３：電流検出用トランジスタ７に流れる電流 ｌ／１〈工′４のときには第２の電流検出用トランジス
タ７はカット・オフとなるため、■′３＝０である。
従って、
１′４＝■′２ ・・・・・・ ・ ・ ・・・ ・
・・・ ・ ■となシ、■および０式より Ｉ／ ＝ １’ １１． ・・・・・・・・・・・・・
・・・・・・・・・・・ １０となる。すなわち出力端
子６からは、第１の電流検出用トランジスタ４に流れた
電流であって、第２の電流入力端子３の入力電流１′４
と第１の電流入力端子２０入力電流Ｉ′１の差電流が
取シ出されることになる。
・・・ ・ ■となシ、■および０式より Ｉ／ ＝ １’ １１． ・・・・・・・・・・・・・
・・・・・・・・・・・ １０となる。すなわち出力端
子６からは、第１の電流検出用トランジスタ４に流れた
電流であって、第２の電流入力端子３の入力電流１′４
と第１の電流入力端子２０入力電流Ｉ′１の差電流が
取シ出されることになる。
逆に、ＰＩ＞ Ｐ４のときは、第１の電流検出用トラン
ジスタ４がカット・オフとなるため■′５−０である。
ジスタ４がカット・オフとなるため■′５−０である。
従って・
■Ｉ、 ＝ ｌ／、・・・・・・・・・・・・ ・・
・・ １１となシ、■および１１式よシ ■１． ＝ ｌ／、 ｌ／４ ・・・・・・・・・・・
・・・・・・・ １２となる。すなわち、出力端子６か
らは第２の電流検出用トランジスタ７に流れた電流であ
って、第１の電流入力端子２の入力電流１／、と第２の
電流入力端子３の入力電流工′４の差電流が取シ出され
ることになる。
・・ １１となシ、■および１１式よシ ■１． ＝ ｌ／、 ｌ／４ ・・・・・・・・・・・
・・・・・・・ １２となる。すなわち、出力端子６か
らは第２の電流検出用トランジスタ７に流れた電流であ
って、第１の電流入力端子２の入力電流１／、と第２の
電流入力端子３の入力電流工′４の差電流が取シ出され
ることになる。
ダイオード８はカレントミラー回路１の出力端１１の動
作点をカレントミラー回路１が正常に動作する範囲に保
つための電圧降下回路として動作している。
作点をカレントミラー回路１が正常に動作する範囲に保
つための電圧降下回路として動作している。
以上説明したように、第３図に示した本発明による電流
検出回路によっても、第１の電流入力端子２に流れる第
１の入力電流と第２の電流入力端子３に流れる第２の入
力電流の大きさに係わらず、両者の差電流を取り出すこ
とができ、しかもバイアス電源が必要とならない利点が
ある。
検出回路によっても、第１の電流入力端子２に流れる第
１の入力電流と第２の電流入力端子３に流れる第２の入
力電流の大きさに係わらず、両者の差電流を取り出すこ
とができ、しかもバイアス電源が必要とならない利点が
ある。
なお・第２図、第３図で示したカレントミラー回路１は
周知であシ、例えば二つのＰＮＰ ）ランジスタで構成
し、それらのベース同士、エミッタ同士を共通接続し、
エミッタ共通接続点はバイアス点に接続し、そして−万
のトランジスタのコレクタはベースと共に入力端１０に
接続され、他方のトランジスタのコレクタは出力端１１
に接続される。もちろん、電源の極性、電流の流れ方向
等によって、カレントミラー回路１内のトランジスタや
トランジスタ４，７の導電型は変更できる。
周知であシ、例えば二つのＰＮＰ ）ランジスタで構成
し、それらのベース同士、エミッタ同士を共通接続し、
エミッタ共通接続点はバイアス点に接続し、そして−万
のトランジスタのコレクタはベースと共に入力端１０に
接続され、他方のトランジスタのコレクタは出力端１１
に接続される。もちろん、電源の極性、電流の流れ方向
等によって、カレントミラー回路１内のトランジスタや
トランジスタ４，７の導電型は変更できる。
第１図は従来の電流検出回路を示す回路図、第２図は本
発明の一実施例を示す回路図、第３図は本発明の他の実
施例を示す回路図である。 １・・・・・カレントミラー回路、２・・・・・第１の
電流入力端子、３・・・・・・第２の電流入力端子、４
・・・・第１の電流検出用トランジスタ、５・・・・・
バイアス電源、６・・・・出力端、７・・・・・第２の
電流検出用トランジスタ、８ ・ダイオード、１ｏ・・
・カレントミラー回路の入力端、１１・・・ カレント
ミラー回路の出力端 方１ 閃 躬２閃
発明の一実施例を示す回路図、第３図は本発明の他の実
施例を示す回路図である。 １・・・・・カレントミラー回路、２・・・・・第１の
電流入力端子、３・・・・・・第２の電流入力端子、４
・・・・第１の電流検出用トランジスタ、５・・・・・
バイアス電源、６・・・・出力端、７・・・・・第２の
電流検出用トランジスタ、８ ・ダイオード、１ｏ・・
・カレントミラー回路の入力端、１１・・・ カレント
ミラー回路の出力端 方１ 閃 躬２閃
Claims (1)
- カレントミラー回路と第１および第２のトランジスタと
を備え、上記カレントミラー回路の入力端、上記第１の
トランジスタのベースおよび上記第２のトランジスタの
エミッタを第１の電流入力端子へ結合し上記カレントミ
ラー回路の出力端上記第４のトランジスタのエミッタ、
および上記第２のトランジスタのベースを第２の電流入
力端子に結合し、上記第１および第２のトランジスタの
コレクタｆ、電流出力端子に結合したことを特徴とする
電流検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17253683A JPS6064264A (ja) | 1983-09-19 | 1983-09-19 | 電流検出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17253683A JPS6064264A (ja) | 1983-09-19 | 1983-09-19 | 電流検出回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6064264A true JPS6064264A (ja) | 1985-04-12 |
| JPH0522873B2 JPH0522873B2 (ja) | 1993-03-30 |
Family
ID=15943716
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17253683A Granted JPS6064264A (ja) | 1983-09-19 | 1983-09-19 | 電流検出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6064264A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5497465A (en) * | 1978-01-18 | 1979-08-01 | Nec Corp | Current detecting circuit |
-
1983
- 1983-09-19 JP JP17253683A patent/JPS6064264A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5497465A (en) * | 1978-01-18 | 1979-08-01 | Nec Corp | Current detecting circuit |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0522873B2 (ja) | 1993-03-30 |
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