JPS607139A - ボンデイング方法 - Google Patents

ボンデイング方法

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Publication number
JPS607139A
JPS607139A JP58114526A JP11452683A JPS607139A JP S607139 A JPS607139 A JP S607139A JP 58114526 A JP58114526 A JP 58114526A JP 11452683 A JP11452683 A JP 11452683A JP S607139 A JPS607139 A JP S607139A
Authority
JP
Japan
Prior art keywords
chip
bump
bonding
lead
bumps
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP58114526A
Other languages
English (en)
Inventor
Masanobu Horii
堀井 政信
Yutaka Makino
豊 牧野
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP58114526A priority Critical patent/JPS607139A/ja
Publication of JPS607139A publication Critical patent/JPS607139A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • H10W72/071Connecting or disconnecting
    • H10W72/072Connecting or disconnecting of bump connectors
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • H10W72/071Connecting or disconnecting
    • H10W72/072Connecting or disconnecting of bump connectors
    • H10W72/07231Techniques
    • H10W72/07236Soldering or alloying

Landscapes

  • Wire Bonding (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、半導体チップ(以下チップと称す)のボンデ
ィングバット(以下パッドと称す)と基板電極(以下リ
ードと称す)を接続するボンディング方法に関するもの
である。
従来例の構成とその問題点 従来のボンディング方法は第1図に具体例を示すように
、3i、Ge等のチ、ノブ1に素子間を接続し、外部へ
導出するだめのアルミニウム膜で形成された所望形状の
パッド2を設け、更にとの<ン2 ・ − ド2とチンプ1の表面を低温で形成されたCVDSi○
2 膜3で覆い、前記パッド2の伺近のみをウェットエ
ツチングあるいはドライエツチングにより開孔し1次い
で例えばCr、Cuから成る2層膜4を真空蒸着法によ
り被着し、パッド2の部分のみ残し他を除去する。次い
で感光性樹脂等を用いて10〜15μ77Iの高さにA
u、半田等の金属を電着せしめ、バンプ5を形成させる
。一方リード6はポリイミドを補強材としてCu箔T上
にSn又はAu メッキ層8を形成したもので、このリ
ード6の図示せざる一方の端部は他の電子回路に接続さ
れるものとする。上述のバンプ5とリード6とを熱圧着
等の方法によりボンディングしていた。
しかしながら上記のような方法では、チップ上にバンプ
を形成する工程において、バンプの形成速度が小さく、
所定の厚さのバンプを形成するのにかなりの時間を要し
、工程時間が長くなる。またチップが長時間にわたり加
熱、エツチングその他バンプ形成のための各種工程を経
ることにより、3゜ チップの性能に悪影響が及ぶという欠点を有していた。
発明の目的 本発明は上記欠点に鑑み、工程時間を短縮し。
寸たチップの性能劣化が少ないボンディング方法を提供
するものである。
発明の構成 本発明は、バンプをリード−Hの所定位置に形成し、リ
ートにのバンプブにチンツブをボンディングすることか
ら構成されており、バンプ形成工程をボンディング工程
と別ラインに設け、バンプ形成をボンディング工程と並
行して行うことにより、工程時間を短縮でき、斗た加熱
、エツチングその他バンブ形成の各種工程はリードに対
して行われるだめ、チップがボンディング工程を経るこ
とにより発生するチップの性能劣化が少ないという特有
の効果を有する。
実施例の説明 以下本発明の一実施例について、図面を参照しながら説
明する。
第2図は本発明の一実施例におけるボンディング方法の
工程順を示すものである。
(a) Si基板9上のチタン・パラジウム膜10」二
に形成されたAuバンプ11をリード12に熱圧着工具
13により熱圧着する。
(bl) Auバンプ11をリード12に転写する。
(c)Siチップ13のパッド14を上記Auバンプ1
1の上方に移送する。
(d) Si チップ13上のバント14を上記バンプ
11にボンディングする。
以上のように本実施例によれば、バンプをチ。
プ上でなくリード上に形成することにより、工程時間を
短縮でき、捷たチップの性能劣化が少ない。
発明の効果 以」二のように本発明は、バンプ材料とリード材料との
結合力よりもバンプ材料との結合力の弱い材料の上に形
成したバンプをリードに転写し、前記リードをチップに
ボンディングすることにより。
工程時間を短縮し、またチップの性能劣化を少なくする
のに有効であり、その実用的効果は犬なる6/、 − ものがある。
【図面の簡単な説明】
第1図は従来のボンディング装置の断面図、第2図(a
)〜(d)は本発明の一実施例におけるボンディング装
置の各工程における断面図である。 1.13 ・・チップ、2,14・・・・パッド、5.
11 ・ ・バンプ、6.12・・・・・IJ −ト。 代理人の氏名 弁理士 中 尾 敏 男 ほか1名第1

Claims (1)

    【特許請求の範囲】
  1. バンプ材料と基板電極材料との結合力よりもバンプ材料
    との結合力の弱い材料の」二に形成し7たバンプを基板
    電極に転写し、基板電極上の前記バンプに半導体チップ
    をボンディングするボンディング方法。
JP58114526A 1983-06-24 1983-06-24 ボンデイング方法 Pending JPS607139A (ja)

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Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01146337A (ja) * 1987-12-03 1989-06-08 Matsushita Electric Ind Co Ltd 半導体の組立方法
JPH01149569U (ja) * 1988-04-08 1989-10-17
JPH03120736A (ja) * 1989-10-03 1991-05-22 Matsushita Electric Ind Co Ltd 半導体装置
US6077725A (en) * 1992-09-03 2000-06-20 Lucent Technologies Inc Method for assembling multichip modules

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