JPS6074851A - 同期式トランスミツタ・レシ−バ制御方式 - Google Patents
同期式トランスミツタ・レシ−バ制御方式Info
- Publication number
- JPS6074851A JPS6074851A JP58180820A JP18082083A JPS6074851A JP S6074851 A JPS6074851 A JP S6074851A JP 58180820 A JP58180820 A JP 58180820A JP 18082083 A JP18082083 A JP 18082083A JP S6074851 A JPS6074851 A JP S6074851A
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- JP
- Japan
- Prior art keywords
- signal
- receiver
- modem
- mode
- synchronizing
- Prior art date
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- Pending
Links
- 230000001360 synchronised effect Effects 0.000 claims description 31
- 238000000034 method Methods 0.000 claims description 5
- 125000004122 cyclic group Chemical group 0.000 claims 1
- 230000000903 blocking effect Effects 0.000 abstract description 14
- 230000005540 biological transmission Effects 0.000 abstract description 5
- 230000000694 effects Effects 0.000 abstract 1
- 230000001105 regulatory effect Effects 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 2
- 230000001934 delay Effects 0.000 description 1
Landscapes
- Communication Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、同期式トランスミッタ・レシーバによるデー
タ通信方式に関する。
タ通信方式に関する。
同期式トランスミッタ・レシーバによるデータ通信を行
なう場合、通常、データの授受がない場合、お互に同期
信号を送出している。そして、データを送出する場合、
送出側装置が同期信号を閉塞信号に一定時間切換え、再
び同期信号に戻して相手装置側からの閉塞信号の受信待
ち状態となっている。そして、時間オーバになれば、送
出側装置は、再び閉塞信号を一定時間送出後、同期信号
に戻して相手装置からの閉塞信号受信待ちとな１以後上
記のくり返しを行なっていた。
なう場合、通常、データの授受がない場合、お互に同期
信号を送出している。そして、データを送出する場合、
送出側装置が同期信号を閉塞信号に一定時間切換え、再
び同期信号に戻して相手装置側からの閉塞信号の受信待
ち状態となっている。そして、時間オーバになれば、送
出側装置は、再び閉塞信号を一定時間送出後、同期信号
に戻して相手装置からの閉塞信号受信待ちとな１以後上
記のくり返しを行なっていた。
ところが、データ送出側のモデムおよび相手装置側のモ
デム内部のデータ遅延に合わせてデータ送出側の同期信
号／閉塞信号の送出時間幅を考慮しな−と、データ送出
側が相手装置からの閉塞信号を受信出来ない場合があっ
た。つまり、データ送出側同期式トランスミッタ赤レシ
ーバーりＩ Ｍ 塞％−ド時に、相手側から閉塞信号が
返って来た場合、送出側では閉塞信号の受信処理が出来
ないのである。
デム内部のデータ遅延に合わせてデータ送出側の同期信
号／閉塞信号の送出時間幅を考慮しな−と、データ送出
側が相手装置からの閉塞信号を受信出来ない場合があっ
た。つまり、データ送出側同期式トランスミッタ赤レシ
ーバーりＩ Ｍ 塞％−ド時に、相手側から閉塞信号が
返って来た場合、送出側では閉塞信号の受信処理が出来
ないのである。
本発明は、斯かる欠点に鑑みてなされたもので、同期式
トランスミッタ・レシーバのデータ出カッ後段にゲート
回路を設けることにより、モデム内部のデータ遅延（対
向モデムも含めて）の影響を全く受けずに同期式トラン
スミッタ・レシーバを制御し得る同期式トランスミッタ
・レシーバ制御方式を提供することを目的とする。
トランスミッタ・レシーバのデータ出カッ後段にゲート
回路を設けることにより、モデム内部のデータ遅延（対
向モデムも含めて）の影響を全く受けずに同期式トラン
スミッタ・レシーバを制御し得る同期式トランスミッタ
・レシーバ制御方式を提供することを目的とする。
上記目的を達成すべく、処理装置とモデムとに接続され
てデータ通信を行なう同期式トランスミツターレシーバ
の制御方式において、上記同期式トランスミッタ・レシ
ーバのデータ出方の後段にゲート回路を設け、該ゲート
回路の出方を上記モデムのＳ Ｄ ＋７−ドに接続し、
かつ、上記同期式トランスミッタ・レシーバを制御する
処理装置からのリセット信号線を同期式トランスミッタ
・レシーバのモード設定リードに接続すると共に、処理
装置からの閉塞モード設定信号線を上記ゲート回路に接
続して成り、上記同期式トランスミッタ・レシーバは、
処理装置からのリセット信号にょシ、動作モードが閉塞
モードとなって閉塞信号を出方し、一方、リセット信号
が解除されると、動作モードが同期モードとなって同期
信号を出方するよう構成され、上記ゲート回路は、上記
閉塞信号、同期信号及び上記処理装置がら出力される閉
塞モード設定信号をモデム、に送出するよう構成されて
成ることを特徴とする。
てデータ通信を行なう同期式トランスミツターレシーバ
の制御方式において、上記同期式トランスミッタ・レシ
ーバのデータ出方の後段にゲート回路を設け、該ゲート
回路の出方を上記モデムのＳ Ｄ ＋７−ドに接続し、
かつ、上記同期式トランスミッタ・レシーバを制御する
処理装置からのリセット信号線を同期式トランスミッタ
・レシーバのモード設定リードに接続すると共に、処理
装置からの閉塞モード設定信号線を上記ゲート回路に接
続して成り、上記同期式トランスミッタ・レシーバは、
処理装置からのリセット信号にょシ、動作モードが閉塞
モードとなって閉塞信号を出方し、一方、リセット信号
が解除されると、動作モードが同期モードとなって同期
信号を出方するよう構成され、上記ゲート回路は、上記
閉塞信号、同期信号及び上記処理装置がら出力される閉
塞モード設定信号をモデム、に送出するよう構成されて
成ることを特徴とする。
以下、本発明の実施例について図面を参照して説明する
。
。
第１図は本発明同期式−トランスミッタ魯レシーバ制御
方式の一実施例を示すブロック図である。
方式の一実施例を示すブロック図である。
図において本発明実施例は、処理装置１と、同期式トラ
ンスミッタ・レシーバ２と、ゲート回路３と、モデム４
とを備え、かつ、これらの回路を結ぶ信号線として、リ
セット信号線５と、閉塞信号受信線６と、閉塞モード設
定信号線７と、出力線８と、データ受信線９と、データ
送出線１０とを有して構成される。
ンスミッタ・レシーバ２と、ゲート回路３と、モデム４
とを備え、かつ、これらの回路を結ぶ信号線として、リ
セット信号線５と、閉塞信号受信線６と、閉塞モード設
定信号線７と、出力線８と、データ受信線９と、データ
送出線１０とを有して構成される。
次に、このように構成される実施例の動作について１ｉ
ｆｉ’、明する。
ｆｉ’、明する。
着初、処理装置１がリセット信号をリセット信号線５を
通して同期式トランスミッタ・レシーバ２の動作モード
設定リードに与えると、同期式ト→ ソ ２々１ソ Ｊ
ａ ｌノ Ｘ−ｔ ｐＺ Ｑ ｂ＋ １４４ 十虞白
Ｑ ｆ６→ ｌ イ閉塞信号（Ｈレベル信号）を送出
する。すると、その信号は、ゲート回路３を通してデー
タ送出線１０を経由してモデム４に入力され、図示しな
ｈ対向モデムに送出される。
通して同期式トランスミッタ・レシーバ２の動作モード
設定リードに与えると、同期式ト→ ソ ２々１ソ Ｊ
ａ ｌノ Ｘ−ｔ ｐＺ Ｑ ｂ＋ １４４ 十虞白
Ｑ ｆ６→ ｌ イ閉塞信号（Ｈレベル信号）を送出
する。すると、その信号は、ゲート回路３を通してデー
タ送出線１０を経由してモデム４に入力され、図示しな
ｈ対向モデムに送出される。
次に、処理装置１がリセット信号を解除すると、同期式
トランスミッタ番レシーバ２＆ｆ、ｆｉ作モードが同期
モードとなり、出方線８に対して同期信号（（７Ｅ）１
６進）を送出する。その信号は、ゲート回路３を通して
データ送出線１ｏを経由してモデム４に入力され、対向
モデムに送出される。
トランスミッタ番レシーバ２＆ｆ、ｆｉ作モードが同期
モードとなり、出方線８に対して同期信号（（７Ｅ）１
６進）を送出する。その信号は、ゲート回路３を通して
データ送出線１ｏを経由してモデム４に入力され、対向
モデムに送出される。
この様な状態で、規定タイミング以上対向モデムからの
閉塞信号を受信出来ない場合、処理装置１は、閉塞モー
ド設定信号線７に対して閉塞モード信号（Ｌレベル信号
）を送出する。その信号は、ゲート回路３で反転され、
データ送出線１ｏ経由モデム４に入力される。そして、
モデム４Ｉｒｉ、閉塞信号（Ｈレベル信号）を対向モデ
ムに送出する。
閉塞信号を受信出来ない場合、処理装置１は、閉塞モー
ド設定信号線７に対して閉塞モード信号（Ｌレベル信号
）を送出する。その信号は、ゲート回路３で反転され、
データ送出線１ｏ経由モデム４に入力される。そして、
モデム４Ｉｒｉ、閉塞信号（Ｈレベル信号）を対向モデ
ムに送出する。
１−Ａ、Ｉ １留 討８；卜 Ｌ 弓 −ノ ッ コ
１リ 書 −１−−リ −夕１ｊ べＬ作モードが同期
モードになっているので、対向モデムからの閉塞信号を
常に受信出来る状態になってｂる。
１リ 書 −１−−リ −夕１ｊ べＬ作モードが同期
モードになっているので、対向モデムからの閉塞信号を
常に受信出来る状態になってｂる。
対向モデムからの閉塞信号をモデム４が受信すれば、そ
の信号は、データ受信線９経由同期式トランスミッタ・
レシーバ２に入力される。そして同期式トランスミッタ
Φレシーバ２は、閉塞信号全受信したことを閉塞信号受
信線６を通して処理装置１に知らせる。
の信号は、データ受信線９経由同期式トランスミッタ・
レシーバ２に入力される。そして同期式トランスミッタ
Φレシーバ２は、閉塞信号全受信したことを閉塞信号受
信線６を通して処理装置１に知らせる。
以上説明したように本発明は、同期式トランスミッタ・
レシーバのデータ出力の後段にゲート回路を設ける構成
としたことによ如、対向モデムをも含めてモデム内部の
データ遅延の影響を全く受けずに同期式トランスミッタ
・レシーバを制ｍし得る効果がある。
レシーバのデータ出力の後段にゲート回路を設ける構成
としたことによ如、対向モデムをも含めてモデム内部の
データ遅延の影響を全く受けずに同期式トランスミッタ
・レシーバを制ｍし得る効果がある。
第１図は本発明同期式トランスミッタ・レシーバ制御方
式の一実施例を示すブロック図である。 １・・・処理装置 ２・・・同期式）ランスミッタ・レシーバ３・・・ゲー
ト回路 ４・・・モデム ５・・・リセット信号線 ６・・・閉塞信号受信線７・
・・閉塞モード設定信号線 ８・・・出力線９・・・デ
ータ受信線 １ｏ・・・データ送出線出願人 日本電気
株式会社
式の一実施例を示すブロック図である。 １・・・処理装置 ２・・・同期式）ランスミッタ・レシーバ３・・・ゲー
ト回路 ４・・・モデム ５・・・リセット信号線 ６・・・閉塞信号受信線７・
・・閉塞モード設定信号線 ８・・・出力線９・・・デ
ータ受信線 １ｏ・・・データ送出線出願人 日本電気
株式会社
Claims (1)
- 【特許請求の範囲】 処理装置とモデムとに接続されてデータ通信を行々つ回
期式トランスミッタ・レシーバの制御方式において、 上記同期式トランスミッタ・レシーバのデータ出力の後
段にゲート回路を設け、該ゲート回路の出力を上記モデ
ムのＳＤリードに接続し、かつ、上記同期式トランスミ
ッタ・レシーバを制御する処理装置からのリセット信号
線を同期式トランスミッタ・レシーバのモード設定リー
ドに接続すると共に、処理装置からの閉塞モード設定信
号線を上記ゲート回路に接続して成シ、 上記同期式トランスミッタ・レシーバは、処理装置から
のリセット信号によシ、動作モードが閉塞モードとなっ
て閉塞信号を出力し、一方、リセット信号が解除される
と、動作モードが同期モードとなって同期信号を出力す
るよう構成され、上記ゲート回路は、上記閉塞信号、同
期信号及び上記処理装置から出力される閉塞モード設定
信号をモデムに送出するよう構成されて成ることを特徴
とする同期式トランスミッタ・レシーバ制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58180820A JPS6074851A (ja) | 1983-09-30 | 1983-09-30 | 同期式トランスミツタ・レシ−バ制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58180820A JPS6074851A (ja) | 1983-09-30 | 1983-09-30 | 同期式トランスミツタ・レシ−バ制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6074851A true JPS6074851A (ja) | 1985-04-27 |
Family
ID=16089926
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58180820A Pending JPS6074851A (ja) | 1983-09-30 | 1983-09-30 | 同期式トランスミツタ・レシ−バ制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6074851A (ja) |
-
1983
- 1983-09-30 JP JP58180820A patent/JPS6074851A/ja active Pending
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