JPS6091706A - 増幅回路 - Google Patents
増幅回路Info
- Publication number
- JPS6091706A JPS6091706A JP58200478A JP20047883A JPS6091706A JP S6091706 A JPS6091706 A JP S6091706A JP 58200478 A JP58200478 A JP 58200478A JP 20047883 A JP20047883 A JP 20047883A JP S6091706 A JPS6091706 A JP S6091706A
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- bias
- differential amplifier
- buffer circuit
- amplifier
- Prior art date
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- Granted
Links
- 230000008878 coupling Effects 0.000 abstract description 6
- 238000010168 coupling process Methods 0.000 abstract description 6
- 238000005859 coupling reaction Methods 0.000 abstract description 6
- 230000000087 stabilizing effect Effects 0.000 abstract description 2
- 239000003990 capacitor Substances 0.000 description 7
- 239000004065 semiconductor Substances 0.000 description 3
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 238000009434 installation Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03G—CONTROL OF AMPLIFICATION
- H03G5/00—Tone control or bandwidth control in amplifiers
- H03G5/02—Manually-operated control
- H03G5/025—Equalizers; Volume or gain control in limited frequency bands
Landscapes
- Tone Control, Compression And Expansion, Limiting Amplitude (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は増幅回路に係り、特にグラフインクイコライ
ザ等として用いられる周波数特性可変増幅回路のバイア
ス回路の改良に関する。
ザ等として用いられる周波数特性可変増幅回路のバイア
ス回路の改良に関する。
第１図は従来の周波数特性可変増幅回路を示している。
この増幅回路には、入力端子２に加えられる信号に所望
の周波数特性を付与するための複数のフィルタ回路４１
．４２ ・・・４Ｎが設置され、各フィルタ回路４＋、
４２ ・・・４Ｎには入力端子２から抵抗３を介して入
力信号が与えられ、フィルタ回路４１．４２ ・・・４
Ｎによって所望の周波数特性を付与された信号は、コン
デンサ６を介して差動増幅器８の非反転入力端子（＋）
に与えられている。
の周波数特性を付与するための複数のフィルタ回路４１
．４２ ・・・４Ｎが設置され、各フィルタ回路４＋、
４２ ・・・４Ｎには入力端子２から抵抗３を介して入
力信号が与えられ、フィルタ回路４１．４２ ・・・４
Ｎによって所望の周波数特性を付与された信号は、コン
デンサ６を介して差動増幅器８の非反転入力端子（＋）
に与えられている。
各フィルタ回路４＋、４ｚ ・・・４Ｎは、個別に可変
抵抗１０、半導体インダクタ１２及び定電流源１４で構
成され、半導体インダクタ１２はトランジスタ１６、抵
抗１８．２０及びコンデンサ２２．２４で構成され、可
変抵抗１０の調整によって所望の周波数特性を信号に付
与可能に構成されている。
抵抗１０、半導体インダクタ１２及び定電流源１４で構
成され、半導体インダクタ１２はトランジスタ１６、抵
抗１８．２０及びコンデンサ２２．２４で構成され、可
変抵抗１０の調整によって所望の周波数特性を信号に付
与可能に構成されている。
そして、差動増幅器８の非反転入力端子（＋）には、前
記信号入力とともに、バイアス回路２６から一定の直流
バイアスが付与されている。このバイアス回路２６は抵
抗２８．３０．３２から構成され、電源端子３４と基準
電位点端子（ＧＮＤ）３６に印加される電圧Ｖｃｃを抵
抗２８．３０で分圧して得た値を抵抗３２を介してバイ
アス入力としている。
記信号入力とともに、バイアス回路２６から一定の直流
バイアスが付与されている。このバイアス回路２６は抵
抗２８．３０．３２から構成され、電源端子３４と基準
電位点端子（ＧＮＤ）３６に印加される電圧Ｖｃｃを抵
抗２８．３０で分圧して得た値を抵抗３２を介してバイ
アス入力としている。
また、差動増幅器８の反転入力端子（−）と出力点との
間には、帰還素子３８が接続され、差動増幅器８は帰還
増幅器を構成し、その出力は出力端子４０から取出すこ
とができる。
間には、帰還素子３８が接続され、差動増幅器８は帰還
増幅器を構成し、その出力は出力端子４０から取出すこ
とができる。
このような増幅回路では、複数のフィルタ回路４＋、４
２ ・・・４Ｎの設置によって、その入力インピーダン
スが信号周波数により変化して不安定である。
２ ・・・４Ｎの設置によって、その入力インピーダン
スが信号周波数により変化して不安定である。
そこで、第２図に示すように、前記増幅回路の入力部に
バッファ回路４２を設置するとともに、このバッファ回
路４２に独自のバイアス回路４４から一定のバイアスを
与えるようにしたものが提案された。バッファ回路４２
はトランジスタ４６及び抵抗４８で構成され、また、バ
イアス回路４４は前記バイアス回路２６と同様に抵抗５
０．５２．５４で構成されている。そして、バッファ回
路４２を通過した入力信号は、コンデンサ５６及び抵抗
３を介して各フィルタ回路４Ｉ、４２ ・・・４Ｎに与
えられる。
バッファ回路４２を設置するとともに、このバッファ回
路４２に独自のバイアス回路４４から一定のバイアスを
与えるようにしたものが提案された。バッファ回路４２
はトランジスタ４６及び抵抗４８で構成され、また、バ
イアス回路４４は前記バイアス回路２６と同様に抵抗５
０．５２．５４で構成されている。そして、バッファ回
路４２を通過した入力信号は、コンデンサ５６及び抵抗
３を介して各フィルタ回路４Ｉ、４２ ・・・４Ｎに与
えられる。
しかしながら、この増幅回路では２個の結合コンデンサ
５６．６を必要とし、全回路を半導体集積回路で構成す
る場合、外部接続する部品点数を増加させ、且つその端
子を必要としている。また、バッファ回路４２にバイア
ス回路４４、差動増幅器８にバイアス回路２６を個別に
設置することは、回路構成の複雑化とともに、半導体集
積回路化する上でチップ面積を拡大する原因になる。
５６．６を必要とし、全回路を半導体集積回路で構成す
る場合、外部接続する部品点数を増加させ、且つその端
子を必要としている。また、バッファ回路４２にバイア
ス回路４４、差動増幅器８にバイアス回路２６を個別に
設置することは、回路構成の複雑化とともに、半導体集
積回路化する上でチップ面積を拡大する原因になる。
この発明は、入力インピーダンスの安定化とともに、結
合用コンデンサを除いて回路構成の簡略化を図った増幅
回路の提供を目的とする。
合用コンデンサを除いて回路構成の簡略化を図った増幅
回路の提供を目的とする。
この発明は、信号人力部にバッファ回路とともにバイア
ス回路を設置し、前記バッファ回路の出力側に１又は２
以上のフィルタ回路を設置するとともに、周波数特性を
付与した信号を増幅する増幅器を直結し、この増幅器に
前記バイアス回路からバイアスを付与するようにしたこ
とを特徴とする。
ス回路を設置し、前記バッファ回路の出力側に１又は２
以上のフィルタ回路を設置するとともに、周波数特性を
付与した信号を増幅する増幅器を直結し、この増幅器に
前記バイアス回路からバイアスを付与するようにしたこ
とを特徴とする。
以下、この発明を図面に示した実施例を参照して詳細に
説明する。
説明する。
第３図はこの発明の増幅回路の実施例を示し、第２図と
同一部分には同一符号を付しである。
同一部分には同一符号を付しである。
図において、信号入力部に設置したへソファ回路４２の
出力部に、差動増幅器８の非反転入力端子（＋）を従来
の結合コンデンサを除いて直結し、バッファ回路４２に
設置したバイアス回路４４からバイアスがバッファ回路
４２を介して差動増幅器８に与えられている。
出力部に、差動増幅器８の非反転入力端子（＋）を従来
の結合コンデンサを除いて直結し、バッファ回路４２に
設置したバイアス回路４４からバイアスがバッファ回路
４２を介して差動増幅器８に与えられている。
この実施例のバイアス回路４４は、抵抗５０．５２．５
４及びダイオード６０，６２で構成されている。
４及びダイオード６０，６２で構成されている。
このような構成において、電源電圧をＶｃｃ、ダイオー
ド６０．６２の順方向降下電圧をそれぞれｖＦ、トラン
ジスタ４６のベース・エミッタ間電圧ＶＢＥをＶＦとす
ると、差動増幅器８の非反転入力端子（＋）のバイアス
電圧Ｖｅは、Ｖｓ ＝ （（Ｖｃｃ−２Ｖｐ ）／２＋
２Ｖｐ ）ＶＦ ＝ Ｖ ｃｃ／ ２ で与えられる。
ド６０．６２の順方向降下電圧をそれぞれｖＦ、トラン
ジスタ４６のベース・エミッタ間電圧ＶＢＥをＶＦとす
ると、差動増幅器８の非反転入力端子（＋）のバイアス
電圧Ｖｅは、Ｖｓ ＝ （（Ｖｃｃ−２Ｖｐ ）／２＋
２Ｖｐ ）ＶＦ ＝ Ｖ ｃｃ／ ２ で与えられる。
このような構成によれば、信号入力部に設置したバッフ
ァ回路４２は交流的には通常のバッファ回路として機能
するが、差動増幅器８の直結によって、直流的には差動
増幅器８に対する安定化バイアス回路として機能する。
ァ回路４２は交流的には通常のバッファ回路として機能
するが、差動増幅器８の直結によって、直流的には差動
増幅器８に対する安定化バイアス回路として機能する。
従って、入力インピーダンスを高く設定し、しかもそれ
を安定化することができ、さらに、差動増幅器８にバッ
ファ回路４２から安定したバイアスを供給することがで
きるとともに、単一のバイアス回路４４から所定のバイ
アスをバッファ回路４２及び差動増幅器８に供給するこ
とができ、バイアス回路系統の構成の簡略化を図ること
ができる。
を安定化することができ、さらに、差動増幅器８にバッ
ファ回路４２から安定したバイアスを供給することがで
きるとともに、単一のバイアス回路４４から所定のバイ
アスをバッファ回路４２及び差動増幅器８に供給するこ
とができ、バイアス回路系統の構成の簡略化を図ること
ができる。
特に、差動増幅器８に対してへソファ回路４２をバイア
ス源としているため、フィルタ回路４Ｉ、４２ ・・・
４Ｎによるバイアスの不安定化を大幅に改善できる。
ス源としているため、フィルタ回路４Ｉ、４２ ・・・
４Ｎによるバイアスの不安定化を大幅に改善できる。
また、差動増幅器８の直結で結合コンデンサが不要にな
り、半導体集積回路で構成する場合、外部接続する部品
の省略とともに、その接続のための端子を削減できる。
り、半導体集積回路で構成する場合、外部接続する部品
の省略とともに、その接続のための端子を削減できる。
なお、実施例では２以上のフィルタ回路を設置した場合
について説明したが、この発明は単一のフィルタ回路を
設置した場合でも同様の効果が期待できる。
について説明したが、この発明は単一のフィルタ回路を
設置した場合でも同様の効果が期待できる。
以上説明したようにこの発明によれば、バイアス回路の
削減、結合コンデンサの削減により回路構成の簡略化と
ともに、入力インピーダンスを高くでき、増幅器に対す
るバイアス入力の安定化を図ることができ、安定した周
波数特性の可変ができる。
削減、結合コンデンサの削減により回路構成の簡略化と
ともに、入力インピーダンスを高くでき、増幅器に対す
るバイアス入力の安定化を図ることができ、安定した周
波数特性の可変ができる。
第１図及び第２図は従来の周波数特性可変増幅回路を示
す回路図、第３図はこの発明の増幅回路の実施例を示す
回路図である。 ８・・・差動増幅器、４１．４２ ・・・４Ｎ・・・フ
ィルタ回路、４２・・・バッファ回路、４４・・・バイ
アス回路。
す回路図、第３図はこの発明の増幅回路の実施例を示す
回路図である。 ８・・・差動増幅器、４１．４２ ・・・４Ｎ・・・フ
ィルタ回路、４２・・・バッファ回路、４４・・・バイ
アス回路。
Claims (1)
- 信号入力部にバッファ回路とともにバイアス回路を設置
し、前記バッファ回路の出力側に１又は２以上のフィル
タ回路を設置するとともに、周波数特性を付与した信号
を増幅する増幅器を直結し、この増幅器に前記バイアス
回路からバイアスを付与するようにしたことを特徴とす
る増幅回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58200478A JPS6091706A (ja) | 1983-10-25 | 1983-10-25 | 増幅回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58200478A JPS6091706A (ja) | 1983-10-25 | 1983-10-25 | 増幅回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6091706A true JPS6091706A (ja) | 1985-05-23 |
| JPH0519324B2 JPH0519324B2 (ja) | 1993-03-16 |
Family
ID=16424978
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58200478A Granted JPS6091706A (ja) | 1983-10-25 | 1983-10-25 | 増幅回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6091706A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58516U (ja) * | 1981-06-25 | 1983-01-05 | 日本ビクター株式会社 | グラフイツク・イコライザ回路 |
-
1983
- 1983-10-25 JP JP58200478A patent/JPS6091706A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58516U (ja) * | 1981-06-25 | 1983-01-05 | 日本ビクター株式会社 | グラフイツク・イコライザ回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0519324B2 (ja) | 1993-03-16 |
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