JPS6113354A - 分散情報キヤツシユ制御方式 - Google Patents
分散情報キヤツシユ制御方式Info
- Publication number
- JPS6113354A JPS6113354A JP59133701A JP13370184A JPS6113354A JP S6113354 A JPS6113354 A JP S6113354A JP 59133701 A JP59133701 A JP 59133701A JP 13370184 A JP13370184 A JP 13370184A JP S6113354 A JPS6113354 A JP S6113354A
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- JP
- Japan
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- information
- cache memory
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- Pending
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- 238000000034 method Methods 0.000 claims description 5
- 230000004044 response Effects 0.000 claims description 2
- 150000003839 salts Chemical class 0.000 description 3
- 238000010586 diagram Methods 0.000 description 2
- 230000010365 information processing Effects 0.000 description 2
- 230000007423 decrease Effects 0.000 description 1
- 238000010926 purge Methods 0.000 description 1
Landscapes
- Memory System Of A Hierarchy Structure (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(発明の属する技術分野)
本発明はコンピュータとワークステーションと間の分散
情報管理に関するもので、特に情報キャッシュ制御方式
に関する。
情報管理に関するもので、特に情報キャッシュ制御方式
に関する。
(従来技術)
パーソナルコンピュータ、インテリジェント端末、およ
びワードプロセッサ等のパーソナルワークステーション
の高機能および高性能化にともないこれらをネットワー
クを介して汎用コンピュータ、またはミニコンピユータ
と結合し分散情報管理システムが構等されている。ワー
クステーションで処理された情報はネットワークを介し
てコンピュータに管理され、必要に応じてワークステー
ションにおいて参照または再処理される。またコンピュ
ータで処理され管理されている情報はネットワークを介
してワークステーションに取りだされ処理される。この
ようなシステムでは、コンピュータのディスクファイル
等に管理されている情報をアクセスするとき情報量が大
きくなる程、またアクセス頻度が多くなる程、通信時間
および集中トラフィック制御のために情報のアクセス性
能が低下する要因となっている。
びワードプロセッサ等のパーソナルワークステーション
の高機能および高性能化にともないこれらをネットワー
クを介して汎用コンピュータ、またはミニコンピユータ
と結合し分散情報管理システムが構等されている。ワー
クステーションで処理された情報はネットワークを介し
てコンピュータに管理され、必要に応じてワークステー
ションにおいて参照または再処理される。またコンピュ
ータで処理され管理されている情報はネットワークを介
してワークステーションに取りだされ処理される。この
ようなシステムでは、コンピュータのディスクファイル
等に管理されている情報をアクセスするとき情報量が大
きくなる程、またアクセス頻度が多くなる程、通信時間
および集中トラフィック制御のために情報のアクセス性
能が低下する要因となっている。
(′@明の目的)
本発明の目的は、上述の欠点を除去した分散情報キャッ
シュ制御方式を提供することにある。
シュ制御方式を提供することにある。
(発明の構成)
−本発明の制御方式は、コンピュータのディスクファイ
ル等に格納管理された情報の写しを記憶するワークステ
ージ目ン内のキャッシュメモリを有する分散情報キャッ
シュの制御方式において、ワークスチーシーI/からの
情報読み要求に応答L テv+ 記コンピュータシステ
ムに格納された情報の写しが前記キャッシュメモリに存
在するか否かを判別する判別手段と、 この判別手段で前記キャッシュメモリに前記情報が存在
しないと判別されたときに前記コンピュータシステムの
情報をキャッシュメモリに読み込みワークステーション
に提供する手段とを含むことを特徴とする。
ル等に格納管理された情報の写しを記憶するワークステ
ージ目ン内のキャッシュメモリを有する分散情報キャッ
シュの制御方式において、ワークスチーシーI/からの
情報読み要求に応答L テv+ 記コンピュータシステ
ムに格納された情報の写しが前記キャッシュメモリに存
在するか否かを判別する判別手段と、 この判別手段で前記キャッシュメモリに前記情報が存在
しないと判別されたときに前記コンピュータシステムの
情報をキャッシュメモリに読み込みワークステーション
に提供する手段とを含むことを特徴とする。
(発明の実施例)
次に本発明について図面を参照して詳細に説明する。本
発明の分散情報キャッジSi置を含む第1図に示す分散
情報処理システムは、ディスク装置数等情報格納装置を
含むコンピュータシステム1000とネットワークとを
介して接続されたワークステージヨシ2000および分
散情報キャツシエ装[3000で構成されている。
発明の分散情報キャッジSi置を含む第1図に示す分散
情報処理システムは、ディスク装置数等情報格納装置を
含むコンピュータシステム1000とネットワークとを
介して接続されたワークステージヨシ2000および分
散情報キャツシエ装[3000で構成されている。
分散情報キャッシュ装置3000にはキャッシュ−制御
装置100およびキャッシュメモリ200を有しており
、キャッシュメモリ200にはコンピュータシステム1
000に格納されている情報の一部が記憶されている。
装置100およびキャッシュメモリ200を有しており
、キャッシュメモリ200にはコンピュータシステム1
000に格納されている情報の一部が記憶されている。
キャッシュ制御装置100はワークスチーシー:/20
00から出力される情報読みだし指令を解読し、アクセ
スされた情報がキャッシュメモリ200に存在するか否
かを誠べる。
00から出力される情報読みだし指令を解読し、アクセ
スされた情報がキャッシュメモリ200に存在するか否
かを誠べる。
存在すれは制御装置100はキャッシュメモリ200に
対して必要な情報をアクセスする。もしアクセスされた
情報がキャッシュメモリに存在しなければネットワーク
を介してコンピュータから ゛その情報を読みだしそ
の情報をワークステーション2000に与えるとともに
キャッシュメモリ200に記憶する。このときキャッシ
ュメモリ200に空きブロックがないときには、参照頻
度の低い情報の格納されたブロックが選択される。以下
の説明では、説明を簡単にするためにコンピュータに管
理されている情報はブロックと呼ばれる固定長の一頭域
に格納されているものとし、情報はディレクトリ名によ
り一意に管理されているものとする。情報キャッシュメ
モリは固定長の複数ブロックで構成されている。
対して必要な情報をアクセスする。もしアクセスされた
情報がキャッシュメモリに存在しなければネットワーク
を介してコンピュータから ゛その情報を読みだしそ
の情報をワークステーション2000に与えるとともに
キャッシュメモリ200に記憶する。このときキャッシ
ュメモリ200に空きブロックがないときには、参照頻
度の低い情報の格納されたブロックが選択される。以下
の説明では、説明を簡単にするためにコンピュータに管
理されている情報はブロックと呼ばれる固定長の一頭域
に格納されているものとし、情報はディレクトリ名によ
り一意に管理されているものとする。情報キャッシュメ
モリは固定長の複数ブロックで構成されている。
第2図を参照すると、本発明の第1の実施例は。
情報の書込みモードを示すモード設定レジスタ151を
有し信号線110を介してワークステーション2000
から要求される情報読みだし指令を解読し、分散情報キ
ャツシュ装置13000各部を制御するとともに信号線
120およびネットワークを介してコンピュータに対す
る制御指令を出力する制御装置150.ワークスチーシ
ーa/2000からの要求を識別するディレクトリ名を
格納するレジスタ160.該当情報がキャッシュメモリ
200に存在しなかったとき、読み込むべきキャッシュ
メモリブロックを選択する掃きだしブロック選択回路1
70.情報を格納する部分と情報ディレクトリ名を格納
する部分が対になった配列で成っておりバス260およ
び250を介してワークステーションと情報の入出力を
行いバス250と270によりネットワークを介してコ
ンピュータと情報の入出力ヲ行うキャッシュメモリ20
0、レジスタ160の内容とキャッシュメモリ200の
ディレクトリ名部の内容とを入力してアクセスされた情
報がキャッシュメモリ200にあるか否かを判定するヒ
ツト判定回路180から構成されている。
有し信号線110を介してワークステーション2000
から要求される情報読みだし指令を解読し、分散情報キ
ャツシュ装置13000各部を制御するとともに信号線
120およびネットワークを介してコンピュータに対す
る制御指令を出力する制御装置150.ワークスチーシ
ーa/2000からの要求を識別するディレクトリ名を
格納するレジスタ160.該当情報がキャッシュメモリ
200に存在しなかったとき、読み込むべきキャッシュ
メモリブロックを選択する掃きだしブロック選択回路1
70.情報を格納する部分と情報ディレクトリ名を格納
する部分が対になった配列で成っておりバス260およ
び250を介してワークステーションと情報の入出力を
行いバス250と270によりネットワークを介してコ
ンピュータと情報の入出力ヲ行うキャッシュメモリ20
0、レジスタ160の内容とキャッシュメモリ200の
ディレクトリ名部の内容とを入力してアクセスされた情
報がキャッシュメモリ200にあるか否かを判定するヒ
ツト判定回路180から構成されている。
ワークステーションから要求される指令に基づき、書込
み指定の場合には制御装置150内のモード設定レジス
タ151に書込み指定モードがセットされる。
み指定の場合には制御装置150内のモード設定レジス
タ151に書込み指定モードがセットされる。
また、キャッシュメモリの消去制御指令に応答して消去
指定モードがセットされ各モードに応じた制御が行われ
る。
指定モードがセットされ各モードに応じた制御が行われ
る。
次に、第2図を参照して、本発明の一実施例の動作を詳
細に説明する。
細に説明する。
制御装置150はワークステーションから与えられた情
報に基き、続出し情報のディレクトリ塩をレジスタ16
0に格納する。ヒツト判定回路180はレジスタ160
の内容とキャッシュメモリ200のディレクトリ各部の
内容とを比較して読出す情報がキャッシュメモリに存在
するか否かヲ副べろ。もし、キャッシュメモリ200に
読出し情報が存在すればキャッシュメモリ200の該当
ブロックが読みだされバス250°および260を介し
てワークステーションに送出される。もし、読比し情報
がキャッシュメモリ200に存在しないときには制御装
置150は掃き出しブロック選択回路170に従い、キ
ャッシュメモリ200のブロックを選択し読み出し情報
のディレクトリ塩を該当ブロックのディレクトリ部にセ
ットしコンピュータから読みだした情報を選択ブロック
の情報部にバス270および250を介して書込む。
報に基き、続出し情報のディレクトリ塩をレジスタ16
0に格納する。ヒツト判定回路180はレジスタ160
の内容とキャッシュメモリ200のディレクトリ各部の
内容とを比較して読出す情報がキャッシュメモリに存在
するか否かヲ副べろ。もし、キャッシュメモリ200に
読出し情報が存在すればキャッシュメモリ200の該当
ブロックが読みだされバス250°および260を介し
てワークステーションに送出される。もし、読比し情報
がキャッシュメモリ200に存在しないときには制御装
置150は掃き出しブロック選択回路170に従い、キ
ャッシュメモリ200のブロックを選択し読み出し情報
のディレクトリ塩を該当ブロックのディレクトリ部にセ
ットしコンピュータから読みだした情報を選択ブロック
の情報部にバス270および250を介して書込む。
また同情報はバス260を介してワークスチーシー1/
に送出される。
に送出される。
ワークステーションからの情報書き込み指令を制御装置
150が受けたときにはモードレジスタ151に書込み
モードがセットされる。ディレクトリ塩はレジスタ16
0にセットされキャッシュメモリ200のディレクトリ
部の内容と比較され、書込む情報がキャッシュメモリに
存在するか否かが副べられる。もしキャッシュメモリ2
00に書出し情報が存在すれば書へ込み情報がバス26
0および250を介して該当ブロックの情報部に書き込
まれる。さらにその情報はバス250および270を介
してコンピュータに送出される。
150が受けたときにはモードレジスタ151に書込み
モードがセットされる。ディレクトリ塩はレジスタ16
0にセットされキャッシュメモリ200のディレクトリ
部の内容と比較され、書込む情報がキャッシュメモリに
存在するか否かが副べられる。もしキャッシュメモリ2
00に書出し情報が存在すれば書へ込み情報がバス26
0および250を介して該当ブロックの情報部に書き込
まれる。さらにその情報はバス250および270を介
してコンピュータに送出される。
キャッシュメモリに情報が存在しないときにはキャッシ
ュメモリへの書き込みは行わずにバス260および27
0を介してコンピュータに情報の選出が行われる。
ュメモリへの書き込みは行わずにバス260および27
0を介してコンピュータに情報の選出が行われる。
ワークスチーシヲ゛ンからのキャッシェ情報の消去指令
を制御装置が受けると全部または該当キャッシュメモリ
が削除される。
を制御装置が受けると全部または該当キャッシュメモリ
が削除される。
(発明の効果)
本発明には分散情報キャッシェ装置を分散処理システム
に導入することにより集中管理された情報の参照が各ワ
ークステーションの参照特性に合せてキャッシュメモリ
に分散配置されアクセスされた情報がキャッシュメモリ
で見出す割合を高めアクセス性能を改善する効果がある
。
に導入することにより集中管理された情報の参照が各ワ
ークステーションの参照特性に合せてキャッシュメモリ
に分散配置されアクセスされた情報がキャッシュメモリ
で見出す割合を高めアクセス性能を改善する効果がある
。
第1図は分散情報キャッシュ装置の情報処理システム内
の位置を示す図および第2図は本発明の一実施例を示す
図でらる。
の位置を示す図および第2図は本発明の一実施例を示す
図でらる。
Claims (1)
- 【特許請求の範囲】 コンピュータのディスクファイル等に格納管理された情
報の写しを記憶するワークステーション内のキャッシュ
メモリを有する分散情報キャッシュの制御方式において
、 ワークステーションからの読み出し要求に応答して、前
記コンピュータシステムに格納された情報の写しが前記
キャッシュメモリに存在するか否かを判別する判別手段
と、 この判別手段で前記キャッシュメモリに前記情報の写し
が存在しないと判別されたときに前記コンピュータシス
テムに格納された情報をキャッシュメモリに読み込みワ
ークステーションに提供する手段とを含むことを特徴と
する分散情報キャッシュ制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59133701A JPS6113354A (ja) | 1984-06-28 | 1984-06-28 | 分散情報キヤツシユ制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59133701A JPS6113354A (ja) | 1984-06-28 | 1984-06-28 | 分散情報キヤツシユ制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6113354A true JPS6113354A (ja) | 1986-01-21 |
Family
ID=15110864
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59133701A Pending JPS6113354A (ja) | 1984-06-28 | 1984-06-28 | 分散情報キヤツシユ制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6113354A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5450559A (en) * | 1989-05-31 | 1995-09-12 | International Business Machines Corporation | Microcomputer system employing address offset mechanism to increase the supported cache memory capacity |
-
1984
- 1984-06-28 JP JP59133701A patent/JPS6113354A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5450559A (en) * | 1989-05-31 | 1995-09-12 | International Business Machines Corporation | Microcomputer system employing address offset mechanism to increase the supported cache memory capacity |
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