JPS61170024A - 半導体装置の製造方法 - Google Patents

半導体装置の製造方法

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Publication number
JPS61170024A
JPS61170024A JP60010105A JP1010585A JPS61170024A JP S61170024 A JPS61170024 A JP S61170024A JP 60010105 A JP60010105 A JP 60010105A JP 1010585 A JP1010585 A JP 1010585A JP S61170024 A JPS61170024 A JP S61170024A
Authority
JP
Japan
Prior art keywords
layer
impurity
diffusion
doped
semiconductor device
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP60010105A
Other languages
English (en)
Inventor
Tadakatsu Yamaguchi
忠克 山口
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP60010105A priority Critical patent/JPS61170024A/ja
Publication of JPS61170024A publication Critical patent/JPS61170024A/ja
Pending legal-status Critical Current

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Classifications

    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P32/00—Diffusion of dopants within, into or out of wafers, substrates or parts of devices
    • H10P32/10—Diffusion of dopants within, into or out of semiconductor bodies or layers
    • H10P32/14—Diffusion of dopants within, into or out of semiconductor bodies or layers within a single semiconductor body or layer in a solid phase; between different semiconductor bodies or layers, both in a solid phase

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  • Semiconductor Integrated Circuits (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は半導体装置の製造方法に関し、特に不純物濃度
の異なる領域を不純物の拡散によって同時に形成する方
法に関する。
〔従来の技術〕
従来の半導体装置の製造方法において、同一導電型の二
種類の表面濃度を有する拡散層を形成するためには、例
えば、ガス拡散による方法では、第2図に示すように、
半導体基板11の表面にシリコン酸化膜12を形成して
半導体ウェノ・−1の所望の開口部13をPR技術によ
り形成し、しかる後、第1回目の拡散を行なって領域1
0を形成しく同図(a))、次に第2図(b)に示すよ
うに、新たなシリコン酸化膜14を形成し、再び第2図
(C)に示すようにPR技術によシ所望の開口部15を
露出させ、第1回目とは異なる濃度の第2回目の拡散を
行なって領域11を形成し、そして第2図(d)に示す
ようにシリコン酸化膜14をフッ酸液で除去するという
方法が行なわれてきた。
〔発明が解決しようとする問題点〕
上述した従来の半導体装置の製造方法は、同一導電型の
二種類の表面濃度を有する拡散層を形成するために、二
回に分けて、拡散を行なう必要があシ、製造工程が長く
なるという欠点がある。
〔問題点を解決するための手段〕
本発明は、上記の点に鑑みなされたもので、拡散源とし
てドープトオキサイド層又はドープトポリシリコン層を
採用し、同層中の不純物濃度と同層の厚さ及び同層上の
窒化膜(又はノンドープCVD酸化膜)の有無を組み合
わせることによシ、所望の不純物濃度及び濃度差のある
二種類の拡散層を一回の熱処理で形成することを特徴と
する。
〔実施例〕
次に、本発明について図面を参照して説明する。
第1図(a)乃至(d)は、この発明の一実施例を示す
図である。まず第1図(a)に示すようにP型半導体ウ
ェハー(たとえばシリコンクエバー)lの表面にシリコ
ン酸化膜2をたとえば5000A厚に形成した後、半導
体ウェハー1の所望の表面領域を露出させるためにシリ
コン酸化膜2に開口部3ないし4をPR技術により形成
する。次に第1図(b)に示すように、シリコン酸化膜
2の表面及び露出した半導体ウェハー1の表面にドープ
トオキサイド層5を3000〜500 oA厚に形成す
る。オキサイド層の代わシにドープトポリシリコン層を
使ってもよい。このドープトオキサイド層5の形成には
、例えは、砒素シリカフィルムの塗布等を用いる。ドー
プトポリシリコン層を用いる場合は、減圧CVD方式に
よりて約1000〜3000Aの厚さに形成する。
続いて、形成したドープオキサイド層5の表面に窒化膜
6を800〜100OA厚に減圧CVD方式などKよる
窒化膜成長装置によって形成する。窒化膜60代わりに
ノンドープのCVD酸化膜を用いてもよい。さらに第1
図(C)に示すように、高濃度拡散層を形成する開口部
3の上部にある窒化膜6のみを残すように、PR技術及
びドライエッチ技術により窒化膜6の選択除去を行なう
。そして、Yの状態でドライブインを行なうことにより
、開口部3及び4に対応する半導体ウェハー1の表面内
に、拡散層7及び8を形成する。ここでドライブインの
条件は、温度が800℃〜1100℃であシ、雰囲気は
NtまたはAr等の不活性ガスを用いる。
このドライブインの際にドープトオキサイド中の不純物
(たとえば砒素)は、半導体ウェハー中に拡散するが、
一方では、ドープトオキサイド表面を窒化膜6で覆われ
ていない開口部4上のドープトオキサイド5の表面から
は、ドライブインの雰囲気ガス中へも不純物が拡散する
。他方、ドープトオキサイド5の表面を窒化膜6で覆わ
れている開口部3上のドープトオキサイド5からは、ド
ライブインの雰囲気ガス中への不純物拡散は行なわれず
、不純物の拡散は専ら半導体ウェハー1中に行なわれる
。この結果、開口部4に対応する拡散層7の表面不純物
濃度は、開口部3に対応する拡散層8の表面不純物濃度
に比べて低いものとなる。
雰囲気ガス中への不純物拡散の程度は、ドープトオキサ
イド中の不純物濃度及びドープオキサイド層の厚さによ
り異なるためこの両者を適当に選ぶことKより、形成さ
れる拡散層7と8の表面閾度と表面濃度差は所望の結果
を得ることが可能である。
しかる後、第1図(e)に示すように、ドープトオキサ
イド上の窒化膜6を熱リン酸によシ除去し、さらにドー
プトオキサイド層5を10%7ツ酸溶液で除去する。
〔発明の効果〕
以上説明したように本発明は、拡散源としてドープトオ
キサイドやドープトポリシリコンを採用し、ド・−ブト
オキサイド等中の不純物濃度とドープトオキサイド等の
厚さ及びドープトオキサイド等上の窒化膜等の選択除去
の王者を組み合わせることにtシ所望の不純物濃度及び
#度差のある二種の拡散層を一回の熱処理(ドライブイ
ン)により形成することができ、工程を簡略化できる効
果がある。
【図面の簡単な説明】
第1図(a)乃至(d)は本発明の一実施例による半導
体装置の製造方法を示す各工程断面図である。第2図は
、従来例の半導体装置の製造方法を示す工程断面図であ
る。 1.11・・・・・・半導体ウエノ〜−12,12・−
・・・・シリコン酸化膜、3,4,13.15・・・・
・・開口部、14・・・・・・シリコン酸化膜、5・・
・・・・ドープトオキサイド層、6・・・・・・シリコ
ン窒化膜、7,10・・・・・・低表面濃度領域、8.
11・・・・・・高表面濃度領域。 yf51 図

Claims (1)

    【特許請求の範囲】
  1. 半導体層上に第1および第2の開口を有する不純物拡散
    阻止層を形成する工程と、前記第1および第2の開口を
    うめるように不純物含有層を形成する工程と、外方不純
    物拡散阻止層を前記第1および第2の開口のいずれか一
    方上に位置する不純物含有層上に形成する工程と、前記
    不純物含有層からの不純物拡散によって表面不純物濃度
    が異なる二つの領域を前記半導体層内に形成する工程と
    を含むことを特徴とする半導体装置の製造方法。
JP60010105A 1985-01-23 1985-01-23 半導体装置の製造方法 Pending JPS61170024A (ja)

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JP (1) JPS61170024A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01179313A (ja) * 1987-12-30 1989-07-17 Fujitsu Ltd 半導体装置の製造方法

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01179313A (ja) * 1987-12-30 1989-07-17 Fujitsu Ltd 半導体装置の製造方法

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