JPS6119057B2 - - Google Patents
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- Publication number
- JPS6119057B2 JPS6119057B2 JP55174591A JP17459180A JPS6119057B2 JP S6119057 B2 JPS6119057 B2 JP S6119057B2 JP 55174591 A JP55174591 A JP 55174591A JP 17459180 A JP17459180 A JP 17459180A JP S6119057 B2 JPS6119057 B2 JP S6119057B2
- Authority
- JP
- Japan
- Prior art keywords
- transfer
- packet
- data
- block
- command
- Prior art date
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-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F15/00—Digital computers in general; Data processing equipment in general
- G06F15/16—Combinations of two or more digital computers each having at least an arithmetic unit, a program unit and a register, e.g. for a simultaneous processing of several programs
- G06F15/163—Interprocessor communication
- G06F15/167—Interprocessor communication using a common memory, e.g. mailbox
Landscapes
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Theoretical Computer Science (AREA)
- Software Systems (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Multi Processors (AREA)
- Computer And Data Communications (AREA)
- Exchange Systems With Centralized Control (AREA)
Description
本発明は、マルチプロセツサ式情報処理システ
ムにおけるプロセツサ間通信方式に関するもので
ある。 従来、この種のプロセツサ間通信方式には、大
別して次の２つのものがあつた。 第１の方式は、送信（転送）すべきデータを、
あらかじめ定められた固定長のものに分解し、こ
れを当該データ量に応じて必要回数に分け、送信
側メモリの固定アドレスから受信側メモリの固定
アドレスへ送信するというものであつた。 この方式は、プロセツサ間を接続するバスが１
本でよいが、送信すべきデータが大量の場合に
は、送信動作を何回も繰返さなければならないの
で、送信効率が良くなく、プロセツサの処理能力
低下を来すおそれがある。 第２の方式は、プログラムにより、送信側メモ
リアドレス、受信側メモリアドレス、転送語数等
を指定するものである。 この方式では、大容量データ転送用バス、小容
量データ転送用バスを設け、大容量データの転送
中における他の小容量データ転送を可能とせしめ
るか、または大容量データ転送中に小容量データ
転送が必要となつた場合には、プログラムが介入
することにより、大容量データ転送を中断して小
容量データ転送を行い、その終了後に大容量デー
タ転送を再開せしめる必要がある。 したがつて、第１の方式と同様に、プロセツサ
の処理能力の低下を来すことになる。 本発明の目的は、上記した従来技術の欠点をな
くし、プロセツサ間を接続するバスを増設するこ
となく、また、プログラムがデータ転送途中に介
入する必要がなく、小容量データ転送、大容量デ
ータ転送が可能な効率のよいプロセツサ間通信方
式を提供することにある。 本発明に係るプロセツサ間通信方式は、制御系
を２重化した蓄積プログラム制御方式の構内交換
機において、プロセツサ間のデータ転送を行うた
めに、コマンドを所定の固定データ長で受信側の
固定メモリアドレスへ転送するパケツト転送と、
データ長および受信側のメモリアドレスを指定し
て転送するブロツク転送とに分けて行うごとく
し、ブロツク転送の途中にパケツト転送の要求が
発生したときには、各プロセツサ対応に設けられ
たプロセツサ間通信装置によつて自律的に、当該
要求を蓄積・識別し、当該ブロツク転送を所定時
間または所定語数ごとに中断し、当該パケツト転
送を行わしめうるために、コマンドバツフアとし
てパケツトコマンドバツフアとブロツクコマンド
バツフアを、また、データ送受信回路のほかにブ
ロツク転送中のパケツトコマンドの要求の有無を
識別するパケツト・ブロツク転送識別回路を設け
たものである。 なお、これに付言をすれば、パ
ケツト転送は、データ量は比較的少ないが緊急度
が高いもの、例えば、実時間的なもの（電話交換
システムの例では、発呼加入者情報、課金情報、
特殊サービス情報等）に固定長（固定転送語数）
のデータで、ブロツク転送は、データ量は多いが
比較的緊急度が低いもの、例えば、バツチ処理的
なもの（システム立上げ、障害診断、フアクシミ
リ・データ通信用のデータ処理等）に所要語数の
データで適用するものである。 以下、本発明の実施例を図に基づいて説明す
る。 第１図は、本発明に係るプロセツサ間通信方式
の一実施例の方式構成図、第２図は、そのタイム
チヤートである。 なお、本発明に係るものは、上記したように、
制御系を２重化した蓄積プログラム制御方式の構
内交換機に係るものである。 ここで、１Ａ，１Ｂ，…，１Ｎは、マルチプロ
セツサ式情報処理システムを構成するＮ個のユニ
ツト（UNIT）、２は、ユニツト間データ転送制
御線（CONT）、３は、ユニツト間接続バス
（BUS）、１０Ａ，１０Ｂ，…は、各ユニツト１
Ａ，１Ｂ，…のプロセツサ（CP）、２０Ａ，２０
Ｂ，…は、同メモリ（MM）、３０Ａ，３０Ｂ，
…は、同プロセツサ間通信装置（IPC）、３１
Ａ，３１Ｂ，…は、そのアドレスデコーダ、３２
Ａ，３２Ｂ，…は、同パケツトコマンドバツフ
ア、３３Ａ，３３Ｂ，…は、同ブロツクコマンド
バツフア、３４Ａ，３４Ｂ，…は、同パケツト・
ブロツク転送識別回路、３５Ａ，３５Ｂ，…は、
ダイレクトメモリアクセス回路、３６Ａ，３６
Ｂ，…は、同データ送受信回路、４０Ａ，４０
Ｂ，…は、各ユニツト１Ａ，１Ｂ，…のアドレス
バス（ADB）、５０Ａ，５０Ｂ，…は、同データ
バス（DTB）である。 以下、ユニツト１Ａが送信側になるものとして
説明するが、他のいずれのユニツト１Ｂ〜１Ｎが
送信側となつても同様である。 各プロセツサ１０Ａ，１０Ｂ，…間でデータ転
送が必要な場合において、パケツト転送によると
きは、例えば、第１表に示すごとき構成のパケツ
ト転送要求コマンドを、ブロツク転送によるとき
は、例えば、第２表に示すごとき構成のブロツク
転送要求コマンドを発生する。
ムにおけるプロセツサ間通信方式に関するもので
ある。 従来、この種のプロセツサ間通信方式には、大
別して次の２つのものがあつた。 第１の方式は、送信（転送）すべきデータを、
あらかじめ定められた固定長のものに分解し、こ
れを当該データ量に応じて必要回数に分け、送信
側メモリの固定アドレスから受信側メモリの固定
アドレスへ送信するというものであつた。 この方式は、プロセツサ間を接続するバスが１
本でよいが、送信すべきデータが大量の場合に
は、送信動作を何回も繰返さなければならないの
で、送信効率が良くなく、プロセツサの処理能力
低下を来すおそれがある。 第２の方式は、プログラムにより、送信側メモ
リアドレス、受信側メモリアドレス、転送語数等
を指定するものである。 この方式では、大容量データ転送用バス、小容
量データ転送用バスを設け、大容量データの転送
中における他の小容量データ転送を可能とせしめ
るか、または大容量データ転送中に小容量データ
転送が必要となつた場合には、プログラムが介入
することにより、大容量データ転送を中断して小
容量データ転送を行い、その終了後に大容量デー
タ転送を再開せしめる必要がある。 したがつて、第１の方式と同様に、プロセツサ
の処理能力の低下を来すことになる。 本発明の目的は、上記した従来技術の欠点をな
くし、プロセツサ間を接続するバスを増設するこ
となく、また、プログラムがデータ転送途中に介
入する必要がなく、小容量データ転送、大容量デ
ータ転送が可能な効率のよいプロセツサ間通信方
式を提供することにある。 本発明に係るプロセツサ間通信方式は、制御系
を２重化した蓄積プログラム制御方式の構内交換
機において、プロセツサ間のデータ転送を行うた
めに、コマンドを所定の固定データ長で受信側の
固定メモリアドレスへ転送するパケツト転送と、
データ長および受信側のメモリアドレスを指定し
て転送するブロツク転送とに分けて行うごとく
し、ブロツク転送の途中にパケツト転送の要求が
発生したときには、各プロセツサ対応に設けられ
たプロセツサ間通信装置によつて自律的に、当該
要求を蓄積・識別し、当該ブロツク転送を所定時
間または所定語数ごとに中断し、当該パケツト転
送を行わしめうるために、コマンドバツフアとし
てパケツトコマンドバツフアとブロツクコマンド
バツフアを、また、データ送受信回路のほかにブ
ロツク転送中のパケツトコマンドの要求の有無を
識別するパケツト・ブロツク転送識別回路を設け
たものである。 なお、これに付言をすれば、パ
ケツト転送は、データ量は比較的少ないが緊急度
が高いもの、例えば、実時間的なもの（電話交換
システムの例では、発呼加入者情報、課金情報、
特殊サービス情報等）に固定長（固定転送語数）
のデータで、ブロツク転送は、データ量は多いが
比較的緊急度が低いもの、例えば、バツチ処理的
なもの（システム立上げ、障害診断、フアクシミ
リ・データ通信用のデータ処理等）に所要語数の
データで適用するものである。 以下、本発明の実施例を図に基づいて説明す
る。 第１図は、本発明に係るプロセツサ間通信方式
の一実施例の方式構成図、第２図は、そのタイム
チヤートである。 なお、本発明に係るものは、上記したように、
制御系を２重化した蓄積プログラム制御方式の構
内交換機に係るものである。 ここで、１Ａ，１Ｂ，…，１Ｎは、マルチプロ
セツサ式情報処理システムを構成するＮ個のユニ
ツト（UNIT）、２は、ユニツト間データ転送制
御線（CONT）、３は、ユニツト間接続バス
（BUS）、１０Ａ，１０Ｂ，…は、各ユニツト１
Ａ，１Ｂ，…のプロセツサ（CP）、２０Ａ，２０
Ｂ，…は、同メモリ（MM）、３０Ａ，３０Ｂ，
…は、同プロセツサ間通信装置（IPC）、３１
Ａ，３１Ｂ，…は、そのアドレスデコーダ、３２
Ａ，３２Ｂ，…は、同パケツトコマンドバツフ
ア、３３Ａ，３３Ｂ，…は、同ブロツクコマンド
バツフア、３４Ａ，３４Ｂ，…は、同パケツト・
ブロツク転送識別回路、３５Ａ，３５Ｂ，…は、
ダイレクトメモリアクセス回路、３６Ａ，３６
Ｂ，…は、同データ送受信回路、４０Ａ，４０
Ｂ，…は、各ユニツト１Ａ，１Ｂ，…のアドレス
バス（ADB）、５０Ａ，５０Ｂ，…は、同データ
バス（DTB）である。 以下、ユニツト１Ａが送信側になるものとして
説明するが、他のいずれのユニツト１Ｂ〜１Ｎが
送信側となつても同様である。 各プロセツサ１０Ａ，１０Ｂ，…間でデータ転
送が必要な場合において、パケツト転送によると
きは、例えば、第１表に示すごとき構成のパケツ
ト転送要求コマンドを、ブロツク転送によるとき
は、例えば、第２表に示すごとき構成のブロツク
転送要求コマンドを発生する。
【表】
【表】
なお、パケツト転送の場合には、個々に相手プ
ロセツサが１つに限定されるのに反して、ブロツ
ク転送の場合には、システム立上げのときのごと
く、１つのプロセツサから他の複数のプロセツサ
へのデータ転送が必要となるので、必要に応じ、
全相手プロセツサに対して同時にデータ転送を行
うことができるように、全相手プロセツサ番号を
指定しうるように考えられている。 まず、プロセツサ１０Ａは、あるプログラム処
理中にプロセツサ１０Ｂに対する通信の要求が発
生した場合、これを識別し、パケツト転送要求
P1であるときには、アドレスバス４０Ａ，アド
レスデコーダ３１Ａを介し、パケツト転送要求コ
マンドをパケツトコマンドバツフア３２Ａにセツ
トする。 このとき、ブロツク転送が行われていないの
で、パケツト・ブロツク転送識別回路３４Ａは、
このコマンドの受信により、パケツト転送要求で
あることを識別すると、直ちに、転送すべきデー
タの自メモリ２０Ａにおけるメモリアドレス、固
定転送語数をダイレクトメモリアクセス回路３５
Ａにセツトする。 ダイレクトメモリアクセス回路３５Ａは、アド
レスバス４０Ａへ当該メモリアドレスを送出し、
メモリ２０Ａから送出される当該データをデータ
バス５０Ａ経由でデータ送受信回路３６Ａにセツ
トせしめる。 データ送受信回路３６Ａは、ユニツト間データ
転送制御線２、ユニツト間接続バス３を用いて、
当該パケツト転送要求コマンドに係る固定長デー
タを受信側のユニツト１Ｂのデータ送受信回路３
６Ｂへ転送する。 データ送受信回路３６Ｂは、データ転送を受け
ると、パケツト・ブロツク識別回路３４Ｂを起動
し、パケツト転送かブロツク転送かの識別をせし
め、パケツト転送であることが識別されると、ダ
イレクトメモリアクセス回路３５Ｂに当該データ
に係る自メモリ２０Ｂにおけるメモリアドレス、
転送語数（データ長）をセツトせしめる。 これにより、ダイレクトメモリアクセス回路３
５Ｂは、アドレスバス４０Ｂに当該メモリアドレ
スを、データバス５０Ｂに当該データを送出し、
メモリ２０Ｂに当該転送データを書込む。 以上のようにしてパケツト転送が行われるが、
これは、一連のデータについて、所要の複数回の
パケツト転送を繰返すようにしてもよい。 次に、ブロツク転送要求Ｂが発生すると、所望
のブロツク転送要求コマンドがブロツクコマンド
バツフア３３Ａにセツトされ、パケツト・ブロツ
ク転送識別回路３４Ａがブロツク転送であること
を識別すると、転送すべきデータの自メモリ２０
Ａにおけるメモリアドレス、転送語数がダイレク
トメモリアクセス回路３５Ａにセツトされる。 以下、パケツト転送の場合と同様に、当該ブロ
ツク転送要求コマンドに係る受信側のメモリアド
レスの指定に基づき、所望のデータが受信側のメ
モリ２０Ｂに順次書込まれる。 この場合、受信側のパケツト・ブロツク識別回
路３４Ｂは、転送時間または転送語数の計数を行
い、所定時間Ｔまたは所定語数Ｗ（これらは、例
えば、データ転送が中断されても実用上支障がな
い最小の所定値に選ばれる。）のデータ転送の終
了ごとに、自律的にパケツトコマンドバツフア３
２Ｂをチエツクし、第２図に示すごとく、パケツ
ト転送要求Ｐ２があると、直ちに、データ送受信
回路３６Ｂに当該ブロツク転送を中断せしめ、パ
ケツト転送要求Ｐ２に係るデータ受信を行わしめ
る。 これが終了すると、ブロツク転送を再開し、指
定された語数分のデータ受信を行い、当該ブロツ
ク転送が終了する。 以上のようにして、実時間的または緊急度の高
いパケツト転送要求は、そのデータ転送が最低限
の待合せ時間で行われ、システムのサービス性が
低下せしめられないようにすることができる。 以上、詳細に説明したように、本発明によれ
ば、プロセツサ間を接続するバスを増設すること
なく、また、プログラムがデータ転送途中に介入
する必要がないので、プロセツサ間通信方式の経
済化，効率向上、ひいては、システムのサービス
性向上に顕著な効果が得られる。
ロセツサが１つに限定されるのに反して、ブロツ
ク転送の場合には、システム立上げのときのごと
く、１つのプロセツサから他の複数のプロセツサ
へのデータ転送が必要となるので、必要に応じ、
全相手プロセツサに対して同時にデータ転送を行
うことができるように、全相手プロセツサ番号を
指定しうるように考えられている。 まず、プロセツサ１０Ａは、あるプログラム処
理中にプロセツサ１０Ｂに対する通信の要求が発
生した場合、これを識別し、パケツト転送要求
P1であるときには、アドレスバス４０Ａ，アド
レスデコーダ３１Ａを介し、パケツト転送要求コ
マンドをパケツトコマンドバツフア３２Ａにセツ
トする。 このとき、ブロツク転送が行われていないの
で、パケツト・ブロツク転送識別回路３４Ａは、
このコマンドの受信により、パケツト転送要求で
あることを識別すると、直ちに、転送すべきデー
タの自メモリ２０Ａにおけるメモリアドレス、固
定転送語数をダイレクトメモリアクセス回路３５
Ａにセツトする。 ダイレクトメモリアクセス回路３５Ａは、アド
レスバス４０Ａへ当該メモリアドレスを送出し、
メモリ２０Ａから送出される当該データをデータ
バス５０Ａ経由でデータ送受信回路３６Ａにセツ
トせしめる。 データ送受信回路３６Ａは、ユニツト間データ
転送制御線２、ユニツト間接続バス３を用いて、
当該パケツト転送要求コマンドに係る固定長デー
タを受信側のユニツト１Ｂのデータ送受信回路３
６Ｂへ転送する。 データ送受信回路３６Ｂは、データ転送を受け
ると、パケツト・ブロツク識別回路３４Ｂを起動
し、パケツト転送かブロツク転送かの識別をせし
め、パケツト転送であることが識別されると、ダ
イレクトメモリアクセス回路３５Ｂに当該データ
に係る自メモリ２０Ｂにおけるメモリアドレス、
転送語数（データ長）をセツトせしめる。 これにより、ダイレクトメモリアクセス回路３
５Ｂは、アドレスバス４０Ｂに当該メモリアドレ
スを、データバス５０Ｂに当該データを送出し、
メモリ２０Ｂに当該転送データを書込む。 以上のようにしてパケツト転送が行われるが、
これは、一連のデータについて、所要の複数回の
パケツト転送を繰返すようにしてもよい。 次に、ブロツク転送要求Ｂが発生すると、所望
のブロツク転送要求コマンドがブロツクコマンド
バツフア３３Ａにセツトされ、パケツト・ブロツ
ク転送識別回路３４Ａがブロツク転送であること
を識別すると、転送すべきデータの自メモリ２０
Ａにおけるメモリアドレス、転送語数がダイレク
トメモリアクセス回路３５Ａにセツトされる。 以下、パケツト転送の場合と同様に、当該ブロ
ツク転送要求コマンドに係る受信側のメモリアド
レスの指定に基づき、所望のデータが受信側のメ
モリ２０Ｂに順次書込まれる。 この場合、受信側のパケツト・ブロツク識別回
路３４Ｂは、転送時間または転送語数の計数を行
い、所定時間Ｔまたは所定語数Ｗ（これらは、例
えば、データ転送が中断されても実用上支障がな
い最小の所定値に選ばれる。）のデータ転送の終
了ごとに、自律的にパケツトコマンドバツフア３
２Ｂをチエツクし、第２図に示すごとく、パケツ
ト転送要求Ｐ２があると、直ちに、データ送受信
回路３６Ｂに当該ブロツク転送を中断せしめ、パ
ケツト転送要求Ｐ２に係るデータ受信を行わしめ
る。 これが終了すると、ブロツク転送を再開し、指
定された語数分のデータ受信を行い、当該ブロツ
ク転送が終了する。 以上のようにして、実時間的または緊急度の高
いパケツト転送要求は、そのデータ転送が最低限
の待合せ時間で行われ、システムのサービス性が
低下せしめられないようにすることができる。 以上、詳細に説明したように、本発明によれ
ば、プロセツサ間を接続するバスを増設すること
なく、また、プログラムがデータ転送途中に介入
する必要がないので、プロセツサ間通信方式の経
済化，効率向上、ひいては、システムのサービス
性向上に顕著な効果が得られる。
第１図は、本発明に係るプロセツサ間通信方式
の一実施例の方式構成図、第２図は、そのタイム
チヤートである。 １Ａ，１Ｂ，〜，１Ｎ……ユニツト、２……ユ
ニツト間データ転送制御線、３……ユニツト間接
続バス、１０Ａ，１０Ｂ……プロセツサ、２０
Ａ，２０Ｂ……メモリ、３０Ａ，３０Ｂ……プロ
セツサ間通信装置、３１Ａ，３１Ｂ……アドレス
デコーダ、３２Ａ，３２Ｂ……パケツトコマンド
バツフア、３３Ａ，３３Ｂ……ブロツクコマンド
バツフア、３４Ａ，３４Ｂ……パケツト・ブロツ
ク転送識別回路、３５Ａ，３５Ｂ……ダイレクト
メモリアクセス回路、３６Ａ，３６Ｂ……データ
送受信回路、４０Ａ，４０Ｂ……アドレスバス、
５０Ａ，５０Ｂ……データバス。
の一実施例の方式構成図、第２図は、そのタイム
チヤートである。 １Ａ，１Ｂ，〜，１Ｎ……ユニツト、２……ユ
ニツト間データ転送制御線、３……ユニツト間接
続バス、１０Ａ，１０Ｂ……プロセツサ、２０
Ａ，２０Ｂ……メモリ、３０Ａ，３０Ｂ……プロ
セツサ間通信装置、３１Ａ，３１Ｂ……アドレス
デコーダ、３２Ａ，３２Ｂ……パケツトコマンド
バツフア、３３Ａ，３３Ｂ……ブロツクコマンド
バツフア、３４Ａ，３４Ｂ……パケツト・ブロツ
ク転送識別回路、３５Ａ，３５Ｂ……ダイレクト
メモリアクセス回路、３６Ａ，３６Ｂ……データ
送受信回路、４０Ａ，４０Ｂ……アドレスバス、
５０Ａ，５０Ｂ……データバス。
Claims (1)
- １ 制御系を２重化した蓄積プログラム制御方式
の構内交換機において、プロセツサ間のデータ転
送を行うために、コマンドを所定の固定データ長
で受信側の固定メモリアドレスへ転送するパケツ
ト転送と、データ長および受信側のメモリアドレ
スを指定して転送するブロツク転送とに分けて行
うごとくし、ブロツク転送の途中にパケツト転送
を要求が発生したときには、各プロセツサ対応に
設けられたプロセツサ間通信装置によつて自律的
に、当該要求を蓄積・識別し、当該ブロツク転送
を所定時間または所定語数ごとに中断し、当該パ
ケツト転送を行わしめうるために、コマンドバツ
フアとしてパケツトコマンドバツフアとブロツク
コマンドバツフアを、また、データ送受信回路の
ほかにブロツク転送中のパケツトコマンドの要求
の有無を識別するパケツト・ブロツク転送識別回
路を設けたことを特徴とするプロセツサ間通信方
式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP55174591A JPS5798062A (en) | 1980-12-12 | 1980-12-12 | Communication system between processors |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP55174591A JPS5798062A (en) | 1980-12-12 | 1980-12-12 | Communication system between processors |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5798062A JPS5798062A (en) | 1982-06-18 |
| JPS6119057B2 true JPS6119057B2 (ja) | 1986-05-15 |
Family
ID=15981236
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP55174591A Granted JPS5798062A (en) | 1980-12-12 | 1980-12-12 | Communication system between processors |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5798062A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| GB8329509D0 (en) * | 1983-11-04 | 1983-12-07 | Inmos Ltd | Computer |
-
1980
- 1980-12-12 JP JP55174591A patent/JPS5798062A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5798062A (en) | 1982-06-18 |
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