JPS6120232B2 - - Google Patents
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- JPS6120232B2 JPS6120232B2 JP53074036A JP7403678A JPS6120232B2 JP S6120232 B2 JPS6120232 B2 JP S6120232B2 JP 53074036 A JP53074036 A JP 53074036A JP 7403678 A JP7403678 A JP 7403678A JP S6120232 B2 JPS6120232 B2 JP S6120232B2
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- offset voltage
- current
- resistor
- circuit
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Description
【発明の詳細な説明】
本発明は、ホール素子の不平衡出力を補償する
補償回路に関する。
補償回路に関する。
回転子の回転位置を検出する位置検出手段の検
出出力を増幅器でもつて増幅してモータの２相の
コイルに供給し、コイルの鎖交磁束と同相の正弦
波状の駆動電流を夫々のコイルに流すようにした
２相交流駆動ブラシレスモータが知られている。
出出力を増幅器でもつて増幅してモータの２相の
コイルに供給し、コイルの鎖交磁束と同相の正弦
波状の駆動電流を夫々のコイルに流すようにした
２相交流駆動ブラシレスモータが知られている。
第１図はこのような従来から知られている２相
交流駆動ブラシレスモータの回路図である。第１
図において、回転子を構成するロータマグネツト
１は例えば２極であつて、180゜ずつの互に逆極
性の正弦波状の着磁部分を有している。固定予側
には２相のコイル２，３が電気角π／２若しくは
π／２の寄数倍の位相差で設けられている。従つ
て、ロータマグネツト１によつて形成されるコイ
ル２，３の鎖交磁束密度は、その最大値をB0と
すると、夫々B1＝Bosinθ及びB2＝B0cosθとな
る。また固定子にはロータマグネツト１を備える
回転子の回転角度を検出するためのホール素子
４，５が第１図に示すようにコイル２，３の夫々
と同相または180゜の整数倍の位相差で設けられ
ている。
交流駆動ブラシレスモータの回路図である。第１
図において、回転子を構成するロータマグネツト
１は例えば２極であつて、180゜ずつの互に逆極
性の正弦波状の着磁部分を有している。固定予側
には２相のコイル２，３が電気角π／２若しくは
π／２の寄数倍の位相差で設けられている。従つ
て、ロータマグネツト１によつて形成されるコイ
ル２，３の鎖交磁束密度は、その最大値をB0と
すると、夫々B1＝Bosinθ及びB2＝B0cosθとな
る。また固定子にはロータマグネツト１を備える
回転子の回転角度を検出するためのホール素子
４，５が第１図に示すようにコイル２，３の夫々
と同相または180゜の整数倍の位相差で設けられ
ている。
これらのホール素子４，５の出力は上記コイル
２，３の鎖交磁束と同相である。即ち、e1＝
K1sinθ及びe2＝K1cosθ（K1：定数）になる検
出出力が得られ、この検出出力はリニア増幅動作
する駆動回路７，８に供給される。従つて、コイ
ル２，３にはi1＝K2sinθ及びi2＝K2cosθで表わ
される駆動電流が流される（K2：定数）。この結
果、マグネツト１によつて形成されるコイル２，
３の鎖交磁束B1，B2と、コイル２，３を流れる
駆動電流とによつて生ずるトルクは、 Ｔ＝K2B0sin2θ＋K2B0cos2θ＝K2B0 ………… となつて、回転子の回転角θに一定となる。
２，３の鎖交磁束と同相である。即ち、e1＝
K1sinθ及びe2＝K1cosθ（K1：定数）になる検
出出力が得られ、この検出出力はリニア増幅動作
する駆動回路７，８に供給される。従つて、コイ
ル２，３にはi1＝K2sinθ及びi2＝K2cosθで表わ
される駆動電流が流される（K2：定数）。この結
果、マグネツト１によつて形成されるコイル２，
３の鎖交磁束B1，B2と、コイル２，３を流れる
駆動電流とによつて生ずるトルクは、 Ｔ＝K2B0sin2θ＋K2B0cos2θ＝K2B0 ………… となつて、回転子の回転角θに一定となる。
第２図は第１図のモータ駆動回路の回路図であ
る。第２図に示すように、ホール素子４の電流端
子４ａには電流源１１から所定方向の動作電流ｉ
が供給される。なおホール素子４の一方の電流端
子４ｂは接地されている。ホール素子４は第１図
のロータマグネツト１の磁束に感応してその磁束
密度に応じた正弦波状の検出出力ｅを発生する。
この検出出力はホール素子４の出力端子４ｃ，４
ｄから抵抗Ｒ１、Ｒ２を介して演算増幅器１０の
＋及び−入力端子に夫々供給される。この演算増
幅器１０の出力は、抵抗Ｒ５を介してパワートラ
ンジスタＴ１，Ｔ２からなるプツシユプル回路１
３に供給され、ここで電力増幅された後コイル２
に供給される。
る。第２図に示すように、ホール素子４の電流端
子４ａには電流源１１から所定方向の動作電流ｉ
が供給される。なおホール素子４の一方の電流端
子４ｂは接地されている。ホール素子４は第１図
のロータマグネツト１の磁束に感応してその磁束
密度に応じた正弦波状の検出出力ｅを発生する。
この検出出力はホール素子４の出力端子４ｃ，４
ｄから抵抗Ｒ１、Ｒ２を介して演算増幅器１０の
＋及び−入力端子に夫々供給される。この演算増
幅器１０の出力は、抵抗Ｒ５を介してパワートラ
ンジスタＴ１，Ｔ２からなるプツシユプル回路１
３に供給され、ここで電力増幅された後コイル２
に供給される。
第２図に示す回路において、ホール素子４の検
出出力ｅにはオフセツト電圧Δｅ（不平衡電圧）
が含まれている。即ち、ホール素子４に与えられ
る磁束が零のときも幾分かの正または負の直流電
圧が出力端子４ｃ，４ｄ間に発生している。従つ
て、モータが駆動されている時のホール素子４の
正弦波状の出力電圧ｅの波形は、上記直流電圧に
相当したレベルΔｅだけ正または負にオフセツト
されている。このオフセツト電圧Δｅはホール素
子４の構造に起因して発生し、例えば出力端子４
ｃ，４ｄの相互の位置ずれによつて生ずる。従つ
て、このオフセツト電圧Δｅはホール素子４の
個々の製造精度によつて異なり、またホール素子
４の駆動電流ｉに応じて増減する。
出出力ｅにはオフセツト電圧Δｅ（不平衡電圧）
が含まれている。即ち、ホール素子４に与えられ
る磁束が零のときも幾分かの正または負の直流電
圧が出力端子４ｃ，４ｄ間に発生している。従つ
て、モータが駆動されている時のホール素子４の
正弦波状の出力電圧ｅの波形は、上記直流電圧に
相当したレベルΔｅだけ正または負にオフセツト
されている。このオフセツト電圧Δｅはホール素
子４の構造に起因して発生し、例えば出力端子４
ｃ，４ｄの相互の位置ずれによつて生ずる。従つ
て、このオフセツト電圧Δｅはホール素子４の
個々の製造精度によつて異なり、またホール素子
４の駆動電流ｉに応じて増減する。
このオフセツト電圧Δｅは演算増幅器１０、プ
ツシユプル回路１３によつて増幅されるので、コ
イル２に直流オフセツト電流が流れる。この結
果、コイル２を往復して流れる正弦波状の駆動電
流の一方方向の電流が増加してトルク損失が生
じ、無効電力が増大する。また第１式が成立しな
くなつてトルクリツプルが増大する。
ツシユプル回路１３によつて増幅されるので、コ
イル２に直流オフセツト電流が流れる。この結
果、コイル２を往復して流れる正弦波状の駆動電
流の一方方向の電流が増加してトルク損失が生
じ、無効電力が増大する。また第１式が成立しな
くなつてトルクリツプルが増大する。
従つて、第２図に示すモータ駆動回路において
は、ホール素子４のオフセツト電圧キヤンセル手
段が設けられている。即ち、＋Ｖ及び−Ｖの電源
電圧を抵抗Ｒ６、可変抵抗VR及び抵抗Ｒ７でも
つて分圧し、可変抵抗VR１の可動端子から得ら
れるキヤンセル電圧Δｃをホール素子４の一方の
出力端子４ｄに加えている。そして可変抵抗VR
１を調整してオフセツト電圧Δｅが零になるよう
にしている。なお上述のような２相交流駆動ブラ
シレスモータをダイレクトドライブ方式のターン
テーブル駆動モータとして使用する場合には、例
えば、ターンテーブルが331/3回転のとき上記オ
フセツト電圧Δｅが零となるように調整し、トル
クリツプルが最小になるようにしている。
は、ホール素子４のオフセツト電圧キヤンセル手
段が設けられている。即ち、＋Ｖ及び−Ｖの電源
電圧を抵抗Ｒ６、可変抵抗VR及び抵抗Ｒ７でも
つて分圧し、可変抵抗VR１の可動端子から得ら
れるキヤンセル電圧Δｃをホール素子４の一方の
出力端子４ｄに加えている。そして可変抵抗VR
１を調整してオフセツト電圧Δｅが零になるよう
にしている。なお上述のような２相交流駆動ブラ
シレスモータをダイレクトドライブ方式のターン
テーブル駆動モータとして使用する場合には、例
えば、ターンテーブルが331/3回転のとき上記オ
フセツト電圧Δｅが零となるように調整し、トル
クリツプルが最小になるようにしている。
このようなターンテーブルモータは速度サーボ
がかけられていて、一般には、サーボ電圧（速度
誤差検出信号）に応じてホール素子４の動作電流
ｉを変化させてホール素子４の出力電圧を増減さ
せ、これによつてモータ駆動電流を制御してター
ンテーブルの回転速度制御をしている。しかし、
第２図のオフセツト電圧キヤンセル手段は半固定
であるので、ホール素子の動作電流ｉが変化する
とオフセツト電圧Δｅもこれに応じて変化する。
がかけられていて、一般には、サーボ電圧（速度
誤差検出信号）に応じてホール素子４の動作電流
ｉを変化させてホール素子４の出力電圧を増減さ
せ、これによつてモータ駆動電流を制御してター
ンテーブルの回転速度制御をしている。しかし、
第２図のオフセツト電圧キヤンセル手段は半固定
であるので、ホール素子の動作電流ｉが変化する
とオフセツト電圧Δｅもこれに応じて変化する。
第３図はホール素子４の動作電流ｉが変化した
ときのオフセツト電圧Δｅの変化を示している。
第３図に示すように、例えば331/3回転のとき
（ホール素子動作電流ｉがほゞ１ｍＡのとき）、第
３図Ｑ点のようにオフセツト電圧Δｅを零に調整
しても、動作電流ｉが変化すると、この変化に
ほゞ比例してオフセツト電圧Δｅが変化する。な
お動作電流ｉの８ｍＡ以上の領域において、第３
図の特性曲線が直線（点線で示す）から外れて非
線形性を示すのは、ホール素子４の不純物による
キヤリアの拡散の影響が出てくるためである。従
つて、例えばモータの駆動時にはホール素子の動
作電流ｉが８〜10倍になり、これに応じてオフセ
ツト電圧Δｅが増大するので、このオフセツト電
圧によつてトルクリツプルが増加して振動、騒音
が発生することがある。
ときのオフセツト電圧Δｅの変化を示している。
第３図に示すように、例えば331/3回転のとき
（ホール素子動作電流ｉがほゞ１ｍＡのとき）、第
３図Ｑ点のようにオフセツト電圧Δｅを零に調整
しても、動作電流ｉが変化すると、この変化に
ほゞ比例してオフセツト電圧Δｅが変化する。な
お動作電流ｉの８ｍＡ以上の領域において、第３
図の特性曲線が直線（点線で示す）から外れて非
線形性を示すのは、ホール素子４の不純物による
キヤリアの拡散の影響が出てくるためである。従
つて、例えばモータの駆動時にはホール素子の動
作電流ｉが８〜10倍になり、これに応じてオフセ
ツト電圧Δｅが増大するので、このオフセツト電
圧によつてトルクリツプルが増加して振動、騒音
が発生することがある。
本発明は上述の問題点にかんがみてなされたも
のであつて、ホール素子の一対の出力端子の夫々
と、このホール素子の一対の直流端子の少なくと
も一方との間に接続されたバイアス回路を具備す
るように構成したものである。このように構成す
ることによつて、簡単な回路構成でもつてホール
素子の動作電流に追従してホール素子の不平衡出
力を補償することができるようにすることを目的
とする。
のであつて、ホール素子の一対の出力端子の夫々
と、このホール素子の一対の直流端子の少なくと
も一方との間に接続されたバイアス回路を具備す
るように構成したものである。このように構成す
ることによつて、簡単な回路構成でもつてホール
素子の動作電流に追従してホール素子の不平衡出
力を補償することができるようにすることを目的
とする。
以下本発明の実施例を図面を参照して説明す
る。
る。
第４図はホール素子４の等価回路図である。ホ
ール素子の電流端子４ａ，４ｂ間のインピーダン
スは内部抵抗Ｒ１１及びＲ１２で代表される。ま
たこれらの抵抗Ｒ１１とＲ１２との間にはオフセ
ツト電圧Δｅの発生源となる抵抗R0が存在して
いる。抵抗R0の両端にはホール効果によつて生
ずる起電力の発生源となる電圧源１４及び１５が
夫々逆極性で接続される。なお電圧源１４，１５
によつて発生される逆極性の起電力は互にほゞ等
しく、KBi（Ｋ：定数、Ｂ：磁束、ｉ：動作電
流）で表わされる。これらの電圧源１４，１５の
出力は夫々出力抵抗Ｒ１２及びＲ２２を介して出
力端子４ｃ，４ｄから外部に導出される。
ール素子の電流端子４ａ，４ｂ間のインピーダン
スは内部抵抗Ｒ１１及びＲ１２で代表される。ま
たこれらの抵抗Ｒ１１とＲ１２との間にはオフセ
ツト電圧Δｅの発生源となる抵抗R0が存在して
いる。抵抗R0の両端にはホール効果によつて生
ずる起電力の発生源となる電圧源１４及び１５が
夫々逆極性で接続される。なお電圧源１４，１５
によつて発生される逆極性の起電力は互にほゞ等
しく、KBi（Ｋ：定数、Ｂ：磁束、ｉ：動作電
流）で表わされる。これらの電圧源１４，１５の
出力は夫々出力抵抗Ｒ１２及びＲ２２を介して出
力端子４ｃ，４ｄから外部に導出される。
第４図の等価回路から明らかなように、電流端
子４ａに供給される動作電流ｉに比例した直流の
オフセツト電圧Δｅ＝R0iが出力端子４ｃ，４ｄ
間に生ずる。即ち、Ｂ＝Ｏで起電力が零のときも
出力Δｅが生じている。そこで本出願の発明者
は、第５Ａ図に示すように、ホール素子４の各端
子４ａ〜４ｄに点Ａ〜Ｄを頂点とする抵抗Ｒ３１
〜３５から成る不平衡ブリツジ回路を接続して、
上記オフセツト電圧をキヤンセルすることを考え
た。この場合、ブリツジ回路は不平衡であるから
ブリツジのＣ−Ｂ間及びＢ−Ｄ間に接続される抵
抗Ｒ３２，Ｒ３３は省略してもよい。
子４ａに供給される動作電流ｉに比例した直流の
オフセツト電圧Δｅ＝R0iが出力端子４ｃ，４ｄ
間に生ずる。即ち、Ｂ＝Ｏで起電力が零のときも
出力Δｅが生じている。そこで本出願の発明者
は、第５Ａ図に示すように、ホール素子４の各端
子４ａ〜４ｄに点Ａ〜Ｄを頂点とする抵抗Ｒ３１
〜３５から成る不平衡ブリツジ回路を接続して、
上記オフセツト電圧をキヤンセルすることを考え
た。この場合、ブリツジ回路は不平衡であるから
ブリツジのＣ−Ｂ間及びＢ−Ｄ間に接続される抵
抗Ｒ３２，Ｒ３３は省略してもよい。
従つて、第５図ａに示すような抵抗Ｒ３１，Ｒ
３４，Ｒ３５から成る３端子回路のＣ−Ｄ間の電
圧を調整することによつてオフセツト電圧Δｅを
キヤンセルすることができる。この電圧調整は例
えば抵抗Ｒ３１及びＲ３４の一方または両方を調
整することによつて行うことができるが、第５Ｂ
図ｂに示すように△−Ｙ変換した抵抗Ｒ３６及び
可変抵抗VR２から成る回路でもつて調整しても
よい。
３４，Ｒ３５から成る３端子回路のＣ−Ｄ間の電
圧を調整することによつてオフセツト電圧Δｅを
キヤンセルすることができる。この電圧調整は例
えば抵抗Ｒ３１及びＲ３４の一方または両方を調
整することによつて行うことができるが、第５Ｂ
図ｂに示すように△−Ｙ変換した抵抗Ｒ３６及び
可変抵抗VR２から成る回路でもつて調整しても
よい。
従つて、第５Ｂ図ｂに基いて、第６図に示すよ
うなオフセツト電圧キヤンセル手段を構成するこ
とができる。第６図に示すように、ホール素子４
の出力端子４ｃ，４ｄ間には可変抵抗VR２が接
続され、この可変抵抗VR２の可動端子は抵抗Ｒ
３６を介して電流供給端子４ａに接続される。そ
して可変抵抗VR２を調整することによつて出力
電圧ｅのオフセツト電圧Δｅはキヤンセルされ、
ホール素子４が線型動作する範囲内では動作電流
ｉが変化してもオフセツト電圧Δｅはほゞ零に保
たれている。
うなオフセツト電圧キヤンセル手段を構成するこ
とができる。第６図に示すように、ホール素子４
の出力端子４ｃ，４ｄ間には可変抵抗VR２が接
続され、この可変抵抗VR２の可動端子は抵抗Ｒ
３６を介して電流供給端子４ａに接続される。そ
して可変抵抗VR２を調整することによつて出力
電圧ｅのオフセツト電圧Δｅはキヤンセルされ、
ホール素子４が線型動作する範囲内では動作電流
ｉが変化してもオフセツト電圧Δｅはほゞ零に保
たれている。
第７図は第６図のオフセツト電圧キヤンセル回
路の動作を説明するための等価回路図である。第
７図に示すように、ホール素子４の電流供給端子
４ａに供給される動作電流ｉはホール素子４内を
流れる電流ｉ０（点線）、抵抗３６、可変抵抗VR
２を通つて出力端子４ｃからホール素子に流入す
る電流ｉ１（実線）及び抵抗Ｒ３６、可変抵抗
VR２を通つて出力端子４ｄからホール素子に流
入する電流ｉ２（一点鎖線）に夫々分流される。
なお電流ｉ０によつて抵抗R0の両端にオフセツ
ト電圧Δｅが発生される。また電流ｉ１は出力端
子４ｃから抵抗Ｒ２１、R0、Ｒ１２を通つて接
地電位に流れ、電流ｉ２は出力端子４ｄから抵抗
Ｒ２２，Ｒ１２を通つて接地電位に流れる。
路の動作を説明するための等価回路図である。第
７図に示すように、ホール素子４の電流供給端子
４ａに供給される動作電流ｉはホール素子４内を
流れる電流ｉ０（点線）、抵抗３６、可変抵抗VR
２を通つて出力端子４ｃからホール素子に流入す
る電流ｉ１（実線）及び抵抗Ｒ３６、可変抵抗
VR２を通つて出力端子４ｄからホール素子に流
入する電流ｉ２（一点鎖線）に夫々分流される。
なお電流ｉ０によつて抵抗R0の両端にオフセツ
ト電圧Δｅが発生される。また電流ｉ１は出力端
子４ｃから抵抗Ｒ２１、R0、Ｒ１２を通つて接
地電位に流れ、電流ｉ２は出力端子４ｄから抵抗
Ｒ２２，Ｒ１２を通つて接地電位に流れる。
第７図において、直流分の電流ｉ０，ｉ１，ｉ
２のみによつて生ずる出力端子４ｃ，４ｄの間の
電位差ΔＥを考えると、 ΔＥ＝R21i1＋R0（i0＋i1）−R22i2 ………… である。従つて、ΔＥ＝０となるようにすればオ
フセツト電圧Δｅ＝R0i０はキヤンセルされる。
２のみによつて生ずる出力端子４ｃ，４ｄの間の
電位差ΔＥを考えると、 ΔＥ＝R21i1＋R0（i0＋i1）−R22i2 ………… である。従つて、ΔＥ＝０となるようにすればオ
フセツト電圧Δｅ＝R0i０はキヤンセルされる。
即ち、第２式より、
R0i0＝R22i2−（R21＋R0）i1 …………
となるように、ｉ１とｉ２との比率を定めれば、
オフセツト電圧Δｅがキヤンセルされる。このｉ
１とｉ２との比率は可変抵抗VR２を調整するこ
とによつて定めることができる。
オフセツト電圧Δｅがキヤンセルされる。このｉ
１とｉ２との比率は可変抵抗VR２を調整するこ
とによつて定めることができる。
なおオフセツト電圧Δｅ＝R0i０は正の場合と
負の場合とがあるが、ｉ１とｉ２との比率の調整
によつていずれの場合でもオフセツト電圧をキヤ
ンセルすることが可能である。
負の場合とがあるが、ｉ１とｉ２との比率の調整
によつていずれの場合でもオフセツト電圧をキヤ
ンセルすることが可能である。
ホール素子４の動作電流ｉが増加して（１＋
α）ｉになつた場合には、第７図の回路が線形性
を示す範囲内では、各電流ｉ０，ｉ１，ｉ２も
夫々１÷αの割合で増加する。従つて、第２式
は、 ΔＥ＝R21（１＋α）i1＋R0（１＋α）（i0＋i1） −R22（１＋α）i2 ＝（１＋α）ΔＥ＝０ ………… となる。即ち、動作電流ｉが変化しても出力端子
４ｃ，４ｄ間に現れるオフセツト電圧は零に保た
れてている。
α）ｉになつた場合には、第７図の回路が線形性
を示す範囲内では、各電流ｉ０，ｉ１，ｉ２も
夫々１÷αの割合で増加する。従つて、第２式
は、 ΔＥ＝R21（１＋α）i1＋R0（１＋α）（i0＋i1） −R22（１＋α）i2 ＝（１＋α）ΔＥ＝０ ………… となる。即ち、動作電流ｉが変化しても出力端子
４ｃ，４ｄ間に現れるオフセツト電圧は零に保た
れてている。
第８図は第６図の実施例におけるホール素子４
の動作電流ｉ及びオフセツト電圧Δｅの関係（実
側値）を示すグラフである。第８図に示すよう
に、０〜4mAまではオフセツト電圧Δｅはほゞ
零となつている。そして4mA以上では極めて微
少であるが除々に増加する。なお従来のキヤンセ
ル回路（例えば第２図）による第３図に示すオフ
セツト電圧−動作電流のグラフを比較のために示
すと点線のようになる。例えば、動作電流が
10mAのときのオフセツト電圧は、従来回路では
8.5mVであるが、本実施例では0.36mVとなつて
いる。即ち、オフセツト電圧ほゞ１／20に低減さ
れる。
の動作電流ｉ及びオフセツト電圧Δｅの関係（実
側値）を示すグラフである。第８図に示すよう
に、０〜4mAまではオフセツト電圧Δｅはほゞ
零となつている。そして4mA以上では極めて微
少であるが除々に増加する。なお従来のキヤンセ
ル回路（例えば第２図）による第３図に示すオフ
セツト電圧−動作電流のグラフを比較のために示
すと点線のようになる。例えば、動作電流が
10mAのときのオフセツト電圧は、従来回路では
8.5mVであるが、本実施例では0.36mVとなつて
いる。即ち、オフセツト電圧ほゞ１／20に低減さ
れる。
なお第８図において動作電流が4mA以上の範
囲でオフセツト電圧が増加するのは、既述のよう
に拡散によつてホール素子が非線形動作をするた
めである。
囲でオフセツト電圧が増加するのは、既述のよう
に拡散によつてホール素子が非線形動作をするた
めである。
次に、第９Ａ図〜第９Ｅ図は第６図に示す実施
例の変形例を夫々示すものである。第９Ａ図は、
第５Ａ図において抵抗Ｒ３２，Ｒ３３，Ｒ３５か
ら成る回路でもつてオフセツト電圧をキヤンセル
するようにしたものであつて、第６図の可変抵抗
VR２の可動端子が抵抗Ｒ３６を介してホール素
子４の他方の電流端子４ｄ（接地電位）に接続さ
れている。
例の変形例を夫々示すものである。第９Ａ図は、
第５Ａ図において抵抗Ｒ３２，Ｒ３３，Ｒ３５か
ら成る回路でもつてオフセツト電圧をキヤンセル
するようにしたものであつて、第６図の可変抵抗
VR２の可動端子が抵抗Ｒ３６を介してホール素
子４の他方の電流端子４ｄ（接地電位）に接続さ
れている。
第９Ａ図のキヤンセル回路の回路動作は第７図
とほゞ同様であつて、この場合には、電流ｉ１，
ｉ２の方向が逆になる。即ち、ホール素子４の電
流供給端子４ａから抵抗Ｒ１１，Ｒ２１可変抵抗
VR２及び抵抗Ｒ３６を通つて接地電位に電流ｉ
１が流れる。また電流供給端子４ａから抵抗Ｒ１
１，R0，Ｒ２２、可変抵抗VR２及び抵抗Ｒ３６
を通つて電流ｉ２が流れる。そして電流ｉ１とｉ
２とを適当な比率にすればオフセツト電圧がキヤ
ンセルされる。
とほゞ同様であつて、この場合には、電流ｉ１，
ｉ２の方向が逆になる。即ち、ホール素子４の電
流供給端子４ａから抵抗Ｒ１１，Ｒ２１可変抵抗
VR２及び抵抗Ｒ３６を通つて接地電位に電流ｉ
１が流れる。また電流供給端子４ａから抵抗Ｒ１
１，R0，Ｒ２２、可変抵抗VR２及び抵抗Ｒ３６
を通つて電流ｉ２が流れる。そして電流ｉ１とｉ
２とを適当な比率にすればオフセツト電圧がキヤ
ンセルされる。
第９図は第６図の抵抗Ｒ３６を省略したもので
ある。第９Ｃ図は第９Ａ図の抵抗Ｒ３６を省略し
たものである。第９Ｄ図及び第９Ｅ図は夫々第９
Ｂ図及び第９Ｄ図において、可変抵抗VR２を抵
抗Ｒ３７と可変抵抗VR３とでもつて構成したも
のである。なお第９Ｄ図及び第９Ｅ図において
は、抵抗Ｒ３７と可変抵抗VR３とを入れ換える
ことができる。
ある。第９Ｃ図は第９Ａ図の抵抗Ｒ３６を省略し
たものである。第９Ｄ図及び第９Ｅ図は夫々第９
Ｂ図及び第９Ｄ図において、可変抵抗VR２を抵
抗Ｒ３７と可変抵抗VR３とでもつて構成したも
のである。なお第９Ｄ図及び第９Ｅ図において
は、抵抗Ｒ３７と可変抵抗VR３とを入れ換える
ことができる。
なお第６図及び第９Ａ〜９Ｅ図の実施例におい
て、キヤンセル回路のＣ点と出力端子４ｃとの間
及びＤ点と出力端子４ｄとの間に夫々抵抗を挿入
してもよい。
て、キヤンセル回路のＣ点と出力端子４ｃとの間
及びＤ点と出力端子４ｄとの間に夫々抵抗を挿入
してもよい。
本発明は上述の如く、ホール素子の一対の出力
端子の夫々と、このホール素子の一対の電流供給
端子の少なくとも一方との間に抵抗より成るバイ
アス回路を接続して、この抵抗の少なくとも１つ
を可変したので、簡単な回路構成でもつてホール
素子の動作電流に追従して不平衡出力を補償する
ことができ、動作電流が変化しても不平衡出力を
極めて小さくすることができる。
端子の夫々と、このホール素子の一対の電流供給
端子の少なくとも一方との間に抵抗より成るバイ
アス回路を接続して、この抵抗の少なくとも１つ
を可変したので、簡単な回路構成でもつてホール
素子の動作電流に追従して不平衡出力を補償する
ことができ、動作電流が変化しても不平衡出力を
極めて小さくすることができる。
第１図は２相交流駆動ブラシレスモータの回路
図、第２図は第１図のモータ駆動回路の回路図、
第３図は第２図のオフセツト電圧キヤンセル回路
によるホール素子駆動電流とオフセツト電圧との
関係を示すグラフ、第４図はホール素子の等価回
路図、第５Ａ図は本発明のオフセツト電圧キヤン
セル回路の原理を示す回路図、第５Ｂ図ａは第５
Ａ図のキヤンセル回路を簡略化した回路図、第５
Ｂ図ｂは第５Ｂ図ａの回路を△−Ｙ変換した回路
図、第６図は本発明の一実施例を示すオフセツト
電圧キヤンセル回路の回路図、第７図は第６図の
動作を説明するための等価回路図、第８図は第６
図のキヤンセル回路によるホール素子動作電流と
オフセツト電圧との関係を示すグラフ、第９Ａ図
〜第９Ｅ図は夫々本発明の別の実施例を示すオフ
セツト電圧キヤンセル回路の回路図である。 なお図面に用いられている符号において、４…
…ホール素子、Ｒ３６……抵抗、VR２……可変
抵抗である。
図、第２図は第１図のモータ駆動回路の回路図、
第３図は第２図のオフセツト電圧キヤンセル回路
によるホール素子駆動電流とオフセツト電圧との
関係を示すグラフ、第４図はホール素子の等価回
路図、第５Ａ図は本発明のオフセツト電圧キヤン
セル回路の原理を示す回路図、第５Ｂ図ａは第５
Ａ図のキヤンセル回路を簡略化した回路図、第５
Ｂ図ｂは第５Ｂ図ａの回路を△−Ｙ変換した回路
図、第６図は本発明の一実施例を示すオフセツト
電圧キヤンセル回路の回路図、第７図は第６図の
動作を説明するための等価回路図、第８図は第６
図のキヤンセル回路によるホール素子動作電流と
オフセツト電圧との関係を示すグラフ、第９Ａ図
〜第９Ｅ図は夫々本発明の別の実施例を示すオフ
セツト電圧キヤンセル回路の回路図である。 なお図面に用いられている符号において、４…
…ホール素子、Ｒ３６……抵抗、VR２……可変
抵抗である。
Claims (1)
- １ ホール素子の一対の出力端子の夫々と、この
ホール素子の一対の電流供給端子の少なくとも一
方との間に接続された抵抗より成るバイアス回路
を具備し、上記バイアス回路を構成する抵抗の少
なくとも一つを可変にしてホール素子の不平衡出
力を補償するようにしたホール素子の不平衡出力
補償回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7403678A JPS54164207A (en) | 1978-06-19 | 1978-06-19 | Hall element unbalanced output compensating circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7403678A JPS54164207A (en) | 1978-06-19 | 1978-06-19 | Hall element unbalanced output compensating circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS54164207A JPS54164207A (en) | 1979-12-27 |
| JPS6120232B2 true JPS6120232B2 (ja) | 1986-05-21 |
Family
ID=13535518
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7403678A Granted JPS54164207A (en) | 1978-06-19 | 1978-06-19 | Hall element unbalanced output compensating circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS54164207A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS56171596U (ja) * | 1980-05-21 | 1981-12-18 |
-
1978
- 1978-06-19 JP JP7403678A patent/JPS54164207A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS54164207A (en) | 1979-12-27 |
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