JPS6149245A - プログラム・モジユ−ル構造の自動解析装置 - Google Patents

プログラム・モジユ−ル構造の自動解析装置

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Publication number
JPS6149245A
JPS6149245A JP59171081A JP17108184A JPS6149245A JP S6149245 A JPS6149245 A JP S6149245A JP 59171081 A JP59171081 A JP 59171081A JP 17108184 A JP17108184 A JP 17108184A JP S6149245 A JPS6149245 A JP S6149245A
Authority
JP
Japan
Prior art keywords
program
module structure
module
lower module
cpu
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP59171081A
Other languages
English (en)
Inventor
Yoichi Ishii
洋一 石井
Kazutaka Tokunaga
徳永 和孝
Kazutaka Inoue
井上 一孝
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP59171081A priority Critical patent/JPS6149245A/ja
Publication of JPS6149245A publication Critical patent/JPS6149245A/ja
Pending legal-status Critical Current

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Classifications

    • GPHYSICS
    • G06COMPUTING OR CALCULATING; COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F11/00Error detection; Error correction; Monitoring
    • G06F11/36Prevention of errors by analysis, debugging or testing of software
    • G06F11/3604Analysis of software for verifying properties of programs

Landscapes

  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Software Systems (AREA)
  • Computer Hardware Design (AREA)
  • Quality & Reliability (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Debugging And Monitoring (AREA)
  • Devices For Executing Special Programs (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 発明の目的 産業上の利用分野 本発明は、指定されたプログラムをプログラム・ライブ
ラリから読出してそのモジュール構造を自動的に解析・
編集・表示する自動解析装置に関するものである。
従来の技術 一般にプログラムは、ユーザーの多種多様な要求や技術
革新に対応できるよう、モジュール構造に基づく開放設
計となっている。
従来、プログラムのモジュール構造を把握するために、
プログラムごとにモジュール構造図を人手で作成し管理
していた。
また、従来はプログラムごとに下位モジュール構造図だ
けを作成していた。
発明が解決しようとする問題点 上述のように、従来はプログラムごとにモジュール構造
図を人手で作成し管理していたので、プログラムのモジ
ュール構造が変更されるたびに1モジユ一ル構造図の修
正に多大な労力を要し、また修正漏れ等の誤りも生じや
すいという問題があった。
また、従来はプログラムごとに下位モジュール構造図だ
けを作成していたので、特定の下位モジュールに着目し
た場合、その下位モジュールがどの上位モジュール(プ
ログラム)に参照されているのかを正確に把握すること
が困難であった。従って、下位モジュールの変更等があ
った場合、その変更等の形容が及ぶ上位モジュールの範
囲を正確に把握することが困難であるという問題があっ
た。
発明の構成 問題点を解決するための手段 上記問題点を解決する本発明は、プログラム・ライブラ
リから指定されたプログラムを読出す読出手段と、該読
出手段から読出されたプログラムから下位モジュール参
照命令を抽出する抽出手段と、該抽出手段から抽出され
た各下位モジュール参照命令からモジュール構造を整理
して記憶する記憶手段と、該記憶手段の記憶内容を指令
に応じて表示する手段とを備えるように構成されている
!作用 本発明に係わるプログラム・モジュール構造の自動解析
装置は、指定されたプログラムのモジュール構造を自動
的に解析し、整理し1表示するように動作する。
以下1本発明の構成を実施例により更に詳細に説明する
実施例 第1図は2本発明の一実施例のプログラム・モジュール
構造の自動解析装置1oを、プログラム・ライブラリ2
0と共に示すブロック図である。
このプログラム・モジュール構造の自動解析装置10は
、CPUl1.一時記憶装置12.記憶装置13.入力
装置14及び出力装置15を備えている。
以下、第2図のフローチャートを使用して本装置10の
動作を説明する。
CPU11は、動作を開始すると、まずステップ31に
おいて、入力装置14から紙カード等による指令を読取
る。CPUI 1は2次のステップ32において、入力
装置14がらの指令がモジュール構造の解析指令である
と判定すると、ステップ33に進む。ステップ33にお
いて、モジュール構造の解析対象となるソース・プログ
ラムが。
プログラム・ライブラリ20から一時記憶装置12に言
売込まれる。CPUI 1は、プログラムの君売込みカ
リ冬了すると9次のステップ34に進む。ステップ34
において、一時記憶装置20内に読込まれたプログラム
のヘッダ部分がCPUIIに読取られ、解析され、使用
言語タイプが認識される。
CPUI 1は、使用言語タイプに応じて、モジュール
構造の解析に必要な下位モジュール参照命令のパターン
をレジスタに設定する。例えば、この使用言語タイプが
C0BOLの場合、CPU11は、ソース・プログラム
のモジュール構造の解析に必要なCALL命令、C0P
Y命令、ザブスキーマ・エントリ等のパターンをレジス
タに設定する。
次のステップ35において、ソース・プログラムの最初
の1ステツプ(1文)がCPUI 1に読取られる。C
PUI 1は、ステ・ノブ36〜38において、一時記
憶装置12から読取った最初の1文をレジスタに設定し
た各パターンと照合することにより、これがCALL命
令、C0PY命令。
サブスキーマ・エントリ等下位モジュール参照命令のい
ずれかに該当するかどうかを検査する。CPUIIは、
最初の1文が下位モジュール参照命令のいすにも該当し
ない場合にはステップ39に進み、上記検査の終了した
1文が一時記憶装置12に読込まれたプログラムの最終
文であるがどうかを判定する。
この場合、最終文ではないので、CPUIIの動作はス
テップ35に戻る。ステップ35において、内部記憶装
置20内に読込まれたプログラムの次の1ステツプ(1
文)がCPUIIに読取られ、この1文についても、下
位モジュール参照命令のいずれかに該当するかどうかが
検査される。
このようにして、CPUIIは、プログラムの各ステッ
プについて次々に、下位モジュール参照命令のいずれか
に該当するかどうかを検査する。
CPUI 1は、ステップ36〜38のいずれかにおい
て、内部記憶装置12から読取ったプログラムの1文が
下位モジュール参照命令に該当する場合には、ステップ
40に進む。CPUIIは。
ステップ40において、下位モジュール参照命令に該当
する1文を一時記憶装置12に記す、aシた後。
ステップ39を経て、ステップ35に戻る。
プログラムの最終ステップに至るまで、 −に述のよう
な下位モジュール参照命令の抽出が繰返される。CPU
I 1は、ステップ39でプログラムの終了を判定する
と、ステップ41に進む。CPU11は、ステップ41
において、解析の終了したプログラムが入力装置14か
ら解析指令のあった最終のプログラムであるかどうかを
判定する。解析指令のあった最終プログラムでなければ
、CPU1lは、ステップ33において1次に解析すべ
きソース・プログラムをプログラム・ライブラリ20か
ら一時記憶装置12に読込む。この後、一時記憶装置1
2に読込まれたプログラムに対して。
上述したと全く同様の下位モジュール参照命令の。
抽出が行われる。
CPUI 1は、解析指令のあった全てのプログラムに
ついて上述のような下位モジュール参照命令の抽出を終
了すると、ステップ42に進む。CPUI 1は、ステ
ップ42において、各プログラムから抽出した下位モジ
ュール参照命令を整理することにより、各プログラムが
参照している下位モジュールのリストと、各下位モジュ
ールを参照しているプログラム(上位モジュール)のリ
ストを作成し、これらを記憶装置13に書込む。これら
のリストが既に書込まれている場合には、新たに作成さ
れたリストによって旧リストの更新が行われる。従って
、プログラムを変更・修正するたびに、そのプログラム
についてモジュール構造の解析指令を発することにより
、モジュール構造のリストは自動的に更新される。
第3図は、各プログラムについて作成された下位モジュ
ールのリストの一例を示している。プログラムAでは、
下位モジュール(サブルーチン・プログラム)a、b、
cがCALLされ、下位モジュール(登録集メンバ)d
、eがC0PYされ。
サブスキーマx、yが参照されることが例示されている
。一方、プログラムBでは、下位モジュールb、cがC
ALLされており、また下位モジュールaがC0PYさ
れていることが例示されている。
第4図は、各下位モジュールについて作成された上位モ
ジュールのリストの一例を示している。
モジュールaは、プログラムA、 D、 EによってC
ALLされることが例示されている。一方、モジュール
bとCは、プログラムA、B、FによってCALLされ
、モジエールdはプログラムA。
B、HによってC0PYされることが例示されている。
’  CPUIIは、上述のような下位モジュールと上
位モジュールのリストからなるモジュール構造の作成を
終了すると、ステップ43に進む。表示が指令されてい
るモジュール構造を出力装置15に出力し表示させ、動
作を終了する。
入力装置14からの指令が、既に作成されてい。
るモジュール構造の表示である場合には1判定ステップ
32から直ちにステップ43に進み9表示が指令されて
いるモジュール構造を出力装置15に出力し表示させる
これらのモジュール構造リスト、には必要に応じて9作
成/更新の日付1作成/更新者の氏名。
所属の識別番号等が付記される。
以上、解析対象のプログラムをプログラム・ライブラリ
から一旦一時記憶装置12に読込む構成を例示したが、
プログラム・ライブラリから直接1ステツプずつCPU
I 1に読取るように構成してもよい。
また、下位モジュール参照命令ごとに下位モジュールと
上位モジュールのリストを作成する構成を例示したが、
下位モジュール参照命令の種別にかかわりな(モジュー
ルのみをリストアンプするように構成してもよい。
プログラム・ライブラリに格納されているプログラムが
ソース・プログラムである場合を例示したが、オブジェ
クト・プログラム、ロード・モジュールに対しても同様
に本発明を適用できる。
発明の効果 以上詳細に説明したように9本発明は、指定されたプロ
グラムとモジュールの関連を自動的に。
′A7折、記1a2表示するように構成されているので
従来のように多大な労力や誤りのおそれがなく迅速かつ
正確にプログラムのモジュール構造を作成し、更新する
ことができるという利点がある。
また、下位モジュール構造だけでなく、上位モジュール
構造をも作成し、更新する構成であるから、下位モジュ
ールの変更が上位モジュールに及ぼす影響の範囲を迅速
かつ正確に把握することができるという利点がある。
【図面の簡単な説明】
第1図は本発明の一実施例の構成をプログラム・ライブ
ラリと共に示すブロック図、第2図は上記実施例の動作
を説明するためのフローチャート。 第3図と第4図は作成さたモジュール構造リストの一例
を示す概念図である。 10・・プログラム・モジュール構造の自動5貿近装置
、11・・CPU、12・・一時記憶装置。 13・・記憶装置、14・・入力装置、15・・出力装
置。 茶 1  図 屋 # 3 面    某 4 面

Claims (1)

  1. 【特許請求の範囲】 指定されたプログラムをプログラム・ライブラリから読
    出す読出手段と、 該読出手段から読出されたプログラムの各ステップから
    下位モジュール参照命令を抽出する抽出手段と、 該抽出手段から抽出された各下位モジュール参照命令か
    らプログラム・モジュール構造を整理して記憶する記憶
    手段と、 該記憶手段の記憶内容を指令に応じて表示する手段とを
    備えたことを特徴とするプログラム・モジュール構造の
    自動解析装置。
JP59171081A 1984-08-17 1984-08-17 プログラム・モジユ−ル構造の自動解析装置 Pending JPS6149245A (ja)

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JP59171081A JPS6149245A (ja) 1984-08-17 1984-08-17 プログラム・モジユ−ル構造の自動解析装置

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JP59171081A JPS6149245A (ja) 1984-08-17 1984-08-17 プログラム・モジユ−ル構造の自動解析装置

Publications (1)

Publication Number Publication Date
JPS6149245A true JPS6149245A (ja) 1986-03-11

Family

ID=15916654

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JP59171081A Pending JPS6149245A (ja) 1984-08-17 1984-08-17 プログラム・モジユ−ル構造の自動解析装置

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Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63197229A (ja) * 1987-02-12 1988-08-16 Fujitsu Ltd モジユ−ル構造自動生成方式
JPH01310438A (ja) * 1988-06-08 1989-12-14 Nec Corp コール元モジュール検索方式
JPH03157725A (ja) * 1989-11-16 1991-07-05 Sharp Corp 自動フローチャート作成装置
JPH0497426A (ja) * 1990-08-15 1992-03-30 Nec Corp 言語処理プログラムのリスト出力方式
CN102541526A (zh) * 2010-12-27 2012-07-04 富泰华工业(深圳)有限公司 程序结构自动解析电子装置及方法

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