JPS62149097U - - Google Patents

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JPS62149097U
JPS62149097U JP3496987U JP3496987U JPS62149097U JP S62149097 U JPS62149097 U JP S62149097U JP 3496987 U JP3496987 U JP 3496987U JP 3496987 U JP3496987 U JP 3496987U JP S62149097 U JPS62149097 U JP S62149097U
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Description

【図面の簡単な説明】
第１図は本考案の実施例の構成を示す説明図、
第２図は第１図の実施例の要部の詳細説明図、第
３図ａ，ｂは本考案の要部の動作説明図であり、
図中、１は鍵信号発生回路、２はバツフア増幅器
、３はコンパレータ、４はウインドコンパレータ
、５は押鍵検出回路、６は発振器、７はアツプダ
ウンカウンタ、１０はラツチ回路、１１はＤ／Ａ
変換器、１２は楽音形成回路、２１は加算器、２
２はパターンメモリ（ＲＯＭ）、２３はエンコー
ダ、２４はパターン選択スイツチを示す。

Claims (1)

  1. 【実用新案登録請求の範囲】 押鍵に対応した信号を発生する鍵信号発生回路
    １、 該鍵信号発生回路１の出力信号より押鍵信号を
    検出する押鍵検出回路５、 該押鍵検出回路５の押鍵信号によりリセツトさ
    れその発振周波数を変化し得る発振器６、 該発振器６の出力信号をクロツク部に入力して
    アツプカウント動作またはダウンカウント動作を
    開始するアツプダウンカウンタ７、 前記鍵信号発生回路１の出力信号と前記アツプ
    ダウンカウンタ７の出力信号とを比較し該比較信
    号によつて前記アツプカウンタ７のアツプカウン
    トまたはダウンカウント制御をするコンパレータ
    ３、 前記鍵信号発生回路１の出力と前記アツプダウ
    ンカウンタ７の出力信号とが一致する時前記アツ
    プダウンカウンタ７を停止させる手段、グリツサ
    ンド効果の２音間の変化パターンの加算データを
    格納しパターン選択スイツチ２４により読み出す
    記憶回路２２、 前記アツプダウンカウンタ７の出力信号と前記
    記憶回路２２から読み出された加算データとを加
    算して出力する加算回路２１、 該加算回路２１の出力信号を記憶するラツチ回
    路１０、 および該ラツチ回路１０の出力信号を楽音に変
    換する楽音波形形成回路１２を具えたことを特徴
    とする電子楽器。
JP1987034969U 1987-03-10 1987-03-10 Expired JPH0419591Y2 (ja)

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JPS62149097U true JPS62149097U (ja) 1987-09-21
JPH0419591Y2 JPH0419591Y2 (ja) 1992-05-01

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ID=30844023

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Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5252624U (ja) * 1975-10-14 1977-04-15
JPS53143622U (ja) * 1977-04-19 1978-11-13

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5252624U (ja) * 1975-10-14 1977-04-15
JPS53143622U (ja) * 1977-04-19 1978-11-13

Also Published As

Publication number Publication date
JPH0419591Y2 (ja) 1992-05-01

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