JPS62149498A - 情報カ−ド - Google Patents
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- JPS62149498A JPS62149498A JP60294310A JP29431085A JPS62149498A JP S62149498 A JPS62149498 A JP S62149498A JP 60294310 A JP60294310 A JP 60294310A JP 29431085 A JP29431085 A JP 29431085A JP S62149498 A JPS62149498 A JP S62149498A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は内部に情報処理を行う半尋体素子金内蔵した情
報カードに関する。
報カードに関する。
クレジットカードや、IDカードあるいはプロセスカー
ドとして、カード自体の中にICメモリやマイクロコン
ピュータ等のICチップを内蔵している情報カードが、
従来の磁気カードの代替や。
ドとして、カード自体の中にICメモリやマイクロコン
ピュータ等のICチップを内蔵している情報カードが、
従来の磁気カードの代替や。
工程管理票の代用として考えられておシ、フランスでは
電話カードとして既に実用されている。
電話カードとして既に実用されている。
このように半轡体素子チッフーを内蔵した情報カードは
、従来の磁気カードとの共用性をきえ、半専体素子モジ
ーール部以外は、ホリ塩化ビニールやポリエステル等の
プラスチックで長方形状に封入され、前記モジニール端
子部の一部のカバープラスチック部に端子孔が開口され
ている。
、従来の磁気カードとの共用性をきえ、半専体素子モジ
ーール部以外は、ホリ塩化ビニールやポリエステル等の
プラスチックで長方形状に封入され、前記モジニール端
子部の一部のカバープラスチック部に端子孔が開口され
ている。
この情報カードは、表面が絶縁プラスナックで侮成され
ているため、又内蔵ICはMOSあるいは0MO8m造
のものが採用ちれているため、静電気による内蔵ICの
破壊が多発する。このために、これまではIcの入出力
端子の電極バッド近辺に保獲抵抗回路を形成したり、あ
るいは特開昭59−46085に示されているようにモ
ジュール端子近辺に他の放電しやすい第2の放電電極を
形成したり、あるいはカード表面に導体層を形成してカ
ード自体の帯電性を低くすることによシ、情報カードの
ICの静電破壊防止対策を行っていた。
ているため、又内蔵ICはMOSあるいは0MO8m造
のものが採用ちれているため、静電気による内蔵ICの
破壊が多発する。このために、これまではIcの入出力
端子の電極バッド近辺に保獲抵抗回路を形成したり、あ
るいは特開昭59−46085に示されているようにモ
ジュール端子近辺に他の放電しやすい第2の放電電極を
形成したり、あるいはカード表面に導体層を形成してカ
ード自体の帯電性を低くすることによシ、情報カードの
ICの静電破壊防止対策を行っていた。
しかしながら、これらの対策だけでは充分ではなく、↑
ド5報刀−ドとの電気信号をやり取シする情報カード用
端末等の探針等の外部端子が静電気を帯電している場合
や、モジュール近辺の放電電極を介して他の部材からの
高圧の静電気が流れた場合、カード表面の導体層を介し
て他からの静電気が流れた場合等には、やはり情報カー
ドに内蔵されているICの静電破壊を防止することは困
難であった。
ド5報刀−ドとの電気信号をやり取シする情報カード用
端末等の探針等の外部端子が静電気を帯電している場合
や、モジュール近辺の放電電極を介して他の部材からの
高圧の静電気が流れた場合、カード表面の導体層を介し
て他からの静電気が流れた場合等には、やはり情報カー
ドに内蔵されているICの静電破壊を防止することは困
難であった。
本発明の情報カードは内部に情報処理を行う半導体素子
を内蔵している。又、該情報カードは、該半導体素子の
外部電極端子をカード面に有しており、電気的情報16
号の入出力を行う時たけ、それぞれの電極端子に電気的
に分離され、入出力信号処理可能な状態となる特徴を有
している。
を内蔵している。又、該情報カードは、該半導体素子の
外部電極端子をカード面に有しており、電気的情報16
号の入出力を行う時たけ、それぞれの電極端子に電気的
に分離され、入出力信号処理可能な状態となる特徴を有
している。
枯」ち、他の信号入出力装置の端子がM記情報カードの
電極端子に接触することにより、該情報カードの141
端子の全導通状態が解除され、それぞれの端子として絶
縁分離されて、前記信号入出力装置との情報信号処理を
行う。次に信号処理が完了し、該信号入出力装置の端子
が、該情報カードの電極との接触が解除きれると、該情
報カードの電極端子はすべて、導通状態に戻る機能を有
している。
電極端子に接触することにより、該情報カードの141
端子の全導通状態が解除され、それぞれの端子として絶
縁分離されて、前記信号入出力装置との情報信号処理を
行う。次に信号処理が完了し、該信号入出力装置の端子
が、該情報カードの電極との接触が解除きれると、該情
報カードの電極端子はすべて、導通状態に戻る機能を有
している。
次に本発明について図面を参照して説明する。
第1図は1本発明の一実施例の情報カードの平面図であ
る。グラスチック情報カード1は、ISO規格を満足す
る寸法で厚さ0.7611!、幅540闘、長さ86.
0mで、磁気テープ2と半導体モジュール3(破線領域
)を有している。開孔部は、半導体モジュール3の電極
端子4である。
る。グラスチック情報カード1は、ISO規格を満足す
る寸法で厚さ0.7611!、幅540闘、長さ86.
0mで、磁気テープ2と半導体モジュール3(破線領域
)を有している。開孔部は、半導体モジュール3の電極
端子4である。
第2図は、ita:極端子4の拡大平面図である。一点
鎖線で囲まれている領域は、情報カード内に埋設されて
いる導通メタル層5である。導通メタル層5は、それぞ
れ電極端子4に合わせた開孔6を有している。
鎖線で囲まれている領域は、情報カード内に埋設されて
いる導通メタル層5である。導通メタル層5は、それぞ
れ電極端子4に合わせた開孔6を有している。
第3図は、電極端子4部における縦断面図である。7は
、半導体装置モジュールで、表面に電極端子4を有して
お9、全体でs 0.35m厚に設計しである。
、半導体装置モジュールで、表面に電極端子4を有して
お9、全体でs 0.35m厚に設計しである。
半導体モジュールi、0MO8LSIメモリとCMOS
マイクロコンピュータLSIとを搭載しており、LSI
部はエポキシ樹脂でホラティング封止しである。導体パ
ターンは20μm厚の銅で形成し又あり、基材板はガラ
スエポキシ、ポリイミド、トリアジン材を使用している
。電極端子4の表面は、ニッケルメッキ6μm、金メッ
キ4μm旋しである。8は、@質塩化ヒニル板でs
0.55ysnノリとしである。9.10は、0.1m
s+厚の塩化ビニル7−トで、シート9には、あらがじ
め0.05m1J%1の金メッキ付きニッケル導通メタ
ル5をD「定位置に添付し、必要な開孔6を設けである
。本情報カードの製造プロセスは、主に次の工程を経る
ことによシ得られる。
マイクロコンピュータLSIとを搭載しており、LSI
部はエポキシ樹脂でホラティング封止しである。導体パ
ターンは20μm厚の銅で形成し又あり、基材板はガラ
スエポキシ、ポリイミド、トリアジン材を使用している
。電極端子4の表面は、ニッケルメッキ6μm、金メッ
キ4μm旋しである。8は、@質塩化ヒニル板でs
0.55ysnノリとしである。9.10は、0.1m
s+厚の塩化ビニル7−トで、シート9には、あらがじ
め0.05m1J%1の金メッキ付きニッケル導通メタ
ル5をD「定位置に添付し、必要な開孔6を設けである
。本情報カードの製造プロセスは、主に次の工程を経る
ことによシ得られる。
まず、モジュール7を内包できる開孔12を有する硬質
塩化ビニル板8金準備し、該塩化ビニル板8の片面に、
塩化ビニルシート10t−添付する。
塩化ビニル板8金準備し、該塩化ビニル板8の片面に、
塩化ビニルシート10t−添付する。
この際塩化ビニルシートにはシリコーンゴムエラストマ
ー板11(厚み0.16闘)を所定位置に貼付しである
。次いで半導体装置モジュール7を開孔12の中に入れ
、更に上面を塩化ビニルシート9で熱圧接する。以上の
工程を経ることによシ、本発明情報カードを形成できる
。第4図は1本発明実施例の情報カードを信号入出力端
末装置に通した時の接触探針13で押えられた時の電極
端子4との接触状況が示しである。シリコーンエラスト
マー11は弾性係数が極めて優れているので、電極端子
4と接触探針13との電気接触は極めて良くなる上、電
極端子4の導通メタル5との接触も容易に解除できる程
に収縮する。又、接触探針13の圧力が解除されると、
ニジストマー11は容易に原形に復し、モジュール7の
電極端子4は導通メタル5と再度接触する。以上のよう
に1本発明情報カードは、すべての外部電極端子が、情
報処理待以外は、同電位に短絡されているため、いかな
る静電気が端子部に加えられても、半害体素子部が静電
破壊を受けることがない。又、接触探針13が帯電して
いても電極端子4に触れる寸前又は、同時に導通メタル
5を経由して放電する。従って望むらくは、導通メタル
5はアース端子として、接地さノ1.ている構造がよい
。
ー板11(厚み0.16闘)を所定位置に貼付しである
。次いで半導体装置モジュール7を開孔12の中に入れ
、更に上面を塩化ビニルシート9で熱圧接する。以上の
工程を経ることによシ、本発明情報カードを形成できる
。第4図は1本発明実施例の情報カードを信号入出力端
末装置に通した時の接触探針13で押えられた時の電極
端子4との接触状況が示しである。シリコーンエラスト
マー11は弾性係数が極めて優れているので、電極端子
4と接触探針13との電気接触は極めて良くなる上、電
極端子4の導通メタル5との接触も容易に解除できる程
に収縮する。又、接触探針13の圧力が解除されると、
ニジストマー11は容易に原形に復し、モジュール7の
電極端子4は導通メタル5と再度接触する。以上のよう
に1本発明情報カードは、すべての外部電極端子が、情
報処理待以外は、同電位に短絡されているため、いかな
る静電気が端子部に加えられても、半害体素子部が静電
破壊を受けることがない。又、接触探針13が帯電して
いても電極端子4に触れる寸前又は、同時に導通メタル
5を経由して放電する。従って望むらくは、導通メタル
5はアース端子として、接地さノ1.ている構造がよい
。
このような導通メタル5が、接地されやすい構造にした
十内報カードの例が、第5図、第6図に示しである。本
笑施例では、前実施例のシリコーンエラストマー11の
代りに0.8闘厚のベリリウム銅バネ板15を使用した
もので、電極端子4の上になるように配置したものであ
る。更に導通メタル5の接地を行いやすくするために塩
化ビニルシート90代シに、ステンレスやアルミニウム
シート14に変更したものである。本例も前例と同様の
効果があったことは云うまでもなく、史には、放電が更
に容易な構造となっている。又、バネ板15は必すしも
本例の形状に限定されるのではなくて、カニ1圧により
、全体高さが縮むもので、且つ各々の電極端子に相応の
大きさであれはよいことは明らかである。
十内報カードの例が、第5図、第6図に示しである。本
笑施例では、前実施例のシリコーンエラストマー11の
代りに0.8闘厚のベリリウム銅バネ板15を使用した
もので、電極端子4の上になるように配置したものであ
る。更に導通メタル5の接地を行いやすくするために塩
化ビニルシート90代シに、ステンレスやアルミニウム
シート14に変更したものである。本例も前例と同様の
効果があったことは云うまでもなく、史には、放電が更
に容易な構造となっている。又、バネ板15は必すしも
本例の形状に限定されるのではなくて、カニ1圧により
、全体高さが縮むもので、且つ各々の電極端子に相応の
大きさであれはよいことは明らかである。
又、配置する位置も、第3図例のように半畳体モジュー
ルの下部に置いてもよく、この場合は、該半導体モジュ
ールの太きさよりも少し小さければ良いことも明らかで
ある。又、情報カードの表面に碍′屯性ポリマーを塗布
して、本発明の効果を上げたり出来るし、カバーシート
自体全専′屯性ポリマーとしても良いことも明らかであ
る。又、導通メタル5も金属丈に限定されるのではなく
4電性樹脂でもよいことも明らかである。
ルの下部に置いてもよく、この場合は、該半導体モジュ
ールの太きさよりも少し小さければ良いことも明らかで
ある。又、情報カードの表面に碍′屯性ポリマーを塗布
して、本発明の効果を上げたり出来るし、カバーシート
自体全専′屯性ポリマーとしても良いことも明らかであ
る。又、導通メタル5も金属丈に限定されるのではなく
4電性樹脂でもよいことも明らかである。
以上説明したように本発明は、情報カードの内蔵されて
いる半導体装置の外部電極端子を信号処理待以外は、す
べて導通させておき、次いで、他の信号入出力装置の端
子が該情報カードの端子に接触する時の外力によシ、す
べての電極端子が独立した端子になるように全導通状態
が解除され、各々の機能の端子の働きをするように分離
されるため、外部のいかなる静電気による半導体装置の
破壊を受けることがない情報カードを提供できる効果を
有するものである。
いる半導体装置の外部電極端子を信号処理待以外は、す
べて導通させておき、次いで、他の信号入出力装置の端
子が該情報カードの端子に接触する時の外力によシ、す
べての電極端子が独立した端子になるように全導通状態
が解除され、各々の機能の端子の働きをするように分離
されるため、外部のいかなる静電気による半導体装置の
破壊を受けることがない情報カードを提供できる効果を
有するものである。
第1図は本発明実施例の情報カードの平面図、第2図は
第1図の一部拡大平面図、第3図〜第6図は、本発明実
施例情報カードの縦断面図である。 l 情報カード、2 ・・磁気テープ、3.7・・
半導体モジュール、4−・電極端子、5・・・・導通端
子、6・・・端子孔、8 ・情報カード基板、9.1
0.14・・・ カバーシート、11・・・ エラスト
マー、13・・・・・・外部装置端子ビン、15・・・
・バネ材。 71図 名2図 茗3図 導 茅5図 ↓
第1図の一部拡大平面図、第3図〜第6図は、本発明実
施例情報カードの縦断面図である。 l 情報カード、2 ・・磁気テープ、3.7・・
半導体モジュール、4−・電極端子、5・・・・導通端
子、6・・・端子孔、8 ・情報カード基板、9.1
0.14・・・ カバーシート、11・・・ エラスト
マー、13・・・・・・外部装置端子ビン、15・・・
・バネ材。 71図 名2図 茗3図 導 茅5図 ↓
Claims (2)
- 1.情報処理を行う半導体素子を内蔵し、他の信号入出
力装置との信号処理をする時以外は、該半導体素子の外
部電極端子がすべて導通されていることを特徴とする情
報カード。 - 2.前記他の信号入出力装置の端子が接触することによ
り、前記外部の電極端子の全導通状態が解除され、電源
端子,アース端子,信号入出力端子等の各端子に電気的
に分離されることを特徴とする特許請求の範囲第1項記
載の情報カード。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60294310A JPS62149498A (ja) | 1985-12-25 | 1985-12-25 | 情報カ−ド |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60294310A JPS62149498A (ja) | 1985-12-25 | 1985-12-25 | 情報カ−ド |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62149498A true JPS62149498A (ja) | 1987-07-03 |
Family
ID=17806037
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60294310A Pending JPS62149498A (ja) | 1985-12-25 | 1985-12-25 | 情報カ−ド |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62149498A (ja) |
-
1985
- 1985-12-25 JP JP60294310A patent/JPS62149498A/ja active Pending
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