JPS6217165B2 - - Google Patents

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Publication number
JPS6217165B2
JPS6217165B2 JP1347782A JP1347782A JPS6217165B2 JP S6217165 B2 JPS6217165 B2 JP S6217165B2 JP 1347782 A JP1347782 A JP 1347782A JP 1347782 A JP1347782 A JP 1347782A JP S6217165 B2 JPS6217165 B2 JP S6217165B2
Authority
JP
Japan
Prior art keywords
output
circuit
peak value
sample
sampling
Prior art date
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Expired
Application number
JP1347782A
Other languages
English (en)
Other versions
JPS58129305A (ja
Inventor
Kazuhisa Kanda
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
Nippon Electric Co Ltd
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Filing date
Publication date
Application filed by Nippon Electric Co Ltd filed Critical Nippon Electric Co Ltd
Priority to JP1347782A priority Critical patent/JPS58129305A/ja
Publication of JPS58129305A publication Critical patent/JPS58129305A/ja
Publication of JPS6217165B2 publication Critical patent/JPS6217165B2/ja
Granted legal-status Critical Current

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Classifications

    • GPHYSICS
    • G01MEASURING; TESTING
    • G01BMEASURING LENGTH, THICKNESS OR SIMILAR LINEAR DIMENSIONS; MEASURING ANGLES; MEASURING AREAS; MEASURING IRREGULARITIES OF SURFACES OR CONTOURS
    • G01B11/00Measuring arrangements characterised by the use of optical techniques
    • G01B11/02Measuring arrangements characterised by the use of optical techniques for measuring length, width or thickness

Landscapes

  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Optical Recording Or Reproduction (AREA)
  • Length Measuring Devices By Optical Means (AREA)
  • Automatic Focus Adjustment (AREA)

Description

【発明の詳細な説明】 本発明は光位置検出装置の信号処理装置に関す
る。
2分割検知器を使用した光位置検出装置として
従来一般に使用されている一例の系統図を第1図
に、その波形図を第2図に示す。その動作を以下
説明する。検知器1にパルス光2が入ると、光に
よる電流I1,I2がそれぞれのプリアンプ3,4に
入力され(ここでI1側を+系、I2側を−系とす
る)、その出力E1,E2は、それぞれ増幅器5,6
で増幅される。さらに、入力光の強さに対するダ
イナミツクレンジを得るため対数増幅回路7,8
にこれを加え出力E3,E4を得る。次にパルスの
ピーク値に比例した直流電圧を得るためにまず、
ピーク検出回路9,10でパルス幅を広げ
(E5,E6)、サンプルホールド回路11,12に
より直流電圧E7,E8を得る。このときのサンプ
ルホルド回路のゲート信号は各対数増幅回路の出
力E3,E4を加算器13で加算し、単安定マルチ
バイブレータ14で波形成形した出力E9を使
う。サンプルホールド回路の出力E7,E8の差を
減算器15で、得る。その出力E10はE10=K
(E7−E8)となりE10が、光の位置でKは光の位置
に対する利得定数で、減算器の利得で決まる。こ
こで増幅器3,4.対数増幅回路7,8とピーク
レベル検出回路9,10をそれぞれの系の信号増
幅部という。
この信号処理装置において光が検知器の中心に
あり光の強さPのみが変化したとして第2図と第
3図のA,B,Cの3点について考えると、A点
での入力レベルでは系の利得G1と、−系の利得G2
とが一致しているので角度出力E10は0である。
一方、B点ではG1>G2であるため角度出力E0
誤差出力EBを生ずる。同様にC点ではG1<G2
あるため誤差出力ECを生ずる。このように従来
装置では2系統の信号増幅部の利得が全ての入力
光の強さの範囲で一致していないと光が検知器の
中心にあるにもかかわらず、角度誤差出力を生じ
てしまう。
本発明の目的は光位置検出装置の信号処理装置
において信号増幅部の利得の不一致による角度検
出誤差をなくす装置を提供することにある。
光位置検出装置の信号処理装置において、2系
統とも同じ信号増幅部を使用することにより信号
増幅部の利得の不一致による角度検出誤差をなく
する装置。
以下、本発明の一実施例を図面を参照して説明
する。
本発明の一実施例のブロツク図を第4図に、そ
の波形図を第5図に示す。光が中心にあり入力光
の強さが変化した場合について説明する。
検知器16にパルス光17が入射することによ
り生ずる光電流I3,I4がそれぞれのプリアンプ1
8,19で増幅され、その出力をE11,E12とす
る。−系の出力E12のみ遅延回路20を通し、時間
Tだけ遅延させてE13とする。E11とE13とを加算
器21で加算し(E14)、更に対数増幅回路22お
よびピーク値検出回路23を経て出力E15を得
る。E15を+系のサンプルホールド回路24と−
系のサンプルホールド回路25に同時に加える。
そのときの+系サンプルホールド回路24のゲー
ト信号E16はプリアンプ18の出力を単安定マル
チバイブレータ26により波形整形したものを使
い、−系サンプルホールド回路25のゲート信号
E17は遅延回路出力E13を単安定マルチバイブレー
タ27で波形整形したものを使う。それぞれのサ
ンプルホールド回路出力E18,E19を減算器28に
加え差出力E20とする。このE20をサンプルホール
ド回路29に加えて角度出力E22を得る。サンプ
ルホールド回路29のゲート信号はE17をさらに
単安定マルチバイブレータ30に加え波形整形し
たE21を使う。以上の説明では、第1図に示す増
幅器5,6は図示されていないが、これはその影
響が少ないためで、第4図ではプリアンプ18,
19にそれぞれ含めている。その代りに別に加算
器21の直後に1個の増幅器を設けても良い。こ
のように本発明は信号増幅部を+系と−系で共用
しているために、従来のように利得の不一致によ
る角度誤差出力がなくなる。
本発明は以上説明したように、信号増幅部を+
系、−系で共用することにより、入力光の強さの
変化による角度誤差出力はなくなる。さらに回路
調整は2系統を一致させる必要がなくなるので調
整が容易になる。
【図面の簡単な説明】
第1図と第2図は従来の信号処理装置のブロツ
ク図とその波形図、第3図は+系、−系の信号増
幅部で利得の不一致を生じた場合の各系の直流電
圧出力と角度出力の関係を示す図、第4図は本発
明の信号処理装置のブロツク図、第5図は第4図
の波形図を示す図である。 1,16……検知器、2,17……光、3〜
6,18,19……増幅器、7,8,22……対
数増幅器、9,10,23……ピーク値検出回
路、11,12,24,25,29……サンプル
ホールド回路、13,21……加算器、15,2
8……減算器、20……遅延回路。

Claims (1)

    【特許請求の範囲】
  1. 1 2個に分割された光検知器の各分割部からの
    光電流のうち、一方を所定時間遅延させる遅延回
    路と、この遅延回路の出力と他方の光電流とを加
    算する加算器と、この加算された出力を増幅する
    増幅器と、この増幅器の出力のピーク値を検出す
    るピーク値検出回路と、このピーク値を前記所定
    時間間隔のサンプリングパルスでサンプルホール
    ドする2つのサンプリング回路と、この2つのサ
    ンプリング回路出力の差をとる減算器と、この減
    算器出力を前記時間遅延を受けたサンプリングパ
    ルスと同期したパルスでサンプリングする回路と
    を備えて成ることを特徴とする光位置検出装置。
JP1347782A 1982-01-29 1982-01-29 光位置検出装置 Granted JPS58129305A (ja)

Priority Applications (1)

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JP1347782A JPS58129305A (ja) 1982-01-29 1982-01-29 光位置検出装置

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Publication Number Publication Date
JPS58129305A JPS58129305A (ja) 1983-08-02
JPS6217165B2 true JPS6217165B2 (ja) 1987-04-16

Family

ID=11834199

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* Cited by examiner, † Cited by third party
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KR20240076408A (ko) * 2019-09-02 2024-05-30 삼성전기주식회사 인쇄회로기판

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JPH03226624A (ja) * 1990-01-31 1991-10-07 Nec Corp スタースキャナ
JP3887480B2 (ja) * 1998-03-20 2007-02-28 パイオニア株式会社 プリピット検出装置

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JPS58129305A (ja) 1983-08-02

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