JPS62280897A - 液晶表示装置 - Google Patents
液晶表示装置Info
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- JPS62280897A JPS62280897A JP61126434A JP12643486A JPS62280897A JP S62280897 A JPS62280897 A JP S62280897A JP 61126434 A JP61126434 A JP 61126434A JP 12643486 A JP12643486 A JP 12643486A JP S62280897 A JPS62280897 A JP S62280897A
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- liquid crystal
- axis
- crystal display
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- 239000004973 liquid crystal related substance Substances 0.000 title claims description 28
- 238000006243 chemical reaction Methods 0.000 claims description 6
- 230000002123 temporal effect Effects 0.000 claims 2
- 238000010586 diagram Methods 0.000 description 12
- 238000000605 extraction Methods 0.000 description 3
- 230000004888 barrier function Effects 0.000 description 2
- PEDCQBHIVMGVHV-UHFFFAOYSA-N Glycerine Chemical compound OCC(O)CO PEDCQBHIVMGVHV-UHFFFAOYSA-N 0.000 description 1
- 239000011159 matrix material Substances 0.000 description 1
- 238000000034 method Methods 0.000 description 1
- 238000004806 packaging method and process Methods 0.000 description 1
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- Liquid Crystal (AREA)
- Liquid Crystal Display Device Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
３、発明の詳細な説明
〔産業上の利用分野〕
この発明は、液晶表示装置のインターフェース回路に関
し、特に、パーソナルコンピュータなどに使用されてい
るＣＲＴディスプレイ装置のインターフェース信号のみ
を利用して軽薄短小な液晶表示装置に代替できるように
したインターフェース回路を有する液晶表示装置に関す
るものである。
し、特に、パーソナルコンピュータなどに使用されてい
るＣＲＴディスプレイ装置のインターフェース信号のみ
を利用して軽薄短小な液晶表示装置に代替できるように
したインターフェース回路を有する液晶表示装置に関す
るものである。
本発明は、ＣＲＴディスプレイのインターフェース信号
を利用して、表示データをＲＡＭなどの記憶する記憶回
路を用いることなく、リアルタイムによって表示データ
を処理し、従来と同等の駆動回路によって表示が可能な
インターフェース回路を有する液晶表示装置に関するも
のである。
を利用して、表示データをＲＡＭなどの記憶する記憶回
路を用いることなく、リアルタイムによって表示データ
を処理し、従来と同等の駆動回路によって表示が可能な
インターフェース回路を有する液晶表示装置に関するも
のである。
液晶表示装置は、薄型低電圧、低消費電力の特性を存す
るため、最近では、大型ドツトマトリックスパネルによ
ってパーソナルコンピュータ、ワードプロセッサなどの
表示端末として実用化されるに至っている。第５図は、
従来の液晶表示装置のシステム構成図である。第５図に
示すように、従来の液晶表示装置は、表示データおよび
同時信号は、コントローラ７１に入力し、液晶用タイミ
ングインターフェース信号を発生し、Ｙ軸及びＸ軸駆動
回路に出力すると共に、入力された表示データは、一旦
、記憶回路７２に１フレームの表示データを記憶した後
、液晶用タイミングインターフェース信号とタイミング
をとり、Ｘ軸駆動回路にデータを送る方式である。従っ
て、コントローラの外付は回路として、記ｔα回路ＲＡ
Ｍが１フレーム容量分必要であり、書込み、読出しなど
のタイミング発生回路が、複雑となる。６４０ Ｘ ４
００ドツトの表示容量の表示装置であれば、４ビア）パ
ラレルに表示データを駆動回路に転送する場合、約４．
０Ｍ）ＩＺの転送りロックが必要となり、転送速度の速
い駆動回路が要求され、また消費？Ｔ流も大きいもので
あった。
るため、最近では、大型ドツトマトリックスパネルによ
ってパーソナルコンピュータ、ワードプロセッサなどの
表示端末として実用化されるに至っている。第５図は、
従来の液晶表示装置のシステム構成図である。第５図に
示すように、従来の液晶表示装置は、表示データおよび
同時信号は、コントローラ７１に入力し、液晶用タイミ
ングインターフェース信号を発生し、Ｙ軸及びＸ軸駆動
回路に出力すると共に、入力された表示データは、一旦
、記憶回路７２に１フレームの表示データを記憶した後
、液晶用タイミングインターフェース信号とタイミング
をとり、Ｘ軸駆動回路にデータを送る方式である。従っ
て、コントローラの外付は回路として、記ｔα回路ＲＡ
Ｍが１フレーム容量分必要であり、書込み、読出しなど
のタイミング発生回路が、複雑となる。６４０ Ｘ ４
００ドツトの表示容量の表示装置であれば、４ビア）パ
ラレルに表示データを駆動回路に転送する場合、約４．
０Ｍ）ＩＺの転送りロックが必要となり、転送速度の速
い駆動回路が要求され、また消費？Ｔ流も大きいもので
あった。
〔発明が解決しようとする問題点〕
上記したように、従来のインターフェース回路は、コン
トローラの外付は回路として記憶回路ＲＡＭの必要性を
無くし、人力された表示データをリアルタイムで、液晶
用インターフェースデータとして駆動回路に出力する。
トローラの外付は回路として記憶回路ＲＡＭの必要性を
無くし、人力された表示データをリアルタイムで、液晶
用インターフェースデータとして駆動回路に出力する。
更に、８ビットパラレル信号によってデータを転送する
ことによって、転送スピードが遅くても許容できるよう
な液晶表示装置を提供することを目的とするものである
。
ことによって、転送スピードが遅くても許容できるよう
な液晶表示装置を提供することを目的とするものである
。
次に、本発明の一実施例について説明する。
第１図は、本発明の一実施例に示す回路図であり、第２
図は、第１図の回路動作を補足説明するためのタイミン
グ図である。
図は、第１図の回路動作を補足説明するためのタイミン
グ図である。
第１図において、１Ｉｓｙｃは水平同期信号、Ｖｓｙｃ
は垂直同期信号、ＣＫはドツトクロック信号、Ｄはシリ
アル表示データである。これらのＨｓｙｃ、 Ｖｓｙｃ
。
は垂直同期信号、ＣＫはドツトクロック信号、Ｄはシリ
アル表示データである。これらのＨｓｙｃ、 Ｖｓｙｃ
。
ＣＫ、ＤはＣＲＴディスプレイ装置へのインターフェー
ス信号と同等のものである。１は、ドツトクロックＣＫ
をカウントしてＸ軸方向の表示６Ｎ域（又は位置）を調
整するＸ軸表示位置調整回路、７は水平同期信号＋１ｓ
ｙｃをカウントしてＹ軸方向の表示領域（又は位置）を
調整するＹ軸表示位置調整回路、４，５は、存効ドツト
クロックφ２をカウントするための１７８化及び１／８
０化力ウンタ回路、１０はＡＮＤ回路８の出力φ、のカ
ウント値を２００又は４００に設定するバリアプルカウ
ンタ、１１はシリアル表示データをパラレルな表示デー
タに変換するＳ／Ｐ変換回路、１４は前記Ｓ／Ｐ変換回
路１１のパラレル表示データ出力を一時的に記憶するラ
ッチ回路、１７．１８は前記ラッチ回路１４の８ビツト
出力データを奇数及び偶数ビットに分類して、液晶表示
装置の×軸電極の上側及び下側引出し電極駆動回路に表
示データＵＤ、〜ＵＤ４．ＬＤ、〜Ｌ Ｄ ａを増幅す
るバッファ回路、ＳＫは、前記パラレル表示データＵＤ
、−ＵＤ、、ＬＤ、−ＬＤ、をＸ軸電極駆動回路に内蔵
された４ビノトパラレルシフトレジスク回路に、シフト
するためのシフトクロック信号。ＬＫは、Ｘ＠電極駆動
回路に内蔵されたラッチ回路に、パラレル表示データＵ
Ｄ ＋ 〜ＵＤ、、ＬＤＩ 〜ＬＤ４をラッチするた
めのラッチ信号。ＦＲＭは、液晶表示パネルのＹ電極の
走査を開始するためのスキャンニング開始データ。
ス信号と同等のものである。１は、ドツトクロックＣＫ
をカウントしてＸ軸方向の表示６Ｎ域（又は位置）を調
整するＸ軸表示位置調整回路、７は水平同期信号＋１ｓ
ｙｃをカウントしてＹ軸方向の表示領域（又は位置）を
調整するＹ軸表示位置調整回路、４，５は、存効ドツト
クロックφ２をカウントするための１７８化及び１／８
０化力ウンタ回路、１０はＡＮＤ回路８の出力φ、のカ
ウント値を２００又は４００に設定するバリアプルカウ
ンタ、１１はシリアル表示データをパラレルな表示デー
タに変換するＳ／Ｐ変換回路、１４は前記Ｓ／Ｐ変換回
路１１のパラレル表示データ出力を一時的に記憶するラ
ッチ回路、１７．１８は前記ラッチ回路１４の８ビツト
出力データを奇数及び偶数ビットに分類して、液晶表示
装置の×軸電極の上側及び下側引出し電極駆動回路に表
示データＵＤ、〜ＵＤ４．ＬＤ、〜Ｌ Ｄ ａを増幅す
るバッファ回路、ＳＫは、前記パラレル表示データＵＤ
、−ＵＤ、、ＬＤ、−ＬＤ、をＸ軸電極駆動回路に内蔵
された４ビノトパラレルシフトレジスク回路に、シフト
するためのシフトクロック信号。ＬＫは、Ｘ＠電極駆動
回路に内蔵されたラッチ回路に、パラレル表示データＵ
Ｄ ＋ 〜ＵＤ、、ＬＤＩ 〜ＬＤ４をラッチするた
めのラッチ信号。ＦＲＭは、液晶表示パネルのＹ電極の
走査を開始するためのスキャンニング開始データ。
Ｍは、液晶パネルを交流駆動するための交流化駆動信号
である。
である。
次に、本発明の動作について説明する。
Ｘ他表示位置調整回路１に、水平同期信号Ｈｓｙｃが人
力されると、第２図タイミング図の（Ａ）で示すように
、その出力Ｘｔは、リセットされ１Ｌ”になり、所定の
時間経過後“Ｈ”に立上がる。この時間幅ＬＷ、は、内
蔵のドツトクロックＣＫのバリアプルカウンタのカウン
タ値を任意に調整することによってＸ軸表示方向の表示
スタート位置を変化させることができる。更に水平同期
信号Ｉｔｓｙｃは、Ｒ−Ｓフリップフロップ６をセット
するので、その出力Ｔ１はＨ”となる。それ故に、ＡＮ
Ｄ回路２の出力φ１は（Ａ）に示すタイミングでＸ軸有
効表示期間のドツトクロックを発生する。
力されると、第２図タイミング図の（Ａ）で示すように
、その出力Ｘｔは、リセットされ１Ｌ”になり、所定の
時間経過後“Ｈ”に立上がる。この時間幅ＬＷ、は、内
蔵のドツトクロックＣＫのバリアプルカウンタのカウン
タ値を任意に調整することによってＸ軸表示方向の表示
スタート位置を変化させることができる。更に水平同期
信号Ｉｔｓｙｃは、Ｒ−Ｓフリップフロップ６をセット
するので、その出力Ｔ１はＨ”となる。それ故に、ＡＮ
Ｄ回路２の出力φ１は（Ａ）に示すタイミングでＸ軸有
効表示期間のドツトクロックを発生する。
Ｙ軸表示位置調整回路７も又、同様の構成になっており
、垂直同期信号Ｖｓｙｃが人力されると第２図の（Ｂ）
で示すように、その出力ＹＴは、リセットされて“Ｌ″
になり、所定の時間経過後“Ｈ”に立上がる。この期間
幅Ｌ Ｗ２は、内蔵のハリアブルカウンク値を任意に調
整することによって、Ｙ軸方向の表示スタート位置を調
整することができる。
、垂直同期信号Ｖｓｙｃが人力されると第２図の（Ｂ）
で示すように、その出力ＹＴは、リセットされて“Ｌ″
になり、所定の時間経過後“Ｈ”に立上がる。この期間
幅Ｌ Ｗ２は、内蔵のハリアブルカウンク値を任意に調
整することによって、Ｙ軸方向の表示スタート位置を調
整することができる。
更に、垂直同期信号νｓｙｃは、Ｒ−Ｓフリップフロッ
プ９をセットするので、その出力Ｔ２は“Ｈ”となる。
プ９をセットするので、その出力Ｔ２は“Ｈ”となる。
それ故に、ＡＮＤ回路８の出力は、（Ｂ）に示すタイミ
ングで、Ｙ軸有効表示期間の水平同期信号Ｈｓｙｃのφ
、を出力する。バリアプルカウンタ】０は、スイフチ３
４がＯＮのときカウント値２００゜ＯＦＦのときカウン
ト値４００ ”ｉ？キャリー信号φ６を出力する。Ｒ−
Ｓフリップフロップ９の出力Ｔ！が“Ｈ”の期間、ＡＮ
Ｄ回路３は、有効表示期間のドツトクロックφ２を発生
する。このドツトクロックφ２は、８ビツトシフトレジ
スタにより構成されたＳ／Ｐ変換回路１１のシフトクロ
ックとして人力される。
ングで、Ｙ軸有効表示期間の水平同期信号Ｈｓｙｃのφ
、を出力する。バリアプルカウンタ】０は、スイフチ３
４がＯＮのときカウント値２００゜ＯＦＦのときカウン
ト値４００ ”ｉ？キャリー信号φ６を出力する。Ｒ−
Ｓフリップフロップ９の出力Ｔ！が“Ｈ”の期間、ＡＮ
Ｄ回路３は、有効表示期間のドツトクロックφ２を発生
する。このドツトクロックφ２は、８ビツトシフトレジ
スタにより構成されたＳ／Ｐ変換回路１１のシフトクロ
ックとして人力される。
従って、表示データＤのシリアルデータは、パラレルデ
ータに変換されて、ランチ回路１４に出力される。前記
、有効表示期間のドツトクロックφ２は、１７８化カウ
ンタによって１／８分周され、キャリー信号φ、を発生
する。このキャリー信号φ。
ータに変換されて、ランチ回路１４に出力される。前記
、有効表示期間のドツトクロックφ２は、１７８化カウ
ンタによって１／８分周され、キャリー信号φ、を発生
する。このキャリー信号φ。
は、前記ラッチ回路１４のラッチ信号となる。更に、キ
ャリー信号φ、は、１７８０化カウンタ５に入力され、
１７８０分周され、キャリー信号φ４を発生し、前記、
Ｒ−Ｓクリップフロップ６をリセットする。
ャリー信号φ、は、１７８０化カウンタ５に入力され、
１７８０分周され、キャリー信号φ４を発生し、前記、
Ｒ−Ｓクリップフロップ６をリセットする。
故に、その出力Ｔ、は“Ｌ”にリセットされ、ドツトク
ロックφ１の発生を停止する。
ロックφ１の発生を停止する。
前記、行動表示期間内において、ランチ回路１４の出力
は、バッファ回路１７．１８よりＸ＠電極駆動回路に出
力される。前記、ラッチ回路１４の奇数ビット出力は、
バッファ回路１７に入力されＵＤ、〜ＵＤ、を出力し、
偶数ビット出力は、バッファ回路１８に入力されＬＤ、
〜ＬＤ４を出力する。第２図タイミング図における（Ｄ
）は、Ｘ軸及びＹ軸電極駆動回路へのインターフェース
信号のタイミングを示している。
は、バッファ回路１７．１８よりＸ＠電極駆動回路に出
力される。前記、ラッチ回路１４の奇数ビット出力は、
バッファ回路１７に入力されＵＤ、〜ＵＤ、を出力し、
偶数ビット出力は、バッファ回路１８に入力されＬＤ、
〜ＬＤ４を出力する。第２図タイミング図における（Ｄ
）は、Ｘ軸及びＹ軸電極駆動回路へのインターフェース
信号のタイミングを示している。
シフトクロックＳＫは、１／８０化カウンタ２８に人力
され、１ノ８０分周されたキャリー信号ＬＫは、前記Ｘ
軸電極駆動回路内蔵の４ピントパラレルシフトレジスタ
の出力をラッチするランチ信号となる。
され、１ノ８０分周されたキャリー信号ＬＫは、前記Ｘ
軸電極駆動回路内蔵の４ピントパラレルシフトレジスタ
の出力をラッチするランチ信号となる。
Ｒ−Ｓフリップフロップ回路２９は、Ｖｓｙｃによって
セットし、ラッチ信号ＬＫによってリセットする回路で
あり、（Ｄ）に示すようなタイミングでＹ軸電極の走査
開始信号のＦＲＭを出力する。
セットし、ラッチ信号ＬＫによってリセットする回路で
あり、（Ｄ）に示すようなタイミングでＹ軸電極の走査
開始信号のＦＲＭを出力する。
１／２カウンタ３０は、前記ＦＲＭ信号を１ノ２分周し
た信号Ｍを発生し、液晶に印加される駆動電圧の極性を
フレーム毎に反転させる。
た信号Ｍを発生し、液晶に印加される駆動電圧の極性を
フレーム毎に反転させる。
第３図は、本発明の一実施例を示す液晶表示装置のシス
テム構成を示す図である。第３図は、前述のインターフ
ェース回路、５０は、Ｙ軸電極駆動回路、４０は、カラ
ー液晶表示パネル４４のＸ電極を上側に引出したＸ電極
のＸ軸電極駆動回路、４９は、Ｘ電極を下側に引出した
Ｘ電極のＸ軸電極駆動回路、５０は、Ｙ軸１！掻駆動回
路である。Ｘ軸電極駆動回路４０及び４９は、４ビツト
・パラレルシフトレジスフ４１．４６とラッチ回路４２
．４７ と、液晶ドライバ一部４３．４８によって構成
されている。パラレル表示データＵＤ、〜ＵＤ、及びＬ
Ｄ ＋ 〜ＬＤａは、同時に４ビノトパラレルノフト
レジスタ４１と４６に人力され、ソフトクロックＳＫに
よってシフトされ、ランチクロックＬＫによ−でラッチ
回路４２゜４７にラッチされる°。ランチ回路４２．４
７にラッチされた出力は、液晶ドライバー４３と４５に
よって各々に着色されたフィルタ電極に該当する表示デ
ータに応じて駆動を行う。
テム構成を示す図である。第３図は、前述のインターフ
ェース回路、５０は、Ｙ軸電極駆動回路、４０は、カラ
ー液晶表示パネル４４のＸ電極を上側に引出したＸ電極
のＸ軸電極駆動回路、４９は、Ｘ電極を下側に引出した
Ｘ電極のＸ軸電極駆動回路、５０は、Ｙ軸１！掻駆動回
路である。Ｘ軸電極駆動回路４０及び４９は、４ビツト
・パラレルシフトレジスフ４１．４６とラッチ回路４２
．４７ と、液晶ドライバ一部４３．４８によって構成
されている。パラレル表示データＵＤ、〜ＵＤ、及びＬ
Ｄ ＋ 〜ＬＤａは、同時に４ビノトパラレルノフト
レジスタ４１と４６に人力され、ソフトクロックＳＫに
よってシフトされ、ランチクロックＬＫによ−でラッチ
回路４２゜４７にラッチされる°。ランチ回路４２．４
７にラッチされた出力は、液晶ドライバー４３と４５に
よって各々に着色されたフィルタ電極に該当する表示デ
ータに応じて駆動を行う。
第４図は、本発明の一実施例に使用する液晶パネルの電
極構成図を示したものである。第４図において、Ｘ軸電
極の奇数番電極ｘ、、ｘ、、ｘｓ・−・・・・−は、上
側引出し電極とされ、偶数番電極Ｘ、、Ｘ。
極構成図を示したものである。第４図において、Ｘ軸電
極の奇数番電極ｘ、、ｘ、、ｘｓ・−・・・・−は、上
側引出し電極とされ、偶数番電極Ｘ、、Ｘ。
−−−−−−−は下側引出し電極とされ、上側及び下側
引出し電極は、別々のＸ＠電極駆動回路によって駆動さ
れる。
引出し電極は、別々のＸ＠電極駆動回路によって駆動さ
れる。
以上述べたように、本発明によれば、ＣＲＴディスプレ
イのインターフェース信号を用いて、ＲＡＭなどの記憶
回路を用いずにリアルタイムで表示データを処理し、イ
ンターフェースできるので、回路構成が簡単でかつコス
トダウン化及び小型実装化をはかることができる。また
、上下側電極に８ビツトパラレルで表示データを転送で
きるので、転送シフトクロック信号のスピードを２倍遅
くできる。更に、液晶パネルのＸ軸電極のピッチ間隔を
２倍に拡げることができるので、液晶パネルとＸ軸電極
駆動出力との接続が、やり易くなるなど、多大な効果を
有するものである。
イのインターフェース信号を用いて、ＲＡＭなどの記憶
回路を用いずにリアルタイムで表示データを処理し、イ
ンターフェースできるので、回路構成が簡単でかつコス
トダウン化及び小型実装化をはかることができる。また
、上下側電極に８ビツトパラレルで表示データを転送で
きるので、転送シフトクロック信号のスピードを２倍遅
くできる。更に、液晶パネルのＸ軸電極のピッチ間隔を
２倍に拡げることができるので、液晶パネルとＸ軸電極
駆動出力との接続が、やり易くなるなど、多大な効果を
有するものである。
第１図は、本発明の一実施例を示す回路図、第２図は、
本発明の一実施例を示すタイミング図、第３図は、本発
明の一実施例を示す液晶表示装置のシステム構成図、第
４図は液晶パネルの電極構成図、第５図は従来の液晶表
示装置のシステム構成図である。 ■・・・Ｘ軸表示位置調整回路 ７・・・Ｙ軸表示位置調整回路 １０・・・バリアプルカウンタ １［・・・Ｓ／Ｐ変換回路 １４・・・ラッチ回路 １７・１日・・・バソフプ回路 ４０．４９ ・・・Ｘ＠電極駆動回路５０・・・Ｙ軸
電極駆動回路 ６０・・・インターフェース回路 ４４・・・ン夜晶ドフト・マトリックスパネル以上 出願人 セイコー電子工業株式会社 、不、３ピ日月の一呻Ｃ方−例１ヲーＴオタＪｅｉ；ｌ
冥牙琵１ｔのシステムＳり第 ３ ｇ
本発明の一実施例を示すタイミング図、第３図は、本発
明の一実施例を示す液晶表示装置のシステム構成図、第
４図は液晶パネルの電極構成図、第５図は従来の液晶表
示装置のシステム構成図である。 ■・・・Ｘ軸表示位置調整回路 ７・・・Ｙ軸表示位置調整回路 １０・・・バリアプルカウンタ １［・・・Ｓ／Ｐ変換回路 １４・・・ラッチ回路 １７・１日・・・バソフプ回路 ４０．４９ ・・・Ｘ＠電極駆動回路５０・・・Ｙ軸
電極駆動回路 ６０・・・インターフェース回路 ４４・・・ン夜晶ドフト・マトリックスパネル以上 出願人 セイコー電子工業株式会社 、不、３ピ日月の一呻Ｃ方−例１ヲーＴオタＪｅｉ；ｌ
冥牙琵１ｔのシステムＳり第 ３ ｇ
Claims (1)
- 液晶表示装置のインターフェース回路において、ドット
クロック信号を入力し、表示データとの時間的なタイミ
ングをとるＸ軸表示位置調整回路、水平同期信号を入力
し、Ｙ軸方向における表示データとの時間的なタイミン
グをとるＹ軸表示位置調整回路、及びＸ軸及びＹ軸方向
の有効表示領域を計数するドットクロック及び水平同期
信号の各カウンタ回路、シリアルな表示データをパラレ
ル信号に変換するＳ／Ｐ変換回路により構成され、上記
、Ｓ／Ｐ変換回路の出力は、上記、液晶表示装置のＸ電
極の上側及び下側に引出し各々の電極駆動用に、分離し
て駆動することを特徴とする液晶表示装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61126434A JPS62280897A (ja) | 1986-05-30 | 1986-05-30 | 液晶表示装置 |
| KR1019870003957A KR950003980B1 (ko) | 1986-04-25 | 1987-04-24 | 인터페이스 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61126434A JPS62280897A (ja) | 1986-05-30 | 1986-05-30 | 液晶表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62280897A true JPS62280897A (ja) | 1987-12-05 |
| JPH0473959B2 JPH0473959B2 (ja) | 1992-11-25 |
Family
ID=14935098
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61126434A Granted JPS62280897A (ja) | 1986-04-25 | 1986-05-30 | 液晶表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62280897A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2011070186A (ja) * | 1999-01-28 | 2011-04-07 | Semiconductor Energy Lab Co Ltd | 半導体装置及び電子機器 |
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| JPS5752092A (en) * | 1980-09-16 | 1982-03-27 | Hitachi Ltd | Liquid crystal ac drive signal generator |
| JPS5752088A (en) * | 1980-09-12 | 1982-03-27 | Tokyo Shibaura Electric Co | Display unit |
| JPS59212085A (ja) * | 1983-05-18 | 1984-11-30 | Sanyo Electric Co Ltd | マトリツクスパネル画像表示装置 |
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-
1986
- 1986-05-30 JP JP61126434A patent/JPS62280897A/ja active Granted
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|---|---|---|---|---|
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Also Published As
| Publication number | Publication date |
|---|---|
| JPH0473959B2 (ja) | 1992-11-25 |
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