JPS6266706A - 信号結合回路 - Google Patents
信号結合回路Info
- Publication number
- JPS6266706A JPS6266706A JP20573585A JP20573585A JPS6266706A JP S6266706 A JPS6266706 A JP S6266706A JP 20573585 A JP20573585 A JP 20573585A JP 20573585 A JP20573585 A JP 20573585A JP S6266706 A JPS6266706 A JP S6266706A
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- Japan
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- signal
- impedance
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- Signal Processing Not Specific To The Method Of Recording And Reproducing (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
この発明は信号結合回路に関し、回路結合によりて伝送
信号に歪が生じるのを抑えるようにした回路である。
信号に歪が生じるのを抑えるようにした回路である。
集積回路ブロックを接続し、一方の回路ブロックから他
・方の回路ブロックに信号を伝送する場合、その回路結
合のために信号の歪成分が増加することがある。
・方の回路ブロックに信号を伝送する場合、その回路結
合のために信号の歪成分が増加することがある。
この種の例をあげると、ビデオテープレコーダのFM変
調回路ブロックと記録回路ブロックの接続例がある。ビ
デオテープレコーダにおいては、色信号と分離された輝
度信号がFM変調された後、記録増幅回路を介して電流
出力となりてビデオヘッドシステムに供給される。
調回路ブロックと記録回路ブロックの接続例がある。ビ
デオテープレコーダにおいては、色信号と分離された輝
度信号がFM変調された後、記録増幅回路を介して電流
出力となりてビデオヘッドシステムに供給される。
ここで、記録増幅回路は、定電流記録を行なうために大
電流を扱い、またシリンダに近い位置に配設されるのが
通常である。一方、FM変調回路は、通常は、前記記録
回路と離れた位置に配設され、しかもその出力は電圧出
力である。
電流を扱い、またシリンダに近い位置に配設されるのが
通常である。一方、FM変調回路は、通常は、前記記録
回路と離れた位置に配設され、しかもその出力は電圧出
力である。
従って、FM変調回路と記録増幅回路間には、電圧電流
変換を伴う結合回路を要する。
変換を伴う結合回路を要する。
第5図は、従来のこの種の結合回路を示している。一般
にy変調回路の出力は、トランジスタQ1を有する出力
インピーダンスが低いエミッタフォロア回路11を介し
て導出される。電圧出力(FM信号)は、出力端子−ン
P1、結合インピーダンス回路12を介して記録増幅回
路側の入力端子ピンP2に供給される。この入力端子ピ
ンP2の信号は、電流源13、ダイオード14、トラン
ジスタQ2で成るカレントミラー回路15に供給され電
流出力に変換される@〔背景技術の問題点〕 ビデオテープレコーダにおいては、記録信号の低歪が要
求されているにもかかわらず、上記した回路結合による
とトランジスタの非直線性による歪が問題となる。
にy変調回路の出力は、トランジスタQ1を有する出力
インピーダンスが低いエミッタフォロア回路11を介し
て導出される。電圧出力(FM信号)は、出力端子−ン
P1、結合インピーダンス回路12を介して記録増幅回
路側の入力端子ピンP2に供給される。この入力端子ピ
ンP2の信号は、電流源13、ダイオード14、トラン
ジスタQ2で成るカレントミラー回路15に供給され電
流出力に変換される@〔背景技術の問題点〕 ビデオテープレコーダにおいては、記録信号の低歪が要
求されているにもかかわらず、上記した回路結合による
とトランジスタの非直線性による歪が問題となる。
即ち、エミッタフォロア回路の1m特性を第6図に示し
て説明すると次の通シである。入力信号の図示A点に対
応するJm (=Imm )と、B点に対応する1m
(gmb )とをみると、出力側では、トランジスタの
非直線性のために、#ma ”r Jmbとなる。従っ
て、入力側におけるA点、B点の関係は、出力側におい
て比列した関係とはならず、歪が増大することになる。
て説明すると次の通シである。入力信号の図示A点に対
応するJm (=Imm )と、B点に対応する1m
(gmb )とをみると、出力側では、トランジスタの
非直線性のために、#ma ”r Jmbとなる。従っ
て、入力側におけるA点、B点の関係は、出力側におい
て比列した関係とはならず、歪が増大することになる。
つまシ、動作点を中心に対称に変化する入力信号に対し
てIoの変化が非対称ということは、偶数次歪が発生し
、これに伴って更に出力信号に歪が加わることを意味す
る。特にビデオテープレコーダの記録回路系では、偶数
次歪は信号に悪影響を与えるため、この種の歪を生じな
いような手段が要望されている。
てIoの変化が非対称ということは、偶数次歪が発生し
、これに伴って更に出力信号に歪が加わることを意味す
る。特にビデオテープレコーダの記録回路系では、偶数
次歪は信号に悪影響を与えるため、この種の歪を生じな
いような手段が要望されている。
この発明は、上記の事情に対処すべくなされたもので、
電圧電流変換を伴う信号伝送において歪が生じないよう
にした信号結合回路を提供することを目的とする。
電圧電流変換を伴う信号伝送において歪が生じないよう
にした信号結合回路を提供することを目的とする。
この発明は、例えば第1図に示すように、第1の回路ブ
ロック100の出力回路をエミッタフォロア回路とし、
第2の回路ブロック200の入力回路をペース接地回路
とし、これら回路のトランジスタQll 、Q12が差
動増回路を形成するように、インピーダンス回路300
によって接続することで上記目的を達成するものである
。
ロック100の出力回路をエミッタフォロア回路とし、
第2の回路ブロック200の入力回路をペース接地回路
とし、これら回路のトランジスタQll 、Q12が差
動増回路を形成するように、インピーダンス回路300
によって接続することで上記目的を達成するものである
。
以下この発明の実施例を図面を参照して説明する。
第1図はこの発明の一実施例であシ、第1の回路ブロッ
ク100は例えば第1の集積回路であシ、第2の回路ブ
ロック200は第2の集積回路である。
ク100は例えば第1の集積回路であシ、第2の回路ブ
ロック200は第2の集積回路である。
回路ブロック100の出力回路として、エミ。
タフォロア回路110が採用されている。即ち、信号ν
iは、トランジスタQllのペースに供給されこのトラ
ンジスタQllからの出力は、そのエミッタからとシだ
され、回路ブロック100の出力端子ピンに導かれてい
る。トランジスタQllのコレクタは電源ライン112
に接続され、エミッタは、電流源113を介して接地ラ
イン114に接続される。
iは、トランジスタQllのペースに供給されこのトラ
ンジスタQllからの出力は、そのエミッタからとシだ
され、回路ブロック100の出力端子ピンに導かれてい
る。トランジスタQllのコレクタは電源ライン112
に接続され、エミッタは、電流源113を介して接地ラ
イン114に接続される。
端子ピン111は、交流結合を得るための容量301、
入力インピーダンスを設定する抵抗302よシなるイン
ピーダンス回路SOOを介して、回路ブロック200の
入力端子ピン210に接続される。
入力インピーダンスを設定する抵抗302よシなるイン
ピーダンス回路SOOを介して、回路ブロック200の
入力端子ピン210に接続される。
回路ブロック200の入力回路21ノは、電流源212
、トランジスタQ12 、バイアス源214より構成さ
れたペース接地増幅器であシ、しかも、トランジスタQ
12は、トランジスタQllと同極性のものである。即
ち、トランジスタQ12のエミッタは電流源212を介
して接地ライン213に接続され、コレクタは電流出力
ライン215に接続され、ペースにはバイアス源214
が接続されている。そして端子ピン210からの入力信
号は、トランジスタQ12のエミッタに供給される。
、トランジスタQ12 、バイアス源214より構成さ
れたペース接地増幅器であシ、しかも、トランジスタQ
12は、トランジスタQllと同極性のものである。即
ち、トランジスタQ12のエミッタは電流源212を介
して接地ライン213に接続され、コレクタは電流出力
ライン215に接続され、ペースにはバイアス源214
が接続されている。そして端子ピン210からの入力信
号は、トランジスタQ12のエミッタに供給される。
従って、このベース接地増幅回路は、入力抵抗302に
供給される電圧信号を電流変換し電流出力信号(工。u
t )をトランジスタQ12のコレクタに導出すること
ができる。
供給される電圧信号を電流変換し電流出力信号(工。u
t )をトランジスタQ12のコレクタに導出すること
ができる。
ここで、この発明における、回路ブロック100と20
0の出力回路と入力回路に用いられているトランジスタ
Qll、Q12の接続態様をみると、差動増幅器を構成
していることになる。
0の出力回路と入力回路に用いられているトランジスタ
Qll、Q12の接続態様をみると、差動増幅器を構成
していることになる。
差動増幅器の1m特性は、第2図に示すようになり、入
力信号が動作点を中心に対称に変化すれば、それに伴っ
て!!、も対称に変化する。つまり、入力信号の図示A
点に対応するgm (gma )と、図示B点に対応す
るJam (gmb )は、等しくFma = &mb
となる。このことは、出力信号に歪は生じるが、pmの
変化が動作点を中心に対称であるため、偶数歪が発生し
ないことを意味する。これによって、偶数次歪を低減し
得る電圧電流変換を行なう結合回路が実現される。よっ
て、ビデオテープレコーダなどのように、偶数次歪の低
減を要求されている記録回路系には有効な効果を発揮で
きる。
力信号が動作点を中心に対称に変化すれば、それに伴っ
て!!、も対称に変化する。つまり、入力信号の図示A
点に対応するgm (gma )と、図示B点に対応す
るJam (gmb )は、等しくFma = &mb
となる。このことは、出力信号に歪は生じるが、pmの
変化が動作点を中心に対称であるため、偶数歪が発生し
ないことを意味する。これによって、偶数次歪を低減し
得る電圧電流変換を行なう結合回路が実現される。よっ
て、ビデオテープレコーダなどのように、偶数次歪の低
減を要求されている記録回路系には有効な効果を発揮で
きる。
第3図はこの発明の他の実施例であ〕、この回路は、第
1図の実施例における電流源113゜212を抵抗12
0,220でそれぞれ置きかえた例である。従って、基
本動作は、第1図のものと同じであるから、これと同一
機能部分には同一符号を付して説明は省略する。
1図の実施例における電流源113゜212を抵抗12
0,220でそれぞれ置きかえた例である。従って、基
本動作は、第1図のものと同じであるから、これと同一
機能部分には同一符号を付して説明は省略する。
第4図は更に他の実施例であシ、第1図、第3図に示す
電圧電流変換用の抵抗302を任意伝達関数を持つフィ
ルタにおきかえたものである。従ってこの場合は、出力
信号をフィルタ310の伝達関数によって任意の周波数
特性に設定することができる。
電圧電流変換用の抵抗302を任意伝達関数を持つフィ
ルタにおきかえたものである。従ってこの場合は、出力
信号をフィルタ310の伝達関数によって任意の周波数
特性に設定することができる。
以上説明したようにこの発明は電圧電流変換を伴う信号
伝送を行なう場合に、トランジスタのg。特性のために
生じる歪を無くすことのできる信号結合回路を提供する
ことができる。
伝送を行なう場合に、トランジスタのg。特性のために
生じる歪を無くすことのできる信号結合回路を提供する
ことができる。
第1図はこの発明の一実施例を示す回路図、第2図は第
1図の回路の特性を示す図、第3図。 第4図はこの発明の他の実施例を示す回路図、第5図は
従来の信号結合回路を示す図、第6図は第5図の回路の
特性を示す図である。 100.200・・・第1.第2の回路ブロック、30
0・・・結合回路、Qll 、Q12・・・トランジス
タ@出願人代理人 弁理士 鈴 江 武 彦第3図 第4図
1図の回路の特性を示す図、第3図。 第4図はこの発明の他の実施例を示す回路図、第5図は
従来の信号結合回路を示す図、第6図は第5図の回路の
特性を示す図である。 100.200・・・第1.第2の回路ブロック、30
0・・・結合回路、Qll 、Q12・・・トランジス
タ@出願人代理人 弁理士 鈴 江 武 彦第3図 第4図
Claims (4)
- (1)信号出力回路としてエミッタフォロア回路を有す
る第1の回路ブロックと、信号入力回路として、前記エ
ミッタフォロア回路を構成する第1のトランジスタと同
極性の第2のトランジスタを用いたベース接地回路を有
する第2の回路ブロックと、前記第1、第2のトランジ
スタが差動増幅回路となるように、これらトランジスタ
のエミッタ間を接続したインピーダンス回路とを具備し
たことを特徴とする信号結合回路。 - (2)前記第1、第2の回路ブロックはそれぞれ独立し
た集積回路ブロックであって、前記インピーダンス回路
はそれぞれの集積回路ブロックに端子ピンを介して接続
されたことを特徴とする特許請求の範囲第1項記載の信
号結合回路。 - (3)前記インピーダンス回路は、フィルタ特性を有す
ることを特徴とした特許請求の範囲第1項記載の信号結
合回路。 - (4)前記第1の回路ブロックは、FM変調回路であっ
て前記第2の回路ブロックは記録増幅回路であることを
特徴とする特許請求の範囲第1項記載の信号結合回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20573585A JPS6266706A (ja) | 1985-09-18 | 1985-09-18 | 信号結合回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20573585A JPS6266706A (ja) | 1985-09-18 | 1985-09-18 | 信号結合回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6266706A true JPS6266706A (ja) | 1987-03-26 |
Family
ID=16511796
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20573585A Pending JPS6266706A (ja) | 1985-09-18 | 1985-09-18 | 信号結合回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6266706A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2006066961A (ja) * | 2004-08-24 | 2006-03-09 | General Res Of Electronics Inc | 可変減衰回路 |
-
1985
- 1985-09-18 JP JP20573585A patent/JPS6266706A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2006066961A (ja) * | 2004-08-24 | 2006-03-09 | General Res Of Electronics Inc | 可変減衰回路 |
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