JPS6296825A - 測光回路 - Google Patents
測光回路Info
- Publication number
- JPS6296825A JPS6296825A JP23849985A JP23849985A JPS6296825A JP S6296825 A JPS6296825 A JP S6296825A JP 23849985 A JP23849985 A JP 23849985A JP 23849985 A JP23849985 A JP 23849985A JP S6296825 A JPS6296825 A JP S6296825A
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- JP
- Japan
- Prior art keywords
- transistor
- circuit
- voltage
- light receiving
- receiving element
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Photometry And Measurement Of Optical Pulse Characteristics (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〈産業上の利用分野〉
未発明はカメラの測光回路、特に受光素子から発生する
光電流を対数圧縮した後、対数伸張するカメラの測光回
路に関するものである。
光電流を対数圧縮した後、対数伸張するカメラの測光回
路に関するものである。
〈従来技術〉
」二足型式の測光回路は従来、第１図のように構成され
ていた。第１図を用いて従来装置を説明する。図中に於
いて１は受光素子でシリコンフォトセル（ＳＰＣ）等で
構成される。２は演算増幅器、３はＮＰＮトランジスタ
でそのベース、コレクタ間は短絡されダイオードとして
動作している。４は３と同一特性のＮＰＮトランジスタ
、５は演算増幅器、６，７は３．４と同一特性のＮＰＮ
トランジスタ、８，９は定電流源でその値を各々ｒ、
Ｉｏとする。
ていた。第１図を用いて従来装置を説明する。図中に於
いて１は受光素子でシリコンフォトセル（ＳＰＣ）等で
構成される。２は演算増幅器、３はＮＰＮトランジスタ
でそのベース、コレクタ間は短絡されダイオードとして
動作している。４は３と同一特性のＮＰＮトランジスタ
、５は演算増幅器、６，７は３．４と同一特性のＮＰＮ
トランジスタ、８，９は定電流源でその値を各々ｒ、
Ｉｏとする。
上記の構成で不図示の電源からの電圧が所定の各部に給
電されると、受光素子ｌに照射された光に応じて発生す
る光電流がトランジスタ３に流れ、その電圧降下分が増
幅器２の出力に発生する。この時上記光電流はトランジ
スタ３にて対数圧縮され、これらの回路にていわゆる対
数圧縮回路が構成される。増幅器２の出力電圧は伸張用
トランジスタ４のベースに印加されトランジスタ４のエ
ミッタの電圧が接地レベルであればトランジスタ４のコ
レクタには受光素子ｌの光ｍ ’ｆｉｆ、と同一（１ａ
のコレクタ電流が流れる、実際にはトランジスタ４のエ
ミッタ電圧は増幅器５、トランジスタ６．７定電流源８
゜９で構成される電圧源にて与えられており、この場合
の動作を式を使って説明する。
電されると、受光素子ｌに照射された光に応じて発生す
る光電流がトランジスタ３に流れ、その電圧降下分が増
幅器２の出力に発生する。この時上記光電流はトランジ
スタ３にて対数圧縮され、これらの回路にていわゆる対
数圧縮回路が構成される。増幅器２の出力電圧は伸張用
トランジスタ４のベースに印加されトランジスタ４のエ
ミッタの電圧が接地レベルであればトランジスタ４のコ
レクタには受光素子ｌの光ｍ ’ｆｉｆ、と同一（１ａ
のコレクタ電流が流れる、実際にはトランジスタ４のエ
ミッタ電圧は増幅器５、トランジスタ６．７定電流源８
゜９で構成される電圧源にて与えられており、この場合
の動作を式を使って説明する。
増幅器５の出力電圧ｖ５は
一方、受光素子ｌの光電流をＩ ＳＰＣとすれば増幅器
２の出力電圧ｖ２は となり、トランジスタ４のベースφエミッタ間には となるためトランジスタ４のコレクタ電流Ｉ ＣはＯ Ｉ ｃ ＝ −Ｘ Ｉ ５ Ｐ Ｃ ■ となり受光素子ｌの光電流ｌ５ＰＣをＩｏ／Ｉ倍増幅で
きることになる。
２の出力電圧ｖ２は となり、トランジスタ４のベースφエミッタ間には となるためトランジスタ４のコレクタ電流Ｉ ＣはＯ Ｉ ｃ ＝ −Ｘ Ｉ ５ Ｐ Ｃ ■ となり受光素子ｌの光電流ｌ５ＰＣをＩｏ／Ｉ倍増幅で
きることになる。
該トランジスタ４のコレクタ電流の使用法としてはトラ
ンジスタ４のコレクタに不図示の積分回路を接続し、該
積分動作をシャッター開から開始し、その積分値が所定
値に達した時に不図示のレリーズ用マグネットに通電を
行ってカメラのシャッタ開成させる公知のシャッタ制御
回路や、あるいは、受光素子１にストロボ光による被写
体からの反射光を照射しトランジスタ４のコレクタ電流
を上述と同様に積分して、そのレベル判定し、積分レベ
ルが所定値に達した際にストロボ発光を停止させるとい
った種々の用途が想定される。その場合上記ｒ ｏ ／
Ｉ倍に相当する情報としてはカメラの撮影パラメータ
であるフィルム感度、絞り値、シャッタースピードを設
定することが出来、情報設定演算がなされる。しかしな
がら第１図の回路状態は理想となるが トランジスタ４のペースエミッタ間電圧はとなり、トラ
ンジスタ４のコレクタ電流Ｉｃだけ誤差となりＩｃとし
ては温度特性を持った誤差となり、正確な露出制御を得
るにははなはだ不都合である。
ンジスタ４のコレクタに不図示の積分回路を接続し、該
積分動作をシャッター開から開始し、その積分値が所定
値に達した時に不図示のレリーズ用マグネットに通電を
行ってカメラのシャッタ開成させる公知のシャッタ制御
回路や、あるいは、受光素子１にストロボ光による被写
体からの反射光を照射しトランジスタ４のコレクタ電流
を上述と同様に積分して、そのレベル判定し、積分レベ
ルが所定値に達した際にストロボ発光を停止させるとい
った種々の用途が想定される。その場合上記ｒ ｏ ／
Ｉ倍に相当する情報としてはカメラの撮影パラメータ
であるフィルム感度、絞り値、シャッタースピードを設
定することが出来、情報設定演算がなされる。しかしな
がら第１図の回路状態は理想となるが トランジスタ４のペースエミッタ間電圧はとなり、トラ
ンジスタ４のコレクタ電流Ｉｃだけ誤差となりＩｃとし
ては温度特性を持った誤差となり、正確な露出制御を得
るにははなはだ不都合である。
く目的〉
本発明の目的は上述の従来装置の欠点を除去し、上記誤
差を補償した正確な光電流信号を得る測光回路を提供せ
んとするものである。本発明では上記目的を達成する構
成として受光素子を入力に接続すると共に帰還路中に対
数圧ｌｉｉ素子を接続した対数圧縮回路の出力を制御電
極に印加されると共にその一方の主電極に所定電圧が印
加されるトランジスタを有し、該トランジスタの出力電
流として受光素子の光信号を得る測光回路において、前
記トランジスタの前記一方の主電極に前記所定電圧を関
数とする抵抗成分を有する素子を接続したものである。
差を補償した正確な光電流信号を得る測光回路を提供せ
んとするものである。本発明では上記目的を達成する構
成として受光素子を入力に接続すると共に帰還路中に対
数圧ｌｉｉ素子を接続した対数圧縮回路の出力を制御電
極に印加されると共にその一方の主電極に所定電圧が印
加されるトランジスタを有し、該トランジスタの出力電
流として受光素子の光信号を得る測光回路において、前
記トランジスタの前記一方の主電極に前記所定電圧を関
数とする抵抗成分を有する素子を接続したものである。
〈実施例〉
第３図は本発明に係る測光回路の一実施例に示す回路図
であり、図中に於いて第１．第２図と同一・素子に対し
ては同一番号を符しである。
であり、図中に於いて第１．第２図と同一・素子に対し
ては同一番号を符しである。
図中１２はＮチャンネルＭＤＳＦＥＴで図中のＧ、Ｓ、
Ｄの記号は各々ゲート、ソース、ドレインを表す。１３
は演算増幅器、１４．１５は上述のトランジスタ、３，
４，６．７と同一特性を有するＮＰＮトランジスタであ
り、又１６゜１７は定電流源である。
Ｄの記号は各々ゲート、ソース、ドレインを表す。１３
は演算増幅器、１４．１５は上述のトランジスタ、３，
４，６．７と同一特性を有するＮＰＮトランジスタであ
り、又１６゜１７は定電流源である。
以りの構成にて回路素子１３〜１７にて構成される定電
圧源は定電圧源（５〜９）と同様絶対温度Ｔに比例した
電圧を発生する定電圧源であり、その電圧がＦＥＴ１２
のゲートに印加され、ＦＥＴ１２のゲートソース間電圧
に応じてドレインソース間の抵抗が変化する。ＦＥＴ
１２のゲートソース間の抵抗をＲＯＭとすればトランジ
スタ４のペースエミッタ間の電圧はめには となるようにＲＯＮを決定すれば良い、即ちになればよ
い。
圧源は定電圧源（５〜９）と同様絶対温度Ｔに比例した
電圧を発生する定電圧源であり、その電圧がＦＥＴ１２
のゲートに印加され、ＦＥＴ１２のゲートソース間電圧
に応じてドレインソース間の抵抗が変化する。ＦＥＴ
１２のゲートソース間の抵抗をＲＯＭとすればトランジ
スタ４のペースエミッタ間の電圧はめには となるようにＲＯＮを決定すれば良い、即ちになればよ
い。
そこで、ＦＥＴ１２のゲートソース間電圧ＲＯＭ特性が
（１）を満足する様に動作点を設定る。これを式で示す
と増幅器１３の出力をＶ１３とすると Ｔ Ｖ１３＝−ｆｌ ｎｎ （ｎは定電流源１６．１７の
電流比）よって、ＦＥＴ１２のゲートソース間電圧ＶＣ
Ｓ はｖｃｓ＝Ｖｔ３−ｖ’＋ になる様にＦＥＴ１２を設定すればよいことになり、こ
れにてトランジスタのコレクター電流第４図は本発明に
係る測光回路の他の実施例を示す回路図である。図中１
８−１．１８−２−−−一−−，１８−８，２０−１，
２０−２−−−−−−。
（１）を満足する様に動作点を設定る。これを式で示す
と増幅器１３の出力をＶ１３とすると Ｔ Ｖ１３＝−ｆｌ ｎｎ （ｎは定電流源１６．１７の
電流比）よって、ＦＥＴ１２のゲートソース間電圧ＶＣ
Ｓ はｖｃｓ＝Ｖｔ３−ｖ’＋ になる様にＦＥＴ１２を設定すればよいことになり、こ
れにてトランジスタのコレクター電流第４図は本発明に
係る測光回路の他の実施例を示す回路図である。図中１
８−１．１８−２−−−一−−，１８−８，２０−１，
２０−２−−−−−−。
２０−８はアナログスイッチ−でＣ端子を高レベルにす
るとそのＡ、Ｂ端子間は短絡し、Ｃ端子を低レベルにす
るとＡ、Ｂ端子間は開放する。
るとそのＡ、Ｂ端子間は短絡し、Ｃ端子を低レベルにす
るとＡ、Ｂ端子間は開放する。
１９−１ 、１９−２−−−−−− 、１９−８は各々
ＲＩ Ｒ２−−−−−Ｒ８の値を有する抵抗、８−１．
８−２−一〜−−，８−８は各々Ｉ １． Ｉ ２−一
−−−−、Ｉ Ｑの値を有する定電流源。
ＲＩ Ｒ２−−−−−Ｒ８の値を有する抵抗、８−１．
８−２−一〜−−，８−８は各々Ｉ １． Ｉ ２−一
−−−−、Ｉ Ｑの値を有する定電流源。
２１は３ビツトデコーダでａ、ｂ、ｃが入力端子、ｄ１
〜ｄ８がデコード出力である。
〜ｄ８がデコード出力である。
２２〜２４はスイッチでカメラの撮影パラメータに対応
して設定可能なものである。他の回路構成において、第
３図実施例と同一のものには同一記号を附しである。上
記構成で１例えばスイッチ２２〜２４を全て開放状態に
するとデコーダ２１の出力はｄｌが選ばれ、高レベルと
なり１８−１．２０−１が導通状態、１８−２−−−−
−−．１８−８．２０−２−−−−−−．２０−８は開
放状態になる。このためトランジスタ４のエミッタと増
幅器５の出力の間には抵抗１９−１が接続されることに
なる。また、トランジスタ６に流れる電流源としては８
−１が選ばれるが電流源８−１（１１とする）と抵抗１
９−１（Ｒ１とする）の関係を第３図説明と同様に 工Ｉ Ｒ１＝□・Ｒ Ｏ の関係になるよう設定すれば抵抗１０１１の影響なく、
受光素子１の光電流が対数圧縮、伸張可能となる。又、
スイッチ２２〜２４の設定にて選ばれる電流源と抵抗の
関係を同様にしてとすれば、スイッチ２２〜２４の情報
設定状態によらず、常にトランジスタ４のコレクター電
流が理想イ１ａとなる。
して設定可能なものである。他の回路構成において、第
３図実施例と同一のものには同一記号を附しである。上
記構成で１例えばスイッチ２２〜２４を全て開放状態に
するとデコーダ２１の出力はｄｌが選ばれ、高レベルと
なり１８−１．２０−１が導通状態、１８−２−−−−
−−．１８−８．２０−２−−−−−−．２０−８は開
放状態になる。このためトランジスタ４のエミッタと増
幅器５の出力の間には抵抗１９−１が接続されることに
なる。また、トランジスタ６に流れる電流源としては８
−１が選ばれるが電流源８−１（１１とする）と抵抗１
９−１（Ｒ１とする）の関係を第３図説明と同様に 工Ｉ Ｒ１＝□・Ｒ Ｏ の関係になるよう設定すれば抵抗１０１１の影響なく、
受光素子１の光電流が対数圧縮、伸張可能となる。又、
スイッチ２２〜２４の設定にて選ばれる電流源と抵抗の
関係を同様にしてとすれば、スイッチ２２〜２４の情報
設定状態によらず、常にトランジスタ４のコレクター電
流が理想イ１ａとなる。
く効果〉
以上の如く本発明では光信号を対数圧縮した後伸張し、
かつ伸張過程にて情報値を設定可能ならしめた測光回路
における出力に含まれる誤差成分を除去し、常に正確な
光電流を得ることが出来るものである。
かつ伸張過程にて情報値を設定可能ならしめた測光回路
における出力に含まれる誤差成分を除去し、常に正確な
光電流を得ることが出来るものである。
第１図は従来のＩ！ＩＩＩ光回路を示す回路図、第２図
は第１図示の回路を実装した際の回路を示す回路図、第
３図は本発明に係る測光回路の−実施例を示す回路図、
第４図は本発明の他の実施例を示す回路図である。 ｌは受光素子、２ＳＩＢは演算増幅器、３゜４．５，６
，１４．１５はＮＰＮ トランジスタ、８．９，１６．
１７は定電流源、１０．１１は抵抗、１２はＭＯ５型電
界効果トランジスタ、１Ｂ−１，１８−２，１８−８，
２０−１，２０−２，２０−８はアナログスイッチ、１
９−１ 、１９−２ 、１９−８は抵抗、８−１．８−
２．８−８は定電流源、２１はデコーダ、２２，２３．
２４はスイッチである。 特許出願人 キャノン株式会社 ’Ｅ１［Ｉ］ Ｆ、２８ ６′
は第１図示の回路を実装した際の回路を示す回路図、第
３図は本発明に係る測光回路の−実施例を示す回路図、
第４図は本発明の他の実施例を示す回路図である。 ｌは受光素子、２ＳＩＢは演算増幅器、３゜４．５，６
，１４．１５はＮＰＮ トランジスタ、８．９，１６．
１７は定電流源、１０．１１は抵抗、１２はＭＯ５型電
界効果トランジスタ、１Ｂ−１，１８−２，１８−８，
２０−１，２０−２，２０−８はアナログスイッチ、１
９−１ 、１９−２ 、１９−８は抵抗、８−１．８−
２．８−８は定電流源、２１はデコーダ、２２，２３．
２４はスイッチである。 特許出願人 キャノン株式会社 ’Ｅ１［Ｉ］ Ｆ、２８ ６′
Claims (1)
- 受光素子を入力に接続すると共に帰還路中に対数圧縮素
子を接続した対数圧縮回路の出力を制御電極に印加され
ると共にその一方の主電極に所定電圧が印加されるトラ
ンジスタを有し、該トランジスタの出力電流として受光
素子の光信号を得る測光回路において、前記トランジス
タの前記一方の主電極に前記所定電圧を関数とする抵抗
成分を有する素子を接続したことを特徴とする測光回路
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23849985A JPS6296825A (ja) | 1985-10-24 | 1985-10-24 | 測光回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23849985A JPS6296825A (ja) | 1985-10-24 | 1985-10-24 | 測光回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6296825A true JPS6296825A (ja) | 1987-05-06 |
Family
ID=17031153
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP23849985A Pending JPS6296825A (ja) | 1985-10-24 | 1985-10-24 | 測光回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6296825A (ja) |
-
1985
- 1985-10-24 JP JP23849985A patent/JPS6296825A/ja active Pending
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