JPS6315530B2 - - Google Patents
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- JPS6315530B2 JPS6315530B2 JP18900480A JP18900480A JPS6315530B2 JP S6315530 B2 JPS6315530 B2 JP S6315530B2 JP 18900480 A JP18900480 A JP 18900480A JP 18900480 A JP18900480 A JP 18900480A JP S6315530 B2 JPS6315530 B2 JP S6315530B2
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- 238000001514 detection method Methods 0.000 claims description 4
- 230000001934 delay Effects 0.000 claims description 3
- 238000005070 sampling Methods 0.000 description 16
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- 238000010586 diagram Methods 0.000 description 5
- 230000003111 delayed effect Effects 0.000 description 2
- 101000579646 Penaeus vannamei Penaeidin-1 Proteins 0.000 description 1
- 230000001010 compromised effect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000000630 rising effect Effects 0.000 description 1
- 238000004904 shortening Methods 0.000 description 1
Classifications
-
- G—PHYSICS
- G01—MEASURING; TESTING
- G01D—MEASURING NOT SPECIALLY ADAPTED FOR A SPECIFIC VARIABLE; ARRANGEMENTS FOR MEASURING TWO OR MORE VARIABLES NOT COVERED IN A SINGLE OTHER SUBCLASS; TARIFF METERING APPARATUS; MEASURING OR TESTING NOT OTHERWISE PROVIDED FOR
- G01D9/00—Recording measured values
- G01D9/28—Producing one or more recordings, each recording being of the values of two or more different variables
- G01D9/30—Producing one or more recordings, each recording being of the values of two or more different variables there being a separate recording element for each variable, e.g. multiple-pen recorder
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- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Recording Measured Values (AREA)
Description
【発明の詳細な説明】
本発明は、複数の入力信号を記録紙に記録する
複数の記録チヤンネルを有する多チヤンネル方式
の記録計に関するものである。
複数の記録チヤンネルを有する多チヤンネル方式
の記録計に関するものである。
周知のように、複数の記録チヤンネルを有する
多チヤンネル方式の記録計では、記録紙の全幅に
亘つて複数の入力信号を同時に記録可能なように
各記録チヤンネル（以下、チヤンネルという）の
ペンが記録紙送り方向にずらして取付けられると
共に、複数の入力信号を同時に記録した場合でも
各チヤンネルの記録結果の時間関係が一致するよ
うに、各チヤンネルの入力信号をペンの位置ずれ
と記録紙送り速度とに応じて遅延し、この遅延信
号を記録信号としてペンの駆動部に与えるように
している。この場合、入力信号の遅延処理は、デ
イジタル的に行う方が便利で、かつ高精度である
ため、シフトレジスタ等のメモリ手段の記憶ステ
ージ数Ｎとクロツクパルスの１周期Ｔとを適宜設
定することにより、遅延時間Ｎ・Ｔを得るように
している。
多チヤンネル方式の記録計では、記録紙の全幅に
亘つて複数の入力信号を同時に記録可能なように
各記録チヤンネル（以下、チヤンネルという）の
ペンが記録紙送り方向にずらして取付けられると
共に、複数の入力信号を同時に記録した場合でも
各チヤンネルの記録結果の時間関係が一致するよ
うに、各チヤンネルの入力信号をペンの位置ずれ
と記録紙送り速度とに応じて遅延し、この遅延信
号を記録信号としてペンの駆動部に与えるように
している。この場合、入力信号の遅延処理は、デ
イジタル的に行う方が便利で、かつ高精度である
ため、シフトレジスタ等のメモリ手段の記憶ステ
ージ数Ｎとクロツクパルスの１周期Ｔとを適宜設
定することにより、遅延時間Ｎ・Ｔを得るように
している。
ところで、このような記録計において所定の遅
延時間Ｎ・Ｔを得るために前記記憶ステージ数Ｎ
とクロツクパルスの１周期Ｔとを定める場合、記
憶ステージ数Ｎをペンの位置ずれおよび記録紙送
り速度に応じて変更するのは回路構成上各種の困
難を伴うので、従来は記憶ステージ数Ｎをペンの
位置ずれ量に比例した値に固定した上でクロツク
パルスの１周期Ｔを記録紙送り速度に応じて変更
するようにしている。
延時間Ｎ・Ｔを得るために前記記憶ステージ数Ｎ
とクロツクパルスの１周期Ｔとを定める場合、記
憶ステージ数Ｎをペンの位置ずれおよび記録紙送
り速度に応じて変更するのは回路構成上各種の困
難を伴うので、従来は記憶ステージ数Ｎをペンの
位置ずれ量に比例した値に固定した上でクロツク
パルスの１周期Ｔを記録紙送り速度に応じて変更
するようにしている。
しかし、このようにすると入力信号のサンプリ
ング間隔が記録紙送り速度に応じて変更されるこ
とを意味し、例えば記録送り速度が遅くなつた場
合に入力信号の記録に欠落が発生し、入力信号の
記録の忠実性が損なわれるという欠点が生じてい
る。特に、この欠点は入力信号波形の時間幅が短
く、しかも立上り、立下りが急峻の場合ほど顕著
に表われ、例えば第１図ａに示すような波形形状
の入力信号のうちD2、D3で示す最大値が欠落し、
第１図ｃに示すような波形形状の信号として記録
されてしまうという欠点が生じている。
ング間隔が記録紙送り速度に応じて変更されるこ
とを意味し、例えば記録送り速度が遅くなつた場
合に入力信号の記録に欠落が発生し、入力信号の
記録の忠実性が損なわれるという欠点が生じてい
る。特に、この欠点は入力信号波形の時間幅が短
く、しかも立上り、立下りが急峻の場合ほど顕著
に表われ、例えば第１図ａに示すような波形形状
の入力信号のうちD2、D3で示す最大値が欠落し、
第１図ｃに示すような波形形状の信号として記録
されてしまうという欠点が生じている。
なお、第１図ａ〜ｄにおいて、同図ｂは同図ａ
の拡大図、同図ｄは同図ｃの拡大図である。
の拡大図、同図ｄは同図ｃの拡大図である。
ここで、このような欠点は入力信号のサンプリ
ング周期を短くし、さらにシフトレジスタ等のメ
モリ手段の記憶ステージ数Ｎを大きくすることに
よつて解決することも考えられるが、このように
するとメモリ手段の構成が大規模なものとなり、
装置規模および経済性という点で好ましくない。
ング周期を短くし、さらにシフトレジスタ等のメ
モリ手段の記憶ステージ数Ｎを大きくすることに
よつて解決することも考えられるが、このように
するとメモリ手段の構成が大規模なものとなり、
装置規模および経済性という点で好ましくない。
本発明はこのような欠点を解決するためになさ
れたもので、その目的は小規模、かつ経済的構成
で、入力信号の記録を欠落を防止し、入力信号に
忠実な記録ができるようにした多チヤンネル方式
の記録計を提供することにある。
れたもので、その目的は小規模、かつ経済的構成
で、入力信号の記録を欠落を防止し、入力信号に
忠実な記録ができるようにした多チヤンネル方式
の記録計を提供することにある。
このために本発明は、記録紙送り速度に対応す
る単位周期毎に該単位周期内における入力信号の
代表値を検出し、この代表値を記録紙送り速度お
よびペンの位置ずれに応じて遅延させた後、記録
信号としてペンの駆動部に与えるようにしたもの
である。代表値としては、最大値または最小値の
いずれか一方または両方が適宜選ばれる。
る単位周期毎に該単位周期内における入力信号の
代表値を検出し、この代表値を記録紙送り速度お
よびペンの位置ずれに応じて遅延させた後、記録
信号としてペンの駆動部に与えるようにしたもの
である。代表値としては、最大値または最小値の
いずれか一方または両方が適宜選ばれる。
以下、図示する実施例に基づき本発明を詳細に
説明する。
説明する。
第２図は記録チヤンネルが２チヤンネルの記録
計に本発明を適用した実施例を示すブロツク図で
ある。
計に本発明を適用した実施例を示すブロツク図で
ある。
同図において、第１のチヤンネルCH１の入力
信号は増幅器１を介してサーボモータ２に送られ
る。そして、このサーボモータ２によつてポテン
シヨメータ３の摺動子位置が移動される。このポ
テンシヨメータ３の摺動子の動きは図示しないペ
ン移動機構を介してペン４に伝達される。これに
よつて、ペン４は入力信号に追従して動き、入力
信号に対応した波形を記録紙に記録する。
信号は増幅器１を介してサーボモータ２に送られ
る。そして、このサーボモータ２によつてポテン
シヨメータ３の摺動子位置が移動される。このポ
テンシヨメータ３の摺動子の動きは図示しないペ
ン移動機構を介してペン４に伝達される。これに
よつて、ペン４は入力信号に追従して動き、入力
信号に対応した波形を記録紙に記録する。
一方、第２のチヤンネルCH２においては、
AD変換器５、最大・最小値検出器６、遅延回路
７、補間演算器８、DA変換器９、サンプリング
パルス発生器１０、発振器１１、分周器１２、記
録紙送り早さ切換スイツチ１３、増幅器１４、サ
ーボモータ１５、ポテンシヨメータ１６、ペン１
７、1/2分周器１８が設けられ、入力信号はAD
変換器５においてサンプリングパルス発生器１０
から発生されるサンプリングパルスSPの周期ｔ
でデイジタル信号に変換されて最大・最小値検出
器（以下、検出器と略記する）６に送られる。
AD変換器５、最大・最小値検出器６、遅延回路
７、補間演算器８、DA変換器９、サンプリング
パルス発生器１０、発振器１１、分周器１２、記
録紙送り早さ切換スイツチ１３、増幅器１４、サ
ーボモータ１５、ポテンシヨメータ１６、ペン１
７、1/2分周器１８が設けられ、入力信号はAD
変換器５においてサンプリングパルス発生器１０
から発生されるサンプリングパルスSPの周期ｔ
でデイジタル信号に変換されて最大・最小値検出
器（以下、検出器と略記する）６に送られる。
サンプリングパルスSPの周基ｔは、記録紙送
り速度に対応した単位周期Ｔより極めて短く設定
されるもので、このサンプリングパルスSPは上
記AD変換器５の変換動作周期、検出器６におけ
る最大値および最小値の検出動作周期、補間演算
器８の補間演算周期を定める信号として利用され
ている。AD変換器５においてデイジタル信号に
変換された入力信号は、検出器６において記録紙
送り速度に対応した単位周期Ｔのうちで最大値
Mx、最小値Mnが検出される。第３図ａにチヤ
ンネルCH２に加えられる入力信号の一例を示
し、同図ｂにはその拡大図を示している。
り速度に対応した単位周期Ｔより極めて短く設定
されるもので、このサンプリングパルスSPは上
記AD変換器５の変換動作周期、検出器６におけ
る最大値および最小値の検出動作周期、補間演算
器８の補間演算周期を定める信号として利用され
ている。AD変換器５においてデイジタル信号に
変換された入力信号は、検出器６において記録紙
送り速度に対応した単位周期Ｔのうちで最大値
Mx、最小値Mnが検出される。第３図ａにチヤ
ンネルCH２に加えられる入力信号の一例を示
し、同図ｂにはその拡大図を示している。
検出器６は、第３図ｂに示すように単位周期Ｔ
の開始時点t0における入力信号D0を基準値として
記憶する基準値メモリMsと、単位周期Ｔの中で
基準値に対して正および負の最大偏差を示す入力
信号をそれぞれ最大値Mxおよび最小値Mnとし
て検出する最大偏差検出器MDDと、この検出器
MDDにおいて検出した最大値Mxおよび最小値
Mnを記憶する第１メモリM1および第２メモリ
M2とから構成され、最大偏差の検出はサンプリ
ングパルスSPの周期ｔで実行される。従つて、
第３図ｂに示すような入力信号の場合、入力信号
の瞬時値D0が基準値として基準値メモリMsに記
憶され、また瞬時値D2が最小値Mnとして第２メ
モリM2に記憶され、さらに瞬時値D3が最大値M1
として第１メモリM1に記憶される。この場合、
t0からt1に到る期間においては瞬時値D1が最大値
Mxとして検出されてまず第１メモリM1に記憶さ
れる。次にt1からt2に到る期間においては瞬時値
D2が最小値Mnとして検出されるので、期間t0〜
t1において最大値Mnとして第１メモリM1に記憶
した瞬時値D1は第２メモリM2に転送される。そ
して、第１メモリM1には瞬時値D2が最小値Mn
として記憶される。次に、t2〜t3に到る期間にな
ると、第２メモリM2に転送した瞬時値D1よりさ
らに大きな正の振幅の瞬時値D3が検出されるの
で、第１メモリM1に最小値Mnとして記憶した瞬
時値D2は第２メモリM2に転送され、第１メモリ
M1には瞬時値D3が最大値Mxとして記憶される。
すなわち、t0〜t1において最大値Mxとして検出
した瞬時値D1はその後に現われた瞬時値D3によ
つて追い出された格好となる。
の開始時点t0における入力信号D0を基準値として
記憶する基準値メモリMsと、単位周期Ｔの中で
基準値に対して正および負の最大偏差を示す入力
信号をそれぞれ最大値Mxおよび最小値Mnとし
て検出する最大偏差検出器MDDと、この検出器
MDDにおいて検出した最大値Mxおよび最小値
Mnを記憶する第１メモリM1および第２メモリ
M2とから構成され、最大偏差の検出はサンプリ
ングパルスSPの周期ｔで実行される。従つて、
第３図ｂに示すような入力信号の場合、入力信号
の瞬時値D0が基準値として基準値メモリMsに記
憶され、また瞬時値D2が最小値Mnとして第２メ
モリM2に記憶され、さらに瞬時値D3が最大値M1
として第１メモリM1に記憶される。この場合、
t0からt1に到る期間においては瞬時値D1が最大値
Mxとして検出されてまず第１メモリM1に記憶さ
れる。次にt1からt2に到る期間においては瞬時値
D2が最小値Mnとして検出されるので、期間t0〜
t1において最大値Mnとして第１メモリM1に記憶
した瞬時値D1は第２メモリM2に転送される。そ
して、第１メモリM1には瞬時値D2が最小値Mn
として記憶される。次に、t2〜t3に到る期間にな
ると、第２メモリM2に転送した瞬時値D1よりさ
らに大きな正の振幅の瞬時値D3が検出されるの
で、第１メモリM1に最小値Mnとして記憶した瞬
時値D2は第２メモリM2に転送され、第１メモリ
M1には瞬時値D3が最大値Mxとして記憶される。
すなわち、t0〜t1において最大値Mxとして検出
した瞬時値D1はその後に現われた瞬時値D3によ
つて追い出された格好となる。
このように第１メモリM1と第２メモリM2との
構成を、最大値Mxおよび最小値Mnのいずれか
一方を記憶するものとして固定するのでなく、最
大値Mxまたは最小値Mnの現われる順序に従つ
て順送りする構成にしておけば、第１メモリM1
には最新の最大値または最小値が記憶され、また
第２メモリM2にはそれ以前の最大値または最小
値が記憶されるようになるため、検出した最大値
および最小値をその発生順序に従つて記録するこ
とができる。
構成を、最大値Mxおよび最小値Mnのいずれか
一方を記憶するものとして固定するのでなく、最
大値Mxまたは最小値Mnの現われる順序に従つ
て順送りする構成にしておけば、第１メモリM1
には最新の最大値または最小値が記憶され、また
第２メモリM2にはそれ以前の最大値または最小
値が記憶されるようになるため、検出した最大値
および最小値をその発生順序に従つて記録するこ
とができる。
このようにして第１メモリM1および第２メモ
リM2に記憶された最大値Mxおよび最小値Mn
は、記録紙送り早さ切換スイツチ１３で選択した
周期T/2の制御パルスCPを1/2分周期１８で分周
した周期Ｔの制御パルスCP′によつて遅延回路７
に転送される。
リM2に記憶された最大値Mxおよび最小値Mn
は、記録紙送り早さ切換スイツチ１３で選択した
周期T/2の制御パルスCPを1/2分周期１８で分周
した周期Ｔの制御パルスCP′によつて遅延回路７
に転送される。
チヤンネル早さ切換スイツチ（以下、切換スイ
ツチと略記する）１３は、分周器１２の分周出力
のうち記録紙送り速度に対応した周期T/2の分周
出力を選択し、検出器６、遅延回路７、記録紙送
りモータＭに与えるものであり、検出器６および
モータＭに対しては1/2分周器１８を経由して周
期Ｔの制御パルスCP′として与えられる。この場
合の分周器１２の入力信号は発振器１１から与え
られる。
ツチと略記する）１３は、分周器１２の分周出力
のうち記録紙送り速度に対応した周期T/2の分周
出力を選択し、検出器６、遅延回路７、記録紙送
りモータＭに与えるものであり、検出器６および
モータＭに対しては1/2分周器１８を経由して周
期Ｔの制御パルスCP′として与えられる。この場
合の分周器１２の入力信号は発振器１１から与え
られる。
また、遅延回路７は例えばシフトレジスタ（シ
フトレジスタと同等な動作をするものを含む）か
らなるメモリ手段で構成され、検出器６において
検出した期間Ｔにおける最大値Mxおよび最小値
Mnを記録紙送り速度ｖとペンの位置ずれｌとに
応じて遅延して補間演算器８に供給するものであ
る。
フトレジスタと同等な動作をするものを含む）か
らなるメモリ手段で構成され、検出器６において
検出した期間Ｔにおける最大値Mxおよび最小値
Mnを記録紙送り速度ｖとペンの位置ずれｌとに
応じて遅延して補間演算器８に供給するものであ
る。
ここで、前記制御パルスCPの周期T/2、記録
紙送り速度ｖ、遅延回路７の遅延時間tdは、第１
のチヤンネルのペン４と第２のチヤンネルのペン
１７との記録紙送り方向に対する位置ずれを第４
図に示すようにｌとし、さらに遅延回路７をシフ
トレジスタで構成した時の記憶ステージ数をＮと
すると、次の関係がある。
紙送り速度ｖ、遅延回路７の遅延時間tdは、第１
のチヤンネルのペン４と第２のチヤンネルのペン
１７との記録紙送り方向に対する位置ずれを第４
図に示すようにｌとし、さらに遅延回路７をシフ
トレジスタで構成した時の記憶ステージ数をＮと
すると、次の関係がある。
td＝Ｎ・Ｔ／２＝ｌ／ｖ ……(1)
従つて、記憶ステージ数Ｎが固定されると、制
御パルスCPの周期Ｔは、 Ｔ＝２・ｌ／Ｎ・１／ｖ ……(2) の関係となり、記録紙送り速度ｖの逆数に比例し
た時間として与えられる。
御パルスCPの周期Ｔは、 Ｔ＝２・ｌ／Ｎ・１／ｖ ……(2) の関係となり、記録紙送り速度ｖの逆数に比例し
た時間として与えられる。
従つて、このような関係の制御パルスCP′が検
出器６に与えられると、まず周期Ｔの終了時にお
いて第２メモリM2に記憶されている値が遅延回
路７の第２の記憶ステージに、また第１メモリ
M1に記憶されている値が遅延回路７の第１の記
憶ステージに転送される。すると、これらの値は
制御パルスCPの発生毎（T/2周期毎）に第１お
よび第２の記憶ステージから第Ｎ−１および第Ｎ
の記憶ステージに向けて順次転送される。そし
て、td時間経過すると、第Ｎ−１および第Ｎステ
ージから補間演算器８に供給される。すなわち、
検出器６において検出した入力信号の最大値Mx
および最小値Mnはtd時間遅延されて補間演算器
８に転送される。
出器６に与えられると、まず周期Ｔの終了時にお
いて第２メモリM2に記憶されている値が遅延回
路７の第２の記憶ステージに、また第１メモリ
M1に記憶されている値が遅延回路７の第１の記
憶ステージに転送される。すると、これらの値は
制御パルスCPの発生毎（T/2周期毎）に第１お
よび第２の記憶ステージから第Ｎ−１および第Ｎ
の記憶ステージに向けて順次転送される。そし
て、td時間経過すると、第Ｎ−１および第Ｎステ
ージから補間演算器８に供給される。すなわち、
検出器６において検出した入力信号の最大値Mx
および最小値Mnはtd時間遅延されて補間演算器
８に転送される。
補間演算器８は、周期T/2毎にＡ部に入力され
る値とＢ部に入力される値とに基づきＡ部の値か
らＢ部の値に到る単位時間毎の補間値を求めるも
のであつて、補間演算はサンプリングパルスSP
の周期ｔで実行される。
る値とＢ部に入力される値とに基づきＡ部の値か
らＢ部の値に到る単位時間毎の補間値を求めるも
のであつて、補間演算はサンプリングパルスSP
の周期ｔで実行される。
例えば、入力信号が第３図ｂに示したようなも
のであり、補間演算器８に対し最小値Mnを示す
瞬時値D2が第１番目の値として入力され、次に
最大値Mxを示す瞬時値D3が第２番目の値として
入力され、さらに次の周期Ｔにおける最大値Mx
を示す瞬時値D4が第３番目の値として入力され
ると、周期Ｔの前半Ｔ／２において次式で示され
る補間値DipをサンプリングパルスSPの発生毎に
求めて出力する。
のであり、補間演算器８に対し最小値Mnを示す
瞬時値D2が第１番目の値として入力され、次に
最大値Mxを示す瞬時値D3が第２番目の値として
入力され、さらに次の周期Ｔにおける最大値Mx
を示す瞬時値D4が第３番目の値として入力され
ると、周期Ｔの前半Ｔ／２において次式で示され
る補間値DipをサンプリングパルスSPの発生毎に
求めて出力する。
Dip＝D2＋D3−D2／Ｔ／２・ｎ ……(3)
ここで、ｎはサンプリングパルスSPの発生数
である。
である。
また、周期Ｔの後半Ｔ／２においては次式で示
される補間値DipをサンプリングパルスSPの発生
毎に求めて出力する。
される補間値DipをサンプリングパルスSPの発生
毎に求めて出力する。
Dip＝D3＋D4−D3／Ｔ／２・ｎ ……(4)
これによつて、補間演算器８は第３図ｄに示す
ように変化する値をサンプリングパルスSPの発
生毎に出力する。
ように変化する値をサンプリングパルスSPの発
生毎に出力する。
この補間演算器８の出力はDA変換器９におい
てアナログ信号に変換される。そして、そのアナ
ログ信号の変化は増幅器１４およびサーボモータ
１５を介してポテンシヨメータ６に伝達される。
これによつて、第２のチヤンネルのペン１７は、
補間演算器８の出力の変化に追従して動き、第３
図ｃに示すような波形を記録紙に記録する。すな
わち、周期Ｔにおける入力信号に近似した波形が
記録紙に記録される。
てアナログ信号に変換される。そして、そのアナ
ログ信号の変化は増幅器１４およびサーボモータ
１５を介してポテンシヨメータ６に伝達される。
これによつて、第２のチヤンネルのペン１７は、
補間演算器８の出力の変化に追従して動き、第３
図ｃに示すような波形を記録紙に記録する。すな
わち、周期Ｔにおける入力信号に近似した波形が
記録紙に記録される。
このように本実施例は、周期Ｔにおける入力信
号の最大値および最小値を該周期における入力信
号の代表値として検出し、この代表値を所定時間
遅延した後補間演算しその演算値をペンの駆動部
分へ伝達するようにしたものである。このため、
記録紙送り速度が遅くなつても記録の欠落が発生
せず、入力信号に近似した記録を行うことができ
る。また、補間演算を行つているため、ペンの動
きが滑らかになり、インキのにじみなどが起らず
美観上も優れた記録結果を得ることができる。特
に、従来においては例えば第３図ｅに示すような
正弦波形を記録する場合、サンプリング周期が正
弦波入力信号の周期と一致した場合には第３図ｆ
に示すように波形は全く記録されず、またサンプ
リング周期と正弦波入力信号の周期が半周期だけ
ずれた場合には第３図ｇに示すように矩形波とし
て記録されてしまうが、本実施例においては第３
図ｈに示すように正弦波入力信号に近似した波形
として記録され、入力信号の再現性を向上させる
ことができる。
号の最大値および最小値を該周期における入力信
号の代表値として検出し、この代表値を所定時間
遅延した後補間演算しその演算値をペンの駆動部
分へ伝達するようにしたものである。このため、
記録紙送り速度が遅くなつても記録の欠落が発生
せず、入力信号に近似した記録を行うことができ
る。また、補間演算を行つているため、ペンの動
きが滑らかになり、インキのにじみなどが起らず
美観上も優れた記録結果を得ることができる。特
に、従来においては例えば第３図ｅに示すような
正弦波形を記録する場合、サンプリング周期が正
弦波入力信号の周期と一致した場合には第３図ｆ
に示すように波形は全く記録されず、またサンプ
リング周期と正弦波入力信号の周期が半周期だけ
ずれた場合には第３図ｇに示すように矩形波とし
て記録されてしまうが、本実施例においては第３
図ｈに示すように正弦波入力信号に近似した波形
として記録され、入力信号の再現性を向上させる
ことができる。
この場合、入力信号の再現性をそれ程必要とし
ないときには、最大値Mxおよび最小値Mnのう
ち基準値に対する偏差が大きい方を遅延回路７に
転送するようにし、補間演算器８における補間演
算は次の周期の代表値との間で周期Ｔの期間で行
うようにしても良い。また、最大値Mxおよび最
小値Mnのいずれか一方を遅延回路７に転送し、
補間演算を行なわずにペンの駆動部分に伝達する
ようにしても、入力信号の再現性は低下するが欠
落は防止でき、入力信号に変化があつたか否かを
重視する場合の記録計に適用すればその実用的効
果は大きい。
ないときには、最大値Mxおよび最小値Mnのう
ち基準値に対する偏差が大きい方を遅延回路７に
転送するようにし、補間演算器８における補間演
算は次の周期の代表値との間で周期Ｔの期間で行
うようにしても良い。また、最大値Mxおよび最
小値Mnのいずれか一方を遅延回路７に転送し、
補間演算を行なわずにペンの駆動部分に伝達する
ようにしても、入力信号の再現性は低下するが欠
落は防止でき、入力信号に変化があつたか否かを
重視する場合の記録計に適用すればその実用的効
果は大きい。
なお、実施例においては、記録チヤンネルが２
チヤンネルの場合を示して説明したが、３チヤン
ネル以上の場合には各チヤンネルにおける遅延回
路の記憶ステージ数Ｎを当該チヤンネルのペンの
位置ずれに対応して設定した構成とすれば良い。
また、構成をさらに簡略化したい場合、遅延回路
に並列入力・並列出力型のシフトレジスタを使用
し、第１メモリおよび第２メモリをこのシフトレ
ジスタで兼用するようにすれば良い。
チヤンネルの場合を示して説明したが、３チヤン
ネル以上の場合には各チヤンネルにおける遅延回
路の記憶ステージ数Ｎを当該チヤンネルのペンの
位置ずれに対応して設定した構成とすれば良い。
また、構成をさらに簡略化したい場合、遅延回路
に並列入力・並列出力型のシフトレジスタを使用
し、第１メモリおよび第２メモリをこのシフトレ
ジスタで兼用するようにすれば良い。
また、最大・最小値検出器、遅延回路、補間演
算器はマイクロプロセツサに置換しても良い。
算器はマイクロプロセツサに置換しても良い。
以上の説明から明らかなように本発明によれ
ば、小規模かつ経済的構成で入力信号の欠落を防
止し、入力信号に忠実な記録を行うことができ
る。
ば、小規模かつ経済的構成で入力信号の欠落を防
止し、入力信号に忠実な記録を行うことができ
る。
第１図は従来の記録計において入力信号が欠落
する様子を示す図、第２図は本発明の一実施例を
示す図、第３図は実施例の動作を説明するための
入出力波形図、第４図はペンの取付状態を示す図
である。 １，１４……増幅器、２，１５……サーボモー
タ、３，１６……ポテンシヨメータ、４，１７…
…ペン、５……AD変換器、６……最大・最小検
出器、７……遅延回路、８……補間演算器、９…
…DA変換器、１０……サンプリングパルス発生
器、１１……発振器、１２……分周器、１３……
記録紙送り早さ切換スイツチ、１８……1/2分周
器、Ｍ……記録紙送りモータ。
する様子を示す図、第２図は本発明の一実施例を
示す図、第３図は実施例の動作を説明するための
入出力波形図、第４図はペンの取付状態を示す図
である。 １，１４……増幅器、２，１５……サーボモー
タ、３，１６……ポテンシヨメータ、４，１７…
…ペン、５……AD変換器、６……最大・最小検
出器、７……遅延回路、８……補間演算器、９…
…DA変換器、１０……サンプリングパルス発生
器、１１……発振器、１２……分周器、１３……
記録紙送り早さ切換スイツチ、１８……1/2分周
器、Ｍ……記録紙送りモータ。
Claims (1)
- 【特許請求の範囲】 １ 位置が記録紙送り方向にずらして取付けら
れ、それぞれ対応するチヤンネルの入力信号を記
録紙に記録する複数のペンと、該ペンの位置ずれ
と記録紙送り速度とに応じて各チヤンネルの入力
信号を遅延する少なくとも１つ以上のシフトレジ
スタからなる遅延回路とを有する多チヤンネル式
の記録計において、 少なくとも１チヤンネルは、前記記録紙送り速
度に対応する単位周期毎に該単位周期内における
入力信号の最大値および最小値の少なくとも一方
からなる代表値を検出する検出手段を具備し、該
検出手段により検出された前記代表値を自己のチ
ヤンネルの前記遅延回路へ供給することを特徴と
する記録計。 ２ 位置が記録紙送り方向にずらして取付けら
れ、それぞれ対応するチヤンネルの入力信号を記
録紙に記録する複数のペンと、該ペンの位置ずれ
と記録紙送り速度とに応じて各チヤンネルの入力
信号を遅延する少なくとも１つ以上のシフトレジ
スタからなる遅延回路とを有する多チヤンネル式
の記録計において、 少なくとも１チヤンネルは、前記記録紙送り速
度に対応する単位周期毎に該単位周期内における
入力信号の最大値および最小値を検出し、その現
われる順序に従つてこの最大値および最小値を自
己のチヤンネルの前記遅延回路へ順次供給する最
大・最小値検出器と、遅延回路を経由した前記最
大値および最小値を補間演算し、その演算値をペ
ンの記録信号として出力する補間演算器とを具備
してなる記録計。 ３ 前記最大・最小値検出器は、前記単位周期毎
の開始時点における入力信号を基準値として記憶
する基準値メモリと、上記基準値に対して当該単
位周期内で正および負の最大偏差を示す入力信号
を検出する最大偏差検出器と、上記正および負の
最大偏差を示す入力信号を前記最大値および最小
値としてそれぞれ記憶し、自己のチヤンネルの前
記遅延回路に供給する第１メモリおよび第２メモ
リとから構成することを特徴とする特許請求の範
囲第２項記載の記録計。 ４ 前記第１メモリおよび第２メモリは、最新の
最大値または最小値を第１メモリに記憶し、それ
以前の最大値または最小値を第２のメモリに記憶
し、該第２メモリから前記遅延回路に供給する順
送り構成とすることを特徴とする特許請求の範囲
第３項記載の記録計。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18900480A JPS57113316A (en) | 1980-12-29 | 1980-12-29 | Recorder |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18900480A JPS57113316A (en) | 1980-12-29 | 1980-12-29 | Recorder |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS57113316A JPS57113316A (en) | 1982-07-14 |
| JPS6315530B2 true JPS6315530B2 (ja) | 1988-04-05 |
Family
ID=16233682
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18900480A Granted JPS57113316A (en) | 1980-12-29 | 1980-12-29 | Recorder |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS57113316A (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59147212A (ja) * | 1983-02-12 | 1984-08-23 | Shimadzu Corp | グラフイツク表示装置 |
| JPS61155916A (ja) * | 1984-12-28 | 1986-07-15 | Chino Works Ltd | 記録計 |
-
1980
- 1980-12-29 JP JP18900480A patent/JPS57113316A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS57113316A (en) | 1982-07-14 |
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