JPS63217804A - 音声増幅器のシヨツク音防止回路 - Google Patents
音声増幅器のシヨツク音防止回路Info
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- JPS63217804A JPS63217804A JP62051350A JP5135087A JPS63217804A JP S63217804 A JPS63217804 A JP S63217804A JP 62051350 A JP62051350 A JP 62051350A JP 5135087 A JP5135087 A JP 5135087A JP S63217804 A JPS63217804 A JP S63217804A
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- H03F3/181—Low-frequency amplifiers, e.g. audio preamplifiers
- H03F3/183—Low-frequency amplifiers, e.g. audio preamplifiers with semiconductor devices only
- H03F3/187—Low-frequency amplifiers, e.g. audio preamplifiers with semiconductor devices only in integrated circuits
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- H03—ELECTRONIC CIRCUITRY
- H03F—AMPLIFIERS
- H03F1/00—Details of amplifiers with only discharge tubes, only semiconductor devices or only unspecified devices as amplifying elements
- H03F1/30—Modifications of amplifiers to reduce influence of variations of temperature or supply voltage or other physical parameters
- H03F1/305—Modifications of amplifiers to reduce influence of variations of temperature or supply voltage or other physical parameters in case of switching on or off of a power supply
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- H03—ELECTRONIC CIRCUITRY
- H03G—CONTROL OF AMPLIFICATION
- H03G3/00—Gain control in amplifiers or frequency changers
- H03G3/20—Automatic control
- H03G3/30—Automatic control in amplifiers having semiconductor devices
- H03G3/34—Muting amplifier when no signal is present
- H03G3/348—Muting in response to a mechanical action or to power supply variations, e.g. during tuning; Click removal circuits
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［発明の目的］
（産業上の利用分野）
本発明は、半導体集積回路化された音声増幅器のシｍツ
ク音防止回路に関する。
ク音防止回路に関する。
（従来の技術）
第２図は、従来の集積回路化された音声増幅器５０と、
その負帰還端子５１およびリッゾル端子５２に外付は接
続された負帰還用容量５３、リップル除去用容量５４を
示している。上記音声増幅器５０において、Ｒｌ ＋
Ｒ２はｖｃｃ電源電圧を分圧してバイアス電圧を定める
バイアス用抵抗、Ｒ３は上記バイアス電圧のりッゾル成
分を除去するために前記リップル除去用容ｉ′５４と共
Ｋ ＩＪップルフィルタＦ’ａｒｐを形成する抵抗であ
る。５５は上記リップルフィルタＦＢＩＰの出力電圧が
与えられ、それに応じた電流を流すだめの電流源回路で
あシ、バイポーラトランジスタＱ１〜Ｑ７と抵抗Ｒ４〜
Ｒ７＋ Ｒｘ。
その負帰還端子５１およびリッゾル端子５２に外付は接
続された負帰還用容量５３、リップル除去用容量５４を
示している。上記音声増幅器５０において、Ｒｌ ＋
Ｒ２はｖｃｃ電源電圧を分圧してバイアス電圧を定める
バイアス用抵抗、Ｒ３は上記バイアス電圧のりッゾル成
分を除去するために前記リップル除去用容ｉ′５４と共
Ｋ ＩＪップルフィルタＦ’ａｒｐを形成する抵抗であ
る。５５は上記リップルフィルタＦＢＩＰの出力電圧が
与えられ、それに応じた電流を流すだめの電流源回路で
あシ、バイポーラトランジスタＱ１〜Ｑ７と抵抗Ｒ４〜
Ｒ７＋ Ｒｘ。
とからなる。ＱｓおよびＱ９は差動増幅用のトランジス
タであり、各エミッタが共通接続されると共に前記電流
源用トランジスタＱｓＫ接続されている。
タであり、各エミッタが共通接続されると共に前記電流
源用トランジスタＱｓＫ接続されている。
５６は上記差動増幅用トランジスタＱ８のペースに接続
された入力端子であ如、上記ペースは抵抗Ｒ８を介して
前記リップルフィルタＦＩＬＩＰの出力端に接続されて
いる。５７は上記差動対トランジスタの負荷回路であシ
、カレントミラー接続されたトランジスタＱ＋ｏ ｒ
Ｑｔ＋ と抵抗Ｒ９１Ｒ１０とからなる。
された入力端子であ如、上記ペースは抵抗Ｒ８を介して
前記リップルフィルタＦＩＬＩＰの出力端に接続されて
いる。５７は上記差動対トランジスタの負荷回路であシ
、カレントミラー接続されたトランジスタＱ＋ｏ ｒ
Ｑｔ＋ と抵抗Ｒ９１Ｒ１０とからなる。
Ｑ＋ｔは上記差動増幅用トランジスタＱ８の出力が入力
するエミッタ接地型のトランジスタであυ、そのコレク
タ・ペース間に容量５８が接続され、そのコレクタに前
記電流源用トランジスタＱ７が接続されている。Ｑ＋ｓ
は上記エミッタ接地トランジスタＱ＋ｚのコレクタ出力
が入力するエミッタフォロア接続されたトランジスタで
あり、このトランジスタＱ１ｇのエミッタは抵抗Ｒ１１
を介して接地端子５９に接続されると共に直接に出力端
子６０に接続されている。この出力端子６０と差動増幅
用トランジスタＱ９のペースとの間には負帰還用の抵抗
Ｒ１２が接続されておシ、さらに上記ペースと前記負帰
還用の容量５３との間に抵抗Ｒ１３が接続されている。
するエミッタ接地型のトランジスタであυ、そのコレク
タ・ペース間に容量５８が接続され、そのコレクタに前
記電流源用トランジスタＱ７が接続されている。Ｑ＋ｓ
は上記エミッタ接地トランジスタＱ＋ｚのコレクタ出力
が入力するエミッタフォロア接続されたトランジスタで
あり、このトランジスタＱ１ｇのエミッタは抵抗Ｒ１１
を介して接地端子５９に接続されると共に直接に出力端
子６０に接続されている。この出力端子６０と差動増幅
用トランジスタＱ９のペースとの間には負帰還用の抵抗
Ｒ１２が接続されておシ、さらに上記ペースと前記負帰
還用の容量５３との間に抵抗Ｒ１３が接続されている。
なお、前記リップルフィルタＦＢＩＰは、ＶＣＣ電源の
リッグル成分がバイアス用抵抗Ｒ，を経てバイアス出力
に洩れるのを防ぎ、さらに電源電圧の投入。
リッグル成分がバイアス用抵抗Ｒ，を経てバイアス出力
に洩れるのを防ぎ、さらに電源電圧の投入。
遮断（オン、オフ）時にリップルフィルタＦＲＩＰの出
力ライン（リップルライン）６１の電圧変動をフィルタ
時定数により緩やかにしてシ田ツク音信号が発生するこ
とを防ぐために設けられている。
力ライン（リップルライン）６１の電圧変動をフィルタ
時定数により緩やかにしてシ田ツク音信号が発生するこ
とを防ぐために設けられている。
ところで、上記音声増幅器５０においては、電源５０オ
ン、オフ時に出力端子６０の出力電圧が急激に変動し、
この出力端子６０に接続されているスピーカ等（図示せ
ず）に急激に電流が流れると、ショック音が発生する。
ン、オフ時に出力端子６０の出力電圧が急激に変動し、
この出力端子６０に接続されているスピーカ等（図示せ
ず）に急激に電流が流れると、ショック音が発生する。
このショック音は非常に不快であるので、それを防止す
ることが要求される。このショック音の発生を防ぐため
には、出力端子６０の出力電圧の急激な変動を抑える必
要があり、従来は、前記リップルフィルタＦ’ａｔｐの
時定数によって電源のオン、オフ時にリップルライン６
１の電圧をゆっくり変動させることにより実現している
。
ることが要求される。このショック音の発生を防ぐため
には、出力端子６０の出力電圧の急激な変動を抑える必
要があり、従来は、前記リップルフィルタＦ’ａｔｐの
時定数によって電源のオン、オフ時にリップルライン６
１の電圧をゆっくり変動させることにより実現している
。
しかし、電源のオン、オフ操作が単発的に行われた場合
は上記リップルフィルタＦＢＩＰによるシ菖ツク音防止
作用が得られるが、上記オン、オフ操作が連続的に行わ
れた場合、特にオフ操作の直後にオン操作が行われたと
きにはシｍｙり音が発生してしまう。即ち、リップル除
去用容量５４および負帰還用容量５３に通常は大きな容
量値を用いるので、電源のオフ操作後しばらくは上記容
量に電荷が残る。このときの出力端子６０の出力電圧ｖ
ｏｔｙｔの時間に対する変化の様子を第３＠に示してお
り、電源がオフになると同時に出力電圧ＶＯＵ〒は前記
負帰還用容量５３の残留電荷により除々に下がっていく
。このとき、リップルライン６ノの電圧もリップルフィ
ルタ時定数によりゆっくシ下がる。そして、上記各容量
５３．５４の電荷が十分に放電されてしまう前に電源が
オンになると、上記リップルライン６１の電圧によ＃）
を流源回路５５がオンになって差動増幅用トランジスタ
Ｑｓ、Ｑｅ、エミッタ接地トランジスタＱ１２、エミッ
タフォロア回路は直ちに動作状態に入る。しかし、出力
端子６０の出力電圧ＶＯＵＴが十分に下がシ切っていな
い状態で上記差動増幅用トランジスタＱｓ 、Ｑｅが動
作状態に入ると、入力端子５６は電源がオフになると同
時に電圧が急激に低下しているので、上記トランジスタ
Ｑｓ、Ｑ１１の各ペースバイアスが不平衡状態になシ、
結果として、出力端子６ｏの出力電圧ＶＯＵＴは一気に
接地レベルまで低下する。そして、このときの出力電圧
の急激な変化によりスビー力等からショック音が発生す
る。
は上記リップルフィルタＦＢＩＰによるシ菖ツク音防止
作用が得られるが、上記オン、オフ操作が連続的に行わ
れた場合、特にオフ操作の直後にオン操作が行われたと
きにはシｍｙり音が発生してしまう。即ち、リップル除
去用容量５４および負帰還用容量５３に通常は大きな容
量値を用いるので、電源のオフ操作後しばらくは上記容
量に電荷が残る。このときの出力端子６０の出力電圧ｖ
ｏｔｙｔの時間に対する変化の様子を第３＠に示してお
り、電源がオフになると同時に出力電圧ＶＯＵ〒は前記
負帰還用容量５３の残留電荷により除々に下がっていく
。このとき、リップルライン６ノの電圧もリップルフィ
ルタ時定数によりゆっくシ下がる。そして、上記各容量
５３．５４の電荷が十分に放電されてしまう前に電源が
オンになると、上記リップルライン６１の電圧によ＃）
を流源回路５５がオンになって差動増幅用トランジスタ
Ｑｓ、Ｑｅ、エミッタ接地トランジスタＱ１２、エミッ
タフォロア回路は直ちに動作状態に入る。しかし、出力
端子６０の出力電圧ＶＯＵＴが十分に下がシ切っていな
い状態で上記差動増幅用トランジスタＱｓ 、Ｑｅが動
作状態に入ると、入力端子５６は電源がオフになると同
時に電圧が急激に低下しているので、上記トランジスタ
Ｑｓ、Ｑ１１の各ペースバイアスが不平衡状態になシ、
結果として、出力端子６ｏの出力電圧ＶＯＵＴは一気に
接地レベルまで低下する。そして、このときの出力電圧
の急激な変化によりスビー力等からショック音が発生す
る。
（発明が解決しようとする問題点）
本発明は、上記したように電源のオン、オフ操作を連続
して行なった際、特にオフの直後にオンにしたとき、外
付けされている大容量の残留電６一 荷によ多出力端子の出力電圧の急激な変動を誘発してジ
ーツク音が発生してしまうという問題点を解決すべくな
されたもので、上記電源のオン、オフ操作を行なった場
合のショック音の発生を防止し得る音声増幅器のシ、ツ
タ音防止回路を提供することを目的とする。
して行なった際、特にオフの直後にオンにしたとき、外
付けされている大容量の残留電６一 荷によ多出力端子の出力電圧の急激な変動を誘発してジ
ーツク音が発生してしまうという問題点を解決すべくな
されたもので、上記電源のオン、オフ操作を行なった場
合のショック音の発生を防止し得る音声増幅器のシ、ツ
タ音防止回路を提供することを目的とする。
［発明の構成］
（問題点を解決するための手段）
本発明の音声増幅器のシｍツク音防止回路は、リップル
端子にグツグル除去用フィルタが接続されると共に負帰
還端子に負帰還用容量が接続されている音声増幅器の定
常状態では動作しないが、その電源のオフ時のみ動作し
て前記リップル除去用容量の残留電荷および負帰還用容
量の残留電荷をそれぞれ強制的に放電させる強制放電回
路を設けてなることを特徴とする。
端子にグツグル除去用フィルタが接続されると共に負帰
還端子に負帰還用容量が接続されている音声増幅器の定
常状態では動作しないが、その電源のオフ時のみ動作し
て前記リップル除去用容量の残留電荷および負帰還用容
量の残留電荷をそれぞれ強制的に放電させる強制放電回
路を設けてなることを特徴とする。
（作用）
強制放電回路の作用により電源のオフ時にリップル除去
用容量、負帰還用容量の電荷の残留時間が短かくなるの
で、電源のオン、オフを連続して行なった際、特に電源
のオフの直後にオンしたときでも出力端子の出力電圧の
急激な変動は生じなくなシ、スピーカ等からショック音
は発生しなくなる。
用容量、負帰還用容量の電荷の残留時間が短かくなるの
で、電源のオン、オフを連続して行なった際、特に電源
のオフの直後にオンしたときでも出力端子の出力電圧の
急激な変動は生じなくなシ、スピーカ等からショック音
は発生しなくなる。
（実施例）
以下、図面を参照して本発明の一実施例を詳細に説明す
る。
る。
第１図において、１は集積回路化された音声増幅器であ
シ、そのｖｅｅ電源端子を２、接地端子を３、入力端子
を４、出力端子を５、負帰還端子を６、リップル端子を
７で示している。上記負帰還端子６には接地電位端との
間に負帰還用容ｔｇが外付は接続されておシ、リップル
端子７には接地電位端との間にリップル除去用容量９が
接続されている。上記音声増幅器Ｊにおいて、１０は電
源ノードと接地ノードとの間に抵抗Ｒ１，Ｒ２が直列に
接続されてなるバイアス回路、Ｒ３は上記バイアス回路
１０の出力端（抵抗Ｒ１ｌ Ｒ２の接続点）とりラブル
端子７との間に接続された抵抗であり、この抵抗Ｒ３と
リッゾル除去用容ｉ９とでリップルフィルタＦ’ｉｘｐ
が形成されている。１１は上記リップルフィルタＰＲＥ
？の出力端からリップルライン１２を介して与えられる
電圧を受けて増幅回路部１３に動作電流を供給するため
の電流源回路である。
シ、そのｖｅｅ電源端子を２、接地端子を３、入力端子
を４、出力端子を５、負帰還端子を６、リップル端子を
７で示している。上記負帰還端子６には接地電位端との
間に負帰還用容ｔｇが外付は接続されておシ、リップル
端子７には接地電位端との間にリップル除去用容量９が
接続されている。上記音声増幅器Ｊにおいて、１０は電
源ノードと接地ノードとの間に抵抗Ｒ１，Ｒ２が直列に
接続されてなるバイアス回路、Ｒ３は上記バイアス回路
１０の出力端（抵抗Ｒ１ｌ Ｒ２の接続点）とりラブル
端子７との間に接続された抵抗であり、この抵抗Ｒ３と
リッゾル除去用容ｉ９とでリップルフィルタＦ’ｉｘｐ
が形成されている。１１は上記リップルフィルタＰＲＥ
？の出力端からリップルライン１２を介して与えられる
電圧を受けて増幅回路部１３に動作電流を供給するため
の電流源回路である。
この電流源回路１１は、ｖＣＣノードと接地ノードとの
間に直列に接続されたＮＰＮ型の第１のトランジスタＱ
１、抵抗Ｒ２０、コレクタ・ペース相互が接続され７’
ｊ ＮＰＮ型の第２のトランジスタＱ３ およびダイ
オード接続されたトランジスタＱ４と、上記第２のトラ
ンジスタＱ！とペース相互が接続されたＮＰＮ型の第３
のトランジスタＱ３と、この第３のトランジスタＱ３の
エミッタと接地ノードとの間に接続された抵抗Ｒ４と、
ＶＣＣノードと上記第３のトランジスタＱ３のコレクタ
との間に直列に接続された抵抗Ｒ，、およびコレクタ・
ペース相互が接続されたＰＮＰ屋の第５のトランジスタ
Ｑｓと、この第５のトランジスタＱｓとそれぞれペース
相互が接続されたＰＮＰ Ｍの第６のトランジスタＱ６
および第７のトランジスタＱ、と％ＶＣＣノードと上記
第６のトランジスタＱ ｓ 、第７のトランジスタＱ７
の各エミッタとの間にそれぞれ接続された抵抗Ｒ，ｌ
Ｒ７とからなる。前記増幅回路部１３は、差動増幅回路
と、エミッタ接地回路と、エミッタフォロアとからなる
。
間に直列に接続されたＮＰＮ型の第１のトランジスタＱ
１、抵抗Ｒ２０、コレクタ・ペース相互が接続され７’
ｊ ＮＰＮ型の第２のトランジスタＱ３ およびダイ
オード接続されたトランジスタＱ４と、上記第２のトラ
ンジスタＱ！とペース相互が接続されたＮＰＮ型の第３
のトランジスタＱ３と、この第３のトランジスタＱ３の
エミッタと接地ノードとの間に接続された抵抗Ｒ４と、
ＶＣＣノードと上記第３のトランジスタＱ３のコレクタ
との間に直列に接続された抵抗Ｒ，、およびコレクタ・
ペース相互が接続されたＰＮＰ屋の第５のトランジスタ
Ｑｓと、この第５のトランジスタＱｓとそれぞれペース
相互が接続されたＰＮＰ Ｍの第６のトランジスタＱ６
および第７のトランジスタＱ、と％ＶＣＣノードと上記
第６のトランジスタＱ ｓ 、第７のトランジスタＱ７
の各エミッタとの間にそれぞれ接続された抵抗Ｒ，ｌ
Ｒ７とからなる。前記増幅回路部１３は、差動増幅回路
と、エミッタ接地回路と、エミッタフォロアとからなる
。
上記差動増幅回路は、各エミッタが共通接続されると共
に前記電流源用の第６のトランジスタＱｌ＋７７）コレ
クタに接続された差動対をなすＰＮＰ型の第８のトラン
ジスタＱａおよび第９のトランジスタＱ９と、この両ト
ランジスタＱｓ、Ｑｓの各コレクタと接地ノードとの間
に接続されたカレントミラー型負荷回路とからなる。こ
の負荷回路は、前記第９のトランジスタＱ９のコレクタ
と接地ノードとの間に接続されたＮＰＮ型の第１０のト
ランジスタＱｓｏおよび抵抗Ｒ９と、前記第８のトラン
ジスタＱｓのコレクタと接地ノードとの間に直列に接続
されたＮＰＮ型の第１１のトランジスタＱｓｔおよび抵
抗ＲＩＯを有シ、上記第１０のトランジスタＱ１ｏのコ
レクタ・ペース相互が接続されると共に上記両トランノ
スタＱｓｏ ＋ Ｑｔｔのペース相互が接続されている
。前記エミッタ接地回路は、上記差動増幅用の第８のト
ランジスタＱｓのコレクタにベースが接続され、エミッ
タが接地され、コレクタが前記電流源用の第７のトラン
ジスタＱ７のコレクタに接続されたＮＰＮ型の第１２の
トランジスタＱ１２と、このトランジスタＱ１ｚのコレ
クタ・ペース間に接続された容量１４とからなる。前記
エミッタフォロアは、上記第１２のトランジスタＱ１ｇ
のコレクタにペースが接続され、コレクタがＶＣＣノー
ドに接続されたＮＰＮ型の第１３のトランジスタＱｒｓ
と、このトランジスタＱｘｓのエミッタと接地ノードと
の間に接続された抵抗Ｒ１１とからなり、上記トランジ
スタＱＣｓのエミッタは前記出力端子５に接続されてい
る。そして、前記差動増幅用の第８のトランジスタＱｓ
のペースは、前記入力端子４に接続されると共に抵抗Ｒ
１を介して前記リップル端子７に接続されている。また
、前記差動増幅用の第９のトランジスタＱ９のペースは
、負帰還用抵抗Ｒｔｚを介して前記出力端子５に接続さ
れると共に抵抗Ｒ１３を介して前記負帰還端子６に接続
されている。
に前記電流源用の第６のトランジスタＱｌ＋７７）コレ
クタに接続された差動対をなすＰＮＰ型の第８のトラン
ジスタＱａおよび第９のトランジスタＱ９と、この両ト
ランジスタＱｓ、Ｑｓの各コレクタと接地ノードとの間
に接続されたカレントミラー型負荷回路とからなる。こ
の負荷回路は、前記第９のトランジスタＱ９のコレクタ
と接地ノードとの間に接続されたＮＰＮ型の第１０のト
ランジスタＱｓｏおよび抵抗Ｒ９と、前記第８のトラン
ジスタＱｓのコレクタと接地ノードとの間に直列に接続
されたＮＰＮ型の第１１のトランジスタＱｓｔおよび抵
抗ＲＩＯを有シ、上記第１０のトランジスタＱ１ｏのコ
レクタ・ペース相互が接続されると共に上記両トランノ
スタＱｓｏ ＋ Ｑｔｔのペース相互が接続されている
。前記エミッタ接地回路は、上記差動増幅用の第８のト
ランジスタＱｓのコレクタにベースが接続され、エミッ
タが接地され、コレクタが前記電流源用の第７のトラン
ジスタＱ７のコレクタに接続されたＮＰＮ型の第１２の
トランジスタＱ１２と、このトランジスタＱ１ｚのコレ
クタ・ペース間に接続された容量１４とからなる。前記
エミッタフォロアは、上記第１２のトランジスタＱ１ｇ
のコレクタにペースが接続され、コレクタがＶＣＣノー
ドに接続されたＮＰＮ型の第１３のトランジスタＱｒｓ
と、このトランジスタＱｘｓのエミッタと接地ノードと
の間に接続された抵抗Ｒ１１とからなり、上記トランジ
スタＱＣｓのエミッタは前記出力端子５に接続されてい
る。そして、前記差動増幅用の第８のトランジスタＱｓ
のペースは、前記入力端子４に接続されると共に抵抗Ｒ
１を介して前記リップル端子７に接続されている。また
、前記差動増幅用の第９のトランジスタＱ９のペースは
、負帰還用抵抗Ｒｔｚを介して前記出力端子５に接続さ
れると共に抵抗Ｒ１３を介して前記負帰還端子６に接続
されている。
さらに、本発明には、強制放電回路１５が音声増幅器１
に付加されている。この強制放電回路１５は、ＶＣＣノ
ードと接地ノードとの間に直列に接続された抵抗Ｒム＋
ＲＢと、この抵抗８人ｒ Ｒ１の接続点にペースが接
続され、エミッタが前記リンゾルライン１２に接続され
たＰＮＰ Ｗのトランジスタロムと、このトランジスタ
ロムのペースと接地ノードとの間に直列に接続された抵
抗ＲＣおよびペースが前記トランジスタロムのコレクタ
に接続されたＮＰＮ型のトランジスタＱｍと、このトラ
ンジスタＱＢのペースと接地ノードとの間に接続された
抵抗ＲＤと、上記トランジスタＱＢとペース相互が接続
され、エミッタが接地され、コレクタが前記負帰還端子
６に接続されたＮＰＮ型のトランジスタＱｃとからなる
。
に付加されている。この強制放電回路１５は、ＶＣＣノ
ードと接地ノードとの間に直列に接続された抵抗Ｒム＋
ＲＢと、この抵抗８人ｒ Ｒ１の接続点にペースが接
続され、エミッタが前記リンゾルライン１２に接続され
たＰＮＰ Ｗのトランジスタロムと、このトランジスタ
ロムのペースと接地ノードとの間に直列に接続された抵
抗ＲＣおよびペースが前記トランジスタロムのコレクタ
に接続されたＮＰＮ型のトランジスタＱｍと、このトラ
ンジスタＱＢのペースと接地ノードとの間に接続された
抵抗ＲＤと、上記トランジスタＱＢとペース相互が接続
され、エミッタが接地され、コレクタが前記負帰還端子
６に接続されたＮＰＮ型のトランジスタＱｃとからなる
。
次に、上記音声増幅器１および強制放電回路１５の動作
を説明する。定常状態においては、バイアス回路１０の
出力がリップルフィルタＦＢ！ｐ ｆ 経テ電流源回路
１１に加わり、この電流源回路１ノの動作により増幅回
路部１３が動作状態になり、入力端子４からの音声信号
入力が増幅されて出力端子５に出力される。このとき、
負帰還用抵抗Ｒ１２１Ｒ１３および負帰還用容量８によ
る負帰還作用にょン′ソ差動増幅用の第９のトランジス
タＱ９のペースバイアス電圧は安定に保たれる。このと
き、強制放電回路１５は非動作状ＤＫなっている。即ち
、トラ７ノスタＱ、のペース電圧ＶＢ （ＱＡ）は抵抗
Ｒム＋ＲＢの抵抗値比で決まり、 となる。また、リップルライン１２の電圧ＶＢＩＰは定
常状態では となる。ここで、 Ｖａ（ＱＡ） ＞ Ｖｎｌｐ ・
” （３）となるように抵抗８人＋ Ｒ１Ｏ値を決めて
おくと、上記トランジスタロムはオフになシ、これによ
ってトラフ２フタＱＭ、トランジスタＱｃは共にペース
電流が与えられないのでオフになっている。
を説明する。定常状態においては、バイアス回路１０の
出力がリップルフィルタＦＢ！ｐ ｆ 経テ電流源回路
１１に加わり、この電流源回路１ノの動作により増幅回
路部１３が動作状態になり、入力端子４からの音声信号
入力が増幅されて出力端子５に出力される。このとき、
負帰還用抵抗Ｒ１２１Ｒ１３および負帰還用容量８によ
る負帰還作用にょン′ソ差動増幅用の第９のトランジス
タＱ９のペースバイアス電圧は安定に保たれる。このと
き、強制放電回路１５は非動作状ＤＫなっている。即ち
、トラ７ノスタＱ、のペース電圧ＶＢ （ＱＡ）は抵抗
Ｒム＋ＲＢの抵抗値比で決まり、 となる。また、リップルライン１２の電圧ＶＢＩＰは定
常状態では となる。ここで、 Ｖａ（ＱＡ） ＞ Ｖｎｌｐ ・
” （３）となるように抵抗８人＋ Ｒ１Ｏ値を決めて
おくと、上記トランジスタロムはオフになシ、これによ
ってトラフ２フタＱＭ、トランジスタＱｃは共にペース
電流が与えられないのでオフになっている。
次に、電源がオンからオフになったとき、ＶＣＣ電源は
直ちに接地レベルまで下がるので、前記ＶＢ（ｑム）も
接地レベルに下がる。しかし、前記リップルライン１２
の電圧ＶＩＬＩＦは、リップルフィルタＦＢＩＰの時定
数でゆっくシ下がり、その途中で前記トランジスタＱＡ
のペース・エミッタ間電圧ＶＩＥ（ＱＡ）” ＶＲＩＰ
Ｖｌｌ（ＱＡ）が約０．７ Ｖ以上になったとき、
トランジスタロムがオンし、これによってトランジスタ
Ｑ！＋、）ランジスタＱｃも同時にオンになる。このト
ランジスタＱｃがオンになると、そのコレクタ電流によ
って前記負帰還用容量８の残留電荷を強制的に吸収する
（放電させる）ことになシ、壕だ前記トランジスタＱＡ
はエミッタがリップルライン１２に接続されているので
、オンになることによりてそのエミッタ電流により前記
リンゾル除去用容量９の残留電荷を吸収する（放電させ
る）。この場合、上記トランジスタＱＡ、トランジスタ
ＱＢと抵抗ＲＣとによって一種のサイリスタを形成して
おり、このサイリスタは上記トランジスタロムが一度オ
ンすると、そのオン状態を持続する働きを有する。
直ちに接地レベルまで下がるので、前記ＶＢ（ｑム）も
接地レベルに下がる。しかし、前記リップルライン１２
の電圧ＶＩＬＩＦは、リップルフィルタＦＢＩＰの時定
数でゆっくシ下がり、その途中で前記トランジスタＱＡ
のペース・エミッタ間電圧ＶＩＥ（ＱＡ）” ＶＲＩＰ
Ｖｌｌ（ＱＡ）が約０．７ Ｖ以上になったとき、
トランジスタロムがオンし、これによってトランジスタ
Ｑ！＋、）ランジスタＱｃも同時にオンになる。このト
ランジスタＱｃがオンになると、そのコレクタ電流によ
って前記負帰還用容量８の残留電荷を強制的に吸収する
（放電させる）ことになシ、壕だ前記トランジスタＱＡ
はエミッタがリップルライン１２に接続されているので
、オンになることによりてそのエミッタ電流により前記
リンゾル除去用容量９の残留電荷を吸収する（放電させ
る）。この場合、上記トランジスタＱＡ、トランジスタ
ＱＢと抵抗ＲＣとによって一種のサイリスタを形成して
おり、このサイリスタは上記トランジスタロムが一度オ
ンすると、そのオン状態を持続する働きを有する。
即ち、トランジスタＱ＾がオンになると、トランジスタ
Ｑｍがオンになり、これによって上記トランゾスタＱム
のペース電流が増加してそのコレクタ電流が増加すると
いうような正帰還がかかシ、最終的にリップル除去用容
量９、負帰還用容量８が十分に放電されて残留電荷がな
くなるまで動作し続ける。
Ｑｍがオンになり、これによって上記トランゾスタＱム
のペース電流が増加してそのコレクタ電流が増加すると
いうような正帰還がかかシ、最終的にリップル除去用容
量９、負帰還用容量８が十分に放電されて残留電荷がな
くなるまで動作し続ける。
従って、上記したような強制放電回路１５を付加したこ
とにより、電源を連続的にオン、オフした場合でも上記
残留電荷の影響を受けなくなり、出力電圧ｖｏｏｔの急
変は生じず、ショック音は発生しなくなる。
とにより、電源を連続的にオン、オフした場合でも上記
残留電荷の影響を受けなくなり、出力電圧ｖｏｏｔの急
変は生じず、ショック音は発生しなくなる。
［発明の効果コ
上述したように本発明の音声増幅器のり璽ツク音防止回
路によれば、強制放電回路を設けて電源のオフ時Ｋ Ｉ
Ｊップル除去用容量、負帰還用容量の残留電荷を強制的
に放電させるようにしたので、電源のオン、オフを連続
して行なった際、特に電源のオフの直後にオフしたとき
でも出力端子の出力電圧の急激な変動は生じなくなシ、
スピーカ等からショック音が発生することを防止できる
。
路によれば、強制放電回路を設けて電源のオフ時Ｋ Ｉ
Ｊップル除去用容量、負帰還用容量の残留電荷を強制的
に放電させるようにしたので、電源のオン、オフを連続
して行なった際、特に電源のオフの直後にオフしたとき
でも出力端子の出力電圧の急激な変動は生じなくなシ、
スピーカ等からショック音が発生することを防止できる
。
第１図は本発明の音声増幅器のシＷツク音防止回路の一
実施例を示す回路図、第２図は従来の音声増幅器のショ
ック音防止回路を示す回路図、第３図は第２図の音声増
幅器において電源のオン。 オフが連続的に行われた場合の出力電圧の変化の様子を
示す波形図である。 １０・・・バイアス回路％ ＦＲＩＰ・・・リップルフ
ィルタ、１）・・・電流源回路、１３・・・増幅回路部
、Ｒ１１ｌ ｌ Ｒ１３・・・負帰還用抵抗、８・・・
負帰還用容量、１５・・・強制放電回路、ＱＡ 、（ｂ
・・・トランジスタ。
実施例を示す回路図、第２図は従来の音声増幅器のショ
ック音防止回路を示す回路図、第３図は第２図の音声増
幅器において電源のオン。 オフが連続的に行われた場合の出力電圧の変化の様子を
示す波形図である。 １０・・・バイアス回路％ ＦＲＩＰ・・・リップルフ
ィルタ、１）・・・電流源回路、１３・・・増幅回路部
、Ｒ１１ｌ ｌ Ｒ１３・・・負帰還用抵抗、８・・・
負帰還用容量、１５・・・強制放電回路、ＱＡ 、（ｂ
・・・トランジスタ。
Claims (2)
- （１）バイアス回路と、このバイアス回路の出力端に接
続されたリップルフィルタと、前記リップルフィルタの
出力電圧が一方の入力バイアスとして与えられ、他方の
入力バイアスは出力端子から負帰還回路を介して与えら
れる差動増幅回路を含む増幅回路部とを有する音声増幅
器に付加され、この音声増幅器の定常状態では動作せず
、電源のオフ時のみ動作して前記リップルフィルタの容
量の残留電荷および前記負帰還回路の容量の残留電荷を
それぞれ強制的に放電させる強制放電回路からなること
を特徴とする音声増幅器のショック音防止回路。 - （２）前記強制放電回路は、前記電源のオフ時に前記リ
ップルフィルタの出力電圧の立下りの遅れを利用してオ
ン状態になるＰＮＰ型トランジスタと、このＰＮＰ型ト
ランジスタのコレクタ電流によりオン駆動されるＮＰＮ
型トランジスタとを有し、上記ＰＮＰ型トランジスタの
エミッタ電流により前記リップルフィルタの容量の電荷
を吸収し、上記ＮＰＮ型トランジスタのコレクタ電流に
より前記負帰還回路の容量の電荷を吸収するようにして
なることを特徴とする前記特許請求の範囲第１項記載の
音声増幅器のショック音防止回路。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62051350A JP2585249B2 (ja) | 1987-03-06 | 1987-03-06 | 音声増幅器のシヨツク音防止回路 |
| US07/162,692 US4788508A (en) | 1987-03-06 | 1988-03-01 | Pop noise suppression circuit for audio amplifier |
| EP88103206A EP0281117B1 (en) | 1987-03-06 | 1988-03-02 | Pop noise suppression circuit for audio amplifier |
| DE3854406T DE3854406T2 (de) | 1987-03-06 | 1988-03-02 | Schaltung zum Unterdrücken der Störimpulse in einem Audio-Verstärker. |
| KR1019880002307A KR900007921B1 (ko) | 1987-03-06 | 1988-03-05 | 음성증폭기의 충격음방지회로 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62051350A JP2585249B2 (ja) | 1987-03-06 | 1987-03-06 | 音声増幅器のシヨツク音防止回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS63217804A true JPS63217804A (ja) | 1988-09-09 |
| JP2585249B2 JP2585249B2 (ja) | 1997-02-26 |
Family
ID=12884478
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62051350A Expired - Lifetime JP2585249B2 (ja) | 1987-03-06 | 1987-03-06 | 音声増幅器のシヨツク音防止回路 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US4788508A (ja) |
| EP (1) | EP0281117B1 (ja) |
| JP (1) | JP2585249B2 (ja) |
| KR (1) | KR900007921B1 (ja) |
| DE (1) | DE3854406T2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2006332994A (ja) * | 2005-05-25 | 2006-12-07 | Mitsumi Electric Co Ltd | 増幅回路 |
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| US5121076A (en) * | 1991-05-06 | 1992-06-09 | Thomson Consumer Electronics, Inc. | Plural time constant signal control |
| US5199079A (en) * | 1991-05-21 | 1993-03-30 | Thomson Consumer Electronics, Inc. | Supply voltage responsive audible transient (POP) suppression arrangement |
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| IT1268473B1 (it) * | 1993-10-22 | 1997-03-04 | St Microelectronics Srl | Circuito di controllo della salita della tensione sul nodo di uscita di un amplificatore, all'accensione |
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- 1987-03-06 JP JP62051350A patent/JP2585249B2/ja not_active Expired - Lifetime
-
1988
- 1988-03-01 US US07/162,692 patent/US4788508A/en not_active Expired - Lifetime
- 1988-03-02 EP EP88103206A patent/EP0281117B1/en not_active Expired - Lifetime
- 1988-03-02 DE DE3854406T patent/DE3854406T2/de not_active Expired - Lifetime
- 1988-03-05 KR KR1019880002307A patent/KR900007921B1/ko not_active Expired
Patent Citations (1)
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Also Published As
| Publication number | Publication date |
|---|---|
| US4788508A (en) | 1988-11-29 |
| JP2585249B2 (ja) | 1997-02-26 |
| EP0281117A3 (en) | 1990-12-05 |
| EP0281117A2 (en) | 1988-09-07 |
| DE3854406D1 (de) | 1995-10-12 |
| KR880011995A (ko) | 1988-10-31 |
| KR900007921B1 (ko) | 1990-10-23 |
| DE3854406T2 (de) | 1996-02-29 |
| EP0281117B1 (en) | 1995-09-06 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| EXPY | Cancellation because of completion of term |