JPS63289841A - 半導体装置の製造方法 - Google Patents

半導体装置の製造方法

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JPS63289841A
JPS63289841A JP12521687A JP12521687A JPS63289841A JP S63289841 A JPS63289841 A JP S63289841A JP 12521687 A JP12521687 A JP 12521687A JP 12521687 A JP12521687 A JP 12521687A JP S63289841 A JPS63289841 A JP S63289841A
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JP
Japan
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contact hole
wiring
metal film
melting point
metal
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Pending
Application number
JP12521687A
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English (en)
Inventor
Takaaki Kuwata
孝明 桑田
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NEC Corp
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NEC Corp
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は半導体装置の製造方法に係り、特に多層金属配
線の金属配線間の接続方法に関する。
〔従来の技術〕
従来、この種の金属配線間の接続方法は、コンタクト孔
を開孔すべき領域の第1の金属配線の線幅を、開孔すべ
きコンタクト孔の大きさよりも。
目金せずれのマージンを予め含んだ分だけ通常配線部分
に比べ太く形成する工程と、その領域の第1の層間絶縁
膜にコンタクト孔を異方性エツチングに依り開孔し、第
1の金属配線を露出させる工程と、第2の金属配線を、
前記コンタクト孔を目金せずれのマージンを予め持友せ
、完全に覆う様に、コンタクト孔部で通常配線部分に比
べ線幅を太く形成する様に、配線する工程とを含んで槽
底されていた。
以下に、従来の製造方法を第2図−】乃至第2図(g)
を用いて説明する。第2図(劫セ平面図であり、第2図
ら)乃至(−ハエ種属に示し几断面図である。
第2囚偽) 、 (d) 、 (f)は第2図(&)の
A−A’線にそつ九位置で見比断面図、第2図(c) 
、 (e) 、 (g)は第2図(a)のB−B’線に
そった位置で見た断面図である。
第2図ら) 、 (c)に示す様に、第1の金属配線(
膜厚5000A ) 21上の第1の層間絶縁膜22の
所定の位置に7オトレジスト#i23をパターン形成グ
する0通常、コンタクト孔25の端部と。
第1の金属配線21の端部とは、目金せずれを考慮し、
0.4μm程度の目金せマージンを持tせである。
次に第2図(d) 、 (e)に示す様に、異方性エツ
チングにエフ、第1の層間絶縁膜(膜厚約500OA)
22をエツチングし、第1の金属配線2を露出させる。
次に第2図(f) 、 (g)に示す様に、第2の金属
配線<ytii、厚約800OA )24を、コンタク
ト孔を目金せマージンを持って、完全に覆う様にコンタ
クト孔部では、線@を太して、形成する。こうして、第
2図(a)に示すような平面図が得られる。
〔発明が解決しょうとする問題点〕
以上説明した、従来の配線接続方法に於いてa1コンタ
クト孔は必ず第1の金属配線21上に開孔されなければ
ならない。、なぜならば、第1の金属膜a21よりコン
タクト孔24が、例えば目金せずnなどに工9、はみ出
した場合、第1の金属配線21の側面に溝が形成され、
i@2の金属膜−24がその溝部でカバレッヂが悪くな
り、断線する可能性がある。従って、コンタクト孔24
を開孔する領域では、第1の金属膜a21の線幅をコン
タクト孔より目金せずれを考慮した分だけ広く(通常α
4μm)する必要がある。
まt、コンタクト孔24を覆う様に配線さnる第2の金
属膜@24の場合では、目金せずれによって、コンタク
ト孔中の第1の金属配線21が露出する様な事が生じた
場合、第2の金属膜!24のエツチング時に、第1の金
属膜[21も同時にエツチングされてしまうため、第2
の金属配線24の線幅も、コンタクト部に於いて、目金
せずれを考慮した分だけ、広くする必要がある。
この友め、第1.第2の金属膜M21.24の配線ピン
チが短縮されず、半導体集積回路装置の面積を増大せし
めていた。特に、ゲートアレー、マイクロコンビエータ
などの集積回路に於いては、配線領域の面積がチップ面
積の増大を招いてい比。
ま九、従来の方法では、コンタクト孔の段部に於ける第
2の金属配線のカバレッヂが悪く、断線。
又はエレクトロマイグレーションの発生するおそnが6
つ九。
本発明の目的に、前記欠点を解決し、配線ビー・チが短
縮さn1断線やエレクトロマイグレーション等の発生す
る心配のない工うにし九半導体装置の製造方法を提供す
ることにある。
〔問題漬を解決するための手段〕
本発明の構成は、パターン形成された第1の金属配線上
に第1の層間P3縁膵1−、第1の金属配線とほぼ同−
伊厚底長させる工程と、第1の金猫配線上の所定の位置
に、第1の金MA配線の癲暢エクも大なる長辺を有する
コンタクト孔を異方性エツチングに依t)rM孔すると
同時に、第1の金属配線の側面部の縞1の層間絶縁膜に
所定の深さの舅を形成する工程と減圧CVD法にエフ、
高融点金属膜を半導体基板上に厚く成長する工程と、第
1の金属膜と高融点金属膜との大なる遇択比1&:有す
るエツチングガスを用いた異方性エツチングに依り、高
融点金S膜を全面エツチングすることに依り。
前記コンタクト孔中の第1の金属配線側面部に形成され
t溝中に高融点金属膜を埋込むと同時に、コンタクト孔
中の第1の金属配線の配線方向に垂直なコンタクト孔壁
の側面に高融点金属膜管傾斜を有して残し、他の平担部
で汀、高融点金属をすべてエツチングする工程と、第2
の金属膜を半導体基板上に放炎させる工程と、第2の金
属配線を前記コンタクト孔上をコンタクト孔の短辺と同
一寸法以上のN5ll@lで通道する様に高融点金ms
と。
第2の金属膜との大なる選択比金有するエツチングガス
を用いた異方性エツチングにより形成する工程とを含む
ことを特徴とする。
〔実施例〕
次に本発明について図面を参照して詳細に説明する。
第1図((転)乃至第1寵ωぼ本発明の一実施例の半導
体装置の製造方法を示す平面図、断面図である。
第1図((転)は本実施例で製造し几配線接続部の平面
図、第1図へ)乃至(社)に本実施例の製造方法を工程
順に示した断面図である。第1図(b) 、 (c)に
示す様に、半導体基板上に@1の金属配線11.例えば
アルミニウム配線(膜厚的5000A″)を形成し。
その上部に第1の1聞納縁$12.例えばバイアス・ス
パッタ酸化膜を第1の金属配線11とほぼ同一の膜厚(
約500OA ) t−区長させる0次に。
フォトレジスト13を塗布し、所定の位置にコンタクト
孔を開孔するための7オトレジスト13のパターニング
を行なう。このQ1コンタクト孔の長辺方向の大きさは
、第1の金属配#11ニジ0.2吊)μ−大きく形成す
る。
次に第1図(d) 、 (e)に示す様に、異方性エツ
チングにより、第1の眉間絶縁膜lit所定の深さ約4
00OAまでエツチングし、第1の金属配線11上部t
−g出させると同時に、第1の金属配−11の側面部に
溝を形成する。第1の眉間絶縁v!12の溝の深さに、
第1の金属配線11の厚さより浅く形成する。
さらに第1図(f)1.(g)K、示す様に、減圧CV
D法により、高融点金属膜14例えばタングステンを厚
<、  (Itの深さの約3倍程度)区長させる。この
時、第2の金属配置fi15の配線方向(A −A’断
面)に於いては溝の幅が狭いtめ、高融点金属膜上部で
は、少しのくびれを残すだけでほぼ平担となる。
一方、B−B’の断面に於いてa、コンタクト孔が溝に
比べ大きいため、コンタクト孔の段差を反影し次形状と
なる。
第1図(h) 、 (i)に示す様に、高融点金属膜1
4t−1第1の金属11411と高融点金属膜14との
間で大きな選択比CFJ 系のエツチングガスを使用l
、、異方性エツチングに依り、全面エッチを行ない、第
1の金属配線11の側面の溝中に、高融点金属14を埋
込むと同時に、第1の金属配線11の配線方向(B−8
’断面)に於いては、コンタクト段部に高融点金M14
のサイドウオール(Side−Wall)を傾斜をもっ
て形成する。この時、第1の金属配線11がアルミニウ
ムの場合、高融点金属14のエツチング時に露出しても
、第1の金属配線llはエツチングさnない。
第1図(j) 、 (k)に示す様に、第2の金属配線
15例えばアルミニウム(膜厚的800OA )’i全
全面底長させ、次に第2の金属配線15上の7オトレジ
ストヲ所定のパターンにパターニングシを後、高融点金
属膜14と第2の金属膜15との間で大きな選択比t−
有するCt系のエツチングガスを使用しt異方性エツチ
ングに依り、パターニングを行なう。
この時、コンタクト孔上を通過する第2の金属線15の
lIJ幅がコンタクト孔の短辺の寸法と同一の線毛であ
って、かつ多少の目金ずれが生じt場合に於いても、コ
ンタクト段に傾斜をもって形成され比高融点金属ps1
4が存在するため、第1の金属配allが露出すること
がない、また、露出した高融点金属%i14はCt系の
エツチングガスでは、エツチングさルない、第1図(a
)がこのように製造さn九最終工1の平面図である。
〔発明の効果〕
以上説明し九様に、本発明に、第1の金属配線の配線方
向のコンタクト孔壁に高融点金属膜が傾斜をもって形成
されているtめ、第2の金属配線形成時に、多少の目金
せずれが生じた場合でも、高融点金属膜が露出するだけ
で、コンタクト孔中の第1の金属配線が露出せず、その
ため第2の配線層の喝をコンタクト孔よりも広くする必
要がなく、コンタクト領域に於いても通常配線部と同様
の配線幅、配線ピッチで配線することができ、さらVc
第1の金属配線に於いてもコンタクト孔形成部に於いて
、コンタクト孔エクも線幅を広げる必要がないtめ1通
常配線部と同様の配線幅、配線ピッチで配線することが
できる効果がある。
まt1本発明は、第2の金属配線の配線の配線方向に於
いて、第1の金属配線とその両側の溝に埋込まれた高融
点金属膜とfa2の金属配線が接続するため、接続面積
が大きく、配線間接続の抵抗値を小さくすることができ
、接続部の段差は、溝中に埋込まれt高融点金属膜とコ
ンタクト孔壁に傾斜をもって形成されt高融点金属膜の
几め、低減さnており、第2の金属配線のコンタクト部
に於けるカパレッヂは良好であり、段切れやエレクトロ
マイグレーシlン等の心配がなく、高信頼度の配線間接
続が可能になるなどの効果がある。
【図面の簡単な説明】
第1図(aJに本発明の実施例の半導体装置の製造方法
によって製造され次子面図、第1図(b)、第1図(山
、第1図(f)、第1図(に、第1図(j)はいずれも
第1図ら)のA−A’線にそった位置で切断して見て、
本発明の実施例の製造方法を工程順に示し九断面図、第
1図(c)、第1図(e)、第1図□□□)、第1図(
i)、第1図(転)はそれぞれ第1図(b)、第1図(
d)%第1図(f)、第1図面、第1図Q)と同一工程
であって。 いずれも@1図6》のB−B’線にそつ次位置で切断し
て見た断面図、第2図(mlは従来の製造方法で製造さ
′n几亀子図、第2図(旬、第2図(d)、第2図(f
)は従来の製造方法を工程順に示し、いずれも第1図(
a)のA−A’線に七っ次位置から見た断面図、第2図
(c)、第2図(e]、第2図−)はそnぞn第2図(
b)、第2図(d)、第2図(f)と同一工程中の半導
体基板を示し、いずれも第21図(mlのB−B’線に
そつ次位置で切断して見た平面図である。 11.21・旧軸第1の金属配線、12,22・・・・
・・第1の層間絶縁膜、13.23・・・・・・フォト
レジスト、14・・・・・・高融点金属膜、15.24
・・・・・−第2の金践配線、25・・・・・・コンタ
クト孔。 □ヘ ニ       痴

Claims (1)

    【特許請求の範囲】
  1. 半導体基板上に第1の金属配線を形成する工程と、この
    主表面に第1の層間絶縁膜を前記第1の金属配線とほぼ
    同一膜厚で成長させる工程と、前記第1の金属配線上の
    所定の位置に、前記第1の金属配線の線幅より大なる長
    辺を有するコンタクト孔を、異方性エッチングに依り開
    孔し、前記第1の金属配線の側面部の前記第1の層間絶
    縁膜に所定の深さの溝を形成する工程と、減圧CVD法
    により高融点金属膜を前記半導体基板上に厚く成長する
    工程と、前記第1の金属膜と高融点金属膜との大なる選
    択比を有するエッチングガスを用いた異方性エッチング
    に依り、前記高融点金属膜を全面エッチングすることに
    依り前記コンタクト孔中の第1の金属配線側面部に形成
    された溝中に前記高融点金属膜を埋込むと同時に、コン
    タクト孔中の前記第1の金属配線の配線方向に垂直なコ
    ンタクト孔壁の側面に、前記高融点金属膜を傾斜を有し
    て残し、他の平担部では前記高融点金属をすべてエッチ
    ングする工程と、第2の金属膜を前記半導体基板上に成
    長させる工程と、前記第2の金属配線を前記コンタクト
    孔上をコンタクト孔の短辺と同一寸法以上の線幅で通過
    する様に、前記高融点金属膜と前記第2の金属膜との大
    なる選択比を有するエッチングガスを用いた異方性エッ
    チングにより形成する工程とを含むことを特徴とする半
    導体装置の製造方法。
JP12521687A 1987-05-21 1987-05-21 半導体装置の製造方法 Pending JPS63289841A (ja)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0788160A3 (en) * 1996-02-05 1999-06-16 Matsushita Electronics Corporation Semiconductor device having a multi-layered wire structure

Cited By (1)

* Cited by examiner, † Cited by third party
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