JPS63293616A - 電源制御方式 - Google Patents

電源制御方式

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Publication number
JPS63293616A
JPS63293616A JP62130598A JP13059887A JPS63293616A JP S63293616 A JPS63293616 A JP S63293616A JP 62130598 A JP62130598 A JP 62130598A JP 13059887 A JP13059887 A JP 13059887A JP S63293616 A JPS63293616 A JP S63293616A
Authority
JP
Japan
Prior art keywords
power supply
power
supply control
signal
circuit
Prior art date
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Pending
Application number
JP62130598A
Other languages
English (en)
Inventor
Chiharu Saito
斎藤 千春
Akira Karube
軽部 彰
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Filing date
Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
Priority to JP62130598A priority Critical patent/JPS63293616A/ja
Publication of JPS63293616A publication Critical patent/JPS63293616A/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔概要〕 この発明は、複数電源の制御を電源制御装置で行い、そ
の内容をマイクロプロセッサによってディスプレイ装置
に表示して電源の監視を行う際に、電源制御装置に接続
されない電源の状態情報をディスプレイ装置に表示しな
いようにするため、電源に接続有無を表す搭載信号を出
力する回路を設けた構造とし、この搭載信号によって状
態情報を表示するようにする。
〔産業上の利用分野〕
この発明は電源制御方式に係り、特に複数の電源が電源
制御装置に接続されたシステムの電源制御方式に関する
ものである。
電子計算機システムは、中央処理装置、入出力制御装置
、磁気制御装置、各種入出力装置等から構成されている
。これら、装置の電源は電源制御装置で電源の投入及び
切断の制御が行われる。この電源の状態は、マイクロプ
ロセッサによって監視されている。
このシステムにおいて、各電源接続の有無を容易に検出
できる電源制御方式が必要とされている。
〔従来の技術〕
第4図は従来の電源制御装置を示すブロック図である。
電源制御装置20は、マイクロプロセッサ(以後MPU
と記す)3と、トライステートバッファ4と、フリップ
フロップ回路(以後FF回路と記す)5と、コネクタ2
−1〜2−3と、コネクタ2−1〜2−2からのアラー
ム信号とを入力するアンド回路11と、このアンド回路
11からの信号とコネクタ2−3からのアラーム信号^
LM3を受信するレシーバ6と、?IPIJ 3のプロ
グラムを格納するROM 7と、制御データを格納する
RAM 8と、ROM 7及びRAM8の読取り/書込
みタイミングを司るタイミング回路9とで構成されてい
る。
MPtl 3は電源の接続状態即ち、状態情報を表示す
るディスプレイ装置lOと打鍵盤14とが接続されてい
る。
コネクタ2−1〜2−3に電源1−1〜1−3がそれぞ
れ接続され、電源1−1〜1−3に負荷12が接続され
ている。
電源を作動°させるには、MPU 3はタイミング回路
9を読取りとしてI?A?l 8の内容を順次読取り、
その内容をFF回路5に格納する。例えば電源1−1を
ONにする場合、トライステートバッフ14を介して電
源1−1の論理”1′をFF回路5に入力し、FF回路
5は論理゛1°をコネクタ2−1を介して電源1−1に
出力する。
この論理°1゛ を受けた電源1−1はONとなる。電
源1−2及び電源1−3も同様にONとする。電源1−
1は、MPU 3へ電源1−1のアラーム(例えば低電
圧アラーム、過電流アラーム)を報告するためのアラー
ム信号線を持っている。このアラーム信号は正常状態で
は論理゛0°、異常状態では論理゛1゛ になるように
構成されている。第4図の負荷は最大構成時の負荷を示
しており、電源1−1 、1−2を並列運転して負荷へ
−3,6vを供給している。ここで負荷が最大構成でな
い場合、電源1−1で十分足りるとすれば、電源1−2
はオプション化が可能である。
ところで並列運転を行っている場合、過電流アラームは
、並列運転を行っている全ての過電流アラームのアンド
でアラーム検出を行っている。しかし電源1−2をその
ままオプション化すると、電源1−1が過電流アラーム
になった場合、レシーバ6のALM2信号線が論理゛1
゛ になる。このアラーム信号はトライステートバッフ
ァ4及びMPU 3を介してディスプレイ装置10に電
源1−2があたかもアラーム状態にあるように表示され
てしまう。
上記したように、コネクタに電源1−2が接続されてな
いにもかかわらず、電源1−2がアラームを発生してい
るように表示される。またA/Dコンバータ13を介し
て得られる電源1−2の電圧値は電源1−1と並列運転
されているため、トライステートバッファ4及びMPU
 3を介してディスプレイ装置10にあたかも電源1−
2の電圧値のように表示されてしまう。
〔発明が解決しようとする問題点〕
電源がオプション化やコストダウンによって削減された
場合、npuは、電源接続の有無を判断する判断手段を
もたないため、接続されてない電源があたかも接続され
たように、電源の状態情報(よディスプレイ装置に表示
される。したがって、保守時にこの短絡コネクタを捜し
無接続電源を見いだす必要があり、工数を要するばかり
でなく、作業に誤りが無いことを要求されるという問題
がある。
この発明は、従来の上記した状況から、電源の状態情報
が容易に表示され、しかも無接続電源が容易に検出でき
る電源制御方式を提供することを目的とするものである
(問題点を解決するための手段) この発明は第1図原理図に示すように、各電源1−1〜
1−nに、コネクタ2−1〜2−nとの接続有無を示す
搭載信号を出力する搭載信号回路1−1−1〜1−1−
nを設け、電源制御装置2に搭載信号を受信するレシー
バ6−1を設けた構成とする。
〔作用〕
搭載信号即ち、電源接続の有無信号は、レシーバ6−1
及びトライステートバッファ4を介して読み出されてい
るので、?iPU 3はこの内容を見て電源の状態情報
を表示する。したがって、接続されてない端子の状B情
報は表示されず、容易に電源の接続状態の把握が可能に
なる。
〔実施例〕
第2図は本発明の電源制御方式を示す一実施例のブロッ
ク図であり、第3図と同一個所は同符合を用い、その説
明も省略する。従来と異なる個所は、電源1−1〜1−
3に搭載信号即ち、コネクタl−1〜1−3に電源が接
続された否やを表す信号を出力する搭載信号回路1−L
l〜1−L3を設けである点と、電源制御装置2に搭載
信号を受信するレシーバ6−1を設けたことである。
搭載信号回路例えば1−1−1は電源1−1が接続され
ると、つまり電a1−1がコネクタ2−1 と接続され
ると、接地電圧(論理゛O°)を出力する。
この搭載信号回路1−LLはコネクタ2−1を介してレ
シーバ6−1へ導かれる信号線およびコネクタ2−1を
介して接地される信号線とを短絡するべく構成されてい
る。この搭載信号はレシーバ6−1及びトライステート
バッファ4を介して読み出すことができる。したがって
、コネクタ2−2に電源が接続されないシステムの状態
情報をチェックする場合、MpU 3はレシーバ6−1
を介して搭載信号を読み込み、搭載信号が論理゛0°の
場合、電源の状態情報を表示する。
例えば、第3図に示すように電源の状態情報が表示され
る。即ち、電源1−11名称−3.6V、電圧値−3,
600V、アラーム状態ALMIであり、接続されない
コネクタ2−2−1の電源1−2は表示されないものと
なる。
〔発明の効果〕
以上の説明から明らかなように、この発明によれば、接
続されない電源の状態情報は表示されず、保守時に電源
無接続のコネクタを捜す必要もなく効率が向上するとと
もに、作業の信頼性を高める上できわめて有効な効果を
発揮する。
【図面の簡単な説明】
第1図は本発明の原理図、 第2図は本発明の電源制御方式を示す一実施例のブロッ
ク図、 第3図は本発明の表示内容を示す模式図、第4図は従来
の電源制御方式を示すブロック図である。 図において、1−1〜1−nは電源、2は電源制御装置
、2−1〜2−nはコネクタ、3はMPII 、6と6
−1はレシーバ、10はディスプレイ装置、11はアン
ド回路を示す。 第1図 手完弗電遁刺御拭絆f−り峠1の7゛0γ燗第2図

Claims (1)

  1. 【特許請求の範囲】 複数の電源(1−1〜1−n)の制御を行う電源制御装
    置(2)と電源の監視を行うマイクロプロセッサ(2)
    とからなるシステムにおいて、 前記電源(1−1〜1−n)に接続の有無を表す搭載信
    号を出力する回路(1−1−1〜1−n−1)を設ける
    とともに、 電源制御装置(2)に搭載信号を受信するレシーバ(6
    −1)を付設し、接続しない電源の状態情報を前記搭載
    信号によって表示しないことを特徴とする電源制御方式
JP62130598A 1987-05-26 1987-05-26 電源制御方式 Pending JPS63293616A (ja)

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JP62130598A JPS63293616A (ja) 1987-05-26 1987-05-26 電源制御方式

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JP62130598A JPS63293616A (ja) 1987-05-26 1987-05-26 電源制御方式

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JPS63293616A true JPS63293616A (ja) 1988-11-30

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ID=15038038

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JP62130598A Pending JPS63293616A (ja) 1987-05-26 1987-05-26 電源制御方式

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