JPS6333003A - Offset correction circuit - Google Patents

Offset correction circuit

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JPS6333003A
JPS6333003A JP61175537A JP17553786A JPS6333003A JP S6333003 A JPS6333003 A JP S6333003A JP 61175537 A JP61175537 A JP 61175537A JP 17553786 A JP17553786 A JP 17553786A JP S6333003 A JPS6333003 A JP S6333003A
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JP
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operational amplifier
resistor
input terminal
inverting input
capacitor
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JP61175537A
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Masayoshi Toda
戸田 政義
Seiichi Hamazaki
浜崎 誠一
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Mitsubishi Electric Corp
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Mitsubishi Electric Corp
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
(57) [Abstract] This bulletin contains application data before electronic filing, so abstract data is not recorded.

Description

【発明の詳細な説明】 〔産業上の利用分野〕 この発明は、演算増幅器のオフセット補正回路、特に安
価なコンデンサを使用できるオフセット補正回路に関す
るものであ仝。
DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to an offset correction circuit for an operational amplifier, and particularly to an offset correction circuit that can use inexpensive capacitors.

〔従来の技術〕[Conventional technology]

第2図は従来のオフセット補正回路の回路図であり、図
において(1)は負帰還増幅を施した第1の演算増幅器
(以下オペアンプと云う) 、(2)は一端が外部入力
に接続されかつ他端が第1のオペアンプ(1)の反転入
力端子に接続された第1の抵抗(入力抵抗)、(6)は
一端が第1のオペアンプの反転入力端子に接続されかつ
他端が第1のオペアンプの出力端子に接続された第2の
抵抗(帰還抵抗)、(4)は第2のオペアンプ、(5)
は一端が第1のオペアンプ(1)の出力端子に接続され
かつ他端が第2のオペアンプ(4)の反転入力端子に接
続された第3の抵抗(積分抵抗)、体)は一端が第2の
オペアンプ(4)の反転入力端子に接続されかつ他端が
第2のオペアンプ(4)の出力端子および第1のオペア
ンプ(1)の非反転入力端子に接続されたコンデンサ(
積分コンデンサ)、(7)は一端が第2のオペアンプ(
4)の非反転入力端子に接続されかつ他端がアースに接
続された第4の抵抗である。
Figure 2 is a circuit diagram of a conventional offset correction circuit. In the figure, (1) is a first operational amplifier (hereinafter referred to as an operational amplifier) with negative feedback amplification, and (2) is one end connected to an external input. and (6) has one end connected to the inverting input terminal of the first operational amplifier (6) and the other end connected to the inverting input terminal of the first operational amplifier (1). A second resistor (feedback resistor) connected to the output terminal of the operational amplifier 1, (4) is the second operational amplifier, (5)
is a third resistor (integrating resistor) whose one end is connected to the output terminal of the first operational amplifier (1) and the other end is connected to the inverting input terminal of the second operational amplifier (4); a capacitor (connected to the inverting input terminal of the second operational amplifier (4) and the other end connected to the output terminal of the second operational amplifier (4) and the non-inverting input terminal of the first operational amplifier (1);
(integrating capacitor), (7) has one end connected to the second operational amplifier (
A fourth resistor is connected to the non-inverting input terminal of 4) and has the other end connected to ground.

従来のオフセット補正回路は上述したよう(こ構成され
ており、第1の抵抗(2)〜第4の抵抗(7)の抵抗値
をそれぞれ”2 p R5p R5p R7で表わしか
つコンデンサ(6)の容量をCで表わす。
The conventional offset correction circuit is configured as described above, and the resistance values of the first resistor (2) to the fourth resistor (7) are respectively expressed as "2p R5p R5p R7", and the resistance value of the capacitor (6) is The capacity is expressed as C.

まず、第2のオペアンプ(4)、第3の抵抗(5)詔よ
びコンデンサ(6)がなく、第1のオペアンプ(1)の
非反転入力端子がアースに接続されている場合を考える
。第1のオペアンプ(1)の出力端子でのオフセット電
圧の大きさだけに着目して考えることにし、外部からの
入力電圧Vi=、0.第1のオペアンプ(1)の反転入
力端子、非反転入力端子間のオフセット電圧をVos+
とすると、第1のオペアンプ(1)の出力電圧■0は下
記の(1)式で表わされる。
First, consider the case where the second operational amplifier (4), the third resistor (5), the capacitor (6), and the non-inverting input terminal of the first operational amplifier (1) are connected to ground. We will focus only on the magnitude of the offset voltage at the output terminal of the first operational amplifier (1), and consider the external input voltage Vi=,0. The offset voltage between the inverting input terminal and non-inverting input terminal of the first operational amplifier (1) is Vos+
Then, the output voltage ■0 of the first operational amplifier (1) is expressed by the following equation (1).

Vo = (j+士) Vos+   ・・・曲(1)
次に、第2のオペアンプ(4)、第6の抵抗(5)詔よ
びコンデンサ(6)がある場合について考える。この時
も第1のオペアンプ(1)の出力端子でのオフセット電
圧の大きさに注目して考えることにし、外部からの入力
電圧Vi=0.第1のオペアンプ(1)のオフセット電
圧をVosl、第2のオペアンプ(4)のオフセット電
圧をvos2、第2のオペアンプ(4)の出力電圧をe
とする。第1のオペアンプ(1)の出力電圧V。
Vo = (j+shi) Vos+...song (1)
Next, consider the case where there is a second operational amplifier (4), a sixth resistor (5), and a capacitor (6). At this time as well, we will focus on the magnitude of the offset voltage at the output terminal of the first operational amplifier (1), and consider that the external input voltage Vi=0. The offset voltage of the first operational amplifier (1) is Vosl, the offset voltage of the second operational amplifier (4) is vos2, and the output voltage of the second operational amplifier (4) is e.
shall be. Output voltage V of the first operational amplifier (1).

に関しては、 vO=(θ+Vast) (1+奇)e@・・・・・(
2)が成立し、第2のオペアンプ(4)の出力電圧θに
関しては e = −−(7o−Vosz) −t−1−Voez
    −−−−・(5)C@R5 が成立する。(2)式、(3)式において、充分に時間
が経過した場合、それぞれ(4)式、(5)式が成立す
る。
Regarding, vO=(θ+Vast) (1+odd)e@・・・・・・(
2) holds, and regarding the output voltage θ of the second operational amplifier (4), e = −−(7o−Vosz) −t−1−Voez
-----・(5) C@R5 holds true. In equations (2) and (3), if sufficient time has elapsed, equations (4) and (5) hold, respectively.

(1)式と(4)式を比較した場合、オフセット電圧v
081とv082が等しいとして、出力に現われるオフ
セット電圧はR2/R3−)−R2倍に圧縮されること
がわかり、第2のオペアンプ(4)と第3の抵抗(5)
およびコンデンサ(6)による積分回路とがオフセット
補正回路として動作することが理解される。なお図中、
第2のオペアンプ(4)の非反転入力端子に接続された
第4の抵抗(7)はオフセット電流補正用に用いられる
ものである。
When comparing equations (1) and (4), the offset voltage v
Assuming that 081 and v082 are equal, it can be seen that the offset voltage appearing at the output is compressed to R2/R3-) - R2 times, and the second operational amplifier (4) and the third resistor (5)
It is understood that the integrator circuit including the capacitor (6) and the capacitor (6) operate as an offset correction circuit. In addition, in the figure,
A fourth resistor (7) connected to the non-inverting input terminal of the second operational amplifier (4) is used for offset current correction.

〔発明が解決しようとする問題点〕[Problem that the invention seeks to solve]

従来のオフセット補正回路では、積分用のコンデンサ(
6)の両端間にかかる電圧は、(5)式よりり、ここに
アルミ電解コンデンサ等を使用した場合には容量抜けの
恐れがあった。このため、通常、ここには高価なタンタ
ルコンデンサ等を使用しなければならないと云う問題点
があった。
In conventional offset correction circuits, an integrating capacitor (
According to equation (5), the voltage applied between both ends of 6) may cause a loss of capacity if an aluminum electrolytic capacitor or the like is used here. Therefore, there is usually a problem in that an expensive tantalum capacitor or the like must be used here.

この発明はこのような問題点を解決するためになされた
もので、積分用のコンデンサとして安価なアルミ電解コ
ンデンサを使用できるオフセット補正回路を提供するこ
とを目的とする。
The present invention was made to solve these problems, and an object of the present invention is to provide an offset correction circuit that can use an inexpensive aluminum electrolytic capacitor as an integrating capacitor.

〔問題点°を解決するための手段〕[Means to solve the problem]

この発明に係るオフセット補正回路は、第2のオペアン
プと第6の抵抗およびコンデンサで構成される積分回路
との出力を第5の抵抗(帰還抵抗)を通して第1のオペ
アンプの反転入力端子に供給しス第1のオペアンプの反
転入力端子にバイアス用抵抗を介して正或いは負の電源
を接続するようlこしたものである。
The offset correction circuit according to the present invention supplies the output of the second operational amplifier and the integrating circuit composed of the sixth resistor and the capacitor to the inverting input terminal of the first operational amplifier through the fifth resistor (feedback resistor). A positive or negative power supply is connected to the inverting input terminal of the first operational amplifier via a bias resistor.

〔作 用〕[For production]

この発明においては、正或いは負の電源に接続されたバ
イアス用抵抗および第2のオペアンプの出力端子と第1
のオペアンプの非反転入力端子の間に接続された抵抗と
によって第1のオペアンプの出力端子に所定のバイアス
電圧が発生される。
In this invention, a bias resistor connected to a positive or negative power supply and an output terminal of the second operational amplifier and the first operational amplifier are connected to each other.
A predetermined bias voltage is generated at the output terminal of the first operational amplifier by a resistor connected between the non-inverting input terminals of the first operational amplifier.

〔実施例〕〔Example〕

第1図はこの発明の一実施例を示す回路図であり、第2
図の従来例と違って、コンデンサ(6)の他端と第2の
オペアンプ(4)の出力端子との接続点を第1のオペア
ンプ(1)の非反転入力端子へ直接接続する代りに、上
述した接続点と第1のオペアンプ(1)の非反転入力端
子との間に第5の抵抗(8)を接続すると共に第1のオ
ペアンプ(1)の非反転入力端子と正或いは負の電源と
の間に第6の抵抗(9)を接続したものである。なお、
第5、第6の抵抗(8)、(9)の抵抗値をそれぞれR
6,R9で表わす。また、第2のオペアンプ(4)、第
3の抵抗(5)、コンデンサ(6)および第5の抵抗(
8)でローパスフィルタが構成される。
FIG. 1 is a circuit diagram showing one embodiment of the present invention, and FIG.
Unlike the conventional example shown in the figure, instead of directly connecting the connection point between the other end of the capacitor (6) and the output terminal of the second operational amplifier (4) to the non-inverting input terminal of the first operational amplifier (1), A fifth resistor (8) is connected between the above connection point and the non-inverting input terminal of the first operational amplifier (1), and a positive or negative power supply is connected to the non-inverting input terminal of the first operational amplifier (1). A sixth resistor (9) is connected between the two. In addition,
The resistance values of the fifth and sixth resistors (8) and (9) are respectively R
6, represented by R9. In addition, a second operational amplifier (4), a third resistor (5), a capacitor (6) and a fifth resistor (
8) constitutes a low-pass filter.

上述したように構成されたオフセット補正回路において
、第1のオペアンプ(1)の出力端子に発生するオフセ
ット電圧だけに着目して考えることにし、外部から第1
の抵抗(2)に供給される電圧はOVであるとする。第
1のオペアンプ(1)の入力端子間のオフセット電圧を
Vos+ 、第2のオペアンプ(4)の入力端子間のオ
フセット電圧をVos2、第1のオペアンプ(1)の出
力電圧をVO1O2O3ペアンプ(4)の出力電圧をe
、第1のオペアンプ(1)の非反転入力端子に発生する
電圧を01、電源電圧をVccとすると、θ1.Vo、
eに関して下記の(6)式ないしく8)式が成立する。
In the offset correction circuit configured as described above, we will focus only on the offset voltage generated at the output terminal of the first operational amplifier (1).
It is assumed that the voltage supplied to the resistor (2) is OV. The offset voltage between the input terminals of the first operational amplifier (1) is Vos+, the offset voltage between the input terminals of the second operational amplifier (4) is Vos2, and the output voltage of the first operational amplifier (1) is VO1O2O3 operational amplifier (4). The output voltage of e
, the voltage generated at the non-inverting input terminal of the first operational amplifier (1) is 01, and the power supply voltage is Vcc, then θ1. Vo,
Regarding e, the following equations (6) to 8) hold true.

RgVCe 十R9e ” ”’  R8+R9°−−−−−− (6)R3・
・・・・・・(7) Vo = (e、 +Vos+) (1+可)e = 
VO32−(Vo−VO82)ffi     −・・
・・・a (8)ここでtは経過時間である。
RgVCe 10R9e ” ”' R8+R9°−−−−−− (6) R3・
・・・・・・(7) Vo = (e, +Vos+) (1+ possible) e =
VO32-(Vo-VO82)ffi-・・
...a (8) Here, t is the elapsed time.

(6)弐〜(8)式より (9)式および(10)式より時間が充分に経過した後
のTo、eは、t−+ωとしてそれぞれvO=voe2
・・・・・・(11) (11)式の結果により第1のオペアンプ(1)の出力
端子に発生するオフセット電圧は第2のオペアンプ(4
)のオフセット電圧のみとなる。また、第2のオペアン
プ(4)の出力端子に発生する電圧は、VccをVos
l、 Voθ2に対して充分に大きくとり、各抵抗値を
適切に組合わせることlこより、任意の大きさIこする
ことができ、従って第2のオペアンプ(4)の帰還回路
に接続されているコンデンサ(6)の両端間に充分なバ
イアス電圧を発生させ得ることがわかる。
(6) From equations (9) and (10), To and e after sufficient time have elapsed are vO = voe2, respectively, as t-+ω.
......(11) According to the result of equation (11), the offset voltage generated at the output terminal of the first operational amplifier (1) is
) is the only offset voltage. In addition, the voltage generated at the output terminal of the second operational amplifier (4) is Vcc
By taking a sufficiently large value for l and Voθ2 and appropriately combining each resistance value, it is possible to obtain an arbitrary magnitude of I, and therefore it is connected to the feedback circuit of the second operational amplifier (4). It can be seen that a sufficient bias voltage can be generated across the capacitor (6).

以上の説明では、第2のオペアンプ(4)の出力を第1
のオペアンプ(1)の非反転入力端子に帰還する場合に
ついて述べたが、帰還ループの極性(こより反転入力端
子に帰還した場合についても同様の効果が得られること
は云うまでもない。
In the above explanation, the output of the second operational amplifier (4) is
Although we have described the case where the feedback is fed back to the non-inverting input terminal of the operational amplifier (1), it goes without saying that the same effect can be obtained when the feedback is fed back to the inverting input terminal due to the polarity of the feedback loop.

また、バイアス用の第6の抵抗(9)を第1のオペアン
プ(1)の非反転入力端子に接続した場合について述べ
たが、反転入力端子に接続しても同様の効果が得られる
ことも云うまでもない。
Also, although we have described the case where the sixth bias resistor (9) is connected to the non-inverting input terminal of the first operational amplifier (1), the same effect can also be obtained by connecting it to the inverting input terminal. Needless to say.

〔発明の効果〕〔Effect of the invention〕

以上のようlこ、この発明によれば、第2のオペアンプ
の出力端子と電源の間に2個の抵抗を直列に接続し、こ
れら抵抗の接続点を第1のオペアンプの非反転入力端子
に接続することにより積分回路を構成するコンデンサの
両端に一定の電圧が発生されるようにしたので、アルミ
’I!解コンデンサ特有の無負荷時における容量抜けの
モードが発生しないため、高価なタンタルコンデンサの
代り1こ安価なアルミ電解コンデンサを使用でき、オフ
セット補正回路を安価に製作することができる効果があ
る。
As described above, according to the present invention, two resistors are connected in series between the output terminal of the second operational amplifier and the power supply, and the connection point of these resistors is connected to the non-inverting input terminal of the first operational amplifier. By connecting a constant voltage to both ends of the capacitor that constitutes the integrating circuit, the aluminum 'I! Since the capacitance loss mode during no-load, which is characteristic of electrolytic capacitors, does not occur, an inexpensive aluminum electrolytic capacitor can be used instead of an expensive tantalum capacitor, and the offset correction circuit can be manufactured at a low cost.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図はこの発明の一実施例を示す回路図、第2図は従
来のオフセット補正回路を示す回路図である。 図において、(1)は第1のオペアンプ、(2)は第1
の抵抗、(5)は第2の抵抗、(4)は第2のオペアン
プ、(5)は第3の抵抗、(6)はコンデンサ、(7)
は第4の抵抗、(8)は第5の抵抗、(9)は第6の抵
抗、(Vcc)は電源である。 なお、図中、同一符号は同一、又は相当部分を示す。
FIG. 1 is a circuit diagram showing an embodiment of the present invention, and FIG. 2 is a circuit diagram showing a conventional offset correction circuit. In the figure, (1) is the first operational amplifier, and (2) is the first operational amplifier.
resistor, (5) is the second resistor, (4) is the second operational amplifier, (5) is the third resistor, (6) is the capacitor, (7)
is the fourth resistor, (8) is the fifth resistor, (9) is the sixth resistor, and (Vcc) is the power supply. In addition, in the figures, the same reference numerals indicate the same or equivalent parts.

Claims (1)

【特許請求の範囲】[Claims] 1)負帰還増幅を施した第1の演算増幅器と、第2の演
算増幅器、抵抗およびコンデンサから成り、前記第1の
演算増幅器の出力をこの第1の演算増幅器のいずれか一
方の入力端子に抵抗帰還させるローパスフィルタと、前
記第1の演算増幅器のいずれか一方の入力が端子と正或
いは負の電源との間に接続されたバイアス用抵抗とを備
えたことを特徴とするオフセット補正回路。
1) Consisting of a first operational amplifier with negative feedback amplification, a second operational amplifier, a resistor, and a capacitor, the output of the first operational amplifier is connected to one of the input terminals of the first operational amplifier. An offset correction circuit comprising: a low-pass filter for resistive feedback; and a bias resistor connected between the input terminal of one of the first operational amplifiers and a positive or negative power supply.
JP61175537A 1986-07-28 1986-07-28 Offset correction circuit Expired - Fee Related JPH0666602B2 (en)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0456506A (en) * 1990-06-26 1992-02-24 Nec Corp Offset component elimination circuit

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* Cited by examiner, † Cited by third party
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