JPS634723B2 - - Google Patents
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- JPS634723B2 JPS634723B2 JP56109874A JP10987481A JPS634723B2 JP S634723 B2 JPS634723 B2 JP S634723B2 JP 56109874 A JP56109874 A JP 56109874A JP 10987481 A JP10987481 A JP 10987481A JP S634723 B2 JPS634723 B2 JP S634723B2
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- JP
- Japan
- Prior art keywords
- signal
- load
- stereo
- circuit
- amplifier
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
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Description
【発明の詳細な説明】
この発明は、BTL(Balanced Transfomer
Less)増幅によつてステレオ信号等の信号成分
の合成やステレオ信号の再生を選択的に行う増幅
回路に関する。
Less)増幅によつてステレオ信号等の信号成分
の合成やステレオ信号の再生を選択的に行う増幅
回路に関する。
ステレオの再生はステレオ用ヘツドホンのみで
行い、内蔵スピーカはモノラル信号のみを再生す
るようにされた携帯用の超小型のポータブル用テ
ープレコーダやラジオ等では、スピーカに駆動入
力を与える増幅回路にBTL回路が用いられ、そ
の前段にステレオ信号をモノラル化する信号合成
回路が設置されている。
行い、内蔵スピーカはモノラル信号のみを再生す
るようにされた携帯用の超小型のポータブル用テ
ープレコーダやラジオ等では、スピーカに駆動入
力を与える増幅回路にBTL回路が用いられ、そ
の前段にステレオ信号をモノラル化する信号合成
回路が設置されている。
第1図は、従来のBTL回路及び信号合成回路
を示す。この場合、BTL回路は単一入力に設定
されているため、左右のステレオ信号L、Rは、
予め合成してモノラル化する必要がある。信号合
成器(MIX)2にはスイツチ回路4より合成タ
イミング信号が与えられ、信号合成出力は直接電
力増幅器6で増幅してスピーカ等の負荷8に供給
する一方、位相反転器10で位相反転した後、電
力増幅器12で増幅して負荷8の他方の端子に供
給している。このように従来回路の場合、BTL
増幅の前にステレオ信号の合成が必要であり、信
号合成器2及びスイツチ回路4を設置したため、
回路構成が複雑化して高価になるとともに、信頼
性が低くなる欠点がある。
を示す。この場合、BTL回路は単一入力に設定
されているため、左右のステレオ信号L、Rは、
予め合成してモノラル化する必要がある。信号合
成器(MIX)2にはスイツチ回路4より合成タ
イミング信号が与えられ、信号合成出力は直接電
力増幅器6で増幅してスピーカ等の負荷8に供給
する一方、位相反転器10で位相反転した後、電
力増幅器12で増幅して負荷8の他方の端子に供
給している。このように従来回路の場合、BTL
増幅の前にステレオ信号の合成が必要であり、信
号合成器2及びスイツチ回路4を設置したため、
回路構成が複雑化して高価になるとともに、信頼
性が低くなる欠点がある。
また、BTL回路はスピーカ等のモノラル用の
負荷8に対して設置されており、従来のシステム
ではステレオ用ヘツドホン用に別の増幅回路が設
置されているため、より回路構成が複雑化する。
また、電池の消耗を抑えるため、構成の簡略化が
要請されている。
負荷8に対して設置されており、従来のシステム
ではステレオ用ヘツドホン用に別の増幅回路が設
置されているため、より回路構成が複雑化する。
また、電池の消耗を抑えるため、構成の簡略化が
要請されている。
そこで、この発明は、従来回路の信号合成器及
びスイツチ回路を省略して回路構成を簡略化する
とともに、ステレオ信号のモノラル合成による再
生、又はステレオ信号の左右信号の個別再生を負
荷の接続切換え等の簡単な操作で行えるようにし
たものである。
びスイツチ回路を省略して回路構成を簡略化する
とともに、ステレオ信号のモノラル合成による再
生、又はステレオ信号の左右信号の個別再生を負
荷の接続切換え等の簡単な操作で行えるようにし
たものである。
この発明の増幅回路は、ステレオ信号の右信号
又は左信号の何れか一方を第1の信号、他方を第
2の信号とし、第1の信号の位相を反転する位相
反転器と、第1の信号、又は、位相反転器で位相
を反転させた第1の信号の何れか一方を、外部か
ら加えられる制御入力に基づいて選択する切換回
路と、この切換回路で選択された信号を増幅する
第1の増幅器と、第2の信号を増幅する第2の増
幅器とを備え、第1及び第2の増幅器の出力端子
間、又は、第1及び第2の増幅器の各出力端子毎
に接続される負荷に対応した切換回路の前記信号
選択に応じて、出力端子間に接続された負荷を通
して第1及び第2の信号の加算によつてステレオ
信号のステレオ信号及び左信号からなるモノラル
信号を取り出し、又は、第1の増幅器の出力端子
側の負荷から第1の信号とともに、第2の増幅器
の出力端子側の負荷から第2の信号を得てステレ
オ信号を取り出すようにしたものである。
又は左信号の何れか一方を第1の信号、他方を第
2の信号とし、第1の信号の位相を反転する位相
反転器と、第1の信号、又は、位相反転器で位相
を反転させた第1の信号の何れか一方を、外部か
ら加えられる制御入力に基づいて選択する切換回
路と、この切換回路で選択された信号を増幅する
第1の増幅器と、第2の信号を増幅する第2の増
幅器とを備え、第1及び第2の増幅器の出力端子
間、又は、第1及び第2の増幅器の各出力端子毎
に接続される負荷に対応した切換回路の前記信号
選択に応じて、出力端子間に接続された負荷を通
して第1及び第2の信号の加算によつてステレオ
信号のステレオ信号及び左信号からなるモノラル
信号を取り出し、又は、第1の増幅器の出力端子
側の負荷から第1の信号とともに、第2の増幅器
の出力端子側の負荷から第2の信号を得てステレ
オ信号を取り出すようにしたものである。
以下、この発明を図面に示した実施例に基づき
詳細に説明する。
詳細に説明する。
第2図は、この発明の増幅回路の実施例を示
す。
す。
増幅回路20は、ステレオ信号のモノラル化
や、その左右信号の個別増幅を行うものであり、
ステレオ信号等を加える入力端子22A,22B
が設けられている。例えば、ステレオ信号の右信
号及び左信号の何れか一方を第1の信号、他方を
第2の信号とし、入力端子22Aに第1の信号、
入力端子22Bに第2の信号が加えられる。端子
23は、入力信号の基準となる基準レベル端子
(GND)である。
や、その左右信号の個別増幅を行うものであり、
ステレオ信号等を加える入力端子22A,22B
が設けられている。例えば、ステレオ信号の右信
号及び左信号の何れか一方を第1の信号、他方を
第2の信号とし、入力端子22Aに第1の信号、
入力端子22Bに第2の信号が加えられる。端子
23は、入力信号の基準となる基準レベル端子
(GND)である。
入力端子22Aに加えられた第1の信号は、位
相反転器24で位相が反転され、この位相反転器
24で得られた位相反転力は位相反転前の入力信
号とともに切換回路26に加えられる。切換回路
26は、制御入力端子28に加えられる制御信号
に基づき、第1の信号又は位相反転された第1の
信号の何れか一方を選択する。この切換回路26
は、スイツチングトランジスタ等で構成されるア
ナログスイツチで構成することができる。
相反転器24で位相が反転され、この位相反転器
24で得られた位相反転力は位相反転前の入力信
号とともに切換回路26に加えられる。切換回路
26は、制御入力端子28に加えられる制御信号
に基づき、第1の信号又は位相反転された第1の
信号の何れか一方を選択する。この切換回路26
は、スイツチングトランジスタ等で構成されるア
ナログスイツチで構成することができる。
この切換回路26の信号出力は第1の増幅器と
して設置された電力増幅器32に加えられて増幅
され、その増幅出力は出力端子34Aから取り出
される。
して設置された電力増幅器32に加えられて増幅
され、その増幅出力は出力端子34Aから取り出
される。
入力端子22Bに加えられた第2の信号は、第
2の増幅器として設置された電力増幅器36で増
幅され、その増幅出力は出力端子34Bから取り
出される。
2の増幅器として設置された電力増幅器36で増
幅され、その増幅出力は出力端子34Bから取り
出される。
そして、各出力端子34A,34Bの間には、
スピーカ等の負荷38が接続され、また、各出力
端子34A又は34Bと出力端子40との間に
は、ヘツドホン等の負荷42A,42Bが接続さ
れる。負荷38又は負荷42A,42Bは、出力
端子34A又は34Bと出力端子40に対して接
続を切換えられ、一点鎖線は切換回路26の等価
接点26Pの一点鎖線に対応し、切換回路26が
一点鎖線のように切換えられた場合には、各負荷
42A,42Bが出力端子34A,34Bに接続
され、負荷38の接続は解除される。
スピーカ等の負荷38が接続され、また、各出力
端子34A又は34Bと出力端子40との間に
は、ヘツドホン等の負荷42A,42Bが接続さ
れる。負荷38又は負荷42A,42Bは、出力
端子34A又は34Bと出力端子40に対して接
続を切換えられ、一点鎖線は切換回路26の等価
接点26Pの一点鎖線に対応し、切換回路26が
一点鎖線のように切換えられた場合には、各負荷
42A,42Bが出力端子34A,34Bに接続
され、負荷38の接続は解除される。
以上の構成において、出力端子34A,34B
に負荷38が接続されるとともに、制御入力端子
28から制御信号が切換回路26に与えられて等
価接点26Pで実線で示す側に切換えられた場
合、増幅回路20及び負荷42A,42Bによつ
てBTL回路が構成される。
に負荷38が接続されるとともに、制御入力端子
28から制御信号が切換回路26に与えられて等
価接点26Pで実線で示す側に切換えられた場
合、増幅回路20及び負荷42A,42Bによつ
てBTL回路が構成される。
ここで、入力端子22Aに第1の信号としてス
テレオ信号の例えば、第3図のAに示す右信号R
を加えるとともに、入力端子22Bに第2の信号
としてステレオ信号の第3図のBに示す左信号L
を加え、各信号R、L、の最大振幅をe1,e2とす
る。
テレオ信号の例えば、第3図のAに示す右信号R
を加えるとともに、入力端子22Bに第2の信号
としてステレオ信号の第3図のBに示す左信号L
を加え、各信号R、L、の最大振幅をe1,e2とす
る。
入力端子22Aに加えられた右信号Rは、位相
反転器24で位相が反転され、第3図のCに示す
波形のようになる。また、入力端子22Bに加え
られた左信号Lは、電力増幅器36で直接増幅さ
れ、出力端子34Bには第3図のDに示す出力が
現れる。この出力端子34Bに現れる出力波形の
振幅は、電力増幅器36が持つ増幅利得Kによつ
てK・e2となる。
反転器24で位相が反転され、第3図のCに示す
波形のようになる。また、入力端子22Bに加え
られた左信号Lは、電力増幅器36で直接増幅さ
れ、出力端子34Bには第3図のDに示す出力が
現れる。この出力端子34Bに現れる出力波形の
振幅は、電力増幅器36が持つ増幅利得Kによつ
てK・e2となる。
また、位相反転器26で得られた右信号Rの位
相反転信号は、電力増幅器32で増幅され、出力
端子34Aには第3図のEに示す出力が現れ、そ
の振幅は電力増幅器32の前記と同様の増幅利得
KによつてK・(−e1)となる。
相反転信号は、電力増幅器32で増幅され、出力
端子34Aには第3図のEに示す出力が現れ、そ
の振幅は電力増幅器32の前記と同様の増幅利得
KによつてK・(−e1)となる。
各出力端子34A、34Bに現れるこれらの出
力は、負荷38に反対方向の端子より加えられる
ため、負荷38には第3図のFに示す両出力が与
えられ、その振幅は出力合成によつてK・(e1+
e2)となる。
力は、負荷38に反対方向の端子より加えられる
ため、負荷38には第3図のFに示す両出力が与
えられ、その振幅は出力合成によつてK・(e1+
e2)となる。
また、このようにBTL回路を構成している場
合において、入力端子22Aに左信号成分ΔLを
含んだ右信号(R+ΔL)を加え、入力端子22
Bに右信号成分ΔRを含んだ左信号(L+ΔR)
を加えた場合、位相反転器24で右信号(R+
ΔL)の反転信号{−(R+ΔL)}が得られるた
め、各電力増幅器32,36の利得Kを便宜上K
=1とすると、負荷38に加わる出力V0は、負
荷38を通して反転信号{−(R+ΔL)}と左信
号(L+ΔR)とを加算した合成信号となる。即
ち、出力V0は、両信号の加算{L+ΔR−(−R
−ΔL)}で、(L+R+ΔL+ΔR)のステレオ信
号の和信号を形成することができる。従つて、
BTL増幅によつてステレオ信号の合成を行い、
従来回路で必要としていた信号合成器及びスイツ
チ回路を省略して同様のモノラル化が可能にな
り、ステレオ信号の再生時の負荷38として内蔵
スピーカをモノラル信号で駆動することができ
る。なお、各入力端子22A,22Bにモノラル
信号Aが与えられた場合には、第3図AないしF
より明らかなように、出力V0は各信号の加算
{A−(−A)=2A}によつてBTL出力となり、
この出力V0で負荷38が駆動されることになる。
合において、入力端子22Aに左信号成分ΔLを
含んだ右信号(R+ΔL)を加え、入力端子22
Bに右信号成分ΔRを含んだ左信号(L+ΔR)
を加えた場合、位相反転器24で右信号(R+
ΔL)の反転信号{−(R+ΔL)}が得られるた
め、各電力増幅器32,36の利得Kを便宜上K
=1とすると、負荷38に加わる出力V0は、負
荷38を通して反転信号{−(R+ΔL)}と左信
号(L+ΔR)とを加算した合成信号となる。即
ち、出力V0は、両信号の加算{L+ΔR−(−R
−ΔL)}で、(L+R+ΔL+ΔR)のステレオ信
号の和信号を形成することができる。従つて、
BTL増幅によつてステレオ信号の合成を行い、
従来回路で必要としていた信号合成器及びスイツ
チ回路を省略して同様のモノラル化が可能にな
り、ステレオ信号の再生時の負荷38として内蔵
スピーカをモノラル信号で駆動することができ
る。なお、各入力端子22A,22Bにモノラル
信号Aが与えられた場合には、第3図AないしF
より明らかなように、出力V0は各信号の加算
{A−(−A)=2A}によつてBTL出力となり、
この出力V0で負荷38が駆動されることになる。
また、負荷38から負荷42A,42Bに切換
えられ、同時に制御入力端子28に加えられる制
御信号入力で切換回路26の等価接点26Pが一
点鎖線で示す側に切換えられた場合には、増幅回
路20は電力増幅器32,36で信号増幅が行わ
れる。即ち、入力端子22Aに加えられた右信号
(R+ΔL)は電力増幅器32で直接増幅された
後、負荷42Aに加えられ、また、入力端子22
Bに加えられた左信号(L+ΔR)は、電力増幅
器36で増幅された後、負荷42Bに加えられ
る。従つて、負荷42A,42Bは別個の信号成
分で駆動され、負荷42A,42Bをステレオ用
ヘツドホンとすれば、ステレオ信号の再生を行う
ことができる。
えられ、同時に制御入力端子28に加えられる制
御信号入力で切換回路26の等価接点26Pが一
点鎖線で示す側に切換えられた場合には、増幅回
路20は電力増幅器32,36で信号増幅が行わ
れる。即ち、入力端子22Aに加えられた右信号
(R+ΔL)は電力増幅器32で直接増幅された
後、負荷42Aに加えられ、また、入力端子22
Bに加えられた左信号(L+ΔR)は、電力増幅
器36で増幅された後、負荷42Bに加えられ
る。従つて、負荷42A,42Bは別個の信号成
分で駆動され、負荷42A,42Bをステレオ用
ヘツドホンとすれば、ステレオ信号の再生を行う
ことができる。
そして、このような増幅回路によれば、負荷3
7又は負荷42A,42Bの接続切換えと、切換
回路26の切換え動作とによつて、ステレオ信号
のモノラル化再生又はステレオ信号の再生等、負
荷に応じた再生出力を得ることができ、しかも、
信号合成器等の省略に加えて、切換回路26の挿
入のみで電力増幅器32,36を共用するため、
回路構成が簡略化でき、経済的である。更に、信
号合成器及びスイツチ回路の省略とともにBTL
増幅によつて信号成分を合成するため、信頼性の
高い信号成分の合成が可能になる。また、制御入
力端子28に加える制御信号の発生を負荷38と
負荷42A,42Bとの切換えによつて制御する
ものとすれば、負荷に応じた信号モードを効果的
に形成することができる。
7又は負荷42A,42Bの接続切換えと、切換
回路26の切換え動作とによつて、ステレオ信号
のモノラル化再生又はステレオ信号の再生等、負
荷に応じた再生出力を得ることができ、しかも、
信号合成器等の省略に加えて、切換回路26の挿
入のみで電力増幅器32,36を共用するため、
回路構成が簡略化でき、経済的である。更に、信
号合成器及びスイツチ回路の省略とともにBTL
増幅によつて信号成分を合成するため、信頼性の
高い信号成分の合成が可能になる。また、制御入
力端子28に加える制御信号の発生を負荷38と
負荷42A,42Bとの切換えによつて制御する
ものとすれば、負荷に応じた信号モードを効果的
に形成することができる。
次に、第4図は、FMステレオ放送用受信機に
この発明の増幅回路を用いた場合の具体的な実施
例を示す。即ち、FMフロントエンド42、中間
周波増幅、FM検波回路44及びマルチプレクサ
46を経て左右に分離されたステレオ信号は、増
幅回路20の入力端子22A,22Bに個別に加
えられる。スピーカ48は、前記実施例の負荷3
8に対応し、セツト内に内蔵された単一のスピー
カ、また、スピーカ50A,50Bは、前記実施
例の負荷42A,42Bに対応し、セツトに外部
接続されるもので、ステレオヘツドホンに置換で
きる。従つて、これらスピカーカ48又はスピー
カ50A,50Bの接続の切換えと、制御入力端
子28に加えられる制御信号による切換回路26
の切換えとによつて、スピーカ48ではステレオ
信号のモノラル化信号、スピーカ50A,50B
ではステレオ信号の右信号R及び左信号Lを再生
することができる。
この発明の増幅回路を用いた場合の具体的な実施
例を示す。即ち、FMフロントエンド42、中間
周波増幅、FM検波回路44及びマルチプレクサ
46を経て左右に分離されたステレオ信号は、増
幅回路20の入力端子22A,22Bに個別に加
えられる。スピーカ48は、前記実施例の負荷3
8に対応し、セツト内に内蔵された単一のスピー
カ、また、スピーカ50A,50Bは、前記実施
例の負荷42A,42Bに対応し、セツトに外部
接続されるもので、ステレオヘツドホンに置換で
きる。従つて、これらスピカーカ48又はスピー
カ50A,50Bの接続の切換えと、制御入力端
子28に加えられる制御信号による切換回路26
の切換えとによつて、スピーカ48ではステレオ
信号のモノラル化信号、スピーカ50A,50B
ではステレオ信号の右信号R及び左信号Lを再生
することができる。
なお、この発明は、ラジオだけでなくテープレ
コーダのステレオ録音のモノラル再生等、各種の
信号成分の合成に利用でき、負荷に応じた信号出
力を取り出すことができる。
コーダのステレオ録音のモノラル再生等、各種の
信号成分の合成に利用でき、負荷に応じた信号出
力を取り出すことができる。
以上説明したように、この発明によれば、
BTL増幅によつてステレオ信号のモノラル化が
できるとともに、負荷に応じてステレオ信号出
力、又は、ステレオ信号のモノラル化出力を選択
的に得ることができ、しかも、信号合成器の省略
等で回路構成の簡略化を図ることができる。
BTL増幅によつてステレオ信号のモノラル化が
できるとともに、負荷に応じてステレオ信号出
力、又は、ステレオ信号のモノラル化出力を選択
的に得ることができ、しかも、信号合成器の省略
等で回路構成の簡略化を図ることができる。
第1図は従来のBTL回路を示すブロツク図、
第2図はこの発明の増幅回路の実施例を示すブロ
ツク図、第3図は第2図に示した増幅回路の
BTL増幅動作における各部波形を示す説明図、
第4図はこの発明の増幅回路の具体的な実施例で
あるステレオ放送用受信機を示すブロツク図であ
る。 20……増幅回路、24……位相反転器、26
……切換回路、32……電力増幅器(第1の増幅
器)、34A,34B……出力端子、36……電
力増幅器(第2の増幅器)、38,42A,42
B……負荷。
第2図はこの発明の増幅回路の実施例を示すブロ
ツク図、第3図は第2図に示した増幅回路の
BTL増幅動作における各部波形を示す説明図、
第4図はこの発明の増幅回路の具体的な実施例で
あるステレオ放送用受信機を示すブロツク図であ
る。 20……増幅回路、24……位相反転器、26
……切換回路、32……電力増幅器(第1の増幅
器)、34A,34B……出力端子、36……電
力増幅器(第2の増幅器)、38,42A,42
B……負荷。
Claims (1)
- 【特許請求の範囲】 1 ステレオ信号の右信号又は左信号の何れか一
方を第1の信号、他方を第2の信号とし、第1の
信号の位相を反転する位相反転器と、 第1の信号、又は、位相反転器で位相を反転さ
せた第1の信号の何れか一方を、外部から加えら
れる制御入力に基づいて選択する切換回路と、 この切換回路で選択された信号を増幅する第1
の増幅器と、 第2の信号を増幅する第2の増幅器とを備え、
第1及び第2の増幅器の出力端子間、又は第1及
び第2の増幅器の各出力端子毎に接続される負荷
に対応した切換回路の前記信号選択に応じて、出
力端子間に接続された負荷を通して第1及び第2
の信号の加算によつてステレオ信号の右信号及び
左信号からなるモノラル信号を取り出し、又は、
第1の増幅器の出力端子側の負荷から第1の信号
とともに、第2の増幅器の出力端子側の負荷から
第2の信号を得てステレオ信号を取り出す増幅回
路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56109874A JPS5812409A (ja) | 1981-07-14 | 1981-07-14 | 増幅回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56109874A JPS5812409A (ja) | 1981-07-14 | 1981-07-14 | 増幅回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5812409A JPS5812409A (ja) | 1983-01-24 |
| JPS634723B2 true JPS634723B2 (ja) | 1988-01-30 |
Family
ID=14521369
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56109874A Granted JPS5812409A (ja) | 1981-07-14 | 1981-07-14 | 増幅回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5812409A (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4926504U (ja) * | 1972-06-07 | 1974-03-07 |
-
1981
- 1981-07-14 JP JP56109874A patent/JPS5812409A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5812409A (ja) | 1983-01-24 |
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