JPS635482U - - Google Patents

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JPS635482U
JPS635482U JP9838786U JP9838786U JPS635482U JP S635482 U JPS635482 U JP S635482U JP 9838786 U JP9838786 U JP 9838786U JP 9838786 U JP9838786 U JP 9838786U JP S635482 U JPS635482 U JP S635482U
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Description

【図面の簡単な説明】
第1図は本考案の実施例を示すロジツクパター
ンジエネレータの回路図、第2図は遅延回路の一
例を示す図、第3図は第2図に示す遅延回路の動
作説明に供する波形図である。 14……カウンタ、18……メモリ、21……
遅延回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. テスト用並列データを記憶する記憶手段と、該
    記憶手段のアドレスを所定の順序で指定して該記
    憶手段の複数のデータ出力線から該データを出力
    させるアドレス指定手段と、入力端子が該データ
    出力線に接続され入力されるビツトデータを設定
    時間遅延させて出力する遅延手段と、を有するこ
    とを特徴とするロジツクパターンジエネレータ。
JP1986098387U 1986-06-28 1986-06-28 ロジツクパタ−ンジエネレ−タ Expired - Lifetime JPH0637351Y2 (ja)

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JP1986098387U JPH0637351Y2 (ja) 1986-06-28 1986-06-28 ロジツクパタ−ンジエネレ−タ

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JP1986098387U JPH0637351Y2 (ja) 1986-06-28 1986-06-28 ロジツクパタ−ンジエネレ−タ

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Publication Number Publication Date
JPS635482U true JPS635482U (ja) 1988-01-14
JPH0637351Y2 JPH0637351Y2 (ja) 1994-09-28

Family

ID=30966277

Family Applications (1)

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JP1986098387U Expired - Lifetime JPH0637351Y2 (ja) 1986-06-28 1986-06-28 ロジツクパタ−ンジエネレ−タ

Country Status (1)

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JP (1) JPH0637351Y2 (ja)

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5954857U (ja) * 1982-10-01 1984-04-10 株式会社アドバンテスト 遅延時間制御装置

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5954857U (ja) * 1982-10-01 1984-04-10 株式会社アドバンテスト 遅延時間制御装置

Also Published As

Publication number Publication date
JPH0637351Y2 (ja) 1994-09-28

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