JPS6395673A - 絶縁ゲ−ト形電界効果トランジスタ - Google Patents
絶縁ゲ−ト形電界効果トランジスタInfo
- Publication number
- JPS6395673A JPS6395673A JP61241404A JP24140486A JPS6395673A JP S6395673 A JPS6395673 A JP S6395673A JP 61241404 A JP61241404 A JP 61241404A JP 24140486 A JP24140486 A JP 24140486A JP S6395673 A JPS6395673 A JP S6395673A
- Authority
- JP
- Japan
- Prior art keywords
- transistor
- igbt
- effect transistor
- insulated gate
- type field
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D12/00—Bipolar devices controlled by the field effect, e.g. insulated-gate bipolar transistors [IGBT]
- H10D12/411—Insulated-gate bipolar transistors [IGBT]
- H10D12/441—Vertical IGBTs
- H10D12/461—Vertical IGBTs having non-planar surfaces, e.g. having trenches, recesses or pillars in the surfaces of the emitter, base or collector regions
Landscapes
- Bipolar Transistors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、スイッチング用半導体素了の・−秤である
I G B T (In5ulated Gate B
ipolar abodetranststor ;絶
縁ゲート形電界効果トランジスタ)素子、特にその改良
に関する。
I G B T (In5ulated Gate B
ipolar abodetranststor ;絶
縁ゲート形電界効果トランジスタ)素子、特にその改良
に関する。
IGBTJF2子はバイポーラトランジスタの有する高
耐圧2人容徂化が容易であると云う長所と、パワーMO
8FETの有する高速なスイッチングが可能でドライブ
も容易であると云う長所とを併せもつ新しいデバイスと
して最近注目されているもので、IGT、C0MFET
、GEMFETまたはBJ、FETなとの商品名で各社
がそれぞれ製品化している。
耐圧2人容徂化が容易であると云う長所と、パワーMO
8FETの有する高速なスイッチングが可能でドライブ
も容易であると云う長所とを併せもつ新しいデバイスと
して最近注目されているもので、IGT、C0MFET
、GEMFETまたはBJ、FETなとの商品名で各社
がそれぞれ製品化している。
第2図にその断面!R造を示す。同図において、1はソ
ース電極、2は絶縁層、3はゲート、4はH+層、5.
7はP層、6はN一層、8はドレイン電極である。
ース電極、2は絶縁層、3はゲート、4はH+層、5.
7はP層、6はN一層、8はドレイン電極である。
第3図にその等何回路を示す。すなわち、IGBTはP
NPトランジスタ11およびNPNトランジスタ12と
、このNPNトランジスタ12に並列接続されたFET
13と、NPNトランジスタ12のベース・エミッタ間
を短絡する短絡抵抗14とからなり、トランジスタ11
.12で構成されるサイリスタ回路を内蔵している点が
特徴である。なお、IGBTの回路記号を第3A図に、
また、そのオン電圧とコレクタ電流との関係を第4図に
それぞれ示す。
NPトランジスタ11およびNPNトランジスタ12と
、このNPNトランジスタ12に並列接続されたFET
13と、NPNトランジスタ12のベース・エミッタ間
を短絡する短絡抵抗14とからなり、トランジスタ11
.12で構成されるサイリスタ回路を内蔵している点が
特徴である。なお、IGBTの回路記号を第3A図に、
また、そのオン電圧とコレクタ電流との関係を第4図に
それぞれ示す。
(発明が解決しようとする問題点〕
第4図の特性からも明らかなように、従来のIGBTで
はターンオフタイム(1)の長いもff のほとオン電圧が低く、ターンオフタイムが短くてオン
電圧の低い特性をもつ素子は存在しないのが現状である
。
はターンオフタイム(1)の長いもff のほとオン電圧が低く、ターンオフタイムが短くてオン
電圧の低い特性をもつ素子は存在しないのが現状である
。
したがって、この発明はターンオフタイムを短縮するこ
とが可能なIGBT$子を提供することを目的とする。
とが可能なIGBT$子を提供することを目的とする。
IGBrの内部トランジスタ(N (P)チャンネルI
GBTではPNP (NPN) トランジスタ〕のベー
ス部を外部に引き出して構成する。
GBTではPNP (NPN) トランジスタ〕のベー
ス部を外部に引き出して構成する。
IGBTのターンオフ時にその内部トランシスターンオ
フタイムを短縮できるようにする。
フタイムを短縮できるようにする。
〔実施例〕
第1図はこの発明の実施例を示す構成図である。
これは第2図と比較すれば明らかなように、絶縁層9を
介してベース電極10を引き出した点が特徴である。こ
れは、NPNトランジスタのベース部を引き出したこと
に相当し、等価回路としては第1A図の如く示される。
介してベース電極10を引き出した点が特徴である。こ
れは、NPNトランジスタのベース部を引き出したこと
に相当し、等価回路としては第1A図の如く示される。
そして、IGBTのターンオフ時にその内部トランジス
タのエミッタ(IGBTのコレクタ)・ベース電極10
との間を短絡または逆バイアスすれば、キャリアの消滅
が速められることから、そのターンオフタイムを従来の
ものより短縮させることができる。
タのエミッタ(IGBTのコレクタ)・ベース電極10
との間を短絡または逆バイアスすれば、キャリアの消滅
が速められることから、そのターンオフタイムを従来の
ものより短縮させることができる。
なお、以上ではNチャンネルIGBTについて説明した
が、この発明はPチャンネルI G B Tの場合につ
いても同様にして適用し得ることは云う迄もない。
が、この発明はPチャンネルI G B Tの場合につ
いても同様にして適用し得ることは云う迄もない。
(発明の効果〕
この発明によれば、I G B Tの内部トランジスタ
(N (P)チャンネルIGBTではPNP(NPN)
トランジスタ〕のベース部を外部に引き出すようにした
ので、そのターンオフ時には内部トランジスタのベース
・エミッタ間を短絡または逆バイアスすることが可能と
なり、これによってターンオフタイムを短縮し得る利点
がもたらされる。
(N (P)チャンネルIGBTではPNP(NPN)
トランジスタ〕のベース部を外部に引き出すようにした
ので、そのターンオフ時には内部トランジスタのベース
・エミッタ間を短絡または逆バイアスすることが可能と
なり、これによってターンオフタイムを短縮し得る利点
がもたらされる。
第1図はこの発明の実施例を示す構成図、第1A図はこ
の発明によるIGBTを示す等価回路図、第2図は従来
のI G B Tを示す断面構造図、第3図はその等価
回路図、第3A図は従来のIGBTを示す回路記号図、
第4図はI G B ’rのオン電圧とコレクタ電流と
の関係を示す特性図である。 符号説明 1・・・ソース雷If!(エミッタ)、2.9・・・絶
縁層、3・・・ゲート、4・・・N+層、5.7・・・
1層、6・・・N一層、8・・・ドレイン電極(コレク
タ)、10・・・ベース電極、11・・・PNPトラン
ジスタ、12・・・NPNトランジスタ、13・・・M
OSFET。 14・・・類18抵抗。 代理人 弁理士 並 木 昭 夫 代理人 弁理士 松 崎 清 第1図 第1A図 (−)−ス) 第2図 第3図 、 第3A図 エミッタ 第4図 von(オンノ窩瓜)
の発明によるIGBTを示す等価回路図、第2図は従来
のI G B Tを示す断面構造図、第3図はその等価
回路図、第3A図は従来のIGBTを示す回路記号図、
第4図はI G B ’rのオン電圧とコレクタ電流と
の関係を示す特性図である。 符号説明 1・・・ソース雷If!(エミッタ)、2.9・・・絶
縁層、3・・・ゲート、4・・・N+層、5.7・・・
1層、6・・・N一層、8・・・ドレイン電極(コレク
タ)、10・・・ベース電極、11・・・PNPトラン
ジスタ、12・・・NPNトランジスタ、13・・・M
OSFET。 14・・・類18抵抗。 代理人 弁理士 並 木 昭 夫 代理人 弁理士 松 崎 清 第1図 第1A図 (−)−ス) 第2図 第3図 、 第3A図 エミッタ 第4図 von(オンノ窩瓜)
Claims (1)
- 【特許請求の範囲】 絶縁ゲート形電界効果トランジスタ(IGBT)におい
て、 その内部トランジスタ〔N(P)チャンネルIGBTで
はPNP(NPN)トランジスタ〕のベース部を外部に
引き出してなることを特徴とする絶縁ゲート形電界効果
トランジスタ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61241404A JPS6395673A (ja) | 1986-10-13 | 1986-10-13 | 絶縁ゲ−ト形電界効果トランジスタ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61241404A JPS6395673A (ja) | 1986-10-13 | 1986-10-13 | 絶縁ゲ−ト形電界効果トランジスタ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6395673A true JPS6395673A (ja) | 1988-04-26 |
Family
ID=17073777
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61241404A Pending JPS6395673A (ja) | 1986-10-13 | 1986-10-13 | 絶縁ゲ−ト形電界効果トランジスタ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6395673A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0313756U (ja) * | 1989-06-23 | 1991-02-12 |
-
1986
- 1986-10-13 JP JP61241404A patent/JPS6395673A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0313756U (ja) * | 1989-06-23 | 1991-02-12 |
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