JPS6418329U - - Google Patents
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- Publication number
- JPS6418329U JPS6418329U JP11277487U JP11277487U JPS6418329U JP S6418329 U JPS6418329 U JP S6418329U JP 11277487 U JP11277487 U JP 11277487U JP 11277487 U JP11277487 U JP 11277487U JP S6418329 U JPS6418329 U JP S6418329U
- Authority
- JP
- Japan
- Prior art keywords
- timer
- built
- value
- commercial power
- microcomputer
- Prior art date
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- Pending
Links
- 230000010355 oscillation Effects 0.000 claims description 5
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Microcomputers (AREA)
Description
第１図は本考案で使用するマイクロコンピユー
タのブロツク図、第２図及び第３図は本考案の発
振回路を示す回路図、第４図は第１図のプログラ
ムのフローチヤート、第５図は従来のマイクロコ
ンピユータの発振回路を示す回路図である。 図中、１は発振入力端子、２はクロツク発振回
路、３および４は分周回路、５は内蔵タイマ１、
６は内蔵タイマ２、７はプログラム格納ＲＯＭ、
８はＲＡＭ、９は入出力バツフア、１０は論理演
算部、１１はアキユムレータ、１２は商用周波数
入力端子である。
タのブロツク図、第２図及び第３図は本考案の発
振回路を示す回路図、第４図は第１図のプログラ
ムのフローチヤート、第５図は従来のマイクロコ
ンピユータの発振回路を示す回路図である。 図中、１は発振入力端子、２はクロツク発振回
路、３および４は分周回路、５は内蔵タイマ１、
６は内蔵タイマ２、７はプログラム格納ＲＯＭ、
８はＲＡＭ、９は入出力バツフア、１０は論理演
算部、１１はアキユムレータ、１２は商用周波数
入力端子である。
Claims (1)
- 内蔵タイマを利用するマイクロコンピユータに
おいて、商用電源周波数を基準としてその１サイ
クルをマイクロコンピユータの発振パルスにより
カウントする手段と、このカウント値を分周した
ものを商用電源周波数２サイクル毎に記憶する内
蔵タイマと、この内蔵タイマの値を基準値として
プログラムを進行させる手段とを具備したマイク
ロコンピユータのタイマー装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11277487U JPS6418329U (ja) | 1987-07-22 | 1987-07-22 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11277487U JPS6418329U (ja) | 1987-07-22 | 1987-07-22 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6418329U true JPS6418329U (ja) | 1989-01-30 |
Family
ID=31352018
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11277487U Pending JPS6418329U (ja) | 1987-07-22 | 1987-07-22 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6418329U (ja) |
-
1987
- 1987-07-22 JP JP11277487U patent/JPS6418329U/ja active Pending