JPS6418466U - - Google Patents

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JPS6418466U
JPS6418466U JP6162088U JP6162088U JPS6418466U JP S6418466 U JPS6418466 U JP S6418466U JP 6162088 U JP6162088 U JP 6162088U JP 6162088 U JP6162088 U JP 6162088U JP S6418466 U JPS6418466 U JP S6418466U
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JP
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clock
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JP6162088U
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Landscapes

  • Signal Processing For Digital Recording And Reproducing (AREA)
  • Manipulation Of Pulses (AREA)
  • Synchronisation In Digital Transmission Systems (AREA)

Description

【図面の簡単な説明】
第１図は従来のクロツク切替制御回路のブロツ
ク回路図、第２図は本考案の一実施例としてのク
ロツク切替制御回路のブロツク回路図、第３図は
本考案の他の実施例としてのクロツク切替制御回
路のブロツク回路図、第４図ａ〜第４図ｈは第１
図、第２図および第３図の回路内に現われる信号
のタイミング波形図である。 １，３，８，９……ＪＫフリツプフロツプ、４
，５……ナンドゲート、６……反転入力オアゲー
ト。

Claims (1)

  1. 【実用新案登録請求の範囲】 サーボデータあるいはリードデータに同期した
    クロツクの２倍の周波数のクロツクが入力され、
    この２倍の周波数のクロツクを１／２分周して互
    いに逆位相の２つのタイミングクロツクを作成出
    力する分周回路１と、 デイスク上に予じめ書込まれた一定間隔のプリ
    アンブルデータ読出し時の読出し結果が、予じめ
    決められた結果となるように切替選択指令信号が
    入力され、当該指令信号をラツチするラツチ回路
    ３と、 前記ラツチ回路３の出力信号により前記分周回
    路１から出力されるクロツク信号のいずれか一方
    を選択出力するためのゲート回路４〜６と、 前記ゲート回路４〜６に入力される前記ラツチ
    回路３の出力または前記ゲート回路４〜６の出力
    を前記２倍の周波数のクロツクに同期して出力さ
    せるための同期回路８，９と、を設けたことを特
    徴とするクロツク切替制御回路。
JP6162088U 1988-05-12 1988-05-12 Expired JPH039180Y2 (ja)

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JP6162088U JPH039180Y2 (ja) 1988-05-12 1988-05-12

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JP6162088U JPH039180Y2 (ja) 1988-05-12 1988-05-12

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JPS6418466U true JPS6418466U (ja) 1989-01-30
JPH039180Y2 JPH039180Y2 (ja) 1991-03-07

Family

ID=31287278

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JP6162088U Expired JPH039180Y2 (ja) 1988-05-12 1988-05-12

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JPH039180Y2 (ja) 1991-03-07

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