JPS6438841U - - Google Patents

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JPS6438841U
JPS6438841U JP13379587U JP13379587U JPS6438841U JP S6438841 U JPS6438841 U JP S6438841U JP 13379587 U JP13379587 U JP 13379587U JP 13379587 U JP13379587 U JP 13379587U JP S6438841 U JPS6438841 U JP S6438841U
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JP
Japan
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counter
microprocessor
counter circuit
digits
logic
Prior art date
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Pending
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JP13379587U
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【図面の簡単な説明】
第１図はこの考案の実施例を示すブロツク図、
第２図はマイクロプロセツサの信号処理のフロー
チヤート、第３図は従来技術の実施例を示すブロ
ツク図である。 １……入力パルス信号、２……４ビツトハード
ウエアカウンタ、３……ハードウエアロジツクカ
ウンタ回路、３ａ〜３ｅ……４ビツトハードウエ
アカウンタ、３ｆ……１ビツト符号カウンタ、４
……マイクロプロセツサ、５……表示変換器、６
……数字表示器。

Claims (1)

    【実用新案登録請求の範囲】
  1. デイジタル信号を計数するカウンタ回路におい
    て、該カウンタ回路下位桁の数ビツトを演算する
    ハードウエアロジツクカウンタと、該ロジツクカ
    ウンタの桁上り信号と各桁出力信号とを入力とす
    るマイクロプロセツサとから成り、該マイクロプ
    ロセツサにおけるソフトウエア処理によりカウン
    タ桁数の増大を計つたことを特徴とするカウンタ
    回路。
JP13379587U 1987-09-01 1987-09-01 Pending JPS6438841U (ja)

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JP13379587U JPS6438841U (ja) 1987-09-01 1987-09-01

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Application Number Priority Date Filing Date Title
JP13379587U JPS6438841U (ja) 1987-09-01 1987-09-01

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Publication Number Publication Date
JPS6438841U true JPS6438841U (ja) 1989-03-08

Family

ID=31391988

Family Applications (1)

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JP13379587U Pending JPS6438841U (ja) 1987-09-01 1987-09-01

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JP (1) JPS6438841U (ja)

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