KR970077985A - 고역통과 iir 필터의 설계방법 및 이에 적합한 고역통과 iir 필터 - Google Patents

고역통과 iir 필터의 설계방법 및 이에 적합한 고역통과 iir 필터 Download PDF

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Abstract

본 발명은 고역통과 IIR 필터의 설계 방법 및 이에 적합한 고역통과 IIR 필터를 개시한다. 본 발명의 장치는 디지탈 신호 x(n)를 입력받아 소정시간 지연시키는 지연기(21)와, 지연기(21)의 출력을 MSB 측으로 1비트 시프트하는 시프터(22)와, 지연기(21)의 출력을 소정시간 지연시키는 지연기(23)와, 디지탈 신호 y(n)을 입력받아 소정시간 지연시키는 지연기(24)와, 지연기(24)의 출력을 MSB 측으로 2비트 시프트하는 시프터(25)와, 지연기(24)의 출력을 소정시간 지연시키는 지연기(26)와, 지연기(23)의 출력과 시프터(25)의 출력을 가산하는 가산기(100)와, 가산기(100)의 출력에서 시프터(22)의 출력을 감산하는 감산기(200)와, 디지탈 신호 x(n)와 감산기(200)의 출력을 가산하는 가산기(300)와, 가산기(300)의 출력과 계수 c를 승산하는 승산기(A)와, 지연기(24)의 출력과 지연기(26)의 출력을 가산하는 가산기(400)와, 가산기(400)의 출력과 계수 2t를 승산하는 승산기(B)와, 승산기(A)의 출력에서 승산기(B)의 출력을 감산하는 감산기(500)와, 감산기(500)의 출력과 지연기(26)의 출력을 가산하는 가산기(600)로 구성된다. 여기서,WD는 임계 주파수, T는 샘플링 시간이다. 따라서, 본 발명은 승산기의 갯수가 감소함으로 인하여 하드웨어의 크기가 작아지는 이점이 있다.

Description

고역통과 IIR 필터의 설계 방법 및 이에 적합한 고역통과 IIR 필터
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 2 도는 본 발명에 의한 고역통과 IIR 필터의 구성을 보인 도면.

Claims (2)

  1. 임계 주파수(WD)와 샘플링 주기(T)를 입력받아 아날로그 주파수(WA)를 계산하는 제 1 단계 ; 아날로그 영역에서의 시스템 전달 함수(H(S))를 바이리니어 변환법에 의하여 디지탈 영역에서의 시스템 전달 함수(H(Z))로 변환하는 제 2 단계 ; 상기 제 2 단계에서 구한 디지탈 영역에서의 시스템 전달 함부(H(Z))로부터 차분 방정식(y(n))을 구하는 제 3 단계 ; 및 상기 제 3 단계에서 구한 차분 방정식(y(n))의 계수(a, b, c)를 최적화하여 새로운 차분 방정식(y'(n))을 구하는 제 4 단계로 이루어지는 고역통과 IIR 필터의 설계 방법.
    여기서,
    이다.
  2. 디지탈 신호 x(n)를 입력받아 소정시간 지연시키는 지연기(21)와, 지연기(21)의 출력을 MSB 측으로 1비트 시프트하는 시프터(22)와, 지연기(21)의 출력을 소정시간 지연시키는 지연기(23)와, 디지탈 신호 y(n)을 입력받아 소정시간 지연시키는 지연기(24)와, 지연기(24)의 출력을 MSB 측으로 2비트 시프트하는 시프터(25)와, 지연기(24)의 출력을 소정시간 지연시키는 지연기(26)와, 지연기(23)의 출력과 시프터(25)의 출력을 가산하는 가산기(100)와, 가산기(100)의 출력에서 시프터(22)의 출력을 감산하는 감산기(200)와, 디지탈 신호 x(n)와 감산기(200)의 출력을 가산하는 가산기(300)와, 가산기(300)의 출력과 계수 c를 승산하는 승산기(A)와, 지연기(24)의 출력과 지연기(26)의 출력을 가산하는 가산기(400)와, 가산기(400)의 출력과 계수 2t를 승산하는 승산기(B)와, 승산기(A)의 출력에서 승산기(B)의 출력을 감산하는 감산기(500)와, 감산기(500)의 출력과 지연기(26)의 출력을 가산하는 가산기(600)로 구성되는 고역통과 IIR 필터.
    여기서,WD는 임계 주파수, T는 샘플링 시간이다.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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