HK69393A - Semiconductor integrated circuit device with built-in memories - Google Patents

Semiconductor integrated circuit device with built-in memories

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HK69393A
HK69393A HK693/93A HK69393A HK69393A HK 69393 A HK69393 A HK 69393A HK 693/93 A HK693/93 A HK 693/93A HK 69393 A HK69393 A HK 69393A HK 69393 A HK69393 A HK 69393A
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HK
Hong Kong
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circuit
memory
data
output
signal
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HK693/93A
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English (en)
French (fr)
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Fumio Tuchiya
Kiyoshi Matsubara
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Hitachi, Ltd.
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    • G—PHYSICS
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    • G11C16/102—External programming circuits, e.g. EPROM programmers; In-circuit programming or reprogramming; EPROM emulators
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    • G—PHYSICS
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  • Read Only Memory (AREA)
  • Microcomputers (AREA)

Claims (10)

  1. Integrierte Halbleiterschaltung mit:    einer von einem periodischen Zeitsignal gesteuerten Informationsverarbeitungs-Schaltung (1);    einem mit einer peripheren Schaltung (21...30h) und einem Speicherfeld (20a..h) versehenen elektrisch programmierbaren Nur-Lese-Speicher (2), der mit der InformationsverarbeitungsSchaltung (1) verbunden ist und auf den entweder von der Informationsverarbeitungs-Schaltung (1) zum Auslesen darin gespeicherter Daten oder von außerhalb der integrierten Halbleiterschaltung zum Einschreiben von Daten zugegriffen wird,    gekennzeichnet durch    eine Steuerschaltung (27), die bewirkt, daß die periphere Schaltung (21...30h) statisch arbeitet, wenn auf den elektrisch programmierbaren Nur-Lese-Speichern (2) von außerhalb der integrierten Halbleiterschaltung zugegriffen wird, und dynamisch in Antwort auf das periodische Zeitsignal, wenn auf den elektrisch programmierbaren Nur-Lese-Speicher (2) von der Informationsverarbeitungs-Schaltung (1) zugegriffen wird.
  2. Schaltung nach Anspruch 1,    wobei die periphere Schaltung (21...30h) eine Lese-Schaltung (25) umfaßt, mit: einem auf ein Datensignal des Speicherfelds (20a...h) ansprechenden Leseverstärker (SA); und einer auf das Ausgangssignal des Leseverstärkers (SA) ansprechenden Halteschaltung (34), und    wobei die Steuerschaltung (27) in der Lage ist, die Ausgabe eines Steuersignals zur Unterbrechung des Betriebsstroms der Leseverstärker (SA), nachdem die Lesedaten von der Halteschaltung (34) gehalten werden, zu bewirken.
  3. Schaltung nach Anspruch 2, weiterhin umfassend:    ein Hilfs-Speicherfeld (21) mit einer Hilfs-Datenleitung (DLd); und    einer Leseschaltung (26) für das Hilfs-Speicherfeld (21), die durch Feststellen eines vorbestimmten Pegels auf der Hilfs-Datenleitung (DLd) das Ende der Datenleseoperation feststellt,    wobei die Steuerschaltung in der Lage ist, in Antwort auf das Ausgangssignal der Leseschaltung (26) ein Steuersignal zum Unterbrechen des Betriebs des Leseverstärkers (SA) zu erzeugen.
  4. Integrierte Schaltung, die einen Einchip-Mikrocomputer bildet, umfassend:    einen Bus (7a, b);    eine zentrale Verarbeitungseinheit (CPU, 1), die von einem periodischen Zeitsignal gesteuert wird und an den Bus (7a, 7b) gekoppelt ist;    einen elektrisch programmierbaren Nur-Lese-Speicher (2), der mit an den Bus (7a, b) gekoppelten Adresseneingangs- und Dateneingangs/Ausgangs-Anschlüssen, mit einem Speicherfeld (20a...h) und einer peripheren Schaltung (21...30h) zum Zugriff auf das Speicherfeld (20a...h) versehen ist und auf den entweder von der CPU (1) oder von außerhalb des Einchip-Mikrocomputers zugegriffen wird;    einen an den Bus (7a, b) gekoppelten ersten Außenanschluss (T1...T8, T24...T29), an den ein Adressensignal für den elektrisch programmierbaren Nur-Lese-Speicher (2) angelegt wird, wenn auf den Speicher von außerhalb des Einchip-Mikrocomputers zugegriffen wird;    einen an den Bus (7a, b) gekoppelten zweiten Außenanschluss (T14...T21), an den Daten für den elektrisch programmierbaren Nur-Lese-Speicher (2) angelegt werden, wenn auf den Speicher von außerhalb des Einchip-Mikrocomputers zugegriffen wird;    einen dritten Außenanschluß (11), an den ein Signal angelegt wird, daß angibt, ob auf den elektrisch programmierbaren Nur-Lese-Speicher (2) von der CPU oder von außerhalb des Einchip-Mikrocomputers zugegriffen wird;    eine Unterscheidungseinrichtung (9) zur Unterscheidung auf der Grundlage des genannten angebenden Signals, ob auf den elektrisch programmierbaren Nur-Lese-Speicher (2) von außerhalb des Einchip-Mikrocomputers zugegriffen wird oder nicht;    gekennzeichnet durch    eine an die periphere Schaltung (21...30h) gekoppelte Steuereinrichtung (27), die auf ein Ausgangssignal (EPM) der Unterscheidungseinrichtung (9) anspricht, um zu bewirken, daß die periphere Schaltung statisch arbeitet, wenn auf den elektrisch programmierbaren Nur-Lese-Speicher (2) von außerhalb des Einchip-Mikrocomputers zugegriffen wird, und dynamisch, in Antwort auf das periodische Zeitsignal, wenn auf den elektrisch programmierbaren Nur-Lese-Speicher (2) von der CPU (1) zugegriffen wird.
  5. Schaltung nach Anspruch 4, wobei der Bus einen Datenbus (7b) zur Datenübertragung und einen Adressenbus (7a) zur Übertragung eines Adressensignals umfaßt.
  6. Schaltung nach Anspruch 4 oder 5, wobei die CPU (1) eine Taktgeneratoreinrichtung zur Versorgung des elektrisch programmierbaren Nur-Lese-Speichers (2) mit dem periodischen Zeitsignal umfaßt, so daß der genannte Speicher synchron mit der CPU (1) arbeitet, wenn die CPU (1) auf ihn zugreift, und wobei die Taktgeneratoreinrichtung den Speicher nicht mit dem periodischen Zeitsignal versorgt, wenn auf ihn von außerhalb des Einchip-Mikrocomputers zugegriffen wird.
  7. Schaltung nach einem der Ansprüche 1 bis 6, wobei das Speicherfeld (20a...h) eine Vielzahl von löschbar programmierbaren, nicht-flüchtigen Halbleiter-Speicherelementen (MC) umfaßt.
  8. Schaltung nach einem der Ansprüche 1 bis 7, wobei die periphere Schaltung (21...30h) einen Adressendekoder (22) aufweist, der umfaßt: einen ersten zwischen einem der Anschlüsse einer Energieversorgung (Vcc) und einem Ausgangsknoten (n1) eingeschalteten ersten MOSFET (Qp) zum speisen des Ausgangsknotens mit entweder einer Ladung für den dynamischen Betriebszustand oder einem Betriebsstrom für den statischen Betriebszustand; und einer Vielzahl von in Serie zwischen dem Ausgangsknoten (n1) und dem anderen Anschluß der Energieversorgung geschalteten zweiten MOSFETs (Qd1...Qd4), um von den entsprechenden Adressensignalen (A1...A7) geschaltet zu werden.
  9. Schaltung nach einem der Ansprüche 1 bis 8, wobei auf den elektrisch programmierbaren Nur-Lese-Speicher (2, 20a... 30h) von außerhalb der integrierten Halbleiterschaltung durch eine externe Schreibeinheit zugegriffen wird, die die in den Speicher zu schreibenden Daten liefert.
  10. Schaltung nach einem der Ansprüche 1 bis 9, wobei die Schreibeinheit Spannungen an den elektrisch programmierbaren Nur-Lese-Speicher (2) liefert.
HK693/93A 1984-11-26 1993-07-15 Semiconductor integrated circuit device with built-in memories HK69393A (en)

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JP24810684A JPH0736273B2 (ja) 1984-11-26 1984-11-26 半導体集積回路
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HK69393A true HK69393A (en) 1993-07-23

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HK693/93A HK69393A (en) 1984-11-26 1993-07-15 Semiconductor integrated circuit device with built-in memories

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US (2) US4783764A (de)
EP (1) EP0183232B1 (de)
KR (1) KR950000341B1 (de)
DE (1) DE3584142D1 (de)
HK (1) HK69393A (de)
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