JPH01124227A - 半導体装置 - Google Patents

半導体装置

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Publication number
JPH01124227A
JPH01124227A JP62282561A JP28256187A JPH01124227A JP H01124227 A JPH01124227 A JP H01124227A JP 62282561 A JP62282561 A JP 62282561A JP 28256187 A JP28256187 A JP 28256187A JP H01124227 A JPH01124227 A JP H01124227A
Authority
JP
Japan
Prior art keywords
die pad
semiconductor chip
inner leads
insulator
wire
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP62282561A
Other languages
English (en)
Inventor
Hideyoshi Yano
矢野 栄喜
Jun Otsuji
順 大辻
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP62282561A priority Critical patent/JPH01124227A/ja
Publication of JPH01124227A publication Critical patent/JPH01124227A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • H10W72/50Bond wires
    • H10W72/541Dispositions of bond wires
    • H10W72/5449Dispositions of bond wires not being orthogonal to a side surface of the chip, e.g. fan-out arrangements
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W90/00Package configurations
    • H10W90/701Package configurations characterised by the relative positions of pads or connectors relative to package parts
    • H10W90/751Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires
    • H10W90/756Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires between a chip and a stacked lead frame, conducting package substrate or heat sink

Landscapes

  • Wire Bonding (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〈産業上の利用分野〉 本発明は、半導体装置に係り、詳しくは、半導体装置の
パッケージ構造に関する。
〈従来の技術〉 従来の半導体装置を第3図、第4図に基づいて説明する
。第3図は平面図、第4図はそのIV−I+/線断面図
である。
これらの図において、符号30はダイスバット、31は
インナーリード、32は半導体チップ、33はワイヤで
ある。
ダイスパッド30上には、半導体チップ32が ゛ロウ
剤(図示せず)により固着されている。ダイスパッド3
0の周囲には、外部リード34と一体となったインナー
リード31・・・が配設されている。
半導体チップ32の表面電極32aとインナーリード3
1・・・とは、ワイヤ33によって接続されている。こ
れら半導体装置全体は、外部リード34を残して樹脂の
ような封止剤35によって封止されている。
〈発明が解決しようとする問題点〉 ところで、従来の半導体装置では、半導体チップ32と
インナーリード31・・・との接続用ワイヤ33に金や
アルミニウムなどの細線が用いられており、この細線は
、腰が弱いため、その中途部が垂れ下がって半導体チッ
プ32の端部やダイスパッド30等の不要部分に接触し
てしまい、電気的にショートしてしまうという問題があ
った。
また、製造工程中にダイスパッド30やインナーリード
31・・・が変形して位置ずれを起こし、インナーリー
ド31・・・と半導体チップ32の表面電極32aとの
接続が困難になるという問題らあった。
本発明は、上述の問題点に鑑みてなされたものであって
、ワイヤと不要部分との接触を防いで電気的にショート
するのを防止するとともに、確実に半導体チップとイン
ナーリードとを接続できる半導体装置を提供することを
目的とする。
く問題点を解決するための手段〉 本発明は、上記の目的を達成するために、ワイヤの下側
で、ダイスパッドの周縁上面とその周囲のインナーリー
ドの内端上面とにわたって絶縁体を設けて半導体装置を
構成し、好ましくは、前記絶縁体をダイスパッドとイン
ナーリードとにそれぞれ固着して半導体装置を構成した
〈作用〉 上記構成によれば、ワイヤが半導体チップの表面電極と
インナーリードとの間で垂れ下がっても、その垂れ下が
り部分は、絶縁体によって受は止められるので、半導体
チップの端部やダイスパッド等の不要部分に接触しない
。また、絶縁体をダイスパッドおよび各インナーリード
の内端側に固着すると、ダイスパッドと各インナーリー
ドとは、変形せず位置ずれが起こらない。
〈実施例〉 以下、本発明を図面に示す実施例に基づいて詳細に説明
する。第1図は本発明の一実施例を示す平面図、第2図
はその■−■線断面図である。
これらの図において、符号1はダイスバット、2はイン
ナーリード、3は半導体チップ、4はワイヤ、5は絶縁
体である。
ダイスパッドl上には、半導体チップ3がロウ剤(図示
せず)により固着されている。ダイスパッドlの周囲に
は、外部リード6と一体となったインナーリード2・・
・が配設されている。そして、ポリイミドなどからなり
枠形状をした絶線体5がその中央にある孔から半導体チ
ップ3を突出させた形でダイスパッドlとインナーリー
ド2・・・の内周端との上に載置され、エポキシ系接着
剤などの絶縁性接着剤(図示せず)によってインナーリ
ード2・・・とダイスパッド1とに固着されている。こ
のあと、半導体チップ3の表面電極3aとインナーリー
ド2・・・とは、ワイヤ4によって接続される。そして
、これら半導体装置全体は、外部リード6を残して樹脂
7によって封止される。
この半導体装置は、従来例と同様に、ワイヤ4の垂れ下
がりを起こすことがあるが、絶縁体製の絶縁体5がダイ
スパッドlとインナーリード2・・・の内周端との上面
に載置されているので、その上をまたぐ形で位置するワ
イヤ4は、垂れ下がっても下方に設けられた絶縁体5に
よって受は止められ半導体チップ3の端部やダイスパッ
ドlに接触することはない。
また、インナーリード2・・・とダイスパッドlとは、
絶縁体5によって相互に固定されているので、多少の外
力では変形しない。したがって、インナーリード2・・
・とダイスパッド1とは、製造途中に位置ずれを起こさ
ず、ワイヤ4による接続が困難になることはない。
なお、上記実施例においては、絶縁体5を枠形状をした
一体物としたが、これに限るわけではなく、ダイスパッ
ドlとインナーリード2・・・との上面に載置されて絶
縁体を形成する一つ以上の絶縁体であればよい。また、
上記実施例においては、絶縁体5は、ダイスパッドlと
インナーリード2・・・との双方に固着されていたが、
単にダイスパッド1の周縁上面とインナーリード2の内
端上面とにわたって載置しただけのものであってもよい
〈発明の効果〉 以゛上のように、本発明によれば、ワイヤがダイスパッ
ド等の不要部分に接触するのを未然に防止して電気的に
ショートするのを防げる また、絶縁体をインナーリードに固着すれば、インナー
リードの変形が防げワイヤ接続が確実になる。したがっ
て、高品質な半導体装置が簡単にしかも安価に得られる
【図面の簡単な説明】
第1図と第2図とは本発明の一実施例に係り、第1図は
平面図、第2図はその■−■線断面図である。第3図と
第4図とは従来例に係り、第3図は平面図、第4図はそ
の■−IV線断面図である。 l・・・ダイスパッド 2・・・インナーリード 4・・・ワイヤ 5・・・絶縁体

Claims (2)

    【特許請求の範囲】
  1. (1)ワイヤの下側で、ダイスパッドの周縁上面とその
    周囲のインナーリードの内端上面とにわたって絶縁体を
    設けたことを特徴とする半導体装置。
  2. (2)前記絶縁体は、ダイスパッドとインナーリードと
    にそれぞれ固着されている特許請求の範囲第1項記載の
    半導体装置
JP62282561A 1987-11-09 1987-11-09 半導体装置 Pending JPH01124227A (ja)

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JP62282561A JPH01124227A (ja) 1987-11-09 1987-11-09 半導体装置

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JPH01124227A true JPH01124227A (ja) 1989-05-17

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ID=17654079

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JP62282561A Pending JPH01124227A (ja) 1987-11-09 1987-11-09 半導体装置

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JP (1) JPH01124227A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0287636A (ja) * 1988-09-26 1990-03-28 Nec Corp 半導体装置
JPH0342847A (ja) * 1989-07-11 1991-02-25 Sony Corp 半導体装置

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0287636A (ja) * 1988-09-26 1990-03-28 Nec Corp 半導体装置
JPH0342847A (ja) * 1989-07-11 1991-02-25 Sony Corp 半導体装置

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