JPH01177660A - 情報処理装置 - Google Patents
情報処理装置Info
- Publication number
- JPH01177660A JPH01177660A JP231888A JP231888A JPH01177660A JP H01177660 A JPH01177660 A JP H01177660A JP 231888 A JP231888 A JP 231888A JP 231888 A JP231888 A JP 231888A JP H01177660 A JPH01177660 A JP H01177660A
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- Japan
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- processor
- processing
- cpu
- control information
- control
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- Granted
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- 230000010365 information processing Effects 0.000 title claims abstract description 13
- 238000000034 method Methods 0.000 claims description 5
- 238000010586 diagram Methods 0.000 description 5
- 239000013256 coordination polymer Substances 0.000 description 1
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、I/O処理を実行するI/Oプロセッザを有
する情報処理装置のI/O制御方式に関する。
する情報処理装置のI/O制御方式に関する。
従来、この種の情報処理装置においては、すべてのI/
Oデバイスの制御をI/Oプロセッサを用いて行う方式
となっていた。
Oデバイスの制御をI/Oプロセッサを用いて行う方式
となっていた。
上述した従来の情報処理装置は、全1/Oデバイスの制
御をI/Oプロセッザを用いて制御するため、I/Oプ
ロセッサなしの情報処理装置にI/Oプロセッサを付加
する場合に、最初からすべてのI/Oデバイスの制御用
ファームウェア、ソフトウェアをI/Oプロセッサに用
意しないと、システムが動作しないという欠点がある。
御をI/Oプロセッザを用いて制御するため、I/Oプ
ロセッサなしの情報処理装置にI/Oプロセッサを付加
する場合に、最初からすべてのI/Oデバイスの制御用
ファームウェア、ソフトウェアをI/Oプロセッサに用
意しないと、システムが動作しないという欠点がある。
本発明の情報処理装置は、各1/Oデバイスを制御する
ために、各I/Oデバイスごとにメモリ上に、当該I/
OデバイスのI/O処理をI/Oプロセッサを用いて実
行するか、あるいは、I/Oプロセッサを用いずCPU
で実行するかを示す制御情報を含むI/Oデバイス制御
情報領域が設けられ、CPUは、I/O命令の実行開始
時、I/O命令によって指定されたI/Oデバイスに対
応するI/Oデバイス制御情報領域を参照し、制御情報
にしたがってI/O処理を自身で実行するか、あるいは
I/O処理をT/Oプロセツサに引継ぐかを決定するこ
とを特徴とする。
ために、各I/Oデバイスごとにメモリ上に、当該I/
OデバイスのI/O処理をI/Oプロセッサを用いて実
行するか、あるいは、I/Oプロセッサを用いずCPU
で実行するかを示す制御情報を含むI/Oデバイス制御
情報領域が設けられ、CPUは、I/O命令の実行開始
時、I/O命令によって指定されたI/Oデバイスに対
応するI/Oデバイス制御情報領域を参照し、制御情報
にしたがってI/O処理を自身で実行するか、あるいは
I/O処理をT/Oプロセツサに引継ぐかを決定するこ
とを特徴とする。
したがって、T/Oプロセツサなしの情報処理装置にT
/Oプロセツサを付加する場合に、すべてのI/Oデバ
イスをT/Oプロセツサで制御することなしに、デバイ
スごとにT/Oプロセツサで制御するか、従来のままC
PLJで制御するかを選択し、順次I/Oプロセツ勺制
御に移行できる〔実施例〕 次に、本発明の実施例について図面を参照して説明する
。
/Oプロセツサを付加する場合に、すべてのI/Oデバ
イスをT/Oプロセツサで制御することなしに、デバイ
スごとにT/Oプロセツサで制御するか、従来のままC
PLJで制御するかを選択し、順次I/Oプロセツ勺制
御に移行できる〔実施例〕 次に、本発明の実施例について図面を参照して説明する
。
第1図は本発明の情報処理装置の一実施例のブロック図
である。
である。
本実施例は、CPU1、T/Oプロセツサ2、主記憶3
、I/Oデバイス4,5,6、CPU1とT/Oプロセ
ツサ2との情報転送ライン7で構成されている。
、I/Oデバイス4,5,6、CPU1とT/Oプロセ
ツサ2との情報転送ライン7で構成されている。
第2図は第1図に示す実施例で使用される主記憶3上の
I/Oデバイス制御情報領域の概略図である。主記憶3
には、それぞれI/Oデバイス4、I/Oデバイス5、
I/Oデバイス6に対する制御情報領域8,9./Oが
設けられ、さらに制御情報領域8.9./O内には“0
″であれば、対応するI/Oデバイスに対する処理をC
PU1が実行し、111 I+であれば対応するI/O
デバイスに対する処理をI/Oプロセッv2が実行する
ことを示すフラグ11.12.13が設けられている。
I/Oデバイス制御情報領域の概略図である。主記憶3
には、それぞれI/Oデバイス4、I/Oデバイス5、
I/Oデバイス6に対する制御情報領域8,9./Oが
設けられ、さらに制御情報領域8.9./O内には“0
″であれば、対応するI/Oデバイスに対する処理をC
PU1が実行し、111 I+であれば対応するI/O
デバイスに対する処理をI/Oプロセッv2が実行する
ことを示すフラグ11.12.13が設けられている。
第3図は、CPU1において、実行が開始されるI/O
処理、およびI/Oデバイスを指定するI/O命令のフ
ォーマットである。ビット8〜15で、どのI/Oデバ
イスの処理であるが、すなわちI/OデバイスN0を指
定する。
処理、およびI/Oデバイスを指定するI/O命令のフ
ォーマットである。ビット8〜15で、どのI/Oデバ
イスの処理であるが、すなわちI/OデバイスN0を指
定する。
次に、本実施例の動作を説明する。
CPU1が第3図のフォーマットに示されるI/O命令
の実行を開始すると、CPU1は、I/O命令のビット
8〜15によって指定されたI/Oデバイス船に対応す
るI/Oデバイス制御情報領域を参照する。たとえば、
I/O命令のビット8〜15が111 I+であれば、
I/Oデバイス制御情報領域8を参照する。次に、CP
U1は、I/Oデバイス制御情報領域8内のフラグ11
を調べる。もし、フラグ11がO″であれば、CPLl
lは、自身でI/Oデバイス4の制御を行い、I/O処
理を実行する。もしフラグ11が“1″であれば、CP
U1は、情報転送ライン7により、T/Oプロセツサ2
にI/O処理を引継ぐ。T/Oプロセツサ2は、r/O
デバイス4の制御を行ない、I/O処理を実行する。
の実行を開始すると、CPU1は、I/O命令のビット
8〜15によって指定されたI/Oデバイス船に対応す
るI/Oデバイス制御情報領域を参照する。たとえば、
I/O命令のビット8〜15が111 I+であれば、
I/Oデバイス制御情報領域8を参照する。次に、CP
U1は、I/Oデバイス制御情報領域8内のフラグ11
を調べる。もし、フラグ11がO″であれば、CPLl
lは、自身でI/Oデバイス4の制御を行い、I/O処
理を実行する。もしフラグ11が“1″であれば、CP
U1は、情報転送ライン7により、T/Oプロセツサ2
にI/O処理を引継ぐ。T/Oプロセツサ2は、r/O
デバイス4の制御を行ない、I/O処理を実行する。
以上説明したように本発明は、各1/Oデバイスごとに
、CPUが制御を行うか、あるいは、T/Oプロセツサ
により制御を行うかを決定する方”’? 5 − 式をとることにより、T/Oプロセツサなしの情報処理
装置にT/Oプロセツサを付加する場合に、すべての1
/OデバイスをT/Oプロセツサで制御することなしに
、デバイスごとにT/Oプロセツサで制御するか、従来
のままCPLJで制御するかを選択し、順次I/Oブロ
セッザ制御に移行できるという効果がある。
、CPUが制御を行うか、あるいは、T/Oプロセツサ
により制御を行うかを決定する方”’? 5 − 式をとることにより、T/Oプロセツサなしの情報処理
装置にT/Oプロセツサを付加する場合に、すべての1
/OデバイスをT/Oプロセツサで制御することなしに
、デバイスごとにT/Oプロセツサで制御するか、従来
のままCPLJで制御するかを選択し、順次I/Oブロ
セッザ制御に移行できるという効果がある。
第1図は本発明の情報処理装置の一実施例のブロック図
、第2図は第1図に示される実施例で使用するI/Oデ
バイス制御情報領域の概略図、第3図はI/O命令の命
令フォーマットを示づ図である。 1・・・cpu。 2・・・T/Oプロセツサ、 3・・・主記憶、 4.5.6・・・I/Oデバイス、 7・・・情報転送ライン、 8.9./O・・・I/Oデバイス制御情報領域、11
.12.13・・・フラグ。 −〇 − 第1図 第3図
、第2図は第1図に示される実施例で使用するI/Oデ
バイス制御情報領域の概略図、第3図はI/O命令の命
令フォーマットを示づ図である。 1・・・cpu。 2・・・T/Oプロセツサ、 3・・・主記憶、 4.5.6・・・I/Oデバイス、 7・・・情報転送ライン、 8.9./O・・・I/Oデバイス制御情報領域、11
.12.13・・・フラグ。 −〇 − 第1図 第3図
Claims (1)
- 【特許請求の範囲】 1、I/O処理を実行するI/Oプロセッサを有する情
報処理装置において、 各I/Oデバイスを制御するために、各I/Oデバイス
ごとにメモリ上に、当該I/OデバイスのI/O処理を
、I/Oプロセッサを用いて実行するか、あるいは、I
/Oプロセッサを用いずCPUで実行するかを示す制御
情報を含むI/Oデバイス制御情報領域が設けられ、C
PUは、I/O命令の実行開始時、I/O命令によって
指定されたI/Oデバイスに対応するI/Oデバイス制
御情報領域を参照し、制御情報にしたがってI/O処理
を自身で実行するか、あるいはI/O処理をI/Oプロ
セッサに引継ぐかを決定することを特徴とする情報処理
装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63002318A JP2504796B2 (ja) | 1988-01-07 | 1988-01-07 | 情報処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63002318A JP2504796B2 (ja) | 1988-01-07 | 1988-01-07 | 情報処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01177660A true JPH01177660A (ja) | 1989-07-13 |
| JP2504796B2 JP2504796B2 (ja) | 1996-06-05 |
Family
ID=11525979
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63002318A Expired - Fee Related JP2504796B2 (ja) | 1988-01-07 | 1988-01-07 | 情報処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2504796B2 (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60117359A (ja) * | 1983-11-30 | 1985-06-24 | Toshiba Corp | 情報処理システム |
-
1988
- 1988-01-07 JP JP63002318A patent/JP2504796B2/ja not_active Expired - Fee Related
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60117359A (ja) * | 1983-11-30 | 1985-06-24 | Toshiba Corp | 情報処理システム |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2504796B2 (ja) | 1996-06-05 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |