JPH01190051A - アラーム転送方式 - Google Patents

アラーム転送方式

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Publication number
JPH01190051A
JPH01190051A JP63014305A JP1430588A JPH01190051A JP H01190051 A JPH01190051 A JP H01190051A JP 63014305 A JP63014305 A JP 63014305A JP 1430588 A JP1430588 A JP 1430588A JP H01190051 A JPH01190051 A JP H01190051A
Authority
JP
Japan
Prior art keywords
cpu
pulse pattern
fault
circuit
outputs
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP63014305A
Other languages
English (en)
Inventor
Hitoshi Yokota
横田 仁
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
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Publication of JPH01190051A publication Critical patent/JPH01190051A/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、アラーム転送方式に関し、特にCPUを用い
たシリアルデータ通信に於けるCPU障害のアラーム転
送に関する。
従来の技術 従来の技術としては、CPu障害検出回路の出力を別出
力端子として用意し、受信側のCPuにて送信側のCP
U障害を個別なアラーム情報としてとりこむ方式が提案
されている。
第2図は従来技術によるアラーム転送方式のブロック図
である0図において、1はCPU 、2はシリアルイン
タフェース回路、3は障害検出回路をそれぞれ示す。
発明が解決しようとする課題 上述した従来のアラーム転送方式では、CPU Fl[
害を転送するために1本則の信号線を用意する必要があ
るという欠点があった。
本発明は従来の上記実情に鑑みてなされたものであり、
従って本発明の目的は、従来の技術に内在する上記欠点
゛を解消し、別線にてCPUの障害アラームを転送する
ことなく受信側にて送信側のCPU障害を容易に検出す
ることを可能とした新規なアラーム転送方式を提供する
ことにある。
課題を解決するための手段 上記目的を達成する為に、本発明に係るアラーム転送方
式は、情報転送用のシリアルデータ出力上で固定パルス
パターンによりCPU障害を転送するためにCPUの障
害検出により起動されるパルスパターン発生回路と、C
PU障害時にはシリアル出力としてCPUからのデータ
ではなく固定パルスパターン(CPU障害を示すパター
ン)を出力するための選択回路とを有している。
実施例 次に本発明をその好ましい一実施例について図面を参照
して具体的に説明する。
第1図は本発明の一実施例を示すブロック構成図である
。
第1図を参照するに、CPU1はシリアルイ〉゛タフエ
ース回路2にデータを転送し、シリアルインタフェース
回路2の出力は、選択回路5の一方の入力となっており
通常選択回路はこの信号を選択して出力している。
又、CPU1の状態を監視している障害検出回路3はC
PU障害時にはCPU障害アラーム信号をパルスパター
ン発生回路4と選択回路5に対して出力する。CPU障
害アラーム信号によりパルスパターン発生回路4は起動
をかけられ、CPU障害アラームを示すパルスパターン
を出力し、この出力は選択回路5の他方の入力となる。
CPU III害アラーム信号を受けた選択回路5はパ
ルスパターン発生回路4からのパルスパターンを出力と
して選択し、受信側l\比出力る。
発明の詳細 な説明したように、本発明によれば、CPU Fll待
時は、固定パルスパターンをシリアルデータ出力として
転送することにより、別線にてCPU障害アラームを転
送することなく受信側にて送信側のCPU障害を検出で
きる効果が得られる。
【図面の簡単な説明】
第1図は本発明の一実施例を示すブロック構成図、第2
図は従来方式のブロック図である。 1・・・CPll 、2・・・シリアルインタフェース
回路、3・・・障害検出回路、4・・・パルスパターン
発生回路、5・・・選択回路

Claims (1)

    【特許請求の範囲】
  1. CPUを用いたデータ転送に於けるCPU障害アラーム
    転送方式に於いて、CPUと、該CPUのデータをシリ
    アルデータに変換して出力するシリアルインタフェース
    回路と、前記CPUの障害を検出し障害アラーム信号を
    出力する障害検出回路と、該障害アラーム信号をトリガ
    として障害パターン信号を出力するパルスパターン発生
    回路と、前記障害アラーム信号の論理により前記シリア
    ルインタフェース回路の出力と前記パルスパターン発生
    回路の出力の一方を選択して出力する選択回路とを有す
    ることを特徴とするアラーム転送方式。
JP63014305A 1988-01-25 1988-01-25 アラーム転送方式 Pending JPH01190051A (ja)

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JPH01190051A true JPH01190051A (ja) 1989-07-31

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JP (1) JPH01190051A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0368240A (ja) * 1989-08-07 1991-03-25 Fujitsu Ltd 集中監視システムにおける障害検出方法

Cited By (1)

* Cited by examiner, † Cited by third party
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