JPH01297764A - プロセッサ - Google Patents

プロセッサ

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JPH01297764A
JPH01297764A JP63129260A JP12926088A JPH01297764A JP H01297764 A JPH01297764 A JP H01297764A JP 63129260 A JP63129260 A JP 63129260A JP 12926088 A JP12926088 A JP 12926088A JP H01297764 A JPH01297764 A JP H01297764A
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JP
Japan
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processor
request
coprocessor
register
internal register
Prior art date
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Pending
Application number
JP63129260A
Other languages
English (en)
Inventor
Satoshi Ishii
智 石井
Ikufumi Yamada
山田　郁文
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NEC Corp
NEC Engineering Ltd
Original Assignee
NEC Corp
NEC Engineering Ltd
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Publication date
Application filed by NEC Corp, NEC Engineering Ltd filed Critical NEC Corp
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Priority to US07/356,243 priority patent/US5133057A/en
Priority to CA000600690A priority patent/CA1320279C/en
Priority to EP19890305317 priority patent/EP0343992A3/en
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Pending legal-status Critical Current

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    • G—PHYSICS
    • G06—COMPUTING OR CALCULATING; COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00—Arrangements for program control, e.g. control units
    • G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
    • G06F9/30181—Instruction operation extension or modification
    • G06F9/30189—Instruction operation extension or modification according to execution mode, e.g. mode flag
    • G—PHYSICS
    • G06—COMPUTING OR CALCULATING; COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00—Arrangements for program control, e.g. control units
    • G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
    • G06F9/38—Concurrent instruction execution, e.g. pipeline or look ahead
    • G06F9/3877—Concurrent instruction execution, e.g. pipeline or look ahead using a secondary processor, e.g. coprocessor

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  • Software Systems (AREA)
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  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は汎用プロセッサからの要求に応じて特定の演算
を実行する専用プロセッサ（以下コプロセッサと称す）
に関する。
〔従来の技術〕
従来の数値計算用プロセッサ等のコプロセッサを用いた
システムは、例えば第３図に示すように、マイク四プロ
セッサ等の汎用プロセッサ１と、マイクロプログラム３
により動作が制御されるコプロセッサ２と、データを格
納するメインメモリ５と、プロセッサ１および２ならび
にメモリ相互を接続する外部バス１０と、汎用プロセッ
サ１がコプロセッサ２に特定の演算の実行を要求するた
めのコプロセッサ実行要求線１１とから構成される。
コプロセッサ２はマイクロプログラム制御により、第４
図の概略流れ図に示すように動作する。
ます、マイク四プロセッサ１から演算処理実行要求がコ
プロセッサ実行要求線を介してコプロセッサ２に通知さ
れると、コプロセッサ２は通知された実行要求の内容を
解析し、要求された演算を実行する。演算を終了すると
、プロセッサ２は、内蔵した内部レジスタの内容を初期
化してマイクロプロセッサ１からの次の実行要求を持つ
。
〔発明が解決しようとする課題〕
」二連した従来のコプロセッサでは、演算実行終了時に
内部レジスタを初期化してしまうため、コプロセッサ２
のマイクロプログラム３のデパック時に内部レジスタの
内容変化の履歴を見ることができず、デパックの効率が
悪いという欠点がある。
〔課題を解決するための手段〕
本発明のプロセッサは、外部からの演算実行要求に応答
して要求された演算を内蔵の少なくとも１つの内部レジ
スタを使用して実行したあと該内部レジスタの内容を初
期化するプロセッサにおいて、外部からの要求に従って
表示内容が変化するモード表示手段を有し、前記モード
表示手段が第１のモードを表示しているときには前記内
部レジスタの内容の前記初期化を抑止し、前記モード表
示手段が第２のモードを表示しているときには前記内部
レジスタの内容の前記初期化を抑止しない。
〔実施例〕
次に、本発明について図面を参照して詳細に説明する。
第１図を参照すると、本発明の一実施例は、汎用プ四セ
ッ→ノー１と、マイクロプログラム７により動作が制御
されるとともにデパックモードフラグ４を内部に持つコ
プロセッサ２と、コプロセッサ２の内部レジスタの内容
を退避するためのセーブ領域６を持つメインメモリ５と
、プロセッサ１および２ならびにメインメモリ５相互を
接続する外部ハス１０と、汎用プロセッサ１からコプロ
セッサ２への要求を伝えるコプロセッサ実行要求線１１
とから構成される。
う。次にこの動作を詳細に説明する。
今、デパックモード設定要求がコプロセッサ実行要求線
１１を介してプロセッサ１からコプロセッサ２に発行さ
れたとする。
まず、コプロセッサ２は、要求線１１から受は取った要
求を解析する。この場合、この要求はｆデパックモード
設定要求であるため、通常はＯＦＦ状態であるデパック
モードフラグ４がＯＮ状態にされる。デバッグモードフ
ラグ４をＯＮ状態にしたあと、プロセッサ２は次の要求
を持つ。このあと、演算実行要求をプロセッサ１から受
は取ると、プロセッサ２は要求された演算処理を実行し
たあと次の要求を待つが、デバッグモードフラグ４がＯ
Ｎ状態であるためコプロセッサ２の内部レジスタは初期
化されない。次の要求がレジスタダンプ要求であると、
コプロセッサ２はその内部レジスタの内容をメインメモ
リ５内のコプロセッサレジスタセーブ領域６に退Ｍ’す
る。
フラグ４をＯＦＦ状態にしたい場合には、プロセッサ１
はデパックモード解除要求を発行すればよい。
なお、通常動作中すなわちデバッグモードフラグ４がＯ
ＦＦ状態の場合には、従来と同様に演算終了時に内部レ
ジスタは初期化される。
〔発明の効果〕
以上説明したように本発明には、コプロセ、ソサ内の内
部レジスタの内容変化の履歴をメインメモリに残すこと
ができるためデパック効率の向上を達成できるという効
果がある。
【図面の簡単な説明】
第１図は本発明の一実施例のプロ、ツク図、第２は従来
例に用いたコプロセ、ソサの動作を示す流れ図で゛ある
。 １・・・・・汎用フロセッサ、２・・・・・・コプロセ
ッサ、３．７・・・・・マイクロプログラム、４・・・
・・・デノくツクモードフラグ、５・・・・・メインメ
モリ、６・・・・・コプロセッサレジスタセーブ領域、
１０・・・・・外部ノくス、１１・・・・・・コプロセ
ッサ実行要求線。 代理人　弁理士　　内　原　　　晋 −６＝

Claims (1)

  1. 【特許請求の範囲】 外部からの演算実行要求に応答して要求された演算を内
    蔵の少なくとも１つの内部レジスタを使用して実行した
    あと該内部レジスタの内容を初期化するプロセッサにお
    いて、 外部からの要求に従って表示内容が変化するモード表示
    手段を有し、 前記モード表示手段が第１のモードを表示しているとき
    には前記内部レジスタの内容の前記初期化を抑止し、 前記モード表示手段が第２のモードを表示しているとき
    には前記内部レジスタの内容の前記初期化を抑止しない
    ことを特徴とするプロセッサ。
JP63129260A 1988-05-25 1988-05-25 プロセッサ Pending JPH01297764A (ja)

Priority Applications (4)

Application Number Priority Date Filing Date Title
JP63129260A JPH01297764A (ja) 1988-05-25 1988-05-25 プロセッサ
US07/356,243 US5133057A (en) 1988-05-25 1989-05-24 Co-processor for control setting an internal flag register operation mode which controlled a main processor execution mode in a multi-processor system
CA000600690A CA1320279C (en) 1988-05-25 1989-05-25 Multiprocessor system
EP19890305317 EP0343992A3 (en) 1988-05-25 1989-05-25 Multiprocessor system

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JP63129260A JPH01297764A (ja) 1988-05-25 1988-05-25 プロセッサ

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JPH01297764A true JPH01297764A (ja) 1989-11-30

Family

ID=15005170

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US (1) US5133057A (ja)
EP (1) EP0343992A3 (ja)
JP (1) JPH01297764A (ja)
CA (1) CA1320279C (ja)

Families Citing this family (23)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6336180B1 (en) 1997-04-30 2002-01-01 Canon Kabushiki Kaisha Method, apparatus and system for managing virtual memory with virtual-physical mapping
US5394544A (en) * 1989-08-07 1995-02-28 Ricoh Co., Ltd. Software system debugger with distinct interrupt vector maps for debugging and application programs
JPH07219774A (ja) * 1994-02-07 1995-08-18 Fujitsu Ltd データ処理装置および例外処理方法
AUPO648397A0 (en) 1997-04-30 1997-05-22 Canon Information Systems Research Australia Pty Ltd Improvements in multiprocessor architecture operation
US6414687B1 (en) 1997-04-30 2002-07-02 Canon Kabushiki Kaisha Register setting-micro programming system
US6707463B1 (en) 1997-04-30 2004-03-16 Canon Kabushiki Kaisha Data normalization technique
US6246396B1 (en) 1997-04-30 2001-06-12 Canon Kabushiki Kaisha Cached color conversion method and apparatus
US6061749A (en) 1997-04-30 2000-05-09 Canon Kabushiki Kaisha Transformation of a first dataword received from a FIFO into an input register and subsequent dataword from the FIFO into a normalized output dataword
AUPO647997A0 (en) 1997-04-30 1997-05-22 Canon Information Systems Research Australia Pty Ltd Memory controller architecture
US6112316A (en) * 1997-12-03 2000-08-29 Micron Electronics, Inc. System for use of bus parking states to communicate diagnostic information
US6092219A (en) * 1997-12-03 2000-07-18 Micron Technology, Inc. Method for use of bus parking states to communicate diagnostic information
US6532553B1 (en) 1998-12-08 2003-03-11 Arm Limited Debugging data processing systems
GB9826972D0 (en) * 1998-12-08 1999-02-03 Advanced Risc Mach Ltd Debugging data processing systems
JP2000181890A (ja) * 1998-12-15 2000-06-30 Fujitsu Ltd マルチプロセッサ交換機及びその主プロセッサ切替方法
US6446221B1 (en) * 1999-05-19 2002-09-03 Arm Limited Debug mechanism for data processing systems
JP4277396B2 (ja) * 1999-11-30 2009-06-10 株式会社デンソー 電子制御装置
AU2001255808A1 (en) * 2000-03-15 2001-09-24 Arc Cores, Inc. Method and apparatus for debugging programs in a distributed environment
US7865703B2 (en) 2006-05-05 2011-01-04 International Business Machines Corporation Method and apparatus for executing instrumentation code within alternative processor resources
US20070260849A1 (en) * 2006-05-05 2007-11-08 Chen Wen-Tzer T Method and apparatus for executing instrumentation code using a target processor
US7814466B2 (en) * 2006-05-05 2010-10-12 International Business Machines Corporation Method and apparatus for graphically marking instructions for instrumentation with hardware assistance
US7783866B2 (en) * 2006-05-05 2010-08-24 International Business Machines Corporation Method and apparatus for executing instrumentation code using processor instructions
US8245199B2 (en) * 2006-05-05 2012-08-14 International Business Machines Corporation Selectively marking and executing instrumentation code
GB2504772A (en) 2012-08-10 2014-02-12 Ibm Coprocessor providing service address space for diagnostics collection

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS56110165A (en) * 1980-02-06 1981-09-01 Nec Corp Information processing equipment
JPS5972555A (ja) * 1982-09-21 1984-04-24 ゼロツクス・コ−ポレ−シヨン 多重プロセツサ型電子式制御装置これを用いた機械、並びにそのモニタ及び診断方法

Family Cites Families (13)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4293907A (en) * 1978-12-29 1981-10-06 Bell Telephone Laboratories, Incorporated Data processing apparatus having op-code extension register
US4486827A (en) * 1979-11-09 1984-12-04 Zilog, Inc. Microprocessor apparatus
US4312066A (en) * 1979-12-28 1982-01-19 International Business Machines Corporation Diagnostic/debug machine architecture
JPS5914062A (ja) * 1982-07-15 1984-01-24 Hitachi Ltd 二重化共有メモリ制御方法
US4679166A (en) * 1983-01-17 1987-07-07 Tandy Corporation Co-processor combination
JPS59146352A (ja) * 1983-02-09 1984-08-22 Nec Corp シングル・チップ・マイクロコンピュータ
EP0123337A3 (en) * 1983-04-18 1988-05-18 Motorola, Inc. A method and apparatus for coordinating execution of an instruction by a coprocessor
US4598364A (en) * 1983-06-29 1986-07-01 International Business Machines Corporation Efficient trace method adaptable to multiprocessors
US4591982A (en) * 1983-08-29 1986-05-27 International Business Machines Corporation Storage selection override apparatus for a multimicroprocessor implemented data processing system
US4695945A (en) * 1985-02-28 1987-09-22 International Business Machines Corporation Processor I/O and interrupt filters allowing a co-processor to run software unknown to the main processor
US4703420A (en) * 1985-02-28 1987-10-27 International Business Machines Corporation System for arbitrating use of I/O bus by co-processor and higher priority I/O units in which co-processor automatically request bus access in anticipation of need
US4833596A (en) * 1985-02-28 1989-05-23 International Business Machines Corporation Logical arrangement for controlling use of different system displays by main processor and co-processor
JP2564805B2 (ja) * 1985-08-08 1996-12-18 日本電気株式会社 情報処理装置

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS56110165A (en) * 1980-02-06 1981-09-01 Nec Corp Information processing equipment
JPS5972555A (ja) * 1982-09-21 1984-04-24 ゼロツクス・コ−ポレ−シヨン 多重プロセツサ型電子式制御装置これを用いた機械、並びにそのモニタ及び診断方法

Also Published As

Publication number Publication date
CA1320279C (en) 1993-07-13
EP0343992A3 (en) 1991-10-02
US5133057A (en) 1992-07-21
EP0343992A2 (en) 1989-11-29

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