JPH01319957A - 集積回路 - Google Patents
集積回路Info
- Publication number
- JPH01319957A JPH01319957A JP63154409A JP15440988A JPH01319957A JP H01319957 A JPH01319957 A JP H01319957A JP 63154409 A JP63154409 A JP 63154409A JP 15440988 A JP15440988 A JP 15440988A JP H01319957 A JPH01319957 A JP H01319957A
- Authority
- JP
- Japan
- Prior art keywords
- lead
- leads
- bumps
- fixing frame
- integrated circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/701—Tape-automated bond [TAB] connectors
Landscapes
- Wire Bonding (AREA)
- Lead Frames For Integrated Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、集積回路に関し、特にテープ・オートメイテ
ッド・ボンディング方式で組立てられた集積回路装置に
関する。
ッド・ボンディング方式で組立てられた集積回路装置に
関する。
従来、集積回路の製造においては、組立の自動化を図っ
たT A B (Tape Automated Bo
nding)方式により全ピン同時にボンディング(い
わゆるギヤング・ボンディング)方式が多く採用されて
いる。
たT A B (Tape Automated Bo
nding)方式により全ピン同時にボンディング(い
わゆるギヤング・ボンディング)方式が多く採用されて
いる。
第3図(a)、(b)は従来のTAB方式組立法を説明
するための平面図及びB−B’線断面図である。
するための平面図及びB−B’線断面図である。
L、SIチップ1にはバンプ2が形成されている。絶縁
フィルム3にはデバイスホール4があけられ、片持ち梁
形式でリード5が突出ている。絶縁フィルム3とLSI
チップ1とを位置合わせしてリード5をバンプ2とを溶
着する。
フィルム3にはデバイスホール4があけられ、片持ち梁
形式でリード5が突出ている。絶縁フィルム3とLSI
チップ1とを位置合わせしてリード5をバンプ2とを溶
着する。
上述した従来のTAB方式によるLSI装置では、バン
プ2と接続されるリード5の先端付近にリード固定枠が
なくリード5はデバイスホール4に突出した片持梁の構
造となっているの・で、多くのリード接続するためにリ
ードピッチを狭くすると、リード幅が狭くなりリード強
度が低下してしまう。その結果、ボンディング前工程に
おける応力に対してリードが変形(だれ及びピッチ間不
揃い)を起こしてしまうという欠点がある。さらに、ボ
ンディング以降の工程において、LSIチップ1とリー
ド5とがエツジタッチを起す欠点があり、多くのリード
を必要とするLSIチップでは実現困難である。
プ2と接続されるリード5の先端付近にリード固定枠が
なくリード5はデバイスホール4に突出した片持梁の構
造となっているの・で、多くのリード接続するためにリ
ードピッチを狭くすると、リード幅が狭くなりリード強
度が低下してしまう。その結果、ボンディング前工程に
おける応力に対してリードが変形(だれ及びピッチ間不
揃い)を起こしてしまうという欠点がある。さらに、ボ
ンディング以降の工程において、LSIチップ1とリー
ド5とがエツジタッチを起す欠点があり、多くのリード
を必要とするLSIチップでは実現困難である。
本発明の目的は、多くのリードがあってもリードの変形
なしにTAB方式の組立を行うことのできるgk8回路
を提供することにある。
なしにTAB方式の組立を行うことのできるgk8回路
を提供することにある。
本発明は、集積回路チップ表面の外周部に突出したバン
プと絶縁フィルムに設けられたリードをボンディング接
続する集積回路において、前記集積回路チップ表面のバ
ンプ外側のチップエツジを含むリード下面位置に固着さ
れたリード固定枠を含んで構成される。
プと絶縁フィルムに設けられたリードをボンディング接
続する集積回路において、前記集積回路チップ表面のバ
ンプ外側のチップエツジを含むリード下面位置に固着さ
れたリード固定枠を含んで構成される。
次に、本発明の実施例について図面を参照して説明する
。
。
第1図(a)、(b)は本発明の第1の実施例を示す平
面図及びA−A’線断面図である。
面図及びA−A’線断面図である。
LSIチップ1の表面の外周部にバンプ2が配置されて
いる。一方、絶縁フィルム3のデバイスホール4とリー
ド固定枠8とを前もって打ち抜き、その絶縁フィルム3
上に銅箔を密着させて、所定のリード5と配線パターン
6と試験用電極7とを周知のエツチングとめっき技術に
より形成する。その後、バンプ2とリード5とを1対1
に目合わせして両者をボンディングツールにより熱圧着
する。リード固定枠8は、バンプとチップエツジ間の位
置でリード下面に固着される。
いる。一方、絶縁フィルム3のデバイスホール4とリー
ド固定枠8とを前もって打ち抜き、その絶縁フィルム3
上に銅箔を密着させて、所定のリード5と配線パターン
6と試験用電極7とを周知のエツチングとめっき技術に
より形成する。その後、バンプ2とリード5とを1対1
に目合わせして両者をボンディングツールにより熱圧着
する。リード固定枠8は、バンプとチップエツジ間の位
置でリード下面に固着される。
第2図は本発明の第2の実施例を示す平面図である。
本実施例は、千鳥状に配列したバンプ2によるLSIチ
ップ1にて実現している。リード固定枠8は、LSIチ
ップのバンプ外側のチップエツジを含むリード下面に固
着されているので第1の実施例と同様の利点がある。
ップ1にて実現している。リード固定枠8は、LSIチ
ップのバンプ外側のチップエツジを含むリード下面に固
着されているので第1の実施例と同様の利点がある。
以上説明したように本発明は、LSIチップの内側のバ
ンプ近傍におけるリードの下面にリード固定枠を固着す
る事によって、第1にボンディング以前の作業工程にお
けるリードの変形(だれ及びピッチの不揃い)が防止で
き、結果的には、多ビン化が実現できる。第2にはバン
プとチップエツジ間でのエツジタッチが防止でき、信頼
性の高いLS’I装置が実現できるという効果を有する
。
ンプ近傍におけるリードの下面にリード固定枠を固着す
る事によって、第1にボンディング以前の作業工程にお
けるリードの変形(だれ及びピッチの不揃い)が防止で
き、結果的には、多ビン化が実現できる。第2にはバン
プとチップエツジ間でのエツジタッチが防止でき、信頼
性の高いLS’I装置が実現できるという効果を有する
。
第1図(a)、(b)は本発明の第1の実施例を説明す
るための平面図及びA−A’線断面図、第2図は本発明
の第2の実施例を説明するための平面図、第3図(a>
、(b)は従来のTAB方式組立法を説明するための平
面図及びB−B’線断面図である。 1・・・LSIチップ、2・・・バンプ、3・・・絶縁
フィルム、4・・・デバイスホール、5・・・リード、
6・・・配線パターン、7・・・試験用電極、8・・・
リード固定(b) 第 1 図 第 2 図
るための平面図及びA−A’線断面図、第2図は本発明
の第2の実施例を説明するための平面図、第3図(a>
、(b)は従来のTAB方式組立法を説明するための平
面図及びB−B’線断面図である。 1・・・LSIチップ、2・・・バンプ、3・・・絶縁
フィルム、4・・・デバイスホール、5・・・リード、
6・・・配線パターン、7・・・試験用電極、8・・・
リード固定(b) 第 1 図 第 2 図
Claims (1)
- 集積回路チップ表面の外周部に突出した複数個のTA
Bリード接続バンプと絶縁フィルムに設けられた外部リ
ードを直接ボンディング接続して成る集積回路において
、前記集積回路チップの前記TABリード接続バンプ外
側のチップエッジを含むリード下面位置に固着されたリ
ード固定枠を含むことを特徴とする集積回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63154409A JPH01319957A (ja) | 1988-06-21 | 1988-06-21 | 集積回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63154409A JPH01319957A (ja) | 1988-06-21 | 1988-06-21 | 集積回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01319957A true JPH01319957A (ja) | 1989-12-26 |
Family
ID=15583520
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63154409A Pending JPH01319957A (ja) | 1988-06-21 | 1988-06-21 | 集積回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01319957A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04264743A (ja) * | 1990-10-24 | 1992-09-21 | Internatl Business Mach Corp <Ibm> | パッケージング |
| EP0645806A4 (en) * | 1993-04-08 | 1995-10-11 | Seiko Epson Corp | SEMICONDUCTOR DEVICE. |
-
1988
- 1988-06-21 JP JP63154409A patent/JPH01319957A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04264743A (ja) * | 1990-10-24 | 1992-09-21 | Internatl Business Mach Corp <Ibm> | パッケージング |
| EP0645806A4 (en) * | 1993-04-08 | 1995-10-11 | Seiko Epson Corp | SEMICONDUCTOR DEVICE. |
| US5563445A (en) * | 1993-04-08 | 1996-10-08 | Seiko Epson Corporation | Semiconductor device |
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