JPH0148648B2 - - Google Patents

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JPH0148648B2
JPH0148648B2 JP57141809A JP14180982A JPH0148648B2 JP H0148648 B2 JPH0148648 B2 JP H0148648B2 JP 57141809 A JP57141809 A JP 57141809A JP 14180982 A JP14180982 A JP 14180982A JP H0148648 B2 JPH0148648 B2 JP H0148648B2
Authority
JP
Japan
Prior art keywords
circuit element
molded body
electrode
synthetic resin
parallel
Prior art date
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Expired
Application number
JP57141809A
Other languages
English (en)
Other versions
JPS5932120A (ja
Inventor
Iwao Takefushi
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KOA SPINNING MACH
Original Assignee
KOA SPINNING MACH
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Application filed by KOA SPINNING MACH filed Critical KOA SPINNING MACH
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Publication of JPS5932120A publication Critical patent/JPS5932120A/ja
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  • Non-Adjustable Resistors (AREA)
  • Coils Or Transformers For Communication (AREA)
  • Fixed Capacitors And Capacitor Manufacturing Machines (AREA)

Description

【発明の詳細な説明】 〔発明の技術分野〕 本発明は複合回路素子およびその製造方法に係
り、例えば、レジスタネツトワークなどの形成に
用いられる複数の抵抗、コンデンサなどの回路素
子片を組込んだものに関する。
〔発明の技術的背景〕 従来のこの種レジスタネツトワークなどの回路
形成に用いられる複合回路素子はセラミツク基板
の前面に素子被膜例えば抵抗被膜を並列に形成
し、この各抵抗被膜の両端に接続した電極被膜に
導線を半田接続し、全体を絶縁被膜で覆つた構成
が採られている。
〔背景技術の問題点〕
従来のこの複合回路素子では基板の前面に抵抗
などの回路素子部を並列に印刷などによつて形成
したため、複数の回路素子部を高密度に形成する
ことができず、また耐湿特性も低く、さらに複数
の各回路素子部が異なる場合例えば異なる抵抗値
の抵抗被膜を形成する場合には複数回印刷の版を
変えて被膜の印刷をなくしてはならず、製造工数
が多く、作業が煩雑で、高価となる欠点を有して
いる。
〔発明の目的〕
本発明は上記欠点に鑑みなされたもので、各回
路素子部を高密度に形成でき、耐湿特性を向上で
き、また種類の異なる回路素子部の形成も作業性
よくでき、安価に得られる複合回路素子を提供す
るものである。
〔発明の概要〕
本発明は電極部を有する複数の回路素子片を合
成樹脂成形体に埋込み固定し、この成形体端面
に、各回路素子片の回路素子部の露出された電極
部に接続した配線路を形成するとともに導線を接
続してなるものである。
また本発明は複数の回路素子部およびこの回路
素子部に接続した電極部を有する複数の基板を並
列に合成樹脂に埋込み成形し、この成形された合
成樹脂を切断し、この切断した成形体の端面に各
基板の切断によつて形成された回路素子片の露出
された電極部に接続した配線路を形成するととも
に導線を接続してなるものである。
〔発明の実施例〕
本発明の一実施例の構成を図面第7図、第8図
について説明する。
1は合成樹脂成形体で、複数の回路素子片2を
一体に埋込み固定している。この回路素子片2は
素子形成面3が互いに平行となるように並列に埋
込み固定され、この各回路素子片2の側縁部は前
記成形体1の端面に露出されている。そしてこの
各回路素子片2の素子形成面3に接続形成した電
極部も成形体1の端面に露出されている。さらに
この回路素子片2に成形体1の端面に露出した電
極部は成形体1の端面に形成した配線路5に接続
され、各回路素子片2の配線路5に導線6がそれ
ぞれ接続されている。この導線6を接続した成形
体1は絶縁被膜7で被覆されている。
次にこの複合回路素子の製造方法を第1図ない
し第8図について説明する。
細長板状のセラミツク回路素子基板10の回路
素子形成面3に第1図に示すように長手方向に間
隔をおいて回路素子部11例えば抵抗被膜を印刷
などの適宜の手段で形成する。この回路素子部1
1の両端は、予め回路素子形成面3に長手方向の
両縁に沿つて間隔をおいて蒸着など適宜の手段で
形成した電極部12に接続されている。次いで回
路素子部11をトリミングによつて抵抗調整など
の調整を行う。次いで基板10の長手方向に沿つ
て両縁に連続的に前記回路素子部11の電極部1
2に接続した電極部13を蒸着などによつて形成
する。
次いで第2図に示すように複数の基板10を回
路素子形成面3を平行にして並設する。この各基
板10は図示しないスペーサにて所定間隔をもつ
て並設し或いは直接に当接並設してもよく、基板
10の両面に回路素子部11を形成した場合には
間隔をあけて並設する。そしてこの並設された各
基板10の回路素子部11は複合回路素子の種類
に応じて同一または異種のものを選択して並設す
る。
次いで第3図に示すように並設した基板10を
合成樹脂にて埋込み成形し各基板10を合成樹脂
成形体1にて一体化する。
次いで第4図に示すように合成樹脂成形体1を
各基板10の回路素子部11間の位置で基板10
とともに各基板10と直交方向に切断し、第5図
に示すように切断された合成樹脂成形体1の端面
に基板10の切断によつて成形された各回路素子
片2の縁部が露出され、電極部13も端面に露出
される。
次いで第6図に示すように合成樹脂成形体1の
各回路素子片2の縁部が露出された端面に印刷ま
たはエツチング法など適宜の手段で配線路5を形
成し、この配線路5で電極部13を複合回路素子
の種類に応じて接続する。
次いで第7図に示すように配線路5に導線6を
半田などで接続し、導線6を並列に同一方向に突
設させる。
次いで第8図に示すように成形1の表面を合成
樹脂などの絶縁被膜7で被覆することにより複合
回路素子8が完成する。
なお前述の合成樹脂成形体1と基板10とを切
断した状態(第5図)で基板10の縁部が露出し
た成形体1の端面をエツチングなどの手段で基板
10の側端部を第9図に示すように露出させ、電
極部13と配線路5との接続を確実にすることも
できる。
また第10図に示すように複数の回路素子片2
を並列に配設した一つの回路素子片群9に限られ
ず、複数の回路素子片群9を成形体1にて一体に
埋込み固定してもよい。また回路素子片2の両面
を回路素子形成面3としてより高密度に回路素子
部11を設けることができる。
さらに回路素子片2は抵抗に限らず第11図に
示すようにセラミツクコンデンサにも適用でき、
この構成では細長セラミツクコンデンサ基板10
Aの回路素子形成面3の長手方向に沿つた両縁に
連続して電極部13を形成し、前記実施例で示す
ように成形体1に基板10Aを並列に埋込み固定
して切断して複合回路素子とする。
また第12図に示すようにチツプ形コイルにも
適用でき、コイル基板10Bを同様に成形体1に
埋込み固定して切断して複合回路素子とする。
なお成形体1内に並列に埋込み固定する回路素
子片2は同一種の抵抗、コンデンサ或いはコイル
に限らず、適宜複合回路に応じた抵抗、コンデン
サ或いはコイルを組合せて並設し、さらには抵抗
値、コンデンサ容量、コイル容量なども適宜選択
できる。
〔発明の効果〕
本発明によれば複数の回路素子片を合成樹脂成
形体に埋込み固定したので、高密度に回路素子を
並設でき、各回路素子部は耐湿特性が向上され、
製造も容易にでき、安価に得られるものである。
また基板に複数の回路素子部を形成した基板を
並列に合成樹脂にて埋込み成形し、この合成樹脂
を切断して各基板の切断による回路素子片を形成
することにより異種抵抗値、異種回路素子の組合
せの複合回路素子を容易に得ることができる。
【図面の簡単な説明】
第1図は本発明の回路素子片を形成する基板の
正面図、第2図は同上基板の並設状態を示す斜視
図、第3図は複数の基板を合成樹脂成形体で一体
化した状態を示す斜視図、第4図は同上切断状態
を示す斜視図、第5図は同上切断片を示す斜視
図、第6図は同上配線路を形成した状態の正面
図、第7図は本発明の複合回路素子の正面図、第
8図は同上完成状態の正面図、第9図は他の実施
例を示す切断された成形体の側面図、第10図は
他の実施例を示す複合回路素子の斜視図、第11
図は回路素子部をコンデンサとした基板の正面
図、第12図は回路素子部をコイルとした基板の
正面図である。 1……合成樹脂成形体、2……回路素子片、3
……回路素子形成面、5……配線路、6……導
線、11……回路素子部、13……電極部。

Claims (1)

  1. 【特許請求の範囲】 1 回路素子形成面とこの回路素子形成面の回路
    素子部に接続された電極部を有し回路素子形成面
    を互いに平行に配置した回路素子片と、この複数
    の回路素子片を一体に埋込み固定し各回路素子片
    の縁部の電極部を露出させた合成樹脂成形体とか
    らなり、この成形体の電極部が露出した端面にこ
    の電極部に接続した配線路を形成するとともに導
    線を接続したことを特徴する複合回路素子。 2 基板の回路素子形成面に回路素子部を所定間
    隔毎に形成するとともにこの各回路素子部に接続
    された電極部を形成し、この複数の基板を回路素
    子形成面が互いに平行となるように配置し、この
    複数の並設された基板を合成樹脂に一体に埋込み
    形成し、この複数の基板を埋込み固定した合成樹
    脂成形体を各基板と直交方向に各回路素子部間で
    切断し、切断した成形体の端面に、各基板の切断
    により形成された複数の回路素子片の各縁部の露
    出されている前記電極部を接続する配線路を形成
    するとともに導線を接続することを特徴とする複
    合回路素子の製造方法。
JP57141809A 1982-08-16 1982-08-16 複合回路素子およびその製造方法 Granted JPS5932120A (ja)

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JP57141809A JPS5932120A (ja) 1982-08-16 1982-08-16 複合回路素子およびその製造方法

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JPS5932120A JPS5932120A (ja) 1984-02-21
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JPS5932120A (ja) 1984-02-21

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