JPH0161214B2 - - Google Patents
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- Publication number
- JPH0161214B2 JPH0161214B2 JP14857181A JP14857181A JPH0161214B2 JP H0161214 B2 JPH0161214 B2 JP H0161214B2 JP 14857181 A JP14857181 A JP 14857181A JP 14857181 A JP14857181 A JP 14857181A JP H0161214 B2 JPH0161214 B2 JP H0161214B2
- Authority
- JP
- Japan
- Prior art keywords
- voltage
- circuit
- relay
- transistor
- capacitor
- Prior art date
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- Relay Circuits (AREA)
Description
【発明の詳細な説明】
本発明はトランジスタによりリレーを動作する
リレー駆動回路に関し、リレーコイルに動作電圧
以上の電圧を印加してリレーを動作させ、リレー
が動作した後はリレーコイルへの印加電圧を動作
電圧以下に低下することにより、リレーコイルの
温度上昇を防止するとともに、停電の後でもリレ
ーが安定に動作するようにしたリレー駆動回路を
提供しようとするものである。
リレー駆動回路に関し、リレーコイルに動作電圧
以上の電圧を印加してリレーを動作させ、リレー
が動作した後はリレーコイルへの印加電圧を動作
電圧以下に低下することにより、リレーコイルの
温度上昇を防止するとともに、停電の後でもリレ
ーが安定に動作するようにしたリレー駆動回路を
提供しようとするものである。
以下、本発明の一実施例について添付図面を参
照して説明する。
照して説明する。
第１図において、１は交流電源であり、抵抗
２、ダイオード３、コンデンサ４の直列回路が接
続されている。なお、抵抗２とダイオード３は交
流電源電圧を整流する整流回路５を構成してい
る。コンデンサ４には抵抗６と定電圧ダイオード
７を直列接続した定電圧電源回路８が並列接続さ
れている。また、コンデンサ４にはリレーコイル
９とトランジスタ１０の直列回路が並列接続され
ている。１１はトランジスタ１０を通電制御する
ためにトランジスタ１０のベースに接続された制
御回路である。１２は定電圧電源回路８の出力電
圧を遅延する遅延回路であり、抵抗１３、コンデ
ンサ１４、トランジスタ１５より構成されてい
る。１６は遅延回路１２の出力電圧を減圧して制
御回路１１へ供給する定電圧ダイオードである。
２、ダイオード３、コンデンサ４の直列回路が接
続されている。なお、抵抗２とダイオード３は交
流電源電圧を整流する整流回路５を構成してい
る。コンデンサ４には抵抗６と定電圧ダイオード
７を直列接続した定電圧電源回路８が並列接続さ
れている。また、コンデンサ４にはリレーコイル
９とトランジスタ１０の直列回路が並列接続され
ている。１１はトランジスタ１０を通電制御する
ためにトランジスタ１０のベースに接続された制
御回路である。１２は定電圧電源回路８の出力電
圧を遅延する遅延回路であり、抵抗１３、コンデ
ンサ１４、トランジスタ１５より構成されてい
る。１６は遅延回路１２の出力電圧を減圧して制
御回路１１へ供給する定電圧ダイオードである。
次に上記構成における動作について説明する。
交流電源電圧は整流回路５により整流され、コン
デンサ４により平滑され、定電圧電源回路８によ
り定電圧化され、定電圧ダイオード７の両端には
定電圧が発生する。この定電圧は抵抗１３とコン
デンサ１４により遅延され、トランジスタ１５を
介して遅延回路１２の出力電圧V2（第２図ｂ）と
なる。遅延回路１２の出力電圧V2は定電圧ダイ
オード１６により減圧されて制御回路１１に供給
される。この電圧をV3（第２図ｃ）とする。制御
回路１１の出力電流がない場合にはトランジスタ
１０がOFFであり、リレーコイル９に電流が流
れない。この場合のａ点の電圧はV1（第２図ａ）
となる。一方、制御回路１１の出力電流が発生し
た場合（第２図T2）はトランジスタ１０がONと
なり、リレーコイル９に電流が流れ、ａ点の電圧
はV1′となる。ここで電圧V1がリレーコイル９の
動作電圧以上になり、トランジスタ１０がONし
た時にリレーコイル９に電流が流れてリレーが確
実に動作し、動作後のａ点の電圧がリレーコイル
９の保持電圧以上になるように抵抗２、コンデン
サ４の各値を適当に設定すればリレーが動作する
まではリレーコイル９に動作電圧以上が印加さ
れ、動作後は動作電圧以下の低い電圧をリレーコ
イル９に印加し、リレーを保持できる。ところで
制御回路１１がトランジスタ１０のベースに電流
を供給している状態で、停電等により交流電源電
圧が零になつた場合（第２図T3）、リレーコイル
９の両端電圧がリレーの保持電圧に低下するまで
に制御回路１１の電流を零にするように定電圧ダ
イオード１６の値を設定し、交流電源電圧が回復
した場合は、ａ点の電圧がリレーの動作電圧以上
になつてから制御回路１１の出力電流が発生する
ように抵抗１３、コンデンサ１４の値を設定すれ
ば、停電後にも確実にリレーを動作させることが
できる。
交流電源電圧は整流回路５により整流され、コン
デンサ４により平滑され、定電圧電源回路８によ
り定電圧化され、定電圧ダイオード７の両端には
定電圧が発生する。この定電圧は抵抗１３とコン
デンサ１４により遅延され、トランジスタ１５を
介して遅延回路１２の出力電圧V2（第２図ｂ）と
なる。遅延回路１２の出力電圧V2は定電圧ダイ
オード１６により減圧されて制御回路１１に供給
される。この電圧をV3（第２図ｃ）とする。制御
回路１１の出力電流がない場合にはトランジスタ
１０がOFFであり、リレーコイル９に電流が流
れない。この場合のａ点の電圧はV1（第２図ａ）
となる。一方、制御回路１１の出力電流が発生し
た場合（第２図T2）はトランジスタ１０がONと
なり、リレーコイル９に電流が流れ、ａ点の電圧
はV1′となる。ここで電圧V1がリレーコイル９の
動作電圧以上になり、トランジスタ１０がONし
た時にリレーコイル９に電流が流れてリレーが確
実に動作し、動作後のａ点の電圧がリレーコイル
９の保持電圧以上になるように抵抗２、コンデン
サ４の各値を適当に設定すればリレーが動作する
まではリレーコイル９に動作電圧以上が印加さ
れ、動作後は動作電圧以下の低い電圧をリレーコ
イル９に印加し、リレーを保持できる。ところで
制御回路１１がトランジスタ１０のベースに電流
を供給している状態で、停電等により交流電源電
圧が零になつた場合（第２図T3）、リレーコイル
９の両端電圧がリレーの保持電圧に低下するまで
に制御回路１１の電流を零にするように定電圧ダ
イオード１６の値を設定し、交流電源電圧が回復
した場合は、ａ点の電圧がリレーの動作電圧以上
になつてから制御回路１１の出力電流が発生する
ように抵抗１３、コンデンサ１４の値を設定すれ
ば、停電後にも確実にリレーを動作させることが
できる。
以上の説明から明らかなように、本発明によれ
ば、リレーが動作した後はリレーコイルへの印加
電圧を保持電圧まで低下することができ、リレー
コイルの温度上昇が抑制されて信頼性が向上し、
また停電後においてもリレーを確実に動作させる
ことができる等、その工業的価値は大なるもので
ある。
ば、リレーが動作した後はリレーコイルへの印加
電圧を保持電圧まで低下することができ、リレー
コイルの温度上昇が抑制されて信頼性が向上し、
また停電後においてもリレーを確実に動作させる
ことができる等、その工業的価値は大なるもので
ある。
第１図は本発明の一実施例を示すリレー駆動回
路の電気回路図、第２図は同回路の要部信号波形
図である。 １……交流電源、２……抵抗、３……ダイオー
ド、４……コンデンサ、８……定電圧電源回路、
９……リレーコイル、１０……トランジスタ、１
１……制御回路、１２……遅延回路、１６……定
電圧ダイオード。
路の電気回路図、第２図は同回路の要部信号波形
図である。 １……交流電源、２……抵抗、３……ダイオー
ド、４……コンデンサ、８……定電圧電源回路、
９……リレーコイル、１０……トランジスタ、１
１……制御回路、１２……遅延回路、１６……定
電圧ダイオード。
Claims (1)
- １ 抵抗とダイオードとコンデンサの直列回路を
交流電源に接続し、定電圧を得る定電圧電源回路
と、この定電圧電源回路の出力を遅延する遅延回
路と、リレーとトランジスタの直列回路を前記コ
ンデンサに並列接続し、前記トランジスタの制御
を行なう制御回路とリレーの保持電圧に低下する
までに制御回路の出力発生を停止する定電圧ダイ
オードの直列回路を前記遅延回路の出力に接続し
たリレー駆動回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56148571A JPS5851431A (ja) | 1981-09-18 | 1981-09-18 | リレ−駆動回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56148571A JPS5851431A (ja) | 1981-09-18 | 1981-09-18 | リレ−駆動回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5851431A JPS5851431A (ja) | 1983-03-26 |
| JPH0161214B2 true JPH0161214B2 (ja) | 1989-12-27 |
Family
ID=15455715
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56148571A Granted JPS5851431A (ja) | 1981-09-18 | 1981-09-18 | リレ−駆動回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5851431A (ja) |
-
1981
- 1981-09-18 JP JP56148571A patent/JPS5851431A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5851431A (ja) | 1983-03-26 |
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