JPS5840427B2 - サイリスタの位相制御回路 - Google Patents
サイリスタの位相制御回路Info
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- JPS5840427B2 JPS5840427B2 JP11109277A JP11109277A JPS5840427B2 JP S5840427 B2 JPS5840427 B2 JP S5840427B2 JP 11109277 A JP11109277 A JP 11109277A JP 11109277 A JP11109277 A JP 11109277A JP S5840427 B2 JPS5840427 B2 JP S5840427B2
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- Japan
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- voltage
- power supply
- thyrisk
- rectified power
- capacitor
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- 230000010355 oscillation Effects 0.000 claims description 15
- 239000003990 capacitor Substances 0.000 claims description 14
- 230000000903 blocking effect Effects 0.000 claims description 5
- 238000010586 diagram Methods 0.000 description 2
- 230000001960 triggered effect Effects 0.000 description 2
- 230000005856 abnormality Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000005611 electricity Effects 0.000 description 1
- 238000004904 shortening Methods 0.000 description 1
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- Power Conversion In General (AREA)
Description
【発明の詳細な説明】
この発明はサイリスクの位相制御回路に関するものであ
る。
る。
従来のサイリスクの位相制御回路たとえば調光またはヒ
ータの温度制御等に用いられているものは、負荷が比較
的高い定格電圧を持っているため、電源の最大電圧を印
加しても負荷には異常が生じなかった。
ータの温度制御等に用いられているものは、負荷が比較
的高い定格電圧を持っているため、電源の最大電圧を印
加しても負荷には異常が生じなかった。
しかし、テレビジョン受像機のブランン管のヒータ等の
負荷の定格電圧が１０ｖ以下のものに、トランスを用い
ずに直接ＡＣ１００Ｖ５０／６０Ｈｚの商用電源を位相
制御して電力を供給する場合、すなわち、電源の電圧に
比べて負荷の定格電圧が非常に低い場合、負荷に加えら
れる最大印加電圧と実効電圧との間には大きな差があり
、負荷の寿命を縮めるという欠点があった。
負荷の定格電圧が１０ｖ以下のものに、トランスを用い
ずに直接ＡＣ１００Ｖ５０／６０Ｈｚの商用電源を位相
制御して電力を供給する場合、すなわち、電源の電圧に
比べて負荷の定格電圧が非常に低い場合、負荷に加えら
れる最大印加電圧と実効電圧との間には大きな差があり
、負荷の寿命を縮めるという欠点があった。
したがって、この発明の目的は、負荷に印加する実効電
圧を下げることなく最大印加電圧を低く押えることがで
きるサイリスクの位相制御回路を提供することである。
圧を下げることなく最大印加電圧を低く押えることがで
きるサイリスクの位相制御回路を提供することである。
この発明の一実施例を第１図に示す。
すなわち、このサイリスクの位相制御回路は、抵抗１、
コンデンサ２、コイル３，４、トランジスタ５、コンデ
ンサ６、抵抗７、サイリスタ８および負性抵抗素子９で
構成されている。
コンデンサ２、コイル３，４、トランジスタ５、コンデ
ンサ６、抵抗７、サイリスタ８および負性抵抗素子９で
構成されている。
この場合、抵抗１、コンデンサ２、コイル３，４、トラ
ンジスタ５およびコンデンサ６は転流回路ＴＤを構成し
ている。
ンジスタ５およびコンデンサ６は転流回路ＴＤを構成し
ている。
すなわち、コイル３，４は、同じコアに巻装してあり、
トランジスタ５とでブロッキング発振回路を構成し、こ
のブロッキング発振回路の発振開始電圧■１を設定する
。
トランジスタ５とでブロッキング発振回路を構成し、こ
のブロッキング発振回路の発振開始電圧■１を設定する
。
発振開始電圧■１ において発振を開始すると、トラン
ジスタ５のターンオフ時においてコイル４には高電圧の
逆起電圧が発生し、この逆起電圧によりコンデンサ６を
通してサイリスタ８のカソードに正のパルスを印加する
ことでサイリスタ８をターンオフさせる。
ジスタ５のターンオフ時においてコイル４には高電圧の
逆起電圧が発生し、この逆起電圧によりコンデンサ６を
通してサイリスタ８のカソードに正のパルスを印加する
ことでサイリスタ８をターンオフさせる。
また、トリガ用抵抗７は、転流回路ＴＤが動作する電圧
と同電圧になると負性抵抗素子９がオン状態になるよう
に、その値が設定されている。
と同電圧になると負性抵抗素子９がオン状態になるよう
に、その値が設定されている。
なお、１０は負荷、１１は整流器、１２および１３は端
子である。
子である。
つぎに、この実施例の動作について説明する。
まず、端子１２．１３間に商用電源（図示せず）が接続
されると、整流器１１から第２図ａに示すような両波整
流された電圧が出力される。
されると、整流器１１から第２図ａに示すような両波整
流された電圧が出力される。
この整流器１１の出力電圧をサイリスクの位相制御回路
に入力すると、第２図すに示すような電流が負荷１０に
流れる。
に入力すると、第２図すに示すような電流が負荷１０に
流れる。
すなわち、時刻Ｔ。から時刻Ｔ１までの整流器１１の出
力電圧が発振開始電圧■１ より低い間はブロッキング
発振回路は発振せず、サイリスタ８のカソード電圧は第
３図に示すように正弦波状であり、かつ負性抵抗素子９
がオフ状態でありサイリスタ８が抵抗７を通してトリガ
されてオン状態になり、負荷１０に電力が供給される。
力電圧が発振開始電圧■１ より低い間はブロッキング
発振回路は発振せず、サイリスタ８のカソード電圧は第
３図に示すように正弦波状であり、かつ負性抵抗素子９
がオフ状態でありサイリスタ８が抵抗７を通してトリガ
されてオン状態になり、負荷１０に電力が供給される。
時刻Ｔ１で整流器１１の出力電圧が所定の発振開始電圧
ｖ１を越えると、負性抵抗素子９がオン状態になってサ
イリスク８へのゲート電流がなくなりサイリスタ８への
トリガが停止する。
ｖ１を越えると、負性抵抗素子９がオン状態になってサ
イリスク８へのゲート電流がなくなりサイリスタ８への
トリガが停止する。
この状態において、転流回路ＴＤのコイル４の出力がコ
ンデンサ６を介して第３図に示すようにサイリスタ８の
カソードに印加されるので、サイリスタ８のアノード・
カソード間には逆バイアスが印加され、サイリスク８を
非導通状態にして負荷１０への電力の供給を停止し、時
刻Ｔ１から時刻Ｔ２の期間はこの状態が保持される。
ンデンサ６を介して第３図に示すようにサイリスタ８の
カソードに印加されるので、サイリスタ８のアノード・
カソード間には逆バイアスが印加され、サイリスク８を
非導通状態にして負荷１０への電力の供給を停止し、時
刻Ｔ１から時刻Ｔ２の期間はこの状態が保持される。
時刻Ｔ２で整流器１１の出力電圧が所定の発振開始電圧
ｖ１ よりも低くなり、負性抵抗素子９がオフ状態にな
るとともに転流回路ＴＤが動作を停止し、サイリスタ８
が再びトリガされてオン状態になり、負荷１０に電力が
供給され、時刻Ｔ２から時刻Ｔ３の期間この状態が保持
される。
ｖ１ よりも低くなり、負性抵抗素子９がオフ状態にな
るとともに転流回路ＴＤが動作を停止し、サイリスタ８
が再びトリガされてオン状態になり、負荷１０に電力が
供給され、時刻Ｔ２から時刻Ｔ３の期間この状態が保持
される。
これ以後は上述の動作と同じ動作を繰返す。
このように構成することにより、負荷に印加する実効電
圧を下げることなく最大印加電圧を低く押えることがで
き、電源の電圧に比較してかなり小さい定格電圧の負荷
に対してもその寿命を縮めることなく電力を供給できる
。
圧を下げることなく最大印加電圧を低く押えることがで
き、電源の電圧に比較してかなり小さい定格電圧の負荷
に対してもその寿命を縮めることなく電力を供給できる
。
以上のように、この発明のサイリスクの位相制御回路は
、整流電源の正極にアノードを接続したサイリスクと、
このサイリスクのアノード・ゲート間に接続したトリガ
用抵抗と、前記サイリスクのカソードと前記整流電源の
負極との間に接続した負荷と、前記サイリスクのゲート
と前記整流電源の負極との間に接続して前記整流電源の
電圧が所定の値以上の期間中オンとなることにより前記
サイリスタのゲート電流をバイパスする負性抵抗素子と
、前記整流電源の正極に一端を接続した第１のコイルと
、この第１のコイルの他端と前記整流電源の負極との間
に接続したトランジスタと、前記整流電源の正極に一端
を接続した抵抗と、この抵抗の他端と前記整流電源の負
極との間に接続した第１のコンデンサと、前記第１のコ
イルと電磁結合して前記トランジスタのベースと前記抵
抗および第１のコンデンサの接続点との間に接続した第
２のコイルとからなり、前記整流電源の電圧が前記負性
抵抗素子をオンにさせる電圧を越えたときに発振開始す
るように発振開始電圧を設定し、前記第１のコイルおよ
び前記トランジスタの接続点を第２のコンデンサを介し
て前記サイリスクのカソードに接続したブロッキング発
振回路とを備え、前記整流電源の電圧が前記負性抵抗素
子をオンにさせる電圧を越えたときに前記サイリスクの
カソードに正のパルスを与えて前記サイリスクをターン
オフさせるようにしたので、整流電源の各半波の中間部
を除いて前縁と後縁の両方でサイリスクが導通すること
になり、その結果、負荷に印加する実効電圧を下げるこ
となく最大印加電圧を低く押えることができるという効
果がある。
、整流電源の正極にアノードを接続したサイリスクと、
このサイリスクのアノード・ゲート間に接続したトリガ
用抵抗と、前記サイリスクのカソードと前記整流電源の
負極との間に接続した負荷と、前記サイリスクのゲート
と前記整流電源の負極との間に接続して前記整流電源の
電圧が所定の値以上の期間中オンとなることにより前記
サイリスタのゲート電流をバイパスする負性抵抗素子と
、前記整流電源の正極に一端を接続した第１のコイルと
、この第１のコイルの他端と前記整流電源の負極との間
に接続したトランジスタと、前記整流電源の正極に一端
を接続した抵抗と、この抵抗の他端と前記整流電源の負
極との間に接続した第１のコンデンサと、前記第１のコ
イルと電磁結合して前記トランジスタのベースと前記抵
抗および第１のコンデンサの接続点との間に接続した第
２のコイルとからなり、前記整流電源の電圧が前記負性
抵抗素子をオンにさせる電圧を越えたときに発振開始す
るように発振開始電圧を設定し、前記第１のコイルおよ
び前記トランジスタの接続点を第２のコンデンサを介し
て前記サイリスクのカソードに接続したブロッキング発
振回路とを備え、前記整流電源の電圧が前記負性抵抗素
子をオンにさせる電圧を越えたときに前記サイリスクの
カソードに正のパルスを与えて前記サイリスクをターン
オフさせるようにしたので、整流電源の各半波の中間部
を除いて前縁と後縁の両方でサイリスクが導通すること
になり、その結果、負荷に印加する実効電圧を下げるこ
となく最大印加電圧を低く押えることができるという効
果がある。
第１図はこの発明の一実施例の回路図、第２図ａ、ｂお
よび第３図は第１図の回路の動作を説明するための波形
図である。 １・・・・・・抵抗、２・・・・・・コンデンサ、３，
４・・・・・・コイル、５・・・・・・トランジスタ、
６・・・・・・コンデンサ、７・・・・・・抵抗、８・
・・・・・サイリスク、９・・・・・・負性抵抗素子、
１０・・・・・・負荷、ＴＤ・・・・・・転流回路。
よび第３図は第１図の回路の動作を説明するための波形
図である。 １・・・・・・抵抗、２・・・・・・コンデンサ、３，
４・・・・・・コイル、５・・・・・・トランジスタ、
６・・・・・・コンデンサ、７・・・・・・抵抗、８・
・・・・・サイリスク、９・・・・・・負性抵抗素子、
１０・・・・・・負荷、ＴＤ・・・・・・転流回路。
Claims (1)
- １ 整流電源の正極にアノードを接続したサイリスクと
、このサイリスクのアノード・ゲート間に接続したトリ
ガ用抵抗と、前記サイリスクのカソードと前記整流電源
の負極との間に接続した負荷と、前記サイリスクのゲー
トと前記整流電源の負極との間に接続して前記整流電源
の電圧が所定の値以上の期間中オンとなることにより前
記サイリスクのゲート電流をバイパスする負性抵抗素子
と、前記整流電源の正極に一端を接続した第１のコイル
と、この第１のコイルの他端と前記整流電源の負極との
間に接続したトランジスタと、前記整流電源の正極に一
端を接続した抵抗と、この抵抗の他端と前記整流電源の
負極との間に接続した第１のコンデンサと、前記第１の
コイルと電磁結合して前記トランジスタのベースと前記
抵抗および第１のコンデンサの接続点との間に接続した
第２のコイルとからなり、前記整流電源の電圧が前記負
性抵抗素子をオンにさせる電圧を越えたときに発振開始
するように発振開始電圧を設定し、前記第１コイルおよ
び前記トランジスタの接続点を第２のコンデンサを介し
て前記サイリスクのカソードに接続したブロッキング発
振回路とを備え、前記整流電源の電圧が前記負性抵抗素
子をオンにさせる電圧を越えたときに前記サイリスクの
カソードに正のパルスを与えて前記サイリスクをターン
オフさせるようにしたサイリスクの位相制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11109277A JPS5840427B2 (ja) | 1977-09-14 | 1977-09-14 | サイリスタの位相制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11109277A JPS5840427B2 (ja) | 1977-09-14 | 1977-09-14 | サイリスタの位相制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5444462A JPS5444462A (en) | 1979-04-07 |
| JPS5840427B2 true JPS5840427B2 (ja) | 1983-09-06 |
Family
ID=14552167
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11109277A Expired JPS5840427B2 (ja) | 1977-09-14 | 1977-09-14 | サイリスタの位相制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5840427B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6212428A (ja) * | 1985-07-11 | 1987-01-21 | Kubota Ltd | 農用トラクタの油圧ポンプ取付構造 |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| SE8106447L (sv) * | 1981-11-02 | 1983-05-03 | Bror Allan Eriksson | Anordning for konstanteffektreglering |
| US4675798A (en) * | 1985-07-15 | 1987-06-23 | Harris Corporation | Direct coupled switching power supply with GTO SCR switching element |
| BRPI0510845A (pt) * | 2004-05-24 | 2007-11-27 | Young-Chang Cho | método de controle de baixa tensão usando uma forma de onda de energia de corrente alternada e sistema para controle de baixa tensão |
-
1977
- 1977-09-14 JP JP11109277A patent/JPS5840427B2/ja not_active Expired
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6212428A (ja) * | 1985-07-11 | 1987-01-21 | Kubota Ltd | 農用トラクタの油圧ポンプ取付構造 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5444462A (en) | 1979-04-07 |
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