JPH0161745U - - Google Patents

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JPH0161745U
JPH0161745U JP2651987U JP2651987U JPH0161745U JP H0161745 U JPH0161745 U JP H0161745U JP 2651987 U JP2651987 U JP 2651987U JP 2651987 U JP2651987 U JP 2651987U JP H0161745 U JPH0161745 U JP H0161745U
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JP
Japan
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address
circuit
frame memory
generation circuit
column address
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JP2651987U
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Description

【図面の簡単な説明】
第１図は本考案によるビツトインターリーブ回
路の一実施例を示す回路構成図、第２図は第１図
の回路より得られるビツトインターリーブマトリ
クスのフレーム構成図、第３図は本考案の他の一
実施例を示す回路構成図、第４図は従来のビツト
インターリーブ回路の一例を示す回路構成図、第
５図は第３図の回路より得られるビツトインター
リーブマトリクスのフレーム構成図である。 ２……行アドレス発生回路、３……アドレス切
替回路、４，５……フレームメモリ、８……演算
回路、９……書き込み用列アドレス発生回路、１
０……読み出し用列アドレス発生回路、１１……
演算回路。

Claims (1)

  1. 【実用新案登録請求の範囲】 １ フレームメモリと、このフレームメモリにつ
    いて列アドレスおよび行アドレスを発生させるア
    ドレス発生回路と、前記アドレス発生回路によつ
    て発生した行アドレスを入力し、列アドレスまた
    は列アドレスの初期値を演算する演算回路と、前
    記アドレス発生回路によつて発生したアドレスま
    たは演算回路によつて発生したアドレスを前記フ
    レームメモリの書き込みおよび読み出しの状態に
    よつて切り換えるアドレス切換回路とを有し、行
    アドレスの状態により、列アドレスが一定条件で
    変化することを特徴とするビツトインターリーブ
    回路。 ２ フレームメモリが２系統配置されており、こ
    れらのフレームメモリの一方が入力データの書き
    込みを行う状態で他方が入力データの読み出しを
    行うことを特徴とする実用新案登録請求の範囲第
    １項記載のビツトインターリーブ回路。 ３ フレームメモリの出力を選択するセレクタ回
    路を具備することを特徴とする実用新案登録請求
    の範囲第２項記載のビツトインターリーブ回路。
JP2651987U 1986-11-07 1987-02-24 Pending JPH0161745U (ja)

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Application Number Priority Date Filing Date Title
JP2651987U JPH0161745U (ja) 1986-11-07 1987-02-24

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP17019986 1986-11-07
JP2651987U JPH0161745U (ja) 1986-11-07 1987-02-24

Publications (1)

Publication Number Publication Date
JPH0161745U true JPH0161745U (ja) 1989-04-19

Family

ID=31717573

Family Applications (1)

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JP2651987U Pending JPH0161745U (ja) 1986-11-07 1987-02-24

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