JPH0187448U - - Google Patents

Info

Publication number
JPH0187448U
JPH0187448U JP18306887U JP18306887U JPH0187448U JP H0187448 U JPH0187448 U JP H0187448U JP 18306887 U JP18306887 U JP 18306887U JP 18306887 U JP18306887 U JP 18306887U JP H0187448 U JPH0187448 U JP H0187448U
Authority
JP
Japan
Prior art keywords
pattern
output
circuit
memory
probe
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP18306887U
Other languages
English (en)
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed filed Critical
Priority to JP18306887U priority Critical patent/JPH0187448U/ja
Publication of JPH0187448U publication Critical patent/JPH0187448U/ja
Pending legal-status Critical Current

Links

Landscapes

  • Test And Diagnosis Of Digital Computers (AREA)

Description

【図面の簡単な説明】
第1図は、本考案の一実施例の構成図、第2図
は、実施例2の構成図である。 1……インサーキツトエミユレータ試験装置、
2……インサーキツトエミユレータ、3……エミ
ユレーシヨンポツド、4……トレースデタ出力、
5……ブレーク信号出力、6……エバチツプ状態
信号、7……メモリアドレス発生回路、8……パ
ターンアドレス出力、9……パターンメモリ、1
0……入出力方向メモリ、11……エアビツトメ
モリ、12……出力制御回路、13……方向出力
、14……パターン出力、15……比較器、16
……データエア出力、17……比較結果出力、1
8……ブレーク信号出力、19……コントローラ
、20……システムコントローラ、21……エバ
チツプ、22……実行アドレス出力、23……プ
ログラムメモリ、24……データ出力、25……
トレース回路、101……インサーキツトエミユ
レータ試験装置、102……インサーキツトエミ
ユレータ、103……エミユレーシヨンポツド、
104……トレースデータ出力、105……ブレ
ーク信号出力、106……エバチツプ状態信号、
107……メモリアドレス発生回路、108……
パターンアドレス出力、109……テスト情報メ
モリ、110……入出力方向ラツチ、111……
パターンラツチ、112……ケアビツトラツチ、
113……出力制御回路、114……方向出力、
115……パターン出力、116……比較器、1
17……データケア出力、118……比較結果出
力、119……ブレーク信号発生器、120……
コントローラ。

Claims (1)

    【実用新案登録請求の範囲】
  1. インサーキツトエミユレータのプローブの試験
    用比較パターンと印加パターンを保持するメモリ
    と、インサーキツトエミユレータのトレース回路
    より与えられる信号から、上記パターン保持メモ
    リのアドレスを発生するアドレス発生器と、上記
    パターンメモリのデータをインサーキツトエミユ
    レータのプローブへ印加パターンを与える出力制
    御回路と、プローブからのデータと比較パターン
    とを比較する比較器を有する事を特徴とするイン
    サーキツトエミユレータの試験装置。
JP18306887U 1987-11-30 1987-11-30 Pending JPH0187448U (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP18306887U JPH0187448U (ja) 1987-11-30 1987-11-30

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP18306887U JPH0187448U (ja) 1987-11-30 1987-11-30

Publications (1)

Publication Number Publication Date
JPH0187448U true JPH0187448U (ja) 1989-06-09

Family

ID=31474501

Family Applications (1)

Application Number Title Priority Date Filing Date
JP18306887U Pending JPH0187448U (ja) 1987-11-30 1987-11-30

Country Status (1)

Country Link
JP (1) JPH0187448U (ja)

Similar Documents

Publication Publication Date Title
JPH0255331U (ja)
JPH0187448U (ja)
JPS6019978U (ja) パツケ−ジ試験機用ピンアクセス回路
JPS61189283U (ja)
JPS63168545U (ja)
JPS6361046U (ja)
JPH0166697U (ja)
JPH0172651U (ja)
JPS605535U (ja) デバツグ装置
JPH03123292U (ja)
JPH0284950U (ja)
JPH0196042U (ja)
JPH0371500U (ja)
JPS59113898U (ja) 間欠作動型計測器
JPS604959U (ja) 自動測定装置
JPS5949252U (ja) アドレス制御装置
JPH0334102U (ja)
JPH0466646U (ja)
JPS62101195U (ja)
JPS5847944U (ja) マイクロプロセツサアナライザ
JPH0471183U (ja)
JPS63175249U (ja)
JPH03124248U (ja)
JPS59138961U (ja) トレ−ス・メモリ制御回路
JPS6044140U (ja) マイクロプロセッサ等のデバッグ装置