JPH02100708A - マイクロコンピユータのバツクアツプ回路 - Google Patents
マイクロコンピユータのバツクアツプ回路Info
- Publication number
- JPH02100708A JPH02100708A JP63254361A JP25436188A JPH02100708A JP H02100708 A JPH02100708 A JP H02100708A JP 63254361 A JP63254361 A JP 63254361A JP 25436188 A JP25436188 A JP 25436188A JP H02100708 A JPH02100708 A JP H02100708A
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- JP
- Japan
- Prior art keywords
- microcomputer
- diode
- power
- backup
- backup capacitor
- Prior art date
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- Pending
Links
- 239000003990 capacitor Substances 0.000 claims abstract description 23
- 238000004904 shortening Methods 0.000 abstract description 2
- 230000002411 adverse Effects 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 7
- 230000007423 decrease Effects 0.000 description 1
- 229920006395 saturated elastomer Polymers 0.000 description 1
Landscapes
- Power Sources (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明は、マイクロコンピュータのバックアップ回路に
関し、特には、電源投入後のシステム起動時間を短縮さ
せるようにしたマイクロコンピュータのバックアップ回
路に関する。
関し、特には、電源投入後のシステム起動時間を短縮さ
せるようにしたマイクロコンピュータのバックアップ回
路に関する。
（従来の技術）
従来、マイクロコンピュータ（以下、必要に応じてマイ
コンという）のバックアップ回路としては、例えば第４
図に示すようにパワーラインＶｃｃに介在させたダイオ
ード（１）のカソード側にマイコン（４）と共通に接続
されたバックアップコンデンサ（２）と、該ダイオード
（１）のアノード側に接続されたパワーオンリセット回
路（３）とを備えるものがある（特開昭５４−１２０４
２５ ）。前記パワーオンリセット回路（３）は、パワ
ーオン後の所定の時間にマイコン（４）にリセット信号
前記の構成においては、バックアップコンデンサ（２）
が比較的大容量であるため、これに電荷が飽和するまで
のマイコン（４）の電源電圧の立ち上がりが遅れる上、
パワーオンリセット回路（３）の設定時間をバックアッ
プコンデンサ（２）、マイコン（４）、パワーオンリセ
ット回路（３）のＩＪ 成部品のバラツキや周囲温度の
影響等を考慮して設定する必要があるので、システム起
動に要する時間が比較的長くなる欠点がある。
コンという）のバックアップ回路としては、例えば第４
図に示すようにパワーラインＶｃｃに介在させたダイオ
ード（１）のカソード側にマイコン（４）と共通に接続
されたバックアップコンデンサ（２）と、該ダイオード
（１）のアノード側に接続されたパワーオンリセット回
路（３）とを備えるものがある（特開昭５４−１２０４
２５ ）。前記パワーオンリセット回路（３）は、パワ
ーオン後の所定の時間にマイコン（４）にリセット信号
前記の構成においては、バックアップコンデンサ（２）
が比較的大容量であるため、これに電荷が飽和するまで
のマイコン（４）の電源電圧の立ち上がりが遅れる上、
パワーオンリセット回路（３）の設定時間をバックアッ
プコンデンサ（２）、マイコン（４）、パワーオンリセ
ット回路（３）のＩＪ 成部品のバラツキや周囲温度の
影響等を考慮して設定する必要があるので、システム起
動に要する時間が比較的長くなる欠点がある。
本発明は、上記の事情を考慮してなされたものであり、
電源投入後のシステム起動時間を短縮させるようにした
マイクロコンピュータ等のバックアップ回路を提供する
ことを目的としている。
電源投入後のシステム起動時間を短縮させるようにした
マイクロコンピュータ等のバックアップ回路を提供する
ことを目的としている。
（課題を解決するための手段）
本発明に係るマイクロコンピュータのバックアップ回路
は、上記の目的を達成するために、例えば第１図に示す
ように、パワーラインＶｃｃに介在させた第１のダイオ
ード（１）のカソード側にマイコン（４）と共通に接続
されたバックアップコンデンサ（２）と、該第１のダイ
オード（１）のアノード側に接続されたパワーオンリセ
ット回路（３）とを備えたマイクロコンピュータのバッ
クアップ回路において、パワーラインＶｃｃのバックア
ップコンデンサ（２）接続点とマイコン（４）間に第２
のダイオード（７）を順接続するとともに、パワーライ
ンＶｃｃの第１のダイオード（１）のアノード側にＷ第
３のダイオード（６）を介してマイコン（４）を接続し
たことを特徴としている。
は、上記の目的を達成するために、例えば第１図に示す
ように、パワーラインＶｃｃに介在させた第１のダイオ
ード（１）のカソード側にマイコン（４）と共通に接続
されたバックアップコンデンサ（２）と、該第１のダイ
オード（１）のアノード側に接続されたパワーオンリセ
ット回路（３）とを備えたマイクロコンピュータのバッ
クアップ回路において、パワーラインＶｃｃのバックア
ップコンデンサ（２）接続点とマイコン（４）間に第２
のダイオード（７）を順接続するとともに、パワーライ
ンＶｃｃの第１のダイオード（１）のアノード側にＷ第
３のダイオード（６）を介してマイコン（４）を接続し
たことを特徴としている。
（作用）
本発明のマイクロコンピュータのバックアップ回路によ
れば、電源投入時に、バックアップコンデンサ（２）の
充電開始と同時に第３のダイオード（６）を介して供給
電源がマイコン（４）に接続され、瞬時にマイコン（４
）が能動状態に置かれることになる。従って、バックア
ップコンデンサ（２）の影響を無視してパワーオンリセ
ット回路（３）の設定時間を短縮し、システム起動に要
する時間を短縮することができる。
れば、電源投入時に、バックアップコンデンサ（２）の
充電開始と同時に第３のダイオード（６）を介して供給
電源がマイコン（４）に接続され、瞬時にマイコン（４
）が能動状態に置かれることになる。従って、バックア
ップコンデンサ（２）の影響を無視してパワーオンリセ
ット回路（３）の設定時間を短縮し、システム起動に要
する時間を短縮することができる。
（実施例）
以下、本発明を文例に基づき具体的に説明する。
第１図は本発明の一実施例に係るマイクロコンピュータ
のバックアップ回路の回路図であり、第２図はその作動
を示すタイミング図であり、第３図はそのパワーオンリ
セット回路の回路図である。第１図中、ｖＣＣはパワー
ライン、ＧＮＤはアースライン、（１）は第１のダイオ
ード、（２＋はバックアップコンデンサ、（３）はパワ
ーオンリセット回路、（４）はマイコン、（５）は抵抗
、（６）は第３のダイオード、（７）は第２のダイオー
ドである。また、第２図中、ｖｌはパワーラインＶｃｃ
の電圧、ｖ２はマイコン（４）の入力電圧、ｖ３はバッ
クアップコンデンサ（２）の端子閲見ｉＥ、ＲｚＳはパ
ワーオンリセット回路（３ンの出力信号、ＶＦ６は第３
のダイオード（６）の順方向電圧降下、ＶＦ２は第１の
ダイオード（１）の順方向電圧降下、ＶＦ３は第２のダ
イオード（７）の順方向電圧降下、■３′はバンクアッ
プコンデンサ（２）の残電圧である。更に、第３図にお
いて（８）は抵抗、（９）はコンデンサ、叫はスイッチ
ングトランジスタである。
のバックアップ回路の回路図であり、第２図はその作動
を示すタイミング図であり、第３図はそのパワーオンリ
セット回路の回路図である。第１図中、ｖＣＣはパワー
ライン、ＧＮＤはアースライン、（１）は第１のダイオ
ード、（２＋はバックアップコンデンサ、（３）はパワ
ーオンリセット回路、（４）はマイコン、（５）は抵抗
、（６）は第３のダイオード、（７）は第２のダイオー
ドである。また、第２図中、ｖｌはパワーラインＶｃｃ
の電圧、ｖ２はマイコン（４）の入力電圧、ｖ３はバッ
クアップコンデンサ（２）の端子閲見ｉＥ、ＲｚＳはパ
ワーオンリセット回路（３ンの出力信号、ＶＦ６は第３
のダイオード（６）の順方向電圧降下、ＶＦ２は第１の
ダイオード（１）の順方向電圧降下、ＶＦ３は第２のダ
イオード（７）の順方向電圧降下、■３′はバンクアッ
プコンデンサ（２）の残電圧である。更に、第３図にお
いて（８）は抵抗、（９）はコンデンサ、叫はスイッチ
ングトランジスタである。
上記の構成において、電源が投入されると、第ｚ図Ａ期
間に示すように、マイコン（４）のパワー入力端子がパ
ワーラインＶａｃの前記第１のダイオード（１）のアノ
ード側に第３のダイオード（６）を介して接続されてい
るので、マイコン（４）の入力端子ｖ２は直ちにパワー
ラインＶｃｃの電圧■１に追随して昇圧し、マイコン（
４）は瞬時に能動状態に切り替わる。これに対してバッ
クアップコンデンサ（２）の端子間電圧ｖ３は徐々に昇
圧して、マイコン（４）の入力電圧ｖ２に等しい電圧に
飽和する。また、パワーオンリセット回路（３）は設定
時間Ｔ１を経過する迄にリセット信号を出カシてマイコ
ン（４）をリセットする。この後、電源が遮断されると
、第２図Ｂ期間に示すように、マイコン（４）はバック
アップコンデンサ（２）から電力を供給され、バックア
ップコンデンサ（２）の端子間電圧は次第に低くなる。
間に示すように、マイコン（４）のパワー入力端子がパ
ワーラインＶａｃの前記第１のダイオード（１）のアノ
ード側に第３のダイオード（６）を介して接続されてい
るので、マイコン（４）の入力端子ｖ２は直ちにパワー
ラインＶｃｃの電圧■１に追随して昇圧し、マイコン（
４）は瞬時に能動状態に切り替わる。これに対してバッ
クアップコンデンサ（２）の端子間電圧ｖ３は徐々に昇
圧して、マイコン（４）の入力電圧ｖ２に等しい電圧に
飽和する。また、パワーオンリセット回路（３）は設定
時間Ｔ１を経過する迄にリセット信号を出カシてマイコ
ン（４）をリセットする。この後、電源が遮断されると
、第２図Ｂ期間に示すように、マイコン（４）はバック
アップコンデンサ（２）から電力を供給され、バックア
ップコンデンサ（２）の端子間電圧は次第に低くなる。
更にこの後、電源が再び投入されると、第２図Ｃ期間に
示すよウニ、一方では、マイコン（４）が瞬時に能動状
態に切り替わり、パワーオンリセット回路（３）が設定
時間Ｔ１を経過する迄リセット信号を出力してマイコン
（４）をリセットする。そして、他方では、これらの動
作とは無関係にバックアップコンデンサ（２）の端子間
電圧ｖ３が徐々に昇圧してやがてマイコン（４）の入力
電圧ｖ２に等しい電圧に飽和する。このように、バック
アップコンデンサ（２）の充電と無関係にマイコン（４
）の供給電圧を瞬時に立ち上がらせることより、パワー
オンリセット回路（３）の設定時間Ｔ１を短く設定する
ことが可能になり、短時間内にシステムを起動させるこ
とができる。
示すよウニ、一方では、マイコン（４）が瞬時に能動状
態に切り替わり、パワーオンリセット回路（３）が設定
時間Ｔ１を経過する迄リセット信号を出力してマイコン
（４）をリセットする。そして、他方では、これらの動
作とは無関係にバックアップコンデンサ（２）の端子間
電圧ｖ３が徐々に昇圧してやがてマイコン（４）の入力
電圧ｖ２に等しい電圧に飽和する。このように、バック
アップコンデンサ（２）の充電と無関係にマイコン（４
）の供給電圧を瞬時に立ち上がらせることより、パワー
オンリセット回路（３）の設定時間Ｔ１を短く設定する
ことが可能になり、短時間内にシステムを起動させるこ
とができる。
（発明の効果）
以上説明したように、本発明のマイクロコンピュータの
バックアップ回路によれば、電源投入時にバックアップ
コンデンサの充電と無関係にマイコンを瞬時に能動状態
に立ち上がらせることができるので、パワーオンリセッ
ト回路の設定時間を短く設定して、短時間内にシステム
を起動させることができるのである。
バックアップ回路によれば、電源投入時にバックアップ
コンデンサの充電と無関係にマイコンを瞬時に能動状態
に立ち上がらせることができるので、パワーオンリセッ
ト回路の設定時間を短く設定して、短時間内にシステム
を起動させることができるのである。
第１図は本発明の一実施例を示す回路図、第２図は同例
における作動を示すタイミング図、第３図は同例の要部
回路図、第４図は従来例を示す回路図である。 （１）・・・第１のダイオード （２）・・・バックアップコンデンサ （３）・・・パワーオンリセット回路 （４）・・・マイクロコンピュータ （６）・・・第３のダイオード （７）・・・第２のダイオード
における作動を示すタイミング図、第３図は同例の要部
回路図、第４図は従来例を示す回路図である。 （１）・・・第１のダイオード （２）・・・バックアップコンデンサ （３）・・・パワーオンリセット回路 （４）・・・マイクロコンピュータ （６）・・・第３のダイオード （７）・・・第２のダイオード
Claims (1)
- パワーラインに介在させた第１のダイオードのカソード
側にマイクロコンピュータと共通に接続されたバツクア
ツプコンデンサと、該ダイオードのアノード側に接続さ
れたパワーオンリセット回路とを備えたマイクロコンピ
ュータのバックアップ回路において、パワーラインのバ
ックアップコンデンサ接続点とマイクロコンピュータ間
に第２のダイオードを順接続すると共に、パワーライン
の第１のダイオードのアノード側に第３のダイオードを
介してマイクロコンピュータを接続したことを特徴とす
るマイクロコンピュータのバックアップ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63254361A JPH02100708A (ja) | 1988-10-07 | 1988-10-07 | マイクロコンピユータのバツクアツプ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63254361A JPH02100708A (ja) | 1988-10-07 | 1988-10-07 | マイクロコンピユータのバツクアツプ回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02100708A true JPH02100708A (ja) | 1990-04-12 |
Family
ID=17263921
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63254361A Pending JPH02100708A (ja) | 1988-10-07 | 1988-10-07 | マイクロコンピユータのバツクアツプ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02100708A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5519269B2 (ja) * | 1977-09-22 | 1980-05-24 |
-
1988
- 1988-10-07 JP JP63254361A patent/JPH02100708A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5519269B2 (ja) * | 1977-09-22 | 1980-05-24 |
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