JPH02148238A - データ処理装置 - Google Patents

データ処理装置

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JPH02148238A
JPH02148238A JP63302905A JP30290588A JPH02148238A JP H02148238 A JPH02148238 A JP H02148238A JP 63302905 A JP63302905 A JP 63302905A JP 30290588 A JP30290588 A JP 30290588A JP H02148238 A JPH02148238 A JP H02148238A
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足立 恒三
Takahiro Watabe
隆弘 渡部
Kozo Kimura
浩三 木村
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    • G06COMPUTING OR CALCULATING; COUNTING
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    • G06F9/00Arrangements for program control, e.g. control units
    • G06F9/06Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/30Arrangements for executing machine instructions, e.g. instruction decode
    • G06F9/38Concurrent instruction execution, e.g. pipeline or look ahead
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明はワードクロスを伴うロード/ストア命令を実行
するデータ処理装置に関するものである。
従来の技術 第4図は従来のデータ処理装置の構成図を示すものであ
り、1はデータを保持するデータバッフハ 7はレジス
タファイル1内のデータを転送するデータバスA、  
8はレジスタファイル1内のデータを転送するデータバ
スB1,9はデータを転送するデータバスY110は外
部データを転送する外部データバス、2はデータバスA
7とデータバス8を入力し演算を行い、その結果をデー
タバスY9に出力する演算装置、3はデータバスY9の
データを取込み保持するストアバッファ、4はストアバ
ッファ3の内容をアラインメントし外部データバス10
にデータを出力する出力データアライナ、14は外部デ
ータバス10のデータをアラインメントする入力データ
アライナ、13は入力データアライナ14の出力を取込
み保持する入力データバッフハ 12はデータバスY9
と入力データバッファ13の内容を選択するセレクタ、
11はレジスタファイル1と演算装置2とセレクタ12
を制御する実行制御装置、15はワードクロスを検出す
るワードクロス検出器、16aはワードクロス検出器1
5の結果を入力しロード命令時に入力データバソファ1
3と入力データアライナ14を制御する外部入力制御装
置、16bはワードクロス検出器15の結果を入力しス
トア命令時以上のよつに構成さrした促米の表置をこお
いも第5図に従ってその動作を説明する。まず、ロード
命令におけるワードクロス(アドレス:  n + 2
+サイズ: ワード)の場合には、ワードクロスをワー
ドクロス検出器15が検出しその結果を外部入力制御装
置16aに通知する。外部入力制御装置16aはアドレ
スとサイズの情報から入力データアライナ14を制御し
て第一ワード(n番地)をアラインメントし入力データ
バッファ13に書込む。
外部入力制御装置16aはそのままワードクロスの状態
を保持し第二ワード(n+4番地)のアラインメントを
制御し、アラインメントされたデータカ入力データバッ
ファ13に書込まれる。その後入力データバッファ13
の内容がセレクタ12を経て内部に転送されレジスタフ
ァイル1にデータが書込まれる。
また、ストア命令時のワードクロスの場合には、ワード
クロスをワードクロス検出器15が検出しその結果を外
部出力制御装置18bに通知する。
外部出力制御装置16bは、ロード命令時のワードクロ
スの場合と同様にして、第二ワードの処理が終了するま
でワードクロスの状態を保持して、ストアバッファ3の
内容をアラインメントされた第一ワード及び第二ワード
を外部データバスに出力する。
このため、ワードクロスが発生した場合は実行制御装置
11とは独立に外部入力制御装置16a。
外部出力制御装置16bがワードクロスの状態を保持し
てデータの処理を行うため、ワードクロスを伴うロード
/ストア命令実行時の制御が困難になり、実行制御装置
11との整合性も問題になる。
また外部入出力装置(3,4,13,14)のテスタビ
リティも下がってしまう。
発明が解決しようとする課題 このように上記のような構成では、ワードクロスが発生
した場合は外部入力制御装置、外部出力制御装置におい
てワードクロスの状態を保持してデータの処理を行わな
ければならす、ロード/ストア命令実行時の制御が困難
になるし、またテスタビリティが下がってしまうという
課題を仔していた。
本発明はかかる点に鑑み、ワードクロス発生時のロード
/ストア命令をより簡単に実行できるデータ処理装置を
提供することを目的とする。
課題を解決するための手段 本発明はデータを格納するレジスタファイルと、前記レ
ジスタファイルからの入力データを演算する演算装置と
、前記演算装置で得られた結果を保持するストアバッフ
ァと、前記ストアバッファの内容をアラインメン]・シ
て外部にデータを送出する出力データアライナと、外部
からのデータをアラインメントして内部にデータを送出
する入力データアライナと、前記データアライナの出力
と前記演算装置の演算結果をバイト単位で選択し前記レ
ジスタファイルにデータを送出するバイトセレクタと、
ワードクロスを検出するワードクロス検出器と、前記ワ
ードクロス検出器と接続されワードクロスを伴うロード
命令及び通常のロード命令を実行する時に前記レジスタ
ファイルと前記演算装置と前記入力データアライナと前
記バイトセレクタを制御するロード制御装置と、前記ワ
ードクロス検出器と接続されワードクロスを伴うストア
命令及び通常のストア命令を実行する時に前記レジスタ
ファイルと前記演算装置と前記出力データアライナと前
記ストアバッファを制御するストア制御装置とを備えた
データ処理装置である。。
作   用 本発明は前記した構成により、ロード制御装置及びスト
ア制御装置がワードクロスの状態を管理してデータバス
部全体を制御することで、ワードクロスを伴うロード/
ストア命令を簡単に実行することができる。
実施例 第1図は本発明の実施例におけるデータ処理装置の構成
図である。第1図において、1はデータを保を寺するレ
ジスタファイル、7はレジスタファイル1内のデータを
転送するデータバスA、8はレジスタファイル1内のデ
ータを転送するデータバスB、  9はデータを転送す
るデータバスY110は外部データを転送する外部デー
タバス、2はデータバスA7とデータバスB8を入力し
演算を行い、その結果をデータバスY9に出力する演算
回路、3はデータバスY9のデータを取込み保持するス
トアバッファ、4はストアバッファ3の内容をアライン
メントし外部データバス10にデータを出力する出力デ
ータアライナ、5は外部データバス10のデータのアラ
インメント機能ををし、アラインメントされたデータと
データバスY9とをバイト単位に選択しレジスタファイ
ル1にデータを送出するバイトセレクタ、15はワード
クロスを検出するワードクロス検出器、6aはワードク
ロス検出器15の結果を入力しロード命令時にレジスタ
ファイル1と演算装置2とバイトセレクタ5を制御する
ロード制御装置、6bはワードクロス検出器15の結果
を入力しストア命令時にレジスタファイル1と演算装置
2とストアバッファ3と出力データアライナ4を制御す
るストア制御装置、17はバイトセレクタ5の出力から
フラグを生成するフラグ生成装置である。
以上のように構成された本実施例について、以下第2図
に従ってその動作を説明する。
まず、ロード命令におけるワードクロス(アドレス:n
+2.  サイズ; ワード)の場合には、ワードクロ
スをワードクロス検出器15が検出しその結果をロード
制御装置6aに通知する。ロード制御装置6aはアドレ
スとデータのサイズの情報からノくイトセレクタ5を制
御して第一ワード(n番地)をアラインメントしTR(
レジスタファイル中のテンポラリレジスタ)に書込む。
次に第二ワード(n+4番地)の処理では外部データバ
ス10のデータをアラインメントする一方、レジスタフ
ァイル1からTRの内容が読出されて演算装置2を通過
してデータバスY9に出力され、バイトセレクタ5で有
効なデータが生成されレジスタファイル1にデータが書
込まれる。このときに必要となるフラグがフラグ生成装
置17で生成される。
また、ストア命令時のワードクロスの場合には、ワード
クロスをワードクロス検出器15が検出しその結果をス
トア制御装置6bに通知する。ストア制御装置6bは、
レジスタファイル1から出力データを読出して演算装置
2を通過してストアノくッファ3に格納する。次に、ス
トアバッファ3の内容をアラインメントして第一ワード
及び第二ワードを外部データバスに出力する。
以」二のように、本実施例によれば、ロード命令時ニロ
ード制御装置6aがデータバス部(1,2,5)全制御
する構成により、外部データ入力装置の構成が簡単(入
力データバス部ァが不要)になり、クリティカルパスを
軽減することができる。また、ストア命令時にストア制
御装置6bがデータバス部(+、2,3.4)を制御す
る構成により、ロード/ストア命令実行時にはロード制
御装置6a又はストア制御装置6bがデータバス部(1
,2,3,4,5)の状態を常に管理することになるた
め、テスタビリティも向上する。
第3図は本発明の第2の実施例を示すデータ処理装置の
制御装置の構成図である。第3図において、60はマイ
クロコマンド生成装置、61はマイクロコマンドデコー
ド装置である。
以上のように構成された本実施例について、以下その動
作を説明する。
マイクロコマンド生成装置60で生成されたマイクロコ
マントハマイクロコマンドデコード装置61においてデ
コードされ、その結果がロード制御装置6a又はストア
制御装置6bに送られデータバス部(1,2,3,4,
5)に対する制御信号を生成する。
特にワードクロスを伴うロード/ストア命令を実行する
ためのマイクロコマンドについて次に説明する。
ワードクロスを伴うロード/ストア命令を実行するため
のマイクロコマンドとしては例えば以下の4コマンドが
必要になる。それぞれの動作は第1図で説明したものと
一致する。
1)ロード実行 第1ワード処理 : LDWCI2)
ロード実行 第2ワード処理 : LDWC23)スト
ア実行 第1ワード処理 : 5TWCI4)ストア実
行 第2ワード処理 : 5TWC2従って、ロード命
令実行時のワードクロスの場合にはLDWCI 、LD
WC2を実行すればよく、ストア命令実行時のワードク
ロスの場合には5TWCI 、5TWC2を実行すれば
よい。このため、ロード/ストア命令でのバスリトライ
動作もマイクロコマンドを生成するだけで簡単に実行で
きる。また、上記の4動作(LDWCI 、LDWC2
,5TWCI 、5TWC2)をマイクロコマンドで単
独にテストすることもできるため、テスタビリティは高
い。
以上のように、本実施例によれば、外部入出力部を含む
データバス部は全てマイクロコマンドで制御されるため
、ロード/ストア命令に関する全ての処理をマイクロコ
マンドで簡単に実行でき、データバス部のテスタビリテ
ィはさらに向上する。
発明の詳細 な説明したように、本発明によれば、ロード制御装置が
ロード命令時の処理をストア制御装置がストア命令時の
処理を全て制御する構成により、外部データ入力部の構
成が簡単(ハードウェアが削減)になりしかもクリティ
カルパスを軽減することができる。また、マイクロコマ
ンドにより制御を行う場合は、ワードクロスも含めてロ
ード/ストア命令に関する全ての処理をマイクロコマン
ドで簡単に実行できるため、テストもマイクロコマンド
を実行するだけで容易に実行することができ、そのテス
タビリティも高くなり、その実用的効果は大きい。
【図面の簡単な説明】
第1図は本発明の一実施例の構成を示すブロック図、第
2図は第1図のロード命令ワードクロス動作説明図、第
3図は本発明の他の実施例の制御装置の構成を示す構成
図、第4図は従来の構成を示す構成図、第5図は第4図
のロード命令ワードクロス動作説明図である。 1・・・レジスタファイル、2・・・演算装置、3・・
・ストアバッファ%  4・”出力データアライナ、5
・・・バイトセレクタ、6a・・・ロード制御装置、6
b・・・ストア制御装置、7・・・データバスA18・
・・データバスB19・・・データバスY110・・・
外部データバス、11・・・実行制御装置、12・・・
セレクタ、13・・・入力データバス部ハ14・・・入
力データアライナ、 15・・・ワードクロス検出器、 16a・・・外部入力制御装置、 工6b・・・外部出力制御装置、 60・・・マイクロコマンド生成装置、61・・・マイ
クロコマンドデフード装置。 代理人の氏名 弁理士 粟野重孝 はか1名第 】 図 第 図 第 図 メモソよのデータ徨亙 第 図

Claims (2)

    【特許請求の範囲】
  1. (1)データを格納するレジスタファイルと、前記レジ
    スタファイルからの入力データを演算する演算装置と、
    前記演算装置で得られた結果を保持するストアバッファ
    と、前記ストアバッファの内容をアラインメントして外
    部にデータを送出する出力データアライナと、外部から
    のデータをアラインメントして内部にデータを送出する
    入力データアライナと、前記データアライナの出力と前
    記演算装置の演算結果をバイト単位で選択し前記レジス
    タファイルにデータを送出するバイトセレクタと、ワー
    ドクロスを検出するワードクロス検出器と、前記ワード
    クロス検出器と接続されワードクロスを伴うロード命令
    及び通常のロード命令を実行する時に前記レジスタファ
    イルと前記演算装置と前記入力データアライナと前記バ
    イトセレクタを制御するロード制御装置と、前記ワード
    クロス検出器と接続されワードクロスを伴うストア命令
    及び通常のストア命令を実行する時に前記レジスタファ
    イルと前記演算装置と前記出力データアライナと前記ス
    トアバッファを制御するストア制御装置とを備えたデー
    タ処理装置。
  2. (2)ロード制御装置とストア制御装置がマイクロコマ
    ンドにより制御される構成である請求項1記載のデータ
    処理装置。
JP63302905A 1988-11-30 1988-11-30 データ処理装置 Expired - Fee Related JPH0760408B2 (ja)

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH08504977A (ja) * 1992-09-29 1996-05-28 セイコーエプソン株式会社 スーパースカラ・マイクロプロセサにおけるロード及び/又はストア動作を扱うシステム及び方法
US6957320B2 (en) 1992-09-29 2005-10-18 Seiko Epson Corporation System and method for handling load and/or store operations in a superscalar microprocessor

Cited By (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH08504977A (ja) * 1992-09-29 1996-05-28 セイコーエプソン株式会社 スーパースカラ・マイクロプロセサにおけるロード及び/又はストア動作を扱うシステム及び方法
JP2000148483A (ja) * 1992-09-29 2000-05-30 Seiko Epson Corp コンピュ―タシステム
JP2000148491A (ja) * 1992-09-29 2000-05-30 Seiko Epson Corp マイクロコンピュ―タシステム
US6957320B2 (en) 1992-09-29 2005-10-18 Seiko Epson Corporation System and method for handling load and/or store operations in a superscalar microprocessor
US6965987B2 (en) 1992-09-29 2005-11-15 Seiko Epson Corporation System and method for handling load and/or store operations in a superscalar microprocessor
US7000097B2 (en) 1992-09-29 2006-02-14 Seiko Epson Corporation System and method for handling load and/or store operations in a superscalar microprocessor
US7447876B2 (en) 1992-09-29 2008-11-04 Seiko Epson Corporation System and method for handling load and/or store operations in a superscalar microprocessor

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