JPH02224238A - プラズマ処理装置 - Google Patents

プラズマ処理装置

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Publication number
JPH02224238A
JPH02224238A JP4297789A JP4297789A JPH02224238A JP H02224238 A JPH02224238 A JP H02224238A JP 4297789 A JP4297789 A JP 4297789A JP 4297789 A JP4297789 A JP 4297789A JP H02224238 A JPH02224238 A JP H02224238A
Authority
JP
Japan
Prior art keywords
cathode
sample
semiconductor substrate
high frequency
earth
Prior art date
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Pending
Application number
JP4297789A
Other languages
English (en)
Inventor
Yutaka Omoto
豊 大本
Yutaka Kakehi
掛樋 豊
Keiji Ueyama
植山 啓治
Yoshinao Kawasaki
義直 川崎
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Ltd
Original Assignee
Hitachi Ltd
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Publication date
Application filed by Hitachi Ltd filed Critical Hitachi Ltd
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Publication of JPH02224238A publication Critical patent/JPH02224238A/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、プラズマ処理装置に係り、特に半導体素子基
板等の試料をプラズマを利用して処理するのに好適なプ
ラズマ処理装置に関するものである。
〔従来の技術〕
従来のプラズマ処理装置では、例えば、特開昭59−1
63827号公報に記載のように、電極と試料との間に
絶縁物が介在させられている。
〔発明が解決しようとする課題〕
上記従来技術は、処理終了時の放電について配慮がされ
ておらず、処理中に試料を電極の間に蓄積された電荷の
放電が試料上とプラズマとの間での放電に追従しない場
合には、試料内の絶縁物質を電気的に劣化または破壊し
てしまうという問題があつた。
本発明の目的は、試料内の絶壊物質の電気的な劣化また
は破壊を防止できるプラズマ処理装置を提供することに
あム。
〔課題を解決するだめの手段〕
上記目的は、プラズマ処理装置を、電圧が印加される試
料台と該試料台に設置される試料とを短絡させ、前記試
料台を能動素子を介してアースに接続したものとするこ
とにより、達成される。
〔作   用〕
電圧が印加される試料台と試料とを短絡することによっ
て、試料裏面に蓄積される電荷を試料台側で放電できる
。試料台とアースの間に接続した能動素子は放電電流を
時間制御する。それによって、処理中および処理終了時
に試料の表面う裏面との間の電位差を小さくし、試料内
の絶縁物質の劣化または破壊をおこすことがない。
〔実 施 例〕
以下、本発明の一実施例を第1図、第2図により説明す
る。第1図は放電によりプラズマを発生させて試料、例
えば、半導体基板をエツチング加工するドライエツチン
グ装置である。反応容器lはガス導入口2と排気口3を
持ち、反応性ガスを導入しながら排気することによって
定常の低圧雰囲気に保持されている。半導体基板4を載
置する電極であるカソード5はカブプリングキャパシタ
6、マツチングボックス7を介して高周波電111ft
8に接続されている。カソード5は絶縁物からなる支持
材nによって反応容器1に取り付けられている。高周波
電#8によってカソード5とアノード11との間に高周
波電界を導入すると放電によりプラズマが発生し、半導
体基板4をエツチング加工する。カソード5は抵抗値の
高い、例えば、5ic(炭化珪素)からなり、熱媒14
によって温調された温調部材13によって一定[tに保
たれている。
また、カソード5は能動素子であるMO8FgT9を介
して接地されており、MO8FBT9のゲートは制御回
路lOに接続されている。高周波電源8によってカソー
ド5とアノード11の間に高周波電界を導入すると放電
によりプラズマが発生し、半導体基板4をニー/チング
加工する。対アース容量であるカブプリングキャパシタ
6等にプラズマから流れ込んだ電荷によってカソード3
はアース電位に対しである負電位となる。この電荷は、
カソード5の対アース抵抗が温調部材13によって高く
保たれているのでMO8FgT9を介してのみ流れる。
以下、本実施例によるMO8FgT9の制御回路10に
よる制御方法の一例を示す。プラズマ処理開始時から処
理中はMO8FBT9をカプトオフさせ、半導体基板4
の表面の絶縁膜上とカソード5の電位を一定に保つこと
によって、半導体基板4上の絶縁膜にかかる電界を小さ
くする。
プラズマ処理終了時高周波1[111it8の出力の低
下とともに、プラズマは減衰しはじめる。この時、カソ
ード5の対アース容量に蓄積された電荷をMO8FgT
9によって第2図に示すようにプラズマの減衰にあわせ
て放電させることにより、半導体基板4の表面の絶縁膜
上とカソード5の電位差を小さくでき、半導体基板4上
の絶縁膜の耐圧劣化、破壊を防止できる。なお、第2図
で、aは、プラズマの減衰に伴う絶縁膜上の電位、bは
、制御された電極電位、Cは、制御なしの電極電位であ
り、tlは、尚周波を源オフ時間、Vlは、高周波電源
オフ時の電位である。
〔発明の効果〕
本発明によれば、試料内絶縁物質に与える電気的な損傷
を減少させることができるので、試料を効率よく生産で
きる効果がある。
【図面の簡単な説明】
第1図は本発明の一実施例のドライエツチング装置の要
部縦断面図、!2図は電位の時間変化を示す模式図であ
る。 4・・・・・・半導体素子基板、5・・・・・・カソー
ド、9・・・MO8FET、10・・−・・制御回路、
13・・・・・・温調部材代理人 弁理士  小 川 
勝 男 2.4−1導体港状 5−−−一カゾード ターーーーN05  FET

Claims (1)

    【特許請求の範囲】
  1. 1、電圧が印加される試料台と該試料台に設置される試
    料とを短絡させ、前記試料台を能動素子を介してアース
    に接続したことを特徴とするプラズマ処理装置。
JP4297789A 1989-02-27 1989-02-27 プラズマ処理装置 Pending JPH02224238A (ja)

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JP4297789A JPH02224238A (ja) 1989-02-27 1989-02-27 プラズマ処理装置

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JP4297789A JPH02224238A (ja) 1989-02-27 1989-02-27 プラズマ処理装置

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Publication Number Publication Date
JPH02224238A true JPH02224238A (ja) 1990-09-06

Family

ID=12651102

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JP4297789A Pending JPH02224238A (ja) 1989-02-27 1989-02-27 プラズマ処理装置

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JP (1) JPH02224238A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0837218A (ja) * 1994-07-25 1996-02-06 Sanyo Electric Co Ltd 半導体装置の製造方法

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0837218A (ja) * 1994-07-25 1996-02-06 Sanyo Electric Co Ltd 半導体装置の製造方法

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