JPH02253236A - 非線形抵抗素子の製造方法 - Google Patents
非線形抵抗素子の製造方法Info
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- JPH02253236A JPH02253236A JP1075565A JP7556589A JPH02253236A JP H02253236 A JPH02253236 A JP H02253236A JP 1075565 A JP1075565 A JP 1075565A JP 7556589 A JP7556589 A JP 7556589A JP H02253236 A JPH02253236 A JP H02253236A
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Classifications
-
- G—PHYSICS
- G02—OPTICS
- G02F—OPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
- G02F1/00—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
- G02F1/01—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour
- G02F1/13—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour based on liquid crystals, e.g. single liquid crystal display cells
- G02F1/133—Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
- G02F1/136—Liquid crystal cells structurally associated with a semi-conducting layer or substrate, e.g. cells forming part of an integrated circuit
- G02F1/1362—Active matrix addressed cells
- G02F1/1365—Active matrix addressed cells in which the switching element is a two-electrode device
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
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Description
【発明の詳細な説明】
[産業上の利用分野J
本発明は、液晶等と組み合わせて画像表示装置を構成す
る非線形抵抗素子の製造方法に関する。
る非線形抵抗素子の製造方法に関する。
〔発明の概゛要]
本発明は、非線形抵抗素子の製造方法において非線形抵
抗素子形成後、再度、画素電極と金属膜をエツチングす
る工程を行なうことによって、画素電極間のショート、
金属膜のエッチ残りを除去し、画素欠陥の発生を抑制し
、歩留まり向上に寄与するものである。
抗素子形成後、再度、画素電極と金属膜をエツチングす
る工程を行なうことによって、画素電極間のショート、
金属膜のエッチ残りを除去し、画素欠陥の発生を抑制し
、歩留まり向上に寄与するものである。
従来の非線形抵抗素子の要部の平面図を第3図(a)に
示し、第3図(b)にそのx−x’線断面図を示す、ガ
ラス、石英等の透明絶縁基板l上に、インジウム−錫酸
化物(ITO)等の透明導電膜からなる画素電極2を1
回目のフォトリングラフィにて形成し1次に非線形抵抗
膜3を積層して2回目のフォトリングラフィにてパター
ン形成する0次に行または列電極となるCr、AA等の
金属膜4をスパッタ等で積層して、3回目のフォトリソ
グラフィにて形成している。
示し、第3図(b)にそのx−x’線断面図を示す、ガ
ラス、石英等の透明絶縁基板l上に、インジウム−錫酸
化物(ITO)等の透明導電膜からなる画素電極2を1
回目のフォトリングラフィにて形成し1次に非線形抵抗
膜3を積層して2回目のフォトリングラフィにてパター
ン形成する0次に行または列電極となるCr、AA等の
金属膜4をスパッタ等で積層して、3回目のフォトリソ
グラフィにて形成している。
このような従来の非線形抵抗素子の製造方法においては
、画素電極2、金属膜4をフォトリングラフィにて形成
時、基板に付着したゴミや、マスクに付着したゴミある
いは、レジスト中に混入したゴミ等によって、基板全体
に所望のパターンが得られない不都合がしばしばある。
、画素電極2、金属膜4をフォトリングラフィにて形成
時、基板に付着したゴミや、マスクに付着したゴミある
いは、レジスト中に混入したゴミ等によって、基板全体
に所望のパターンが得られない不都合がしばしばある。
すなわち、第351(a)に示すように、ゴミの付着等
によって画素電極2間がショート5.あるいはエッチ残
り6が形成される。また、金属膜4のエッチ残り7が形
成される。
によって画素電極2間がショート5.あるいはエッチ残
り6が形成される。また、金属膜4のエッチ残り7が形
成される。
[発明が解決しようとする課題]
このように形成された基板で液晶等と組み合わせて画像
表示装置を構成すると、所望する所以外の画素に信号が
書き込まれたり、あるいは画素電極2間のショート5に
よって、となりの画素まで信号が書き込まれたりする欠
陥が発生した。
表示装置を構成すると、所望する所以外の画素に信号が
書き込まれたり、あるいは画素電極2間のショート5に
よって、となりの画素まで信号が書き込まれたりする欠
陥が発生した。
非線形抵抗素子は、液晶と組み合わされ、画像表示装置
等として応用されるものである0通常。
等として応用されるものである0通常。
基板上に多数の非線形抵抗素子が構成されるものであり
、非線形抵抗素子群を有する基板の製造歩留まりを向上
することが課題となっていた。
、非線形抵抗素子群を有する基板の製造歩留まりを向上
することが課題となっていた。
[課題を解決するための手段]
上記課題を解決するために本発明は、非線形抵抗素子形
成後、再度画素電極と金属膜をエツチングする工程を実
施するものである。
成後、再度画素電極と金属膜をエツチングする工程を実
施するものである。
〔作用]
上記のように、画素電極と金属膜を再度エツチングする
ことによって、画素電極と金属膜なフォトリソグラフィ
で形成時に生じるゴミ等に起因するエッチ残り、あるい
は画素間のショートを抑制することができる。従ってプ
ロセス歩留まりが向上し、製造コストの低減と信頼性の
高い非線形抵抗素子を実現するものである。
ことによって、画素電極と金属膜なフォトリソグラフィ
で形成時に生じるゴミ等に起因するエッチ残り、あるい
は画素間のショートを抑制することができる。従ってプ
ロセス歩留まりが向上し、製造コストの低減と信頼性の
高い非線形抵抗素子を実現するものである。
〔実施例J
以下に1本発明の実施例を図面に基づいて説明する。
第1図及び第2図は5本発明の一実施例を示す非線形抵
抗素子の製造工程順の平面図及びX−X′線断面図を示
す。
抗素子の製造工程順の平面図及びX−X′線断面図を示
す。
第1図(a)及び第2図(a)は、ガラス、石英等の透
明絶縁体からなる基板l上に、ITO等の透明導電性被
膜を成膜し、1回目のフォトリソグラフィ(レジストコ
ート−マス2合わせ→露光→現像→エツチング→レジス
ト剥離)によって、画素電極2を形成する。1回目のフ
ォトリングラフィ工程以前あるいは工程中に付着したゴ
ミ、マスクに付着したゴミ、レジスト中に混入したゴミ
、エツチング時に付着したゴミ等によって、画素電極間
のショート部5、あるいはエッチ残り部6が発生するこ
とがある。
明絶縁体からなる基板l上に、ITO等の透明導電性被
膜を成膜し、1回目のフォトリソグラフィ(レジストコ
ート−マス2合わせ→露光→現像→エツチング→レジス
ト剥離)によって、画素電極2を形成する。1回目のフ
ォトリングラフィ工程以前あるいは工程中に付着したゴ
ミ、マスクに付着したゴミ、レジスト中に混入したゴミ
、エツチング時に付着したゴミ等によって、画素電極間
のショート部5、あるいはエッチ残り部6が発生するこ
とがある。
第1図(b)及び第2図(b)は、プラズマCVD装置
やスパッター装置等によって非線形抵抗膜3を成膜後、
連続してスパッタ装置等によって金属膜4を成膜し、2
回目のフォトリングラフィによって金属膜4と非線形抵
抗113をバターニングした状態を示す、なお2回目の
フォトリングラフィ工程は、金属膜4のパターンが非線
形抵抗膜3の内側になるようにする。また本実施例では
、非線形抵抗膜3は化学量論比よりもシリコン含有量の
多いシリコン酸化膜、シリコン窒化膜または炭化シリコ
ン膜を使用した。また、金属膜4はCrあるいはp、t
2−S illを使用した。なお金属膜4のエッチ残り
部7は、ゴミ等によって発生する。従来の非線形抵抗素
子はここで完成する。
やスパッター装置等によって非線形抵抗膜3を成膜後、
連続してスパッタ装置等によって金属膜4を成膜し、2
回目のフォトリングラフィによって金属膜4と非線形抵
抗113をバターニングした状態を示す、なお2回目の
フォトリングラフィ工程は、金属膜4のパターンが非線
形抵抗膜3の内側になるようにする。また本実施例では
、非線形抵抗膜3は化学量論比よりもシリコン含有量の
多いシリコン酸化膜、シリコン窒化膜または炭化シリコ
ン膜を使用した。また、金属膜4はCrあるいはp、t
2−S illを使用した。なお金属膜4のエッチ残り
部7は、ゴミ等によって発生する。従来の非線形抵抗素
子はここで完成する。
第1図(C)及び第2図(c)は、3回目のフォトリン
グラフィ工程の現像後の状態を示す、レジスト8は、非
線形抵抗素子を構成する画素電極2、非線形抵抗膜3、
金属膜4をカバーするように形成されている。
グラフィ工程の現像後の状態を示す、レジスト8は、非
線形抵抗素子を構成する画素電極2、非線形抵抗膜3、
金属膜4をカバーするように形成されている。
第1図(d)及び第2図(d)は、画素電極間のショー
ト部5.エッチ残り部6.金MIII4のエッチ残り部
7をエツチングして、レジストを剥離した状態を示す1
本実施例では1画素電極2としてITO膜、金属膜4と
してCr膜を使用したので、金属膜4のエッチ残り部7
のエツチングとして混酸(過塩素酸中硝酸第二セリウム
アンモン+水)を使用して金属膜4をエツチングした時
と同条件でエツチングした。また画素電極2のショート
部5とエッチ残り部6のエツチングとして塩化第二鉄と
塩酸の混合液で、画素電極2をエツチングした時と同条
件でエツチングした。第1図(d)及び第2図(d)か
ら分るように1画素電極2間のショート部5、金1iE
Ili4のエッチ残り部7が除去される。
ト部5.エッチ残り部6.金MIII4のエッチ残り部
7をエツチングして、レジストを剥離した状態を示す1
本実施例では1画素電極2としてITO膜、金属膜4と
してCr膜を使用したので、金属膜4のエッチ残り部7
のエツチングとして混酸(過塩素酸中硝酸第二セリウム
アンモン+水)を使用して金属膜4をエツチングした時
と同条件でエツチングした。また画素電極2のショート
部5とエッチ残り部6のエツチングとして塩化第二鉄と
塩酸の混合液で、画素電極2をエツチングした時と同条
件でエツチングした。第1図(d)及び第2図(d)か
ら分るように1画素電極2間のショート部5、金1iE
Ili4のエッチ残り部7が除去される。
以上のように、非線形抵抗素子が形成された後に、表示
に必要な部分を再度レジストで覆い、導電性の材料のみ
をそれぞれの前工程と同じ条件でエツチングを行ない、
不要部分を除去するようにした。
に必要な部分を再度レジストで覆い、導電性の材料のみ
をそれぞれの前工程と同じ条件でエツチングを行ない、
不要部分を除去するようにした。
〔発明の効果1
本発明は、以上説明したように非線形抵抗素子の製造方
法において、非線形抵抗素子形成後、再度、画素電極と
金属膜のエッチ残り部やショート部をエツチングするこ
とによって、画素電極間のショートや、金属膜のエッチ
残りを除去でき、画素欠陥の発生を抑制し、歩留まり向
上に効果が大きい。
法において、非線形抵抗素子形成後、再度、画素電極と
金属膜のエッチ残り部やショート部をエツチングするこ
とによって、画素電極間のショートや、金属膜のエッチ
残りを除去でき、画素欠陥の発生を抑制し、歩留まり向
上に効果が大きい。
第1図(a)〜(d)は本発明にかかる非線形抵抗素子
の製造工程順平面図を示し、第2図(a)〜(d)は本
発明にかかる非線形抵抗素子の製造工程順を示す断面図
、第3図(a)、(b)は従来の非線形抵抗素子の平面
図と断面図である。 第 1 図 ・基板 ・画素電極 ・非線形抵抗膜 ・金属膜 ・画素電極間のショート部 ・エッチ残り部 ・金属膜のエッチ残り部 ・レジスト 出願人 セイコー電子工業株式会社
の製造工程順平面図を示し、第2図(a)〜(d)は本
発明にかかる非線形抵抗素子の製造工程順を示す断面図
、第3図(a)、(b)は従来の非線形抵抗素子の平面
図と断面図である。 第 1 図 ・基板 ・画素電極 ・非線形抵抗膜 ・金属膜 ・画素電極間のショート部 ・エッチ残り部 ・金属膜のエッチ残り部 ・レジスト 出願人 セイコー電子工業株式会社
Claims (1)
- 絶縁性基板上に、透明導電性被膜からなる画素電極と、
非線形抵抗膜と、金属膜とを積層構造とする非線形抵抗
素子の製造方法において、非線形抵抗素子形成後、再度
、画素電極と金属膜をエッチングする工程を含んだこと
を特徴とする非線形抵抗素子の製造方法。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1075565A JPH02253236A (ja) | 1989-03-28 | 1989-03-28 | 非線形抵抗素子の製造方法 |
| EP90303113A EP0393851A1 (en) | 1989-03-28 | 1990-03-22 | A method of manufacturing a non-linear resistive element array |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1075565A JPH02253236A (ja) | 1989-03-28 | 1989-03-28 | 非線形抵抗素子の製造方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02253236A true JPH02253236A (ja) | 1990-10-12 |
Family
ID=13579832
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1075565A Pending JPH02253236A (ja) | 1989-03-28 | 1989-03-28 | 非線形抵抗素子の製造方法 |
Country Status (2)
| Country | Link |
|---|---|
| EP (1) | EP0393851A1 (ja) |
| JP (1) | JPH02253236A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| GB2244860A (en) * | 1990-06-04 | 1991-12-11 | Philips Electronic Associated | Fabricating mim type device array and display devices incorporating such arrays |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61151541A (ja) * | 1984-12-25 | 1986-07-10 | Citizen Watch Co Ltd | 液晶表示パネル用電極基板の製造方法 |
-
1989
- 1989-03-28 JP JP1075565A patent/JPH02253236A/ja active Pending
-
1990
- 1990-03-22 EP EP90303113A patent/EP0393851A1/en not_active Withdrawn
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61151541A (ja) * | 1984-12-25 | 1986-07-10 | Citizen Watch Co Ltd | 液晶表示パネル用電極基板の製造方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| EP0393851A1 (en) | 1990-10-24 |
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