JPH02280256A - Detecting system for connecting position - Google Patents

Detecting system for connecting position

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Publication number
JPH02280256A
JPH02280256A JP10224189A JP10224189A JPH02280256A JP H02280256 A JPH02280256 A JP H02280256A JP 10224189 A JP10224189 A JP 10224189A JP 10224189 A JP10224189 A JP 10224189A JP H02280256 A JPH02280256 A JP H02280256A
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JP
Japan
Prior art keywords
adapter
control
section
adaptor
signal
Prior art date
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Pending
Application number
JP10224189A
Other languages
Japanese (ja)
Inventor
Tatsuya Kitajima
北島 竜也
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP10224189A priority Critical patent/JPH02280256A/en
Publication of JPH02280256A publication Critical patent/JPH02280256A/en
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Abstract

PURPOSE:To freely decide the arrangement of each adaptor part by cascade- connecting a signal line for position dettection of (n) bits to each adaptor part, and shifting a position detecting signal sent to the signal line by every bit at each adaptor part. CONSTITUTION:The control part Fo of a processor part Po sens a control signal, etc., to the control parts Foo, Fo1, Fo2.... of the adaptor parts Aoo, A01, Ao2... via an internal bus Boi consisting of plural signal lines, and an adaptor part number is attached on the control signal so as to identify to which adaptor part it corresponds. The control part of each adaptor part compares a sent adaptor part number attached on the control signal with the connecting position number of its own, and performs internal control when coincidence is obtained. Thus, the adaptors Aoo-A07 can detect to which position it is connected in the inside of a unit Co and the processor part Po controls each adaptor part individually, which eliminates such limitation that the unit can only be connected in a decided connecting mode.

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、プロセッサ部とこれにより制御、される複数
のアダプタ部とから構成される情報処理装置に利用する
DETAILED DESCRIPTION OF THE INVENTION [Industrial Application Field] The present invention is applied to an information processing device that includes a processor section and a plurality of adapter sections controlled by the processor section.

〔概要〕〔overview〕

本発明は、ひとつのプロセッサ部に内部バスにより縦続
接続された複数のアダプタ部のそれぞれに設けられた制
御部が、内部バス上の接続位置を検出する方式において
、 各アダプタ部にnビットの位置検出用の信号線を縦続接
続し、これに送出される位置検出信号を各アダプタ部で
1ビットづつシフトするようにすることにより、 各アダプタ部の配置を自由に決定できるようにしたもの
である。
The present invention provides a system in which a control section provided in each of a plurality of adapter sections connected in cascade to one processor section via an internal bus detects the connection position on the internal bus. By cascade-connecting detection signal lines and shifting the position detection signal sent to these lines by 1 bit at each adapter section, the arrangement of each adapter section can be determined freely. .

〔従来の技術〕[Conventional technology]

従来の技術としては、あらかじめ決められた実装形態に
従って、プロセッサ部に対する各アダプタ部の位置を決
定するか、あるいはスイッチ手段などを設定して接続位
置を検出していた。
In the conventional technology, the position of each adapter part with respect to the processor part is determined according to a predetermined implementation form, or the connection position is detected by setting a switch means or the like.

〔発明が解決しようとする問題点〕[Problem that the invention seeks to solve]

しかし、従来の接続位置の検出方式では、あらかじめ決
められた接続位置にしか接続できないのでシステムの構
築が限定されてしまうという欠点がある。また、スイッ
チ手段などを設定することにより位置番号を決定するも
のでは、スイッチ手段の設定などに誤りが生じやすい欠
点がある。さらに、1つのプロセッサ部に同一のアダプ
タ部を複数台接続する場合、アダプタ部自体は同一のも
のであっても、スイッチ手段の設定が異なる。
However, the conventional connection position detection method has the drawback that it is possible to connect only to a predetermined connection position, which limits system construction. Furthermore, in the case where the position number is determined by setting the switch means, etc., there is a drawback that errors are likely to occur in the setting of the switch means. Furthermore, when a plurality of the same adapter sections are connected to one processor section, even if the adapter sections themselves are the same, the settings of the switch means are different.

本発明は、実際に接続される位置に拘束されることなく
、自由にアダプタ部を接続できる接続位置の検出方式を
提供することを目的とする。
SUMMARY OF THE INVENTION An object of the present invention is to provide a connection position detection method that allows an adapter part to be freely connected without being restricted to the actual connection position.

〔問題点を解決するための手段〕[Means for solving problems]

本発明は、ひとつのユニットに、ひとつのプロセッサ部
と、このプロセッサ部に内部バスにより縦続接続された
複数のアダプタ部とを含み、各アダプタ部には制御部を
備え、この制御部が自アダプタ部の内部バス上の接続位
置を検出する方式において、 内部バスに平行してnビット (nは2以上の整数)の
位置検出用の信号線を設け、各アダプタ部には、このn
ビットの信号線の前段からの入力値を検出して制御部に
与えるデコーダと、この前段からの入力値に1ビットの
シフトを与えて後段に宛て出力するエンコーダとを含み
、 プロセッサ部には、nビットの信号線に初期値を与える
位置信号発生回路を含むことを特徴とする。
According to the present invention, one unit includes one processor section and a plurality of adapter sections connected in cascade to the processor section via an internal bus, each adapter section is provided with a control section, and this control section is configured to control the own adapter. In the method of detecting the connection position on the internal bus of the adapter, an n-bit (n is an integer of 2 or more) position detection signal line is provided in parallel with the internal bus, and each adapter
The processor section includes a decoder that detects the input value from the previous stage of the bit signal line and supplies it to the control section, and an encoder that shifts the input value from the previous stage by 1 bit and outputs it to the subsequent stage. It is characterized by including a position signal generation circuit that provides an initial value to an n-bit signal line.

〔作用〕[Effect]

プロセッサ部から信号線に送出された位置信号の初期値
は縦続接続された最初のアダプタ部の制御部で1ビット
、シフトされて後段のアダプタ部の制御部に送られ、こ
の後段の制御部でこれをさらに1ビット、シフトされ、
次の後段の制御部に送出されるようになっている。すな
わち各制御部では入力された位置信号は1ビット、シフ
トされて出力される。したがって信号線の接続順序によ
り、各制御部はその接続位置を自ら検出できる。
The initial value of the position signal sent from the processor section to the signal line is shifted by 1 bit in the control section of the first adapter section connected in cascade and sent to the control section of the subsequent adapter section. This is further shifted by 1 bit,
The data is sent to the next subsequent control unit. That is, in each control section, the input position signal is shifted by 1 bit and output. Therefore, depending on the connection order of the signal lines, each control section can detect its connection position by itself.

〔実施例〕〔Example〕

次に本発明の実施例について図面を参照して説明する。 Next, embodiments of the present invention will be described with reference to the drawings.

第1図は本発明一実施例の要部のブロック構成図であり
、第2図は前記実施例の全体構成図である。
FIG. 1 is a block diagram of the essential parts of an embodiment of the present invention, and FIG. 2 is a diagram of the overall configuration of the embodiment.

本実施例では、ユニットC65C8が汎用バスCBによ
り接続され、ユニットco内にはひとつのプロセッサ部
P。の制御部F。と8組のアダプタ部A。8% A o
7のそれぞれの制御部F。a −F o tとが内部バ
スB。Q ””’ 806により縦続接続されている。
In this embodiment, units C65C8 are connected by a general-purpose bus CB, and one processor section P is included in the unit co. control unit F. and 8 sets of adapter part A. 8% Ao
7, each control unit F. a-F o t is internal bus B. Q ""' 806 cascades.

ここで本発明の特徴とするところは、この内部バスB0
゜〜BOYに平行して3ビットの位置検出用の信号線L
o1L1、L2を設け、各アダプタ部A o。−、A、
 o7にはこの3ビットの信号線り、 、L、、L2の
前段のプロセッサ部またはアダプタ部からの入力値を検
出して、これを位置番号として制御部Foo=Fotに
それぞれ与えるデコーダDoo−I)otと、この前段
からの入力値に1ビットのシフトを与えて後段に宛て出
力するエンコーダE。o ””’ E O7とを含み、
プロセッサ部P。の制御部F、には信号線Lo 、LI
、L2に初期値として「0」、「0」、「0」の位置信
号を発生する位置信号発生回路SG、を含むことにある
Here, the feature of the present invention is that this internal bus B0
~ Signal line L for 3-bit position detection parallel to BOY
o1L1 and L2 are provided, and each adapter part Ao. -,A,
o7 is a decoder Doo-I that detects the input value from the processor section or adapter section in the previous stage of L2, and supplies this to the control section Foo=Fot as a position number. ) ot, and an encoder E that applies a 1-bit shift to the input value from the previous stage and outputs it to the subsequent stage. o ""' E O7,
Processor section P. The control unit F has signal lines Lo and LI.
, L2 includes a position signal generation circuit SG that generates position signals of "0", "0", and "0" as initial values.

このユニットC8の構成は、共通バスCBで接続される
他のユニットC1においても同様である。
The configuration of this unit C8 is the same for other units C1 connected by the common bus CB.

第1図で、ユニッ)C8のアダプタ部A。7よりユニッ
トC1のプログラム部P1に信号線り。、LI 、L2
および内部バスB。フが引き込まれているように図示さ
れているが、これは各アダプタ部を同一の接続構造のも
のとしたためであって、プロセッサn P + に引き
込まれた端子部プロセッサ部P1の制御部F、に接続さ
れていない。さらに信号線り。SLl 、L2はひとつ
のユニット中のアダプタ部が8個であるために3本必要
であり、ひとつのユニット内に最大16個のアダプタ部
が接続される場合は4本必要となる。
In FIG. 1, adapter part A of unit C8. 7 to the program section P1 of the unit C1. , LI , L2
and internal bus B. Although the terminals are shown as being drawn in, this is because each adapter part has the same connection structure, and the control part F of the terminal part processor part P1 drawn into the processor n P + , not connected to. More signal lines. Three SL1 and L2 are required because there are eight adapter sections in one unit, and four are required when a maximum of 16 adapter sections are connected in one unit.

次に各アダプタ部がユニットに於ける接続位置をどのよ
うに検出するかを示す。まず、プロセッサ部Paは後段
のアダプタ部へ〇。に接続位置番号0を2進数で表示し
て出力する(「0」、「0」、「O」)。アダプタ部A
aoは入力された位置番号をデコーダD0゜で2進数か
ら10進数にデコードする。デコードされた位置番号に
より、アダプタ部Aoaの制御部F。0は自己の位置を
0番と認識する。
Next, we will show how each adapter section detects the connection position in the unit. First, the processor part Pa goes to the adapter part in the latter stage. The connection position number 0 is displayed in binary and output ("0", "0", "O"). Adapter part A
In ao, the input position number is decoded from a binary number to a decimal number by a decoder D0°. According to the decoded position number, the control unit F of the adapter unit Aoa. 0 recognizes its own position as number 0.

デコードD0゜の出力はその出力が表わす値より1大き
い値を表わすエンコーダE。0の入力に接続されている
。よってこの場合、エンコーダには“1”が入力される
ことになる。エンコーダE。0は人力された値“l”を
2進数(「0」、「0」、「1」)にエンコードし、後
段のアダプタ部A。、に出力する。ここで、本実施例で
はデコーダとして後段のアダプタ部A O+に出力する
。ここで、本実施例ではデコーダとして集積回路L31
38を使用し、エンコーダとして集積回路LS148と
インバータを使用している。集積回路LS138は人力
された2進数をその値を表わす出力ピンのみを「0」力
された人力ピンが表わす値のうち最も大きい値を2進数
にして出力する。但し、その出力は論理が負になってい
るので本実施例ではそれを反転させるインバータを集積
回路LS14gの出力に接続し、インバータの出力をエ
ンコーダの出力としている。同様にしてアダプタ部A 
01、AO2も接続位置をそれぞれ1番、2番 と認識
することができる。
The output of decode D0° represents a value 1 greater than the value represented by the encoder E. Connected to the 0 input. Therefore, in this case, "1" is input to the encoder. Encoder E. 0 encodes the manually entered value "l" into a binary number ("0", "0", "1") and sends it to the subsequent adapter section A. , output to. Here, in this embodiment, the signal is outputted to the subsequent adapter unit AO+ as a decoder. Here, in this embodiment, the integrated circuit L31 serves as a decoder.
38, and an integrated circuit LS148 and an inverter are used as encoders. The integrated circuit LS138 outputs the manually entered binary number by converting only the output pins representing the value to "0" and converting the largest value among the values represented by the manually entered binary numbers into a binary number. However, since the logic of the output is negative, in this embodiment, an inverter for inverting it is connected to the output of the integrated circuit LS14g, and the output of the inverter is used as the output of the encoder. Similarly, adapter part A
01 and AO2 can also recognize the connection positions as No. 1 and No. 2, respectively.

プロセッサBPoの制御部F。は複数本の信号線から成
る内部バスB。iを通してアダプタ部A。。、A、、S
Ao、  の制御部に制御信号等をおくる。制御信号に
はどのアダプタ部に対する制御信号か識別できるように
アダプタ部番号が付加されている。
Control unit F of processor BPo. is an internal bus B consisting of multiple signal lines. i through adapter part A. . ,A,,S
Send control signals etc. to the control unit of Ao and . An adapter part number is added to the control signal so that it can be identified to which adapter part the control signal is directed.

各アダプタ部の制御部は送られてきた制御信号に付加さ
れたアダプタ部番号と各自の接続位置番号を比較し、一
致していればその制御信号に従い各自の内部の制御を行
う。このようにして、アダプタA。o = A o t
はユニッ1−C6内においてどの位置に接続されている
かを検出することができ、それによりプロセッサ部Pa
は各アダプタ部を個々に制御することができる。以上と
同様にして、ユニッ)CI、C2のアダプタ部は各々が
人出力制御部内でどの位置に接続されているかを検出す
ることができる。また、ユニットは筐体内でどの位置に
実装されてもプロセッサ部あるいはアダプタ部とアダプ
タ部間の信号線の接続関係は同じであるので、筐体内で
はどの位置にも実装できる。さらに、第3図に示すよう
にプロセッサ部P。、P3、P2 は各信号線の端子の
入力端と出力側を内部接続していないので内部バスB。
The control section of each adapter section compares the adapter section number added to the sent control signal with its own connection position number, and if they match, performs its internal control in accordance with the control signal. In this way, adapter A. o = A o t
It is possible to detect at which position in the unit 1-C6 the processor section Pa is connected.
can control each adapter part individually. In the same manner as described above, the adapter sections of units CI and C2 can detect to which position each is connected within the human output control section. Further, since the signal line connections between the processor section or the adapter section are the same no matter where the unit is mounted within the casing, it can be mounted at any position within the casing. Furthermore, as shown in FIG. 3, a processor section P is provided. , P3, and P2 are internal buses B because the input and output sides of the terminals of each signal line are not internally connected.

i、B 、 i−B 、 11!それぞれ分離されてい
る。
i, B, i-B, 11! Each is separated.

〔発明の効果〕〔Effect of the invention〕

以上説明したように本発明によれば、あらかじめ決めら
れた接続形態にしかユニットを接続できないという制限
はなくなる。
As explained above, according to the present invention, there is no longer a restriction that units can only be connected in a predetermined connection form.

また、接続位置によりスイッチ手段などの設定をしない
ですむので、スイッチ手段設定のさいにおきる誤りも生
じなくなる。
Further, since it is not necessary to set the switch means depending on the connection position, errors that occur when setting the switch means are also avoided.

さら1ご、1つのプロセッサ部に同一のアダプタ部を複
数接続する場合も各アダプタ部に手を加える必要がない
Furthermore, even when a plurality of the same adapter sections are connected to one processor section, there is no need to modify each adapter section.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明一実施例のブロック構成図。 第2図は前記実施例の全体説明図。 第3図は前記実施例の信号線の接続図。 Aoo〜A o q−A n + ”’アダプタ部、B
oo〜Bhi・・・内部ハス、CB・・・汎用ハス、D
o0〜D 。?””’ D h□・・・デコーダ、E 
oo = E atEh i−エンコーダ、F。 〜F h 、F oo−F a7Fnt−制御部、Lo
 % Ll %L2・・・信号線、P0〜P、・・・プ
ロセッサ部。
FIG. 1 is a block diagram of an embodiment of the present invention. FIG. 2 is an overall explanatory diagram of the embodiment. FIG. 3 is a connection diagram of signal lines in the embodiment. Aoo~A o q-A n + "'Adapter part, B
oo~Bhi...Internal lotus, CB...General purpose lotus, D
o0~D. ? ""' D h□・・・Decoder, E
oo = E atEh i-encoder, F. ~Fh, Foo-F a7Fnt-control unit, Lo
%Ll %L2...Signal line, P0-P,...Processor section.

Claims (1)

【特許請求の範囲】 1、ひとつのユニットに、ひとつのプロセッサ部と、こ
のプロセッサ部に内部バスにより縦続接続された複数の
アダプタ部とを含み、 各アダプタ部には制御部を備え、 この制御部が自アダプタ部の前記内部バス上の接続位置
を検出する方式において、 前記内部バスに平行してnビット(nは2以上の整数)
の位置検出用の信号線を設け、 各アダプタ部には、 このnビットの信号線の前段からの入力値を検出して前
記制御部に与えるデコーダと、 この前段からの入力値に1ビットのシフトを与えて後段
に宛て出力するエンコーダと を含み、 前記プロセッサ部には、前記nビットの信号線に初期値
を与える位置信号発生回路を含む ことを特徴とする接続位置の検出方式。
[Claims] 1. One unit includes one processor section and a plurality of adapter sections connected in cascade to the processor section via an internal bus, each adapter section having a control section, In a method in which the unit detects the connection position of its own adapter unit on the internal bus, n bits (n is an integer of 2 or more)
A signal line for position detection is provided, and each adapter section includes a decoder that detects the input value from the previous stage of this n-bit signal line and supplies it to the control section, and a 1-bit input value to the input value from the previous stage. and an encoder that applies a shift and outputs the signal to a subsequent stage, the processor section including a position signal generation circuit that applies an initial value to the n-bit signal line.
JP10224189A 1989-04-20 1989-04-20 Detecting system for connecting position Pending JPH02280256A (en)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2022048406A (en) * 2020-09-15 2022-03-28 三菱電機エンジニアリング株式会社 Interface device and processing unit

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2022048406A (en) * 2020-09-15 2022-03-28 三菱電機エンジニアリング株式会社 Interface device and processing unit

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